JP4960216B2 - D/a変換回路 - Google Patents
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Description
以下、本発明を適用した具体的な実施の形態1について、図面を参照しながら詳細に説明する。図1に本実施の形態1にかかるデジタルアナログ変換回路100の構成の一例を示す。
以下、本発明を適用した具体的な実施の形態2について、図面を参照しながら詳細に説明する。この実施の形態2は、実施の形態1の出力段カレントミラー回路130を2つ用いて出力段カレントミラー回路230を構成し、差動電流出力型のDAC200としている。なお、実施の形態1と同一符号のものは同様の構成であるため説明は省略する。
120 デジタルアナログ変換部
130 出力段カレントミラー回路
21 電流源
S22〜S29 スイッチ
MN21〜MN29、MN31、MN33 NMOSトランジスタ
MP31〜MP33 PMOSトランジスタ
40 出力端子
50基準電圧端子
I1〜I4 電流
P、R、S ノード
Claims (16)
- 入力されたデジタル信号に応じて第1の電流を出力するデジタルアナログ変換部と、
前記第1の電流に応じてミラー電流を生成し、アナログ信号として出力する第1のカレントミラー回路とを備え、デジタル信号をアナログ信号に変換するデジタルアナログ変換回路であって、
前記第1の電流に応じて、第1のミラー電流を生成する第2のカレントミラー回路と、
基準電圧に接続されるとともに、前記第1のミラー電流が入力され、当該第1のミラー電流に応じて、前記第1の電流と等しい第2のミラー電流を前記デジタルアナログ変換部と前記第2のカレントミラー回路の間に生成する第3のカレントミラー回路とを備えたデジタルアナログ変換回路。 - 前記第1のカレントミラー回路の入力側トランジスタと、前記第2のカレントミラー回路の入力側トランジスタを共有したことを特徴とする請求項1に記載のデジタルアナログ変換回路。
- 前記第3のカレントミラー回路の入力側トランジスタが前記基準電圧に接続され、出力側トランジスタが前記デジタルアナログ変換部と接続される請求項1または請求項2に記載のデジタルアナログ変換回路。
- 前記第2のカレントミラー回路と第3のカレントミラー回路のミラー電流の電流比が略同じである請求項1乃至請求項3のいずれか1項に記載のデジタルアナログ変換回路。
- 前記第1、第2のカレントミラー回路が有するトランジスタと、前記第3のカレントミラー回路が有するトランジスタの導電型が異なることを特徴とする請求項1乃至請求項4のいずれか1項に記載のデジタルアナログ変換回路。
- 前記第1〜第3のカレントミラー回路が有するトランジスタがMOS型トランジスタもしくはバイポーラ型トランジスタである請求項1乃至請求項5のいずれか1項に記載のデジタルアナログ変換回路。
- 前記デジタルアナログ変換部が、電流セル型の回路もしくはセグメント電流型の回路もしくは電流セル型、セグメント電流型の混載した回路で構成される請求項1乃至請求項6のいずれか1項に記載のデジタルアナログ変換回路。
- 入力されたデジタル信号に応じて差動関係にある第1の電流と第2の電流を出力するデジタルアナログ変換部と、
前記第1、第2の電流に応じてミラー電流を生成し、差動アナログ信号として出力する第1、第4のカレントミラー回路とを備え、デジタル信号をアナログ信号に変換するデジタルアナログ変換回路であって、
前記第1の電流に応じて、第1のミラー電流を生成する第2のカレントミラー回路と、
基準電圧に接続されるとともに、前記第1のミラー電流が入力され、当該第1のミラー電流に応じて、前記第1の電流と等しい第2のミラー電流を前記デジタルアナログ変換部と前記第2のカレントミラー回路の間に生成する第3のカレントミラー回路と、
前記第2の電流に応じて、第3のミラー電流を生成する第5のカレントミラー回路と、
基準電圧に接続されるとともに、前記第3のミラー電流が入力され、当該第3のミラー電流に応じて、前記第2の電流と等しい第4のミラー電流を前記デジタルアナログ変換部と前記第5のカレントミラー回路の間に生成する第6のカレントミラー回路と、を備えたデジタルアナログ変換回路。 - 前記第1のカレントミラー回路の入力側トランジスタと、前記第2のカレントミラー回路の入力側トランジスタを共有し、
前記第4のカレントミラー回路の入力側トランジスタと、前記第5のカレントミラー回路の入力側トランジスタを共有し、たことを特徴とする請求項8に記載のデジタルアナログ変換回路。 - 前記第3のカレントミラー回路の入力側トランジスタが前記基準電圧に接続され、出力側トランジスタが前記デジタルアナログ変換部と接続され、
前記第6のカレントミラー回路の入力側トランジスタが前記基準電圧に接続され、出力側トランジスタが前記デジタルアナログ変換部と接続される請求項8または請求項9に記載のデジタルアナログ変換回路。 - 前記第3、第6のカレントミラー回路の入力側トランジスタが前記基準電圧を供給する同一の端子に接続される請求項10に記載のデジタルアナログ変換回路。
- 前記第3、第6のカレントミラー回路の入力側トランジスタが、それぞれ前記基準電圧を供給する第1の端子、第2の端子に接続される請求項10に記載のデジタルアナログ変換回路。
- 前記第2のカレントミラー回路と第3のカレントミラー回路のミラー電流の電流比が略同じであり、
前記第5のカレントミラー回路と第6のカレントミラー回路のミラー電流の電流比が略同じである請求項8乃至請求項12のいずれか1項に記載のデジタルアナログ変換回路。 - 前記第1、第2、第4、第5のカレントミラー回路が有するトランジスタと、前記第3、第6のカレントミラー回路が有するトランジスタの導電型が異なることを特徴とする請求項8乃至請求項413のいずれか1項に記載のデジタルアナログ変換回路。
- 前記第1〜第6のカレントミラー回路が有するトランジスタがMOS型トランジスタもしくはバイポーラ型トランジスタである請求項8乃至請求項14のいずれか1項に記載のデジタルアナログ変換回路。
- 前記デジタルアナログ変換部が、電流セル型の回路もしくはセグメント電流型の回路もしくは電流セル型、セグメント電流型の混載した回路で構成される請求項8乃至請求項15のいずれか1項に記載のデジタルアナログ変換回路。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007339584A JP4960216B2 (ja) | 2007-12-28 | 2007-12-28 | D/a変換回路 |
US12/343,625 US7843372B2 (en) | 2007-12-28 | 2008-12-24 | D/A conversion circuit |
CN200810190236.0A CN101471667B (zh) | 2007-12-28 | 2008-12-26 | D/a转换电路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007339584A JP4960216B2 (ja) | 2007-12-28 | 2007-12-28 | D/a変換回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2009164710A JP2009164710A (ja) | 2009-07-23 |
JP4960216B2 true JP4960216B2 (ja) | 2012-06-27 |
Family
ID=40797569
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2007339584A Expired - Fee Related JP4960216B2 (ja) | 2007-12-28 | 2007-12-28 | D/a変換回路 |
Country Status (3)
Country | Link |
---|---|
US (1) | US7843372B2 (ja) |
JP (1) | JP4960216B2 (ja) |
CN (1) | CN101471667B (ja) |
Families Citing this family (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7750695B2 (en) * | 2004-12-13 | 2010-07-06 | Mosaid Technologies Incorporated | Phase-locked loop circuitry using charge pumps with current mirror circuitry |
KR100945873B1 (ko) * | 2007-12-27 | 2010-03-05 | 주식회사 동부하이텍 | 디지털-아날로그 변환기에서의 전류 셀 회로 |
US8089383B2 (en) * | 2009-05-10 | 2012-01-03 | Cypress Semiconductor Corporation | Programmable digital-to-analog converter |
CN101958715B (zh) * | 2009-07-13 | 2013-05-01 | 扬智科技股份有限公司 | 音频数字模拟转换器 |
US7907072B1 (en) * | 2009-09-02 | 2011-03-15 | Freescale Semiconductor, Inc. | Digital-to-analog converter |
US8094055B2 (en) | 2010-01-26 | 2012-01-10 | Power Integrations, Inc. | Compact digital-to-analog converter |
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US9696350B2 (en) | 2013-03-15 | 2017-07-04 | Intel Corporation | Non-linear control for voltage regulator |
CN105850048A (zh) * | 2013-08-07 | 2016-08-10 | 艾克泽基因公司 | 精确双极电流模式数模转换器 |
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CN105375928B (zh) * | 2014-08-29 | 2020-09-01 | 意法半导体研发(深圳)有限公司 | 被配置用于产生可变输出电流的电流导引型数模转换器电路 |
US9432038B1 (en) * | 2015-02-27 | 2016-08-30 | Broadcom Corporation | Digital-to-analog converter using nonlinear capacitance compensation |
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US9991784B2 (en) | 2016-09-02 | 2018-06-05 | Dialog Semiconductor (Uk) Limited | Dynamic current limit circuit |
CN106774617B (zh) * | 2016-12-23 | 2019-07-19 | 长沙景美集成电路设计有限公司 | 一种电流可精准校正网络 |
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US10915298B1 (en) * | 2019-10-08 | 2021-02-09 | Ali Tasdighi Far | Current mode multiply-accumulate for compute in memory binarized neural networks |
CN116388763B (zh) * | 2023-04-10 | 2023-12-22 | 苏州领慧立芯科技有限公司 | 一种兼容电压/电流输出的dac |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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-
2007
- 2007-12-28 JP JP2007339584A patent/JP4960216B2/ja not_active Expired - Fee Related
-
2008
- 2008-12-24 US US12/343,625 patent/US7843372B2/en active Active
- 2008-12-26 CN CN200810190236.0A patent/CN101471667B/zh active Active
Also Published As
Publication number | Publication date |
---|---|
CN101471667A (zh) | 2009-07-01 |
JP2009164710A (ja) | 2009-07-23 |
CN101471667B (zh) | 2013-06-26 |
US7843372B2 (en) | 2010-11-30 |
US20090167579A1 (en) | 2009-07-02 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20100806 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20120228 |
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TRDD | Decision of grant or rejection written | ||
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A61 | First payment of annual fees (during grant procedure) |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20150330 Year of fee payment: 3 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 4960216 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
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R350 | Written notification of registration of transfer |
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