JP4944042B2 - Soc相互接続において転送待ち時間を低減するための方法および装置 - Google Patents
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Description
Claims (21)
- チップ上のシステム内の転送待ち時間を低減する方法であって、前記チップ上のシステムはバスマスタ、バススレーブおよびアービターを有し、前記バスマスタ、バススレーブおよびアービターは電子通信をしており、前記バススレーブは要求に応答するように構成される方法において、
前記要求と、前記要求の実行が完了するのに必要な時間を定義する待ち時間要件、及び前記要求の優先度を表す優先度信号を有する要求信号を前記バスマスタから前記アービターに送信することと、
前記アービターによって、前記待ち時間要件を調べて前記優先度信号により表される優先度を高めるかどうかを決定することと、
前記要求信号を前記アービターから前記バススレーブに送信することと、
前記要求信号を受けて前記要求に対する前記応答を前記バススレーブから前記アービターに送信することと、
を備えた方法。 - 前記アービターによって、前記要求信号にタイムスタンプを刻印することをさらに備えた、請求項1に記載の方法。
- 前記アービターによって、前記優先度信号により表される優先度を高めることをさらに備えた、請求項1に記載の方法。
- 前記アービターによって、前記タイムスタンプを前記待ち時間要件と比較し前記優先度信号により表される優先度を高めるかどうかを決定することをさらに備えた、請求項2に記載の方法。
- 前記アービターによって、前記バススレーブに送信するために前記要求信号を前記アービター内のキューにセットすることをさらに備えた、請求項1に記載の方法。
- 前記要求信号は第1の要求を有する第1の要求信号であり、前記優先度信号は第1の優先度信号であり、前記待ち時間要件は第1の待ち時間要件であり、
第2の要求と前記第2の要求の実行が完了するのに必要な時間を定義する第2の待ち時間要件、及び前記第1の優先度信号により表される優先度よりも高い優先度を表す第2の優先度信号を有する第2の要求信号を前記バスマスタから前記アービターに送信することと、
前記第2の要求信号を前記アービターから前記バススレーブに送信することと、
をさらに備えた、請求項1に記載の方法。 - 前記アービターによって、前記第1の優先度信号により表される優先度と前記第2の優先度信号により表される優先度とを比較することと、
前記バススレーブによって、前記第1の要求を実行する前に前記第2の要求を実行することと、
をさらに備えた、請求項6に記載の方法。 - 前記アービターによって、前記第1の待ち時間要件と前記第2の待ち時間要件とを比較することと、
前記バススレーブによって、前記第1の要求を実行する前に前記第2の要求を実行することと、
をさらに備えた、請求項6に記載の方法。 - 前記チップ上のシステムは、第1のアービター、第2のアービター、第1のバススレーブ、第2のバススレーブを有し、前記第1のアービターは前記マスタおよび前記第2のアービターに接続され、前記第1のバススレーブは前記第1のアービターに接続され、前記第2のバススレーブは前記第2のアービターに接続され、前記バスマスタからの要求信号は前記第1のアービターおよび前記第2のアービターを介して前記バスマスタから前記第2のバススレーブに送信され、
前記要求信号を前記第2のアービターに送信する前に前記第1のアービターによって前記待ち時間要件を調べて前記優先度信号により表される優先度を高めるかどうかを決定することと、
前記要求信号を前記第2のバススレーブに送信する前に前記第2のアービターによって前記待ち時間要件を調べて前記優先度信号により表される優先度を高めるかどうかを決定することと、
をさらに備えた、請求項1に記載の方法。 - 少なくとも1つのアービターによって、前記優先度信号により表される優先度を高めることをさらに備えた、請求項9に記載の方法。
- 前記要求信号を第2のアービターに送信する前に前記第1のアービターによって前記優先度信号により表される優先度を高めることと、
前記要求信号をバススレーブに送信する前に前記第2のアービターによって前記優先度信号により表される優先度を高めることと、
をさらに備えた、請求項9に記載の方法。 - 前記要求に対する応答を前記アービターに送信する前に前記要求の優先度を前記バススレーブにより高めることをさらに備えた、請求項1に記載の方法。
- 前記要求が前記バススレーブに駐在する間、前記アービターによって前記優先度信号により表される優先度を高めることをさらに備えた、請求項1に記載の方法。
- チップ上のシステム相互接続において、
要求と、前記要求の優先度ステータスを識別する優先度信号と、前記要求の実行が完了するのに必要な時間を定義する待ち時間要件を識別し、また前記待ち時間要件を持たないことを識別する待ち時間識別子とを有する要求信号を送信するように構成されたバスマスタと、
前記要求信号を受信するように構成されたバススレーブと、
前記バスマスタとバススレーブに接続されているアービターであって、前記要求信号は前記アービターを介して前記バスマスタから前記バススレーブに送信され、前記バススレーブは前記要求信号のうち前記優先度信号及び前記待ち時間識別子を前記アービターに送信するように構成される、アービターと、
を備えたシステム。 - 前記優先度信号は、対応する前記待ち時間識別子を識別できるようにエンコードされる請求項14に記載のシステム。
- 前記優先度信号は可変幅を有し、前記可変幅はエンコーディングのために構成される、請求項14に記載のシステム。
- 前記待ち時間識別子は定数、ディスクリプター、クロックサイクルのレンジおよびサイクル上限のグループの1つから選択される、請求項14に記載のシステム。
- 前記バススレーブは、前記優先度信号により表される優先度を高め、前記優先度が高められた優先度信号を前記アービターに送信するように構成される、請求項14に記載のシステム。
- 複数のアービターであって、第1のアービターは前記バスマスタに接続され、さらに第2アービターに接続され、各アービターは前記優先度信号により表される優先度を高めるように構成され、前記優先度信号により表される優先度を高めることは新しい待ち時間識別子に関連している、複数のアービターと、
複数のバススレーブであって、第1のバススレーブは第1のアービターに接続され、第2のバススレーブは前記第2のアービターに接続され、各バススレーブは前記優先度信号により表される優先度を高めるように構成される、複数のバススレーブと、
をさらに備えた、請求項14に記載のシステム。 - 複数のアービターであって、第1のアービターは前記バスマスタに接続され、さらに第2のアービターに接続され、各アービターは前記優先度信号により表される優先度を高めるように構成される、複数のアービターと、
複数のバススレーブであって、第1のバススレーブは前記第1のアービターに接続され、第2のバススレーブは、前記第2のアービターに接続され、各アービターは、前記要求がバススレーブに駐在する間前記優先度信号により表される優先度を高めるように構成される、複数のバススレーブと、
をさらに備えた、請求項14に記載のシステム。 - 前記アービターは前記要求が前記バススレーブに駐在する間前記優先度信号により表される優先度を高めるように構成される、請求項14に記載のシステム。
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---|---|---|---|---|
US7600058B1 (en) | 2003-06-26 | 2009-10-06 | Nvidia Corporation | Bypass method for efficient DMA disk I/O |
US8683132B1 (en) | 2003-09-29 | 2014-03-25 | Nvidia Corporation | Memory controller for sequentially prefetching data for a processor of a computer system |
US8356142B1 (en) | 2003-11-12 | 2013-01-15 | Nvidia Corporation | Memory controller for non-sequentially prefetching data for a processor of a computer system |
US8700808B2 (en) * | 2003-12-01 | 2014-04-15 | Nvidia Corporation | Hardware support system for accelerated disk I/O |
JP2006079394A (ja) * | 2004-09-10 | 2006-03-23 | Renesas Technology Corp | データ処理装置 |
US8356143B1 (en) | 2004-10-22 | 2013-01-15 | NVIDIA Corporatin | Prefetch mechanism for bus master memory access |
US7404025B2 (en) * | 2005-04-14 | 2008-07-22 | Texas Instruments Incorporated | Software programmable dynamically reconfigurable scheme for controlling request grant and masking for ultra high priority accessor during arbitration |
US7380040B2 (en) * | 2005-04-14 | 2008-05-27 | Texas Instruments Incorporated | Software programmable dynamic arbitration scheme |
CN101341474B (zh) * | 2005-12-22 | 2012-02-08 | Arm有限公司 | 用于对事务重排序来确保每个事务所规定的服务质量的仲裁方法 |
US7734853B2 (en) * | 2006-02-28 | 2010-06-08 | Arm Limited | Latency dependent data bus transmission |
US8468283B2 (en) * | 2006-06-01 | 2013-06-18 | Telefonaktiebolaget Lm Ericsson (Publ) | Arbiter diagnostic apparatus and method |
TWI335517B (en) * | 2006-08-25 | 2011-01-01 | Via Tech Inc | Method of requests access and scheduling and related apparatus thereof |
US7596647B1 (en) * | 2006-09-18 | 2009-09-29 | Nvidia Corporation | Urgency based arbiter |
US20080114960A1 (en) * | 2006-11-14 | 2008-05-15 | Tau-Li Huang | Memory control methods for accessing a memory with partial or full serial transmission, and related apparatus |
GB2447688B (en) * | 2007-03-22 | 2011-05-18 | Advanced Risc Mach Ltd | A data processing apparatus and method for arbitrating between messages routed over a communication channel |
US8156273B2 (en) * | 2007-05-10 | 2012-04-10 | Freescale Semiconductor, Inc. | Method and system for controlling transmission and execution of commands in an integrated circuit device |
KR100900980B1 (ko) | 2007-07-16 | 2009-06-04 | 한국생산기술연구원 | 디바이스의 응답 지연을 고려한 데이터 전송 시스템 및방법 |
US7870455B2 (en) * | 2007-12-12 | 2011-01-11 | Infineon Technologies Ag | System-on-chip with master/slave debug interface |
KR100932925B1 (ko) | 2007-12-17 | 2009-12-21 | 한국전자통신연구원 | MMoIP 데이터의 전송 효율을 위한 직접 메모리 접근제어 장치 및 그 방법 |
US20100070656A1 (en) * | 2008-09-12 | 2010-03-18 | Atto Technology, Inc. | System and method for enhanced load balancing in a storage system |
US8356128B2 (en) * | 2008-09-16 | 2013-01-15 | Nvidia Corporation | Method and system of reducing latencies associated with resource allocation by using multiple arbiters |
US7797476B2 (en) * | 2008-09-19 | 2010-09-14 | Texas Instruments Incorporated | Flexible connection scheme between multiple masters and slaves |
US8370552B2 (en) * | 2008-10-14 | 2013-02-05 | Nvidia Corporation | Priority based bus arbiters avoiding deadlock and starvation on buses that support retrying of transactions |
WO2010052679A1 (en) * | 2008-11-10 | 2010-05-14 | Nxp B.V. | Resource controlling |
CN102428450A (zh) | 2009-03-11 | 2012-04-25 | 新诺普系统公司 | 用于资源控制的系统和方法 |
US8698823B2 (en) | 2009-04-08 | 2014-04-15 | Nvidia Corporation | System and method for deadlock-free pipelining |
GB2478795B (en) * | 2010-03-19 | 2013-03-13 | Imagination Tech Ltd | Requests and data handling in a bus architecture |
GB2484483B (en) * | 2010-10-12 | 2018-07-11 | Advanced Risc Mach Ltd | Communication using integrated circuit interconnect circuitry |
KR20120037785A (ko) * | 2010-10-12 | 2012-04-20 | 삼성전자주식회사 | 부하 균형을 유지하는 시스템 온 칩 및 그것의 부하 균형 유지 방법 |
KR101699781B1 (ko) | 2010-10-19 | 2017-01-26 | 삼성전자주식회사 | 시스템 온 칩 및 그것의 데이터 중재 방법 |
KR101841964B1 (ko) | 2011-02-22 | 2018-05-15 | 삼성전자주식회사 | 인터커넥터를 포함하는 시스템 온 칩 및 그것의 제어 방법 |
JP5715458B2 (ja) * | 2011-03-22 | 2015-05-07 | ルネサスエレクトロニクス株式会社 | 情報処理システム、調停方法 |
JP6034008B2 (ja) * | 2011-09-22 | 2016-11-30 | Necプラットフォームズ株式会社 | 送信権調停装置、送信権調停制御方法、及びそのためのプログラム |
KR102031952B1 (ko) * | 2012-03-29 | 2019-10-14 | 삼성전자주식회사 | 메모리 장치 및 메모리 장치의 동작방법 |
KR101949382B1 (ko) * | 2012-04-04 | 2019-02-18 | 삼성전자주식회사 | 서비스 품질의 향상을 위한 시스템 온 칩 및 시스템 온 칩의 제어 방법 |
US9135195B2 (en) * | 2012-07-24 | 2015-09-15 | Freescasle Semiconductor, Inc. | Prediction of electronic component behavior in bus-based systems |
US9684633B2 (en) * | 2013-01-24 | 2017-06-20 | Samsung Electronics Co., Ltd. | Adaptive service controller, system on chip and method of controlling the same |
JP6037869B2 (ja) * | 2013-02-05 | 2016-12-07 | 三菱電機株式会社 | マルチプロセッサ組込み機器 |
US9372818B2 (en) * | 2013-03-15 | 2016-06-21 | Atmel Corporation | Proactive quality of service in multi-matrix system bus |
US9569385B2 (en) | 2013-09-09 | 2017-02-14 | Nvidia Corporation | Memory transaction ordering |
KR102396309B1 (ko) * | 2015-11-06 | 2022-05-10 | 삼성전자주식회사 | 데이터 요청을 제어하기 위한 장치 및 방법 |
DE102016011153A1 (de) * | 2016-09-14 | 2018-03-15 | Kathrein-Werke Kg | Steuerungssystem |
US10764455B2 (en) * | 2018-12-31 | 2020-09-01 | Kyocera Document Solutions Inc. | Memory control method, memory control apparatus, and image forming method that uses memory control method |
KR20210103836A (ko) * | 2020-02-14 | 2021-08-24 | 에스케이하이닉스 주식회사 | 데이터 처리 장치 및 그 동작 방법 |
US11893240B2 (en) * | 2021-10-28 | 2024-02-06 | Qualcomm Incorporated | Reducing latency in pseudo channel based memory systems |
WO2023128479A1 (ko) * | 2021-12-30 | 2023-07-06 | 주식회사 엘엑스세미콘 | 메모리 제어 시스템 및 메모리 제어 기능을 갖는 디스플레이 디바이스 |
CN115269467B (zh) * | 2022-09-29 | 2023-01-10 | 沐曦科技(成都)有限公司 | 一种总线仲裁的方法、装置、存储介质及电子设备 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2000207283A (ja) * | 1999-01-19 | 2000-07-28 | Advanced Risc Mach Ltd | デ―タ処理システムに於けるメモリ制御 |
Family Cites Families (18)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US24987A (en) * | 1859-08-09 | Hukst | ||
US188809A (en) * | 1877-03-27 | Improvement in machines for sewing boots and shoes | ||
US5440752A (en) | 1991-07-08 | 1995-08-08 | Seiko Epson Corporation | Microprocessor architecture with a switch network for data transfer between cache, memory port, and IOU |
US5848297A (en) | 1991-12-30 | 1998-12-08 | Apple Computer, Inc. | Control apparatus for maintaining order and accomplishing priority promotion in a computer interconnect |
KR0163554B1 (ko) * | 1995-08-08 | 1998-12-15 | 윤종용 | 칩의 지연시간을 측정하기 위한 감지회로 |
US5802330A (en) | 1996-05-01 | 1998-09-01 | Advanced Micro Devices, Inc. | Computer system including a plurality of real time peripheral devices having arbitration control feedback mechanisms |
US5907688A (en) * | 1996-06-28 | 1999-05-25 | Intel Corporation | Smart arbitration for non-symmetric data streams |
US5745913A (en) | 1996-08-05 | 1998-04-28 | Exponential Technology, Inc. | Multi-processor DRAM controller that prioritizes row-miss requests to stale banks |
US6304923B1 (en) * | 1998-10-14 | 2001-10-16 | Micron Technology, Inc. | Method for prioritizing data transfer request by comparing a latency identifier value received from an I/O device with a predetermined range of values |
EP1026595B1 (en) | 1999-01-11 | 2008-07-23 | STMicroelectronics Limited | Memory interface device and method for accessing memories |
EP1170669B1 (en) | 2000-07-05 | 2006-03-29 | STMicroelectronics S.r.l. | Arbitration method and circuit architecture therefor |
JP4022719B2 (ja) * | 2001-12-18 | 2007-12-19 | 株式会社日立製作所 | 優先順位制御システム |
US6792516B2 (en) * | 2001-12-28 | 2004-09-14 | Intel Corporation | Memory arbiter with intelligent page gathering logic |
US6823411B2 (en) * | 2002-01-30 | 2004-11-23 | International Business Machines Corporation | N-way psuedo cross-bar having an arbitration feature using discrete processor local busses |
KR100456696B1 (ko) * | 2002-05-21 | 2004-11-10 | 삼성전자주식회사 | 집적회로장치의 버스중재기 |
US6907478B2 (en) * | 2003-02-18 | 2005-06-14 | Adaptec, Inc. | Systems and methods optimizing data transfer throughput of a system on chip |
KR100555501B1 (ko) * | 2003-06-26 | 2006-03-03 | 삼성전자주식회사 | 동적으로 버스 점유 우선 순위를 정하는 버스 중재기 및그 버스 중재 방법 |
US7739436B2 (en) * | 2004-11-01 | 2010-06-15 | Sonics, Inc. | Method and apparatus for round robin resource arbitration with a fast request to grant response |
-
2004
- 2004-12-30 US US11/027,532 patent/US7263566B2/en active Active
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