JP4873144B2 - Electronic device manufacturing method and semiconductor device - Google Patents

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Abstract

<P>PROBLEM TO BE SOLVED: To provide an efficient manufacturing method of an electronic device with high reliability, and to provide a semiconductor device excellent in mounting capability. <P>SOLUTION: The method of manufacturing an electronic device comprises: a process for preparing a semiconductor device 1 having a semiconductor chip 10 wherein an electrode 14 is formed, two or more first portions 21 formed in the surface 15 of the semiconductor chip 10, a resin projection 20 which is arranged between the first portions 21 and includes second portions 22 whose height is lower than that of the first portion 21, and wiring 40 which has an electric connection area 42 arranged on the first portion 21; a process for preparing a wiring substrate 50 having a base substrate 52 and a wiring pattern 54; and a process for mounting the semiconductor device 1 in the wiring substrate 50 and for carrying out electric connection by bringing the electric connection area and the wiring pattern in to contact. In the process for mounting the semiconductor device in the wiring substrate, the second portion 22 is brought into contact with the wiring substrate 50, after bringing the electric connection area and the wiring pattern into contact. <P>COPYRIGHT: (C)2008,JPO&amp;INPIT

Description

本発明は、電子デバイスの製造方法、及び、半導体装置に関する。   The present invention relates to an electronic device manufacturing method and a semiconductor device.

電子デバイスを小型化するためには、半導体装置の外形は小さい方が好ましい。しかし、半導体装置の役割が多様化するにつれ、半導体チップに形成される集積回路の高集積化が進み、これに伴って、半導体チップのピン数の増加が進んでいる。すなわち、現在では、半導体装置の小型化と、集積回路の高集積化及び電極の増加という要求を同時に満たすことが可能な半導体装置の開発が進んでいる。   In order to reduce the size of the electronic device, the outer shape of the semiconductor device is preferably small. However, as the roles of semiconductor devices have diversified, the integration of integrated circuits formed on semiconductor chips has progressed, and accordingly, the number of pins of semiconductor chips has increased. That is, at present, development of a semiconductor device capable of simultaneously satisfying the demands of miniaturization of a semiconductor device, high integration of an integrated circuit, and an increase in electrodes is in progress.

この要求に応えることができる半導体装置として、半導体チップ上に配線が形成されたタイプの半導体装置が注目を集めている。このタイプの半導体装置では、半導体装置の外形を半導体チップの外形とほぼ同じにすることができるため、半導体装置の小型化が可能である。
特開平2−272737号公報
As a semiconductor device that can meet this demand, a semiconductor device of a type in which wiring is formed on a semiconductor chip has attracted attention. In this type of semiconductor device, the outer shape of the semiconductor device can be made substantially the same as the outer shape of the semiconductor chip, so that the semiconductor device can be reduced in size.
JP-A-2-272737

半導体装置が小型化すれば、これを配線基板等に実装することが困難になる。しかし、電子デバイスの信頼性を確保するためには、実装後においても、半導体装置の信頼性を維持することが重要である。   If the semiconductor device is downsized, it becomes difficult to mount it on a wiring board or the like. However, in order to ensure the reliability of the electronic device, it is important to maintain the reliability of the semiconductor device even after mounting.

本発明の目的は、信頼性の高い電子デバイスを効率よく製造する方法、及び、信頼性の高い電子デバイスを効率よく製造することが可能な半導体装置を提供することにある。   An object of the present invention is to provide a method for efficiently manufacturing a highly reliable electronic device and a semiconductor device capable of efficiently manufacturing a highly reliable electronic device.

(1)本発明に係る電子デバイスの製造方法は、
電極が形成された半導体チップと、前記半導体チップにおける前記電極が形成された面に形成された、仮想の直線に沿って配列された複数の第1の部分と、隣り合う二つの前記第1の部分の間に配置された、前記第1の部分よりも高さが低い第2の部分とを含む樹脂突起と、前記第1の部分上に配置された電気的接続部を有する、前記電極と電気的に接続された配線と、を有する半導体装置を用意する工程と、
ベース基板と、前記ベース基板に形成された配線パターンとを有する配線基板を用意する工程と、
前記半導体装置を前記配線基板に搭載して、前記電気的接続部と前記配線パターンとを接触させて電気的に接続する工程と、
を含み、
前記半導体装置を前記配線基板に搭載する工程では、
前記電気的接続部と前記配線パターンとを接触させた後に、前記第2の部分を前記配線基板に接触させる。
(1) An electronic device manufacturing method according to the present invention includes:
A semiconductor chip on which an electrode is formed; a plurality of first portions arranged along a virtual straight line formed on a surface of the semiconductor chip on which the electrode is formed; and two adjacent first first parts The electrode having a resin protrusion including a second portion disposed between the portions and having a second height lower than that of the first portion; and an electrical connection portion disposed on the first portion; A step of preparing a semiconductor device having electrically connected wiring;
Preparing a wiring board having a base board and a wiring pattern formed on the base board;
Mounting the semiconductor device on the wiring board and bringing the electrical connection portion and the wiring pattern into contact with each other to electrically connect;
Including
In the step of mounting the semiconductor device on the wiring board,
After the electrical connection portion and the wiring pattern are brought into contact with each other, the second portion is brought into contact with the wiring board.

本発明によると、半導体装置を配線基板に搭載する工程で、樹脂突起の第2の部分を配線基板に接触させる。樹脂突起の第2の部分が配線基板に接触すると、それ以上半導体装置と配線基板とを押し付けても、半導体装置(半導体チップ)と配線基板とが近接しにくくなる。すなわち、第2の部分によって、半導体装置(半導体チップ)と配線基板との間隔を規制することができる。   According to the present invention, the second portion of the resin protrusion is brought into contact with the wiring board in the step of mounting the semiconductor device on the wiring board. When the second portion of the resin protrusion comes into contact with the wiring board, the semiconductor device (semiconductor chip) and the wiring board are unlikely to approach each other even if the semiconductor device and the wiring board are pressed further. That is, the distance between the semiconductor device (semiconductor chip) and the wiring board can be regulated by the second portion.

このことから、本発明によると、半導体装置(半導体チップ)と配線基板との間隔を容易に規制することが可能で、信頼性の高い電子デバイスを容易に製造することが可能な電子デバイスの製造方法を提供することができる。   Therefore, according to the present invention, it is possible to easily regulate the distance between the semiconductor device (semiconductor chip) and the wiring board, and to manufacture a highly reliable electronic device. A method can be provided.

(2)この電子デバイスの製造方法において、
前記半導体装置の前記樹脂突起は、前記第1の部分の高さHと、前記第1の部分の底面の、前記仮想直線と直交する方向の幅Wとが、H<W/2の関係を満たす形状であってもよい。
(2) In this electronic device manufacturing method,
In the resin protrusion of the semiconductor device, the height H of the first portion and the width W of the bottom surface of the first portion in the direction perpendicular to the imaginary straight line satisfy the relationship of H <W / 2. The shape to satisfy | fill may be sufficient.

これによると、樹脂突起(第1の部分)を大きく変形させることなく、電気的接続部と配線パターンとの接触面積を大きくすることができるため、信頼性の高い電子デバイスを製造することができる。   According to this, since the contact area between the electrical connection portion and the wiring pattern can be increased without greatly deforming the resin protrusion (first portion), a highly reliable electronic device can be manufactured. .

(3)この電子デバイスの製造方法において、
H≦20μm、かつ、
W≦50μmであってもよい。
(3) In this electronic device manufacturing method,
H ≦ 20 μm and
W ≦ 50 μm may be satisfied.

(4)この電子デバイスの製造方法において、
H≧5μm、かつ、
W≧15μmであってもよい。
(4) In this electronic device manufacturing method,
H ≧ 5 μm and
W ≧ 15 μm may be satisfied.

(5)この電子デバイスの製造方法において、
前記半導体装置の前記樹脂突起は、前記第1の部分の高さHと、前記第2の部分の高さhとが、H−h≦5μmの関係を満たす形状であってもよい。
(5) In this electronic device manufacturing method,
The resin protrusion of the semiconductor device may have a shape in which a height H of the first portion and a height h of the second portion satisfy a relationship of Hh ≦ 5 μm.

(6)この電子デバイスの製造方法において、
前記第1の部分の上面は、凸曲面であってもよい。
(6) In this electronic device manufacturing method,
The upper surface of the first portion may be a convex curved surface.

なお、第1の部分の上面は、円弧の一部であってもよい。あるいは、第1の部分の上面は、楕円弧の一部であってもよい。   Note that the upper surface of the first portion may be a part of an arc. Alternatively, the upper surface of the first part may be a part of an elliptical arc.

(7)この電子デバイスの製造方法において、
前記半導体装置の前記樹脂突起は、前記第2の部分の底面の幅が、前記第1の部分の底面の幅よりも狭くてもよい。
(7) In this electronic device manufacturing method,
In the resin protrusion of the semiconductor device, the bottom surface of the second part may be narrower than the bottom surface of the first part.

(8)この電子デバイスの製造方法において、
前記半導体装置は、前記面上に形成された、前記第1の部分よりも高さが低い樹脂部をさらに有し、
前記半導体装置を前記配線基板に搭載する工程では、
前記樹脂部を前記配線基板に接触させてもよい。
(8) In this electronic device manufacturing method,
The semiconductor device further includes a resin portion formed on the surface and having a height lower than that of the first portion,
In the step of mounting the semiconductor device on the wiring board,
You may make the said resin part contact the said wiring board.

これによると、樹脂部によって半導体装置(半導体チップ)と配線基板との間隔を規制することができる。そのため、さらに信頼性の高い電子デバイスを製造することが可能になる。   According to this, the distance between the semiconductor device (semiconductor chip) and the wiring board can be regulated by the resin portion. Therefore, it becomes possible to manufacture an electronic device with higher reliability.

(9)この電子デバイスの製造方法において、
前記樹脂部は、前記第2の部分と同じ高さであってもよい。
(9) In this electronic device manufacturing method,
The resin portion may be the same height as the second portion.

(10)本発明に係る半導体装置は、
電極が形成された半導体チップと、
前記半導体チップにおける前記電極が形成された面に形成された、仮想の直線に沿って配列された複数の第1の部分と、隣り合う二つの前記第1の部分の間に配置された、前記第1の部分よりも高さが低い第2の部分とを含む樹脂突起と、
前記第1の部分上に配置された電気的接続部を有する、前記電極と電気的に接続された配線と、
を有し、
前記第1の部分の高さHと、前記第1の部分の底面の、前記仮想直線と直交する方向の幅Wとは、H<W/2の関係を満たす。
(10) A semiconductor device according to the present invention includes:
A semiconductor chip on which electrodes are formed;
A plurality of first portions arranged along an imaginary straight line formed on a surface of the semiconductor chip on which the electrodes are formed, and the two first portions arranged adjacent to each other; A resin protrusion including a second portion having a height lower than that of the first portion;
A wiring electrically connected to the electrode having an electrical connection disposed on the first portion;
Have
The height H of the first portion and the width W of the bottom surface of the first portion in the direction perpendicular to the virtual line satisfy the relationship of H <W / 2.

本発明によると、樹脂突起(第1の部分)を大きく変形させることなく、電気的接続部と配線パターンとの接触面積を大きくすることが可能な半導体装置を提供することができる。   According to the present invention, it is possible to provide a semiconductor device capable of increasing the contact area between the electrical connection portion and the wiring pattern without greatly deforming the resin protrusion (first portion).

(11)この半導体装置において、
H≦20μm、かつ、
W≦50μmであってもよい。
(11) In this semiconductor device,
H ≦ 20 μm and
W ≦ 50 μm may be satisfied.

(12)この半導体装置において、
H≧5μm、かつ、
W≧15μmであってもよい。
(12) In this semiconductor device,
H ≧ 5 μm and
W ≧ 15 μm may be satisfied.

(13)この半導体装置において、
前記第1の部分の高さHと、前記第2の部分の高さhとは、H−h≦5μmの関係を満たしていてもよい。
(13) In this semiconductor device,
The height H of the first portion and the height h of the second portion may satisfy a relationship of Hh ≦ 5 μm.

(14)この半導体装置において、
前記第1の部分の上面は、凸曲面であってもよい。
(14) In this semiconductor device,
The upper surface of the first portion may be a convex curved surface.

(15)この半導体装置において、
前記第2の部分の底面の幅は、前記第1の部分の底面の幅よりも狭くてもよい。
(15) In this semiconductor device,
The width of the bottom surface of the second portion may be narrower than the width of the bottom surface of the first portion.

(16)この半導体装置において、
前記面上に形成された、前記第1の部分よりも高さが低い樹脂部をさらに有していてもよい。
(16) In this semiconductor device,
You may further have the resin part formed on the said surface and whose height is lower than the said 1st part.

(17)この半導体装置において、
前記樹脂部は、前記第2の部分と同じ高さであってもよい。
(17) In this semiconductor device,
The resin portion may be the same height as the second portion.

以下、本発明を適用した実施の形態について図面を参照して説明する。ただし、本発明は以下の実施の形態に限定されるものではない。また、本発明は、以下の内容を自由に組み合わせたものを含むものとする。   Embodiments to which the present invention is applied will be described below with reference to the drawings. However, the present invention is not limited to the following embodiments. Moreover, this invention shall include what combined the following content freely.

図1(A)〜図10は、本発明を適用した実施の形態に係る電子デバイスの製造方法について説明するための図である。   FIG. 1A to FIG. 10 are diagrams for explaining a method of manufacturing an electronic device according to an embodiment to which the present invention is applied.

(1)半導体装置1について
本実施の形態に係る電子デバイスの製造方法は、半導体装置1を用意することを含む。以下、図1(A)〜図2を参照して、半導体装置1の構成について説明する。ここで、図1(A)は半導体装置1の上視図であり、図1(B)は半導体装置1の斜視図であり、図1(C)は図1(A)のIC−IC線断面の一部拡大図であり、図1(D)は図1(A)のID−ID線断面の一部拡大図である。また、図2は、樹脂突起20の第1の部分21及び配線40を拡大して示す斜視図である。
(1) About Semiconductor Device 1 The method of manufacturing an electronic device according to the present embodiment includes preparing the semiconductor device 1. Hereinafter, the configuration of the semiconductor device 1 will be described with reference to FIGS. Here, FIG. 1A is a top view of the semiconductor device 1, FIG. 1B is a perspective view of the semiconductor device 1, and FIG. 1C is an IC-IC line in FIG. FIG. 1D is a partially enlarged view of a cross section taken along the line ID-ID in FIG. FIG. 2 is an enlarged perspective view showing the first portion 21 of the resin protrusion 20 and the wiring 40.

半導体装置1は、半導体チップ10を有する。半導体チップ10は、例えばシリコンチップであってもよい。半導体チップ10には、集積回路12が形成されていてもよい(図1(C)参照)。集積回路12の構成は特に限定されないが、例えば、トランジスタ等の能動素子や、抵抗、コイル、コンデンサ等の受動素子を含んでいてもよい。   The semiconductor device 1 includes a semiconductor chip 10. The semiconductor chip 10 may be a silicon chip, for example. An integrated circuit 12 may be formed on the semiconductor chip 10 (see FIG. 1C). The configuration of the integrated circuit 12 is not particularly limited, and may include, for example, an active element such as a transistor or a passive element such as a resistor, a coil, or a capacitor.

半導体チップ10には、電極14が形成されている。電極14は、半導体チップ10の内部と電気的に接続されていてもよい。電極14は、集積回路12と電気的に接続されていてもよい。あるいは、集積回路12に電気的に接続されていない導電体(導電パッド)を含めて、電極14と称してもよい。電極14は、半導体チップ10の内部配線の一部であってもよい。このとき、電極14は、半導体チップ10の内部配線のうち、外部との電気的な接続に利用される部分であってもよい。電極14は、アルミニウム又は銅等の金属で形成されていてもよい。また、電極14の表面には、TiNやNi等のキャップ層を有してもよい。なお、半導体チップ10における電極14が形成された面は、矩形(長方形又は正方形)をなしていてもよい。   An electrode 14 is formed on the semiconductor chip 10. The electrode 14 may be electrically connected to the inside of the semiconductor chip 10. The electrode 14 may be electrically connected to the integrated circuit 12. Alternatively, a conductor (conductive pad) that is not electrically connected to the integrated circuit 12 may be referred to as the electrode 14. The electrode 14 may be a part of the internal wiring of the semiconductor chip 10. At this time, the electrode 14 may be a portion of the internal wiring of the semiconductor chip 10 that is used for electrical connection with the outside. The electrode 14 may be formed of a metal such as aluminum or copper. Further, a cap layer such as TiN or Ni may be provided on the surface of the electrode 14. Note that the surface of the semiconductor chip 10 on which the electrodes 14 are formed may be rectangular (rectangular or square).

半導体チップ10は、図1(C)及び図1(D)に示すように、パッシベーション膜16を有していてもよい。パッシベーション膜16は、電極14を露出させるように形成される。パッシベーション膜16には、電極14を露出させる開口が形成されていてもよい。なお、パッシベーション膜16は、電極14を部分的に覆うように形成されていてもよい。パッシベーション膜16は、図1(C)に示すように、電極14の周囲を覆うように形成されていてもよい。パッシベーション膜は、例えば、SiOやSiN等の無機絶縁膜であってもよい。あるいは、パッシベーション膜16は、ポリイミド樹脂などの有機絶縁膜であってもよい。 As shown in FIGS. 1C and 1D, the semiconductor chip 10 may have a passivation film 16. The passivation film 16 is formed so as to expose the electrode 14. An opening that exposes the electrode 14 may be formed in the passivation film 16. The passivation film 16 may be formed so as to partially cover the electrode 14. The passivation film 16 may be formed so as to cover the periphery of the electrode 14 as shown in FIG. The passivation film may be, for example, an inorganic insulating film such as SiO 2 or SiN. Alternatively, the passivation film 16 may be an organic insulating film such as a polyimide resin.

本実施の形態に係る半導体装置は、図1(A)〜図1(D)に示すように、樹脂突起20を含む。樹脂突起20は、半導体チップ10の電極14が形成された面15上に形成されている。樹脂突起20は、図1(C)及び図1(D)に示すように、パッシベーション膜16上に形成されていてもよい。   The semiconductor device according to the present embodiment includes a resin protrusion 20 as shown in FIGS. 1 (A) to 1 (D). The resin protrusion 20 is formed on the surface 15 on which the electrode 14 of the semiconductor chip 10 is formed. The resin protrusion 20 may be formed on the passivation film 16 as shown in FIGS. 1 (C) and 1 (D).

樹脂突起20は、図1(A)に示すように、仮想の直線100に沿って延びる形状をなしていてもよい。このとき、直線100は、半導体チップ10の面15のいずれかの辺と平行な直線であってもよい。例えば、直線100は、面15の長辺17と平行な直線であってもよい。そして、樹脂突起20は、面15における、長辺17の周辺領域に配置されていてもよい。ただし、仮想の直線は、面15の短辺と平行な直線であってもよい。   As shown in FIG. 1A, the resin protrusion 20 may have a shape extending along a virtual straight line 100. At this time, the straight line 100 may be a straight line parallel to any side of the surface 15 of the semiconductor chip 10. For example, the straight line 100 may be a straight line parallel to the long side 17 of the surface 15. The resin protrusion 20 may be disposed in the peripheral region of the long side 17 on the surface 15. However, the virtual straight line may be a straight line parallel to the short side of the surface 15.

樹脂突起20は、直線100に沿って配列された複数の第1の部分21と、隣り合う二つの第1の部分21の間に配置された第2の部分22とを含む(図1(B)及び図1(D)参照)。なお、第1の部分21とは、後述する配線40と重複する部分であり、第2の部分22とは、配線40から露出する部分である。   The resin protrusion 20 includes a plurality of first portions 21 arranged along the straight line 100, and a second portion 22 disposed between two adjacent first portions 21 (FIG. 1B). ) And FIG. 1 (D)). The first portion 21 is a portion overlapping with a wiring 40 described later, and the second portion 22 is a portion exposed from the wiring 40.

本実施の形態では、樹脂突起20は、図1(D)に示すように、第1の部分21の高さHが、第2の部分22の高さhよりも高い。なお、ここで言う高さとは、樹脂突起20の、半導体チップ10の厚み方向(面15と直交する方向)の幅であってもよい。そして、第1の部分21の高さとは、面15(パッシベーション膜16)から第1の部分21の頂点までの距離であってもよい。また、第2の部分22の高さとは、面15(パッシベーション膜16)から第2の部分22の頂点までの距離であってもよい。第1の部分21の高さHと、第2の部分22の高さhとは、H−h≦5μmの関係を満たしていてもよい。   In the present embodiment, the resin protrusion 20 has a height H of the first portion 21 higher than a height h of the second portion 22 as shown in FIG. In addition, the height said here may be the width | variety of the thickness direction (direction orthogonal to the surface 15) of the semiconductor chip 10 of the resin protrusion 20. FIG. The height of the first portion 21 may be the distance from the surface 15 (passivation film 16) to the apex of the first portion 21. Further, the height of the second portion 22 may be a distance from the surface 15 (passivation film 16) to the apex of the second portion 22. The height H of the first portion 21 and the height h of the second portion 22 may satisfy the relationship of Hh ≦ 5 μm.

第1の部分21は、高さHと、底面の幅Wとが、H<W/2の関係を満たす形状をなしていてもよい(図2参照)。ここで、底面の幅とは、底面における直線100と直行する方向の長さである。あるいは、底面の幅とは、底面における後述する配線40が延びる方向の長さであってもよい。本実施の形態では、第1の部分21の形状は、H≦20μm、かつ、W≦50μmであってもよい。第1の部分21の形状は、また、H≧5μm、かつ、W≧15μmであってもよい。また、第1の部分21の上面は、凸曲面をなしていてもよい。第1の部分21の上面は、円弧の一部であってもよい。あるいは、第1の部分21の上面は、楕円弧の一部であってもよい。   The first portion 21 may have a shape in which the height H and the width W of the bottom surface satisfy the relationship of H <W / 2 (see FIG. 2). Here, the width of the bottom surface is a length in a direction perpendicular to the straight line 100 on the bottom surface. Alternatively, the width of the bottom surface may be the length of the bottom surface in the direction in which a wiring 40 described later extends. In the present embodiment, the shape of the first portion 21 may be H ≦ 20 μm and W ≦ 50 μm. The shape of the first portion 21 may also be H ≧ 5 μm and W ≧ 15 μm. Further, the upper surface of the first portion 21 may have a convex curved surface. The upper surface of the first portion 21 may be a part of an arc. Alternatively, the upper surface of the first portion 21 may be a part of an elliptical arc.

なお、本実施の形態では、図1(B)に示すように、第2の部分22の底面の幅wは、第1の部分21の底面の幅Wよりも狭くなっていてもよい。このとき、第2の部分22を直線100と直交する平面で切断した断面形状は、第1の部分21を直線100と直交する平面で切断した断面形状と、相似形をなしていてもよい。ただし、第2の部分22の底面の幅は、第1の部分21の底面の幅と同じ幅であってもよい(図示せず)。   In the present embodiment, the width w of the bottom surface of the second portion 22 may be narrower than the width W of the bottom surface of the first portion 21 as shown in FIG. At this time, the cross-sectional shape obtained by cutting the second portion 22 along a plane orthogonal to the straight line 100 may be similar to the cross-sectional shape obtained by cutting the first portion 21 along a plane orthogonal to the straight line 100. However, the width of the bottom surface of the second portion 22 may be the same as the width of the bottom surface of the first portion 21 (not shown).

なお、樹脂突起20の材料は特に限定されず、既に公知となっているいずれかの材料を適用してもよい。例えば、樹脂突起20は、ポリイミド樹脂、シリコーン変性ポリイミド樹脂、エポキシ樹脂、シリコーン変性エポキシ樹脂、アクリル樹脂、フェノール樹脂、シリコーン樹脂、変性ポリイミド樹脂、ベンゾシクロブテン(BCB;benzocyclobutene)、ポリベンゾオキサゾール(PBO;polybenzoxazole)等の樹脂で形成してもよい。   In addition, the material of the resin protrusion 20 is not particularly limited, and any known material may be applied. For example, the resin protrusion 20 is made of polyimide resin, silicone-modified polyimide resin, epoxy resin, silicone-modified epoxy resin, acrylic resin, phenol resin, silicone resin, modified polyimide resin, benzocyclobutene (BCB), polybenzoxazole (PBO). Polybenzoxazole) or other resin.

本実施の形態に係る半導体装置は、図1(A)〜図1(C)に示すように、樹脂部30を含んでいてもよい。樹脂部30は、半導体チップ10の面15上に形成されている。樹脂部30は、図1(C)に示すように、パッシベーション膜16上に形成されていてもよい。樹脂部30の高さは、第1の部分21の高さよりも低くなっていてもよい。樹脂部30は、第2の部分22と同じ高さであってもよい。また、樹脂部30を直線100に直交する平面で切断した断面形状は、第2の部分22を直線100に直交する平面で切断した断面形状と同じ形状であってもよい。ただし、半導体装置は、樹脂部30を有しない構成をなしていてもよい(図示せず)。   The semiconductor device according to the present embodiment may include a resin portion 30 as shown in FIGS. 1 (A) to 1 (C). The resin part 30 is formed on the surface 15 of the semiconductor chip 10. The resin portion 30 may be formed on the passivation film 16 as shown in FIG. The height of the resin portion 30 may be lower than the height of the first portion 21. The resin portion 30 may be the same height as the second portion 22. The cross-sectional shape obtained by cutting the resin portion 30 along a plane orthogonal to the straight line 100 may be the same as the cross-sectional shape obtained by cutting the second portion 22 along a plane orthogonal to the straight line 100. However, the semiconductor device may be configured without the resin portion 30 (not shown).

なお、樹脂部30の材料は特に限定されないが、樹脂突起20と同じ材料で形成されていてもよい。   The material of the resin portion 30 is not particularly limited, but may be formed of the same material as the resin protrusion 20.

本実施の形態に係る半導体装置は、図1(A)〜図1(D)に示すように、配線40を含む。配線40は、電極14と電気的に接続されている。配線40は、電極14上から樹脂突起20を越えて、パッシベーション膜16上に至るように形成されていてもよい。すなわち、配線40は、樹脂突起20の両側で、パッシベーション膜16(面15)と接触するように形成されていてもよい。そして、樹脂突起20のうち、配線40と重複する部分が、第1の部分21である。   The semiconductor device according to the present embodiment includes a wiring 40 as shown in FIGS. The wiring 40 is electrically connected to the electrode 14. The wiring 40 may be formed so as to extend from the electrode 14 to the passivation film 16 over the resin protrusion 20. That is, the wiring 40 may be formed on both sides of the resin protrusion 20 so as to be in contact with the passivation film 16 (surface 15). A portion of the resin protrusion 20 that overlaps the wiring 40 is the first portion 21.

配線40は、電気的接続部42を含む。ここで、電気的接続部42とは、配線40における樹脂突起20(第1の部分21)上に配置された領域である。なお、電気的接続部42とは、配線40のうち、他の電子部品の導電部(配線基板の配線パターンなど)との電気的な接続に利用される部分である。本実施の形態では、配線40のうち、第2の部分22よりも高い位置に配置された領域(第2の部分22から突出した領域)を指して、電気的接続部42と称してもよい。   The wiring 40 includes an electrical connection portion 42. Here, the electrical connection portion 42 is a region disposed on the resin protrusion 20 (first portion 21) in the wiring 40. The electrical connection portion 42 is a portion of the wiring 40 that is used for electrical connection with a conductive portion (such as a wiring pattern on a wiring board) of another electronic component. In the present embodiment, a region of the wiring 40 that is disposed at a position higher than the second portion 22 (a region protruding from the second portion 22) may be referred to as the electrical connection portion 42. .

配線40に適用可能な材料は特に限定されるものではない。配線40は、例えば、Au、TiW、Cu、Ni、Pd、Al、Cr、Ti、W、NiV、鉛フリーはんだなどによって構成されていてもよい。また、配線40の構造も特に限定されるものではない。例えば、配線40は複数層で形成されていてもよい。このとき、配線40は、チタンタングステンによって形成された第1の層と、金によって形成された第2の層とを含んでいてもよい(図示せず)。あるいは、配線40は、単層で形成されていてもよい。   The material applicable to the wiring 40 is not particularly limited. The wiring 40 may be made of, for example, Au, TiW, Cu, Ni, Pd, Al, Cr, Ti, W, NiV, lead-free solder, or the like. Further, the structure of the wiring 40 is not particularly limited. For example, the wiring 40 may be formed of a plurality of layers. At this time, the wiring 40 may include a first layer formed of titanium tungsten and a second layer formed of gold (not shown). Alternatively, the wiring 40 may be formed of a single layer.

半導体装置1は、以上の構成をなしていてもよい。   The semiconductor device 1 may have the above configuration.

半導体装置1を製造する方法は特に限定されるものではないが、以下、半導体装置1を製造する方法の一例について説明する。   Although the method for manufacturing the semiconductor device 1 is not particularly limited, an example of a method for manufacturing the semiconductor device 1 will be described below.

はじめに、図3(A)及び図3(B)に示す半導体基板11を用意する。ここで、図3(A)は半導体基板11の概略図であり、図3(B)は半導体基板11の断面図の一部拡大図である。   First, the semiconductor substrate 11 shown in FIGS. 3A and 3B is prepared. Here, FIG. 3A is a schematic view of the semiconductor substrate 11, and FIG. 3B is a partially enlarged view of a cross-sectional view of the semiconductor substrate 11.

半導体基板11は、図3(A)に示すように、ウエハ状をなす。そして、ウエハ状の半導体基板11は、複数の半導体チップ(半導体チップ10)となる領域200を有する。ただし、半導体基板として半導体チップ(図1(A)参照)を用意して以下の各工程を行ってもよい。   As shown in FIG. 3A, the semiconductor substrate 11 has a wafer shape. The wafer-like semiconductor substrate 11 has a region 200 to be a plurality of semiconductor chips (semiconductor chips 10). However, a semiconductor chip (see FIG. 1A) may be prepared as a semiconductor substrate and the following steps may be performed.

半導体基板11には、図3(B)に示すように、電極14が形成されている。半導体基板11は、電極14を露出させるパッシベーション膜16を有していてもよい。   An electrode 14 is formed on the semiconductor substrate 11 as shown in FIG. The semiconductor substrate 11 may have a passivation film 16 that exposes the electrode 14.

次に、半導体基板11に樹脂材料25を設け(図4(A)参照)、樹脂材料25をパターニングし(図4(B)参照)、これを硬化(例えば熱硬化)させることによって第1及び第2の樹脂部材27,29を形成する(図4(C)参照)。なお、第1及び第2の樹脂部材27,29とは、後述するエッチング工程によって、樹脂突起20及び樹脂部30となる部材である。第1及び第2の樹脂部材27,29の底面及び高さは、樹脂材料25の高さや幅、硬化条件などを調整することで制御することができる。   Next, a resin material 25 is provided on the semiconductor substrate 11 (see FIG. 4A), the resin material 25 is patterned (see FIG. 4B), and this is cured (for example, thermosetting) to form the first and Second resin members 27 and 29 are formed (see FIG. 4C). In addition, the 1st and 2nd resin members 27 and 29 are members used as the resin protrusion 20 and the resin part 30 by the etching process mentioned later. The bottom surface and height of the first and second resin members 27 and 29 can be controlled by adjusting the height and width of the resin material 25, the curing conditions, and the like.

次に、配線40を形成する。図5(A)〜図5(C)は、配線40を形成する工程について説明するための図である。   Next, the wiring 40 is formed. FIG. 5A to FIG. 5C are diagrams for explaining a process of forming the wiring 40.

はじめに、図5(A)に示すように、金属層45を形成する。金属層45は、電極14、パッシベーション膜16、第1の樹脂部材27、及び、第2の樹脂部材29を覆うように形成してもよい。金属層45は、例えばスパッタリングによって形成することができる。金属層45は、単層の金属層であってもよく、複数層の金属層であってもよい。   First, as shown in FIG. 5A, a metal layer 45 is formed. The metal layer 45 may be formed so as to cover the electrode 14, the passivation film 16, the first resin member 27, and the second resin member 29. The metal layer 45 can be formed by sputtering, for example. The metal layer 45 may be a single metal layer or a plurality of metal layers.

そして、図5(B)に示すように、金属層45上にマスク47を形成する。マスク47は、金属層45のうち、配線40となる領域のみを覆うようにパターニングされていてもよい。   Then, as shown in FIG. 5B, a mask 47 is formed on the metal layer 45. The mask 47 may be patterned so as to cover only the region of the metal layer 45 that becomes the wiring 40.

そして、図5(C)に示すように、金属層45におけるマスク47からの露出領域を除去することによって、配線40を形成することができる。   Then, as illustrated in FIG. 5C, the wiring 40 can be formed by removing the exposed region from the mask 47 in the metal layer 45.

ただし、配線40を形成する方法はこれに限られるものではなく、既に公知となっているいずれかの方法を適用してもよい。配線40は、例えば、インクジェット法やメッキ法を適用して形成してもよい。   However, the method of forming the wiring 40 is not limited to this, and any known method may be applied. The wiring 40 may be formed by applying, for example, an inkjet method or a plating method.

次に、第1の樹脂部材27における配線40からの露出部をエッチングして、配線40からの露出部の高さを低くして、高さが異なる第1及び第2の部分21,22を有する樹脂突起20を形成する(図1(A)〜図1(D)参照)。本工程では、第1の樹脂部材27における配線40からの露出部をエッチングして、当該露出部の幅を細くしてもよい(図1(B)参照)。なお、第2の部分22の幅や高さは、エッチング液やエッチング時間、あるいは、プラズマエッチング条件やプラズマエッチング時間を調整することで制御することができる。   Next, the exposed portion from the wiring 40 in the first resin member 27 is etched, the height of the exposed portion from the wiring 40 is lowered, and the first and second portions 21 and 22 having different heights are formed. The resin protrusion 20 is formed (see FIGS. 1A to 1D). In this step, the exposed portion of the first resin member 27 from the wiring 40 may be etched to reduce the width of the exposed portion (see FIG. 1B). Note that the width and height of the second portion 22 can be controlled by adjusting the etching solution, the etching time, or the plasma etching conditions and the plasma etching time.

また、第2の樹脂部材29をエッチングして、第2の樹脂部材29の高さを低くして、樹脂部30を形成する(図1(A)〜図1(C)参照)。これにより、第1の部分21よりも高さが低い樹脂部30を形成することができる。なお、第2の樹脂部材29をエッチングする工程は、第1の樹脂部材27をエッチングする工程と同時に行ってもよい。第1の樹脂部材27と第2の樹脂部材29とを同時にエッチングすることで、第1の樹脂部材27における配線40からの露出部(第2の部分22)と、樹脂部30とを、同じ形状(同じ高さ)に形成することができる。   Further, the second resin member 29 is etched to reduce the height of the second resin member 29 to form the resin portion 30 (see FIGS. 1A to 1C). Thereby, the resin part 30 whose height is lower than that of the first portion 21 can be formed. Note that the step of etching the second resin member 29 may be performed simultaneously with the step of etching the first resin member 27. By simultaneously etching the first resin member 27 and the second resin member 29, the exposed portion (second portion 22) from the wiring 40 in the first resin member 27 and the resin portion 30 are the same. It can be formed in a shape (same height).

そして、半導体基板11を切断して個片に分割する工程や、検査工程などをさらに経て、図1(A)〜図1(D)に示す、半導体装置1を製造することができる。   Then, the semiconductor device 1 shown in FIGS. 1A to 1D can be manufactured through a process of cutting the semiconductor substrate 11 and dividing it into individual pieces, an inspection process, and the like.

(2)配線基板50について
本実施の形態に係る電子デバイスの製造方法は、配線基板50を用意する工程を含む。以下、配線基板50の構成について説明する。
(2) Wiring Board 50 The electronic device manufacturing method according to the present embodiment includes a step of preparing the wiring board 50. Hereinafter, the configuration of the wiring board 50 will be described.

配線基板50は、ベース基板52と、配線パターン54とを含む。ベース基板52(配線基板50)は、電気光学パネル(液晶パネル・エレクトロルミネッセンスパネル等)の一部であってもよい。このとき、ベース基板52は、例えば、セラミック基板やガラス基板であってもよい。また、配線パターン54の材料についても特に限定されるものではないが、例えば、ITO(Indium Tin Oxide)、Cr、Alなどの金属膜、金属化合物膜、又は、これらの複合膜によって形成されていてもよい。なお、配線パターン54は、液晶を駆動する電極(走査電極、信号電極、対向電極等)に電気的に接続されていてもよい。ただし、配線基板50は、樹脂基板であってもよい。   The wiring substrate 50 includes a base substrate 52 and a wiring pattern 54. The base substrate 52 (wiring substrate 50) may be a part of an electro-optical panel (liquid crystal panel, electroluminescence panel, etc.). At this time, the base substrate 52 may be, for example, a ceramic substrate or a glass substrate. The material of the wiring pattern 54 is not particularly limited. For example, the wiring pattern 54 is formed of a metal film such as ITO (Indium Tin Oxide), Cr, or Al, a metal compound film, or a composite film thereof. Also good. The wiring pattern 54 may be electrically connected to an electrode (scanning electrode, signal electrode, counter electrode, etc.) that drives the liquid crystal. However, the wiring substrate 50 may be a resin substrate.

(3)半導体装置1を配線基板50に搭載する工程について
本実施の形態に係る電子デバイスの製造方法は、半導体装置1を配線基板50に搭載する工程を含む。以下、図面を参照して、この工程について説明する。
(3) About the process of mounting the semiconductor device 1 on the wiring board 50 The manufacturing method of the electronic device according to the present embodiment includes the process of mounting the semiconductor device 1 on the wiring board 50. Hereinafter, this process will be described with reference to the drawings.

はじめに、図6(A)及び図7(A)に示すように、半導体装置1と配線基板50とを、間隔をあけて対向させる。ここでは、半導体装置1を、半導体チップ10の面15が配線基板50を向くように配置する。また、半導体装置1の電気的接続部42(樹脂突起20)と配線基板50の配線パターン54とが対向(重複)するように、半導体装置1と配線基板50との位置合わせをする。例えば、図示しない治具(ボンディングツール)によって、半導体装置1を保持し、半導体装置1と配線基板50との位置合わせを行ってもよい。このとき、半導体装置1を、面15が配線基板50と平行になるように保持してもよい。なお、治具にはヒータが内蔵されていてもよく、これにより、半導体装置1を加熱してもよい。半導体装置1を加熱することによって、電気的接続部42が加熱され、電気的接続部42と配線パターン54とを確実に電気的に接続することができる。   First, as shown in FIGS. 6A and 7A, the semiconductor device 1 and the wiring board 50 are opposed to each other with an interval therebetween. Here, the semiconductor device 1 is arranged so that the surface 15 of the semiconductor chip 10 faces the wiring substrate 50. In addition, the semiconductor device 1 and the wiring substrate 50 are aligned so that the electrical connection portion 42 (resin protrusion 20) of the semiconductor device 1 and the wiring pattern 54 of the wiring substrate 50 face (overlap). For example, the semiconductor device 1 may be held by a jig (bonding tool) (not shown), and the semiconductor device 1 and the wiring board 50 may be aligned. At this time, the semiconductor device 1 may be held such that the surface 15 is parallel to the wiring substrate 50. Note that a heater may be built in the jig, and thereby the semiconductor device 1 may be heated. By heating the semiconductor device 1, the electrical connection portion 42 is heated, and the electrical connection portion 42 and the wiring pattern 54 can be reliably electrically connected.

なお、半導体装置1と配線基板50との間には、図6(A)及び図7(A)に示すように、予め、接着材料72を設けておいてもよい。接着材料72は、ペースト状あるいはフィルム状で設けてもよい。接着材料72は、導電粒子などを含まない絶縁性の材料(NCP,NCF)であってもよい。接着材料72は、例えば、配線基板50上に設けてもよい。   Note that an adhesive material 72 may be provided between the semiconductor device 1 and the wiring board 50 in advance as shown in FIGS. 6A and 7A. The adhesive material 72 may be provided in a paste form or a film form. The adhesive material 72 may be an insulating material (NCP, NCF) that does not contain conductive particles or the like. For example, the adhesive material 72 may be provided on the wiring board 50.

その後、図6(B)及び図6(C)、あるいは、図7(B)及び図7(C)に示すように、半導体装置1と配線基板50とを近接させて電気的接続部42と配線パターン54とを接触させて、両者を電気的に接続する。本工程では、半導体チップ10と配線基板50とによって樹脂突起20を押しつぶして、樹脂突起20を弾性変形させてもよい(図6(C)及び図7(C))。これによると、樹脂突起20の弾性力によって、電気的接続部42と配線パターン54とを押し付けることができるため、電気的な接続信頼性の高い電子機器を製造することができる。   Thereafter, as shown in FIG. 6B and FIG. 6C, or FIG. 7B and FIG. 7C, the semiconductor device 1 and the wiring substrate 50 are brought close to each other and the electrical connection portion 42 is connected. The wiring pattern 54 is brought into contact with each other to electrically connect them. In this step, the resin protrusions 20 may be crushed by the semiconductor chip 10 and the wiring substrate 50 to elastically deform the resin protrusions 20 (FIGS. 6C and 7C). According to this, since the electrical connection part 42 and the wiring pattern 54 can be pressed by the elastic force of the resin protrusion 20, an electronic device with high electrical connection reliability can be manufactured.

また、本工程では、電気的接続部42と配線パターン54とを接触させた後に、第2の部分22を配線基板50に接触させる(図6(C)参照)。すなわち、本工程では、第2の部分22が配線基板50に接触するまで、半導体装置1(半導体チップ10)と配線基板50とを近接させる。このとき、第2の部分22を、配線基板50のベース基板52に接触させてもよい。あるいは、第2の部分22を、配線基板50の配線パターン54に接触させてもよい。   In this step, after the electrical connection portion 42 and the wiring pattern 54 are brought into contact with each other, the second portion 22 is brought into contact with the wiring board 50 (see FIG. 6C). That is, in this step, the semiconductor device 1 (semiconductor chip 10) and the wiring board 50 are brought close to each other until the second portion 22 contacts the wiring board 50. At this time, the second portion 22 may be brought into contact with the base substrate 52 of the wiring substrate 50. Alternatively, the second portion 22 may be brought into contact with the wiring pattern 54 of the wiring board 50.

また、本工程では、電気的接続部42と配線パターン54とを接触させた後に、樹脂部30を配線基板50に接触させてもよい(図7(C)参照)。   In this step, the resin portion 30 may be brought into contact with the wiring board 50 after the electrical connection portion 42 and the wiring pattern 54 are brought into contact (see FIG. 7C).

なお、本工程では、半導体装置1と配線基板50とによって、接着材料72を流動させてもよい。これにより、半導体装置1(半導体チップ10)と配線基板50との間に、接着材料72を充填させてもよい(図6(C)及び図7(C)参照)。   In this step, the adhesive material 72 may be caused to flow by the semiconductor device 1 and the wiring substrate 50. Thereby, the adhesive material 72 may be filled between the semiconductor device 1 (semiconductor chip 10) and the wiring substrate 50 (see FIGS. 6C and 7C).

そして、図6(C)及び図7(C)に示すように、接着剤70を形成する。接着剤70は、接着材料72を硬化させることによって形成することができる。接着剤70によって、半導体装置1と配線基板50とを接着(固着)する。接着剤70によって、半導体チップ10と配線基板50との間隔を維持してもよい。すなわち、接着剤70によって、樹脂突起20が弾性変形した状態を維持してもよい。例えば、樹脂突起20が弾性変形した状態で接着剤70を形成することで、樹脂突起20が弾性変形した状態を維持することができる。   Then, as shown in FIGS. 6C and 7C, an adhesive 70 is formed. The adhesive 70 can be formed by curing the adhesive material 72. The semiconductor device 1 and the wiring board 50 are bonded (fixed) with the adhesive 70. The distance between the semiconductor chip 10 and the wiring substrate 50 may be maintained by the adhesive 70. That is, the adhesive protrusion 70 may maintain the resin protrusion 20 in an elastically deformed state. For example, by forming the adhesive 70 in a state where the resin protrusion 20 is elastically deformed, the state where the resin protrusion 20 is elastically deformed can be maintained.

以上の工程によって、図6(C)、又は、図7(C)に示す、電子デバイス2を製造してもよい。   Through the above steps, the electronic device 2 shown in FIG. 6C or FIG. 7C may be manufactured.

なお、電子デバイス2は、表示デバイス(パネルモジュール)であってもよい。図8には、表示デバイスとしての電子デバイス2の概略図を示す。表示デバイスは、例えば液晶表示デバイスやEL(Electrical Luminescence)表示デバイスであってもよい。そして、半導体装置1(半導体チップ)は、表示デバイスを制御するドライバICであってもよい。   The electronic device 2 may be a display device (panel module). In FIG. 8, the schematic of the electronic device 2 as a display device is shown. The display device may be, for example, a liquid crystal display device or an EL (Electrical Luminescence) display device. The semiconductor device 1 (semiconductor chip) may be a driver IC that controls the display device.

また、図9及び図10には、電子デバイス2を有する電子機器の一例として、ノート型パーソナルコンピュータ1000及び携帯電話2000を示す。   9 and 10 show a notebook personal computer 1000 and a mobile phone 2000 as an example of an electronic apparatus having the electronic device 2.

(4)作用効果
以下、本発明が奏する作用効果について説明する。
(4) Operational Effects Hereinafter, the operational effects exhibited by the present invention will be described.

先に説明したように、電子デバイス2によると、樹脂突起20(第1の部分21)の弾性力によって、電気的接続部42が配線パターン54に押し付けられ、これによって両者の電気的な接続信頼性を維持することができる。すなわち、信頼性の高い電子デバイスを製造するためには、半導体チップ10と配線基板50とによって、樹脂突起20(第1の部分21)を押し付ける必要がある。しかし、半導体チップ10と配線基板50とを近接させ過ぎると、樹脂突起20が破壊されるおそれがある。そのため、信頼性の高い電子デバイスを製造するためには、半導体チップ10と配線基板50との間隔を制御する必要がある。逆に言うと、半導体チップ10と配線基板50との間隔を制御することができれば、信頼性の高い電子デバイスを製造することができる。   As described above, according to the electronic device 2, the electrical connection portion 42 is pressed against the wiring pattern 54 by the elastic force of the resin protrusion 20 (first portion 21). Sex can be maintained. That is, in order to manufacture a highly reliable electronic device, it is necessary to press the resin protrusion 20 (first portion 21) between the semiconductor chip 10 and the wiring substrate 50. However, if the semiconductor chip 10 and the wiring substrate 50 are too close, the resin protrusion 20 may be destroyed. Therefore, in order to manufacture a highly reliable electronic device, it is necessary to control the distance between the semiconductor chip 10 and the wiring substrate 50. Conversely, if the distance between the semiconductor chip 10 and the wiring substrate 50 can be controlled, a highly reliable electronic device can be manufactured.

ところで、先に説明した半導体装置1によると、樹脂突起20は、第1の部分21よりも高さが低い第2の部分22を有する。そして、半導体装置1を配線基板50に実装する工程で、樹脂突起20の第2の部分22を配線基板50に接触させる。第2の部分22が配線基板50に接触すると、樹脂突起20は、それ以上変形しにくくなる。このことから、半導体装置1によると、第2の部分22によって、半導体チップ10(半導体装置1)と配線基板50との間隔を規制することができる。そのため、半導体装置1によると、半導体チップ10と配線基板50とが設計通りの間隔をあけて配置された電子デバイスを製造することができる。すなわち、本発明によると、電気的接続部42と配線パターン54とが設計通りの荷重で押し付けられた信頼性の高い電子デバイスを、効率よく製造する方法を提供することができるとともに、信頼性の高い電子デバイスを効率よく製造することが可能な半導体装置を提供することができる。   By the way, according to the semiconductor device 1 described above, the resin protrusion 20 has the second portion 22 having a height lower than that of the first portion 21. Then, the second portion 22 of the resin protrusion 20 is brought into contact with the wiring board 50 in the step of mounting the semiconductor device 1 on the wiring board 50. When the second portion 22 comes into contact with the wiring substrate 50, the resin protrusion 20 is less likely to be deformed. Therefore, according to the semiconductor device 1, the distance between the semiconductor chip 10 (semiconductor device 1) and the wiring substrate 50 can be regulated by the second portion 22. Therefore, according to the semiconductor device 1, it is possible to manufacture an electronic device in which the semiconductor chip 10 and the wiring substrate 50 are arranged with an interval as designed. That is, according to the present invention, it is possible to provide a method for efficiently manufacturing a highly reliable electronic device in which the electrical connection portion 42 and the wiring pattern 54 are pressed with a load as designed, and the reliability is improved. A semiconductor device capable of efficiently manufacturing a high electronic device can be provided.

また、半導体装置1を配線基板50に実装する工程では、樹脂突起20を配線基板50(配線パターン54)に押し付けると、樹脂突起20の形状が、配線基板50(配線パターン54)の形状に追従して変化する。詳しくは、図7(C)に示すように、樹脂突起20の第1の部分21の上端面が配線パターン54と対向するように変化して、配線40における当該上端面に形成された部分(電気的接続部42)が、配線パターン54と接触して電気的に接続される。このことから、第1の部分21の上面のうち、配線基板50(配線パターン54)と対向する面積が大きくなるほど、配線40と配線パターン54との接触面積が大きくなり、両者の電気的な接続信頼性を高めることができる。   In the process of mounting the semiconductor device 1 on the wiring board 50, when the resin protrusion 20 is pressed against the wiring board 50 (wiring pattern 54), the shape of the resin protrusion 20 follows the shape of the wiring board 50 (wiring pattern 54). And change. Specifically, as shown in FIG. 7C, the upper end surface of the first portion 21 of the resin protrusion 20 changes so as to face the wiring pattern 54, and the portion formed on the upper end surface of the wiring 40 ( The electrical connection portion 42) is in electrical contact with the wiring pattern 54. Therefore, the larger the area facing the wiring substrate 50 (wiring pattern 54) in the upper surface of the first portion 21, the larger the contact area between the wiring 40 and the wiring pattern 54, and the electrical connection between them. Reliability can be increased.

ところで、第1の部分21の高さHと、第1の部分21の底面の幅Wとが、H<W/2の関係を満たしている場合、第1の部分21を大きく変形させることなく、電気的接続部42(配線40)と配線パターン54との接続面積(接触面積)を大きくすることができる。そのため、樹脂突起20(第1の部分21)に大きなストレスをかけることなく、電気的な接続信頼性の高い電子デバイスを製造することができる。また、第1及び第2の部分21,22が、H−h≦5μmという関係を満たす樹脂突起20を利用した場合でも、電気的接続部42と配線パターン54との電気的な接続信頼性を確保することが可能になる。すなわち、第1の部分21のつぶれ量が5μm以下(5μm程度)であっても、電気的接続部42と配線パターン54との電気的な接続信頼性を確保することが可能な半導体装置を提供することができる。   By the way, when the height H of the first portion 21 and the width W of the bottom surface of the first portion 21 satisfy the relationship of H <W / 2, the first portion 21 is not greatly deformed. The connection area (contact area) between the electrical connection portion 42 (wiring 40) and the wiring pattern 54 can be increased. Therefore, an electronic device with high electrical connection reliability can be manufactured without applying a great stress to the resin protrusion 20 (first portion 21). Further, even when the first and second portions 21 and 22 use the resin protrusion 20 satisfying the relationship of Hh ≦ 5 μm, the electrical connection reliability between the electrical connection portion 42 and the wiring pattern 54 is improved. It becomes possible to secure. That is, a semiconductor device capable of ensuring the electrical connection reliability between the electrical connection portion 42 and the wiring pattern 54 even when the collapse amount of the first portion 21 is 5 μm or less (about 5 μm) is provided. can do.

本発明は、上述した実施の形態に限定されるものではなく、種々の変形が可能である。例えば、本発明は、実施の形態で説明した構成と実質的に同一の構成(例えば、機能、方法及び結果が同一の構成、あるいは目的及び効果が同一の構成)を含む。また、本発明は、実施の形態で説明した構成の本質的でない部分を置き換えた構成を含む。また、本発明は、実施の形態で説明した構成と同一の作用効果を奏する構成又は同一の目的を達成することができる構成を含む。また、本発明は、実施の形態で説明した構成に公知技術を付加した構成を含む。   The present invention is not limited to the above-described embodiments, and various modifications can be made. For example, the present invention includes configurations that are substantially the same as the configurations described in the embodiments (for example, configurations that have the same functions, methods, and results, or configurations that have the same objects and effects). In addition, the invention includes a configuration in which a non-essential part of the configuration described in the embodiment is replaced. In addition, the present invention includes a configuration that exhibits the same operational effects as the configuration described in the embodiment or a configuration that can achieve the same object. Further, the invention includes a configuration in which a known technique is added to the configuration described in the embodiment.

半導体装置について説明するための図。4A and 4B illustrate a semiconductor device. 半導体装置について説明するための図。4A and 4B illustrate a semiconductor device. 半導体装置の製造方法について説明するための図。10A and 10B illustrate a method for manufacturing a semiconductor device. 半導体装置の製造方法について説明するための図。10A and 10B illustrate a method for manufacturing a semiconductor device. 半導体装置の製造方法について説明するための図。10A and 10B illustrate a method for manufacturing a semiconductor device. 電子デバイスの製造方法について説明するための図。The figure for demonstrating the manufacturing method of an electronic device. 電子デバイスの製造方法について説明するための図。The figure for demonstrating the manufacturing method of an electronic device. 電子デバイスの製造方法について説明するための図。The figure for demonstrating the manufacturing method of an electronic device. 電子機器の一例を示す図。FIG. 14 illustrates an example of an electronic device. 電子機器の一例を示す図。FIG. 14 illustrates an example of an electronic device.

符号の説明Explanation of symbols

1…半導体装置、 2…電子デバイス、 10…半導体チップ、 11…半導体基板、 12…集積回路、 14…電極、 16…パッシベーション膜、 17…長辺、 20…樹脂突起、 21…第1の部分、 22…第2の部分、 25…樹脂材料、 27…第1の樹脂部材、 29…第2の樹脂部材、 30…樹脂部、 40…配線、 42…電気的接続部、 45…金属層、 47…マスク、 50…配線基板、 52…ベース基板、 54…配線パターン、 70…接着剤、 72…接着材料、 100…直線、 200…領域   DESCRIPTION OF SYMBOLS 1 ... Semiconductor device, 2 ... Electronic device, 10 ... Semiconductor chip, 11 ... Semiconductor substrate, 12 ... Integrated circuit, 14 ... Electrode, 16 ... Passivation film, 17 ... Long side, 20 ... Resin protrusion, 21 ... 1st part 22 ... second part, 25 ... resin material, 27 ... first resin member, 29 ... second resin member, 30 ... resin part, 40 ... wiring, 42 ... electrical connection part, 45 ... metal layer, 47 ... Mask, 50 ... Wiring substrate, 52 ... Base substrate, 54 ... Wiring pattern, 70 ... Adhesive, 72 ... Adhesive material, 100 ... Straight line, 200 ... Region

Claims (16)

電極が形成された半導体チップと、前記半導体チップにおける前記電極が形成された面に形成された、仮想の直線に沿って配列された複数の第1の部分と、隣り合う二つの前記第1の部分の間に配置された、前記第1の部分よりも高さが低い第2の部分とを含む樹脂突起と、前記第1の部分上に配置された電気的接続部を有する、前記電極と電気的に接続された配線と、を有する半導体装置を用意する工程と、
ベース基板と、前記ベース基板に形成された配線パターンとを有する配線基板を用意する工程と、
前記半導体装置を前記配線基板に搭載して、前記電気的接続部と前記配線パターンとを接触させて電気的に接続する工程と、
を含み、
前記半導体装置の前記樹脂突起は、前記第1の部分の高さHと、前記第1の部分の底面の、前記仮想直線と直交する方向の幅Wとが、H<W/2の関係を満たす形状であり、
前記半導体装置を前記配線基板に搭載する工程では、
前記電気的接続部と前記配線パターンとを接触させた後に、前記第2の部分を前記配線基板に接触させる電子デバイスの製造方法。
A semiconductor chip on which an electrode is formed; a plurality of first portions arranged along a virtual straight line formed on a surface of the semiconductor chip on which the electrode is formed; and two adjacent first first parts The electrode having a resin protrusion including a second portion disposed between the portions and having a second height lower than that of the first portion; and an electrical connection portion disposed on the first portion; A step of preparing a semiconductor device having electrically connected wiring;
Preparing a wiring board having a base board and a wiring pattern formed on the base board;
Mounting the semiconductor device on the wiring board and bringing the electrical connection portion and the wiring pattern into contact with each other to electrically connect;
Including
In the resin protrusion of the semiconductor device, the height H of the first portion and the width W of the bottom surface of the first portion in the direction perpendicular to the imaginary straight line satisfy the relationship of H <W / 2. A shape that meets
In the step of mounting the semiconductor device on the wiring board,
A method for manufacturing an electronic device, wherein the second portion is brought into contact with the wiring board after the electrical connection portion and the wiring pattern are brought into contact with each other.
請求項記載の電子デバイスの製造方法において、
H≦20μm、かつ、
W≦50μmである電子デバイスの製造方法。
In the manufacturing method of the electronic device of Claim 1 ,
H ≦ 20 μm and
A method for manufacturing an electronic device in which W ≦ 50 μm.
請求項又は請求項記載の電子デバイスの製造方法において、
H≧5μm、かつ、
W≧15μmである電子デバイスの製造方法。
In the manufacturing method of the electronic device of Claim 1 or Claim 2 ,
H ≧ 5 μm and
An electronic device manufacturing method in which W ≧ 15 μm.
請求項1から請求項のいずれか1項に記載の電子デバイスの製造方法において、
前記半導体装置の前記樹脂突起は、前記第1の部分の高さHと、前記第2の部分の高さhとが、H−h≦5μmの関係を満たす形状である電子デバイスの製造方法。
Method of manufacturing an electronic device as claimed in any one of claims 3,
The method of manufacturing an electronic device, wherein the resin protrusion of the semiconductor device has a shape in which a height H of the first portion and a height h of the second portion satisfy a relationship of Hh ≦ 5 μm.
請求項1から請求項のいずれか1項に記載の電子デバイスの製造方法において、
前記第1の部分の上面は、凸曲面である電子デバイスの製造方法。
Method of manufacturing an electronic device as claimed in any one of claims 4,
The method for manufacturing an electronic device, wherein the upper surface of the first portion is a convex curved surface.
請求項1から請求項のいずれか1項に記載の電子デバイスの製造方法において、
前記半導体装置の前記樹脂突起は、前記第2の部分の底面の幅が、前記第1の部分の底面の幅よりも狭い電子デバイスの製造方法。
Method of manufacturing an electronic device as claimed in any one of claims 5,
In the method of manufacturing an electronic device, the resin protrusion of the semiconductor device has a bottom surface width of the second portion that is narrower than a bottom surface width of the first portion.
請求項1から請求項のいずれか1項に記載の電子デバイスの製造方法において、
前記半導体装置は、前記面上に形成された、前記第1の部分よりも高さが低い樹脂部をさらに有し、
前記半導体装置を前記配線基板に搭載する工程では、
前記樹脂部を前記配線基板に接触させる電子デバイスの製造方法。
Method of manufacturing an electronic device according to any one of claims 1 to 6,
The semiconductor device further includes a resin portion formed on the surface and having a height lower than that of the first portion,
In the step of mounting the semiconductor device on the wiring board,
A method for manufacturing an electronic device, wherein the resin portion is brought into contact with the wiring board.
請求項記載の電子デバイスの製造方法において、
前記樹脂部は、前記第2の部分と同じ高さである電子デバイスの製造方法。
In the manufacturing method of the electronic device of Claim 7 ,
The method of manufacturing an electronic device, wherein the resin portion has the same height as the second portion.
電極が形成された半導体チップと、
前記半導体チップにおける前記電極が形成された面に形成された、仮想の直線に沿って配列された複数の第1の部分と、隣り合う二つの前記第1の部分の間に配置された、前記第1の部分よりも高さが低い第2の部分とを含む樹脂突起と、
前記第1の部分上に配置された電気的接続部を有する、前記電極と電気的に接続された配線と、
を有し、
前記第1の部分の高さHと、前記第1の部分の底面の、前記仮想直線と直交する方向の幅Wとは、H<W/2の関係を満たす半導体装置。
A semiconductor chip on which electrodes are formed;
A plurality of first portions arranged along an imaginary straight line formed on a surface of the semiconductor chip on which the electrodes are formed, and the two first portions arranged adjacent to each other; A resin protrusion including a second portion having a height lower than that of the first portion;
A wiring electrically connected to the electrode having an electrical connection disposed on the first portion;
Have
The height H of the first portion and the width W of the bottom surface of the first portion in the direction orthogonal to the imaginary straight line satisfy the relationship of H <W / 2.
請求項記載の半導体装置において、
H≦20μm、かつ、
W≦50μmである半導体装置。
The semiconductor device according to claim 9 .
H ≦ 20 μm and
A semiconductor device in which W ≦ 50 μm.
請求項又は請求項10記載の半導体装置において、
H≧5μm、かつ、
W≧15μmである半導体装置。
The semiconductor device according to claim 9 or 10 ,
H ≧ 5 μm and
A semiconductor device in which W ≧ 15 μm.
請求項から請求項11のいずれか1項に記載の半導体装置において、
前記第1の部分の高さHと、前記第2の部分の高さhとは、H−h≦5μmの関係を満たす半導体装置。
The semiconductor device according to any one of claims 11 claim 9,
The height H of the first portion and the height h of the second portion are semiconductor devices that satisfy a relationship of H−h ≦ 5 μm.
請求項から請求項12のいずれか1項に記載の半導体装置において、
前記第1の部分の上面は、凸曲面である半導体装置。
The semiconductor device according to any one of claims 12 to claim 9,
A semiconductor device in which an upper surface of the first portion is a convex curved surface.
請求項から請求項13のいずれか1項に記載の半導体装置において、
前記第2の部分の底面の幅は、前記第1の部分の底面の幅よりも狭い半導体装置。
The semiconductor device according to any one of claims 13 claim 9,
The width of the bottom surface of the second portion is a semiconductor device narrower than the width of the bottom surface of the first portion.
請求項から請求項14のいずれか1項に記載の半導体装置において、
前記面上に形成された、前記第1の部分よりも高さが低い樹脂部をさらに有する半導体装置。
The semiconductor device according to any one of claims 14 claim 9,
A semiconductor device further comprising a resin portion formed on the surface and having a height lower than that of the first portion.
請求項15記載の半導体装置において、
前記樹脂部は、前記第2の部分と同じ高さである半導体装置。
The semiconductor device according to claim 15 , wherein
The resin part is a semiconductor device having the same height as the second part.
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