JP4851203B2 - 電源選択検出回路、及び電源制御方法 - Google Patents
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Description
Rb2×Ir<Vb1・・・・・(1)
以下に、本発明の好ましい実施の形態を説明する。説明の明確化のため、以下の記載及び図面は、適宜、省略、及び簡略化がなされている。また、説明の明確化のため、必要に応じて重複説明は省略されている。
V/Imax≦(Rb1+Rb2)・・・・・(2)
次に、図面を参照し、本発明の実施の形態2について説明する。本発明に係る電源選択検出回路を、例えば携帯機器のハードディスクドライブやマイコンの駆動回路を負荷とし、例えばLSI等の半導体素子に形成された回路として例を示すものであることは、実施の形態1と同様である。図3は、実施の形態2に係る電源選択検出回路の構成図を示したものである。回路の構成要素や動作原理等、実施の形態1と同様のものは省略する。
次に、図面を参照し、本発明の実施の形態3について説明する。本発明に係る電源選択検出回路を、例えば携帯機器のハードディスクドライブやマイコンの駆動回路を負荷とし、例えばLSI等の半導体素子に形成された回路として例を示すものであることは、実施の形態1と同様である。図4は、実施の形態3に係る電源選択検出回路の構成図を示したものである。回路の構成要素や動作原理等、実施の形態1と同様のものは省略する。
101 負荷、 102 主電源、 103 外部負荷、
104 半導体素子、
110、120 電源検出回路
111、121 電源、 112、122 ショットキーダイオード、
113、123 電圧比較器、
114、115、124、125 抵抗
119、129 電圧検出回路
126 電圧比較器、 127 スイッチ、 128 抵抗、
202 抵抗、 203 トランジスタ、
300 電源選択検出回路、
310 電源検出回路、
316 電圧比較器、317 スイッチ、 318 抵抗、
400 電源選択検出回路
401 負荷、 402 主電源、 403、404 比較回路、
410、420 電源検出回路
411、421 電源、 412、422 ショットキーダイオード、
413、423 電圧比較器、
414、415、424、425 抵抗
416、426 電圧比較器
417、427 スイッチ
419、429 電圧検出回路
Claims (11)
- 複数の外部電源から一つの主電源が選択される電源選択検出回路において、
前記複数の外部電源に対して、
一端が外部電源と接続され、他端が主電源と接続される抵抗性素子と、
前記外部電源の電圧を入力とし、該外部電源の電圧を検出する第1の電圧検出回路を備え、
少なくとも一つの外部電源に対して、
前記抵抗性素子の前記一端と前記他端との間の電圧を検出する第2の電圧検出回路と、
前記外部電源とグランドとの間に接続され、前記第2の電圧検出回路の出力に応じて、前記外部電源と前記グランド間の接続を短絡及び開放するスイッチと、を備え、
前記スイッチは、その一端に抵抗を接続し、前記外部電源が前記主電源よりも高い場合は開放し、該外部電源が該主電源よりも低い場合は短絡し、
前記第1の電圧検出回路は、前記外部電源と前記グランドとの間に第1の分圧抵抗及び第2の分圧抵抗を有し、
前記抵抗の抵抗値は、前記第1の分圧抵抗と前記第2の分圧抵抗の抵抗値を合計した値よりも低い抵抗値である電源選択検出回路。 - 前記第2の電圧検出回路及び前記スイッチが、前記複数の外部電源に対して備えられる請求項1に記載の電源選択検出回路。
- 前記抵抗が、前記複数の外部電源に対して備えられる請求項1又は2に記載の電源選択検出回路。
- 前記外部電源の電流量上限値をImax、及び供給電圧をVとし、
前記第1の分圧抵抗の抵抗値をR1、
前記第2の分圧抵抗の抵抗値をR2としたとき、
V/Imax≦(R1+R2)である請求項1又は2に記載の電源選択検出回路。 - 前記外部電源の少なくとも一つがUSBインターフェースコネクタである請求項4に記載の電源選択検出回路。
- 前記USBインターフェースコネクタのサスペンドモード時の電流量上限値が500μA、及び供給電圧が4.3Vから5.4Vである時、前記第1の分圧抵抗及び第2の分圧抵抗の抵抗値の和は、8.6KΩから10.8KΩ以上である請求項4又は5に記載の電源選択検出回路。
- 前記USBインターフェースコネクタのサスペンドモード時の電流量上限値が500μA、及び供給電圧が4.3Vから5.4Vである時、前記第1の分圧抵抗及び第2の分圧抵抗の抵抗値の和は、43KΩから54KΩ以上である請求項4又は5に記載の電源選択検出回路。
- 前記USBインターフェースコネクタのサスペンドモード時の電流量上限値が500μA、及び供給電圧が4.3Vから5.4Vである時、前記第1の分圧抵抗及び第2の分圧抵抗の抵抗値の和は、1MΩ以上である請求項4又は5に記載の電源選択検出回路。
- 前記スイッチは、前記外部電源が前記主電源よりも高い場合は短絡し、該外部電源が該主電源よりも低い場合は開放する請求項1又は2に記載の電源選択検出回路。
- 前記抵抗性素子は、ショットキーダイオード、抵抗、及びトランジスタのいずれかである請求項1に記載の電源選択検出回路。
- 第1の電源と第2の電源とから一つの電源を選択し、選択した電源を電源供給線を介して負荷へ供給する電源選択検出回路が、
前記第1の電源の電圧を入力とし、前記第1の電源の電圧を検出する第1の電圧検出回路と、
一端が前記第1の電源と接続され、他端が前記電源供給線と接続される第1の抵抗性素子と、
前記第2の電源の電圧を入力とし、前記第2の電源の電圧を検出する第2の電圧検出回路と、
一端が前記第2の電源と接続され、他端が前記電源供給線と接続される第2の抵抗性素子と、
前記第2の抵抗性素子の前記一端と前記他端との間の電圧を検出する第3の電圧検出回路と、
前記第2の電源とグランドとの間に接続され、一端に抵抗を接続し、前記第3の電圧検出回路の出力に応じて、前記第2の電源と前記グランド間の接続を短絡及び開放するスイッチと、を備え、
前記第2の電圧検出回路は、前記第2の電源と前記グランドとの間に第1の分圧抵抗及び第2の分圧抵抗を有し、
前記スイッチと接続する抵抗は、前記第1の分圧抵抗と前記第2の分圧抵抗の抵抗値を合計した値よりも低い抵抗値である電源選択検出回路の電源制御方法であって、
前記第2の抵抗性素子の前記一端と前記他端との間の電圧を検出することによって、前記第2の電源と前記電源供給線との電圧を比較し、
前記第2の電源が前記電源供給線よりも高い電圧である場合は前記スイッチを開放し、前記第2の電源が前記電源供給線よりも低い電圧である場合は、前記スイッチを短絡する電源制御方法。
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