JP4845820B2 - 操作パネルと該パネルを備えた電子機器 - Google Patents
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Description
本実施形態の操作パネルは、LCD、LEDを表示部として備えている。電子機器のユーザーがキー操作を行うために、SW00からSW33までの16個のキーを備えている。LED表示部は、複数(4つ)の表示素子(LED0からLED3)で構成される。これらのキーは、一方の端子を行線に、他方の端子を列線に接続されている。そして、1つの列線(例えば110)に複数のキー(SW00、SW01、SW02、SW03)の端子が接続されている。また、1つの行線(例えば100)に複数のキー(SW00、SW10、SW20、SW30)の端子が接続されている。このように16個のキーが、4本の列線と4本の行線のそれぞれの線の交差する位置に接続されている。
なお、KI0,KI1,KI2,KI3の入力端子(ポート)は図に示すように、抵抗によるプルダウンされている。
LEDデータの転送、キーデータの入力、LCDデータの転送を時分割(期間分割)で行っていることを示す。
(A)は、LCDの表示の指示やSWの操作がない場合である。この場合には、信号線には、LEDの表示データのみ出力されている。
(B)は、SWの操作が行われた場合である。タイミングt61からt62までキー操作が行われ、タイミングt61にてSEQ1からSEQ2へ移行し、タイミングt62にてSEQ2からSEQ1へ移行している。
(C)は、LCDの表示の指示があった場合である。タイミングt63にて指示があり、タイミングt62にてSEQ1からSEQ3へ移行する。また、タイミングt64にてSWの操作も行われている。
上述した第1の実施形態では、コントローラ1の入力ポートの状態のレベル変化を検出して、キー入力が合ったことを判定(認識)したが、別の形態を説明する。第1の実施形態と共通の部分については説明を省き、第1の実施形態と異なる部分について説明する。
図10は、第3の実施形態の操作パネルの制御部を説明する図である。第1の実施形態と同じ構成の説明は省く。キーマトリクスはコントローラ1の出力ポートと入出力ポートと接続されている。例えば、SW00の端子は出力ポートKO0と入出力ポートI/O0と接続されている。この入出力ポートの出力機能と入力機能の切替えを行って、LEDの点灯/消灯の制御、キー入力の制御を行う。
上述した第1、第2の実施形態に適用する電子機器の制御構成について説明する。
Claims (6)
- 1つのスイッチについて一方の端子に第1信号線の接続するとともに他方の端子に第2信号線を接続し、かつ前記スイッチを複数備えているキーマトリクスと、第1表示部と、前記第1信号線にそれぞれ接続されている表示素子を複数有する第2表示部とを備えた操作パネルの制御装置であって、
前記第1信号線に信号を出力する端子と前記第2信号線の信号を入力する端子を複数のスイッチに対応してそれぞれ備える第1制御手段と、
前記第1制御手段のそれぞれの出力端子に対応する第1信号線を介して前記出力端子から出力されるデータを入力する第1入力端子と、前記第1信号線のデータの入力を指示する指示信号を入力する第2入力端子とを備え、前記表示データに基づき第1表示部の表示の制御を行う第2制御手段と、
前記第1制御手段は、
前記第2表示部の表示に基づくレベル信号を各第1信号線に出力し、かつ各第1信号線に出力されているレベルと逆論理のパルス信号を予め定めた時間間隔で前記表示素子毎に順に出力する第1処理と、
各第2信号線のそれぞれの信号レベルを前記パルス信号に同期して評価する第2処理と、
外部から指示があった場合、前記パルス信号に周期内で前記第1表示部の表示に基づくパルス信号の出力を行う第3処理とを行うことを特徴とする操作パネルの制御装置。 - 前記第2処理は、前記パルス信号の出力タイミングを含む予め定めた期間において、前記信号のレベル変化の有無を評価することを特徴とする請求項1に記載の操作パネルの制御装置。
- 前記第2制御手段は、前記指示信号に同期して、前記第1信号線の信号を入力することを特徴とする請求項1に記載の操作パネルの制御装置。
- 1つのスイッチについて一方の端子に第1信号線の接続するとともに他方の端子に第2信号線を接続し、かつ前記スイッチを複数備えているキーマトリクスと、第1表示部と、前記第1信号線にそれぞれ接続されている表示素子を複数有する第2表示部とを備えた操作パネルの制御装置であって、
前記第1信号線に信号を出力する端子と前記第2信号線の信号を入力する端子を複数のスイッチに対応してそれぞれ備える第1制御手段と、
前記第1制御手段のそれぞれの出力端子に対応する第1信号線を介して前記出力端子から出力されるデータを入力する第1入力端子と、前記第1信号線のデータの入力を指示する指示信号を入力する第2入力端子とを備え、前記表示データに基づき第1表示部の表示の制御を行う第2制御手段と、
前記第1制御手段は、
前記第2表示部の表示に基づくレベル信号と、前記レベルと逆論理のパルス信号を重畳させ、かつ前記パルス信号の出力タイミングは予め定めた時間間隔である第1出力処理と、
前記レベル信号に対し、更に前記パルス信号の周期内で前記第1表示部の表示に基づくパルス信号を重畳させる第2出力処理を行うことを特徴とする操作パネルの制御装置。 - 1つのスイッチについて一方の端子に第1信号線の接続するとともに他方の端子に第2信号線を接続し、かつ前記スイッチを複数備えているキーマトリクスと、第1表示部と、前記第1信号線にそれぞれ接続されている表示素子を複数有する第2表示部とを備えた操作パネルの入力に基づき動作を行う電子機器であって、
前記第1信号線に信号を出力する端子と前記第2信号線の信号を入力する端子を複数のスイッチに対応してそれぞれ備える第1制御手段と、
前記第1制御手段のそれぞれの出力端子に対応する第1信号線を介して前記出力端子から出力されるデータを入力する第1入力端子と、前記第1信号線のデータの入力を指示する指示信号を入力する第2入力端子とを備え、前記表示データに基づき第1表示部の表示の制御を行う第2制御手段と、
前記第1制御手段は、
前記第2表示部の表示に基づくレベル信号を各第1信号線に出力し、かつ各第1信号線に出力されているレベルと逆論理のパルス信号を予め定めた時間間隔で前記表示素子毎に順に出力する第1処理と、
各第2信号線のそれぞれの信号レベルを前記パルス信号に同期して評価する第2処理と、
外部から指示があった場合、前記パルス信号に周期内で前記第1表示部の表示に基づくパルス信号の出力を行う第3処理とを行うことを特徴とする電子機器。 - 1つのスイッチについて一方の端子に第1信号線の接続するとともに他方の端子に第2信号線を接続し、かつ前記スイッチを複数備えているキーマトリクスと、第1表示部と、前記第1信号線にそれぞれ接続されている表示素子を複数有する第2表示部とを備えた操作パネルの入力に基づき動作を行う電子機器であって、
前記第1信号線に信号を出力する端子と前記第2信号線の信号を入力する端子を複数のスイッチに対応してそれぞれ備える第1制御手段と、
前記第1制御手段のそれぞれの出力端子に対応する第1信号線を介して前記出力端子から出力されるデータを入力する第1入力端子と、前記第1信号線のデータの入力を指示する指示信号を入力する第2入力端子とを備え、前記表示データに基づき第1表示部の表示の制御を行う第2制御手段と、
前記第1制御手段は、
前記第2表示部の表示に基づくレベル信号と、前記レベルと逆論理のパルス信号を重畳させ、かつ前記パルス信号の出力タイミングは予め定めた時間間隔である第1出力処理と、
前記レベル信号に対し、更に前記パルス信号の周期内で前記第1表示部の表示に基づくパルス信号を重畳させる第2出力処理を行うことを特徴とする電子機器。
Priority Applications (1)
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---|---|---|---|
JP2007169354A JP4845820B2 (ja) | 2006-06-30 | 2007-06-27 | 操作パネルと該パネルを備えた電子機器 |
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006181893 | 2006-06-30 | ||
JP2006181893 | 2006-06-30 | ||
JP2007169354A JP4845820B2 (ja) | 2006-06-30 | 2007-06-27 | 操作パネルと該パネルを備えた電子機器 |
Publications (2)
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JP2008033915A JP2008033915A (ja) | 2008-02-14 |
JP4845820B2 true JP4845820B2 (ja) | 2011-12-28 |
Family
ID=39123207
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2007169354A Active JP4845820B2 (ja) | 2006-06-30 | 2007-06-27 | 操作パネルと該パネルを備えた電子機器 |
Country Status (1)
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JP3317881B2 (ja) * | 1997-09-05 | 2002-08-26 | シャープ株式会社 | ワンチップマイクロコンピュータシステム |
-
2007
- 2007-06-27 JP JP2007169354A patent/JP4845820B2/ja active Active
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