JP4786312B2 - 記憶制御装置及び記憶制御装置のエラー情報管理方法 - Google Patents
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Description
DKA120は、複数のディスクドライブ210を切替ながらアクセスする。この場合、スイッチ回路240は、DKA120からの要求に応じて、所定のディスクドライブ210をDKA120に接続させる。
なお、FSW230に接続されている複数のディスクドライブ210によってRAIDグループを構成してもよい。
Claims (18)
- ホスト装置とのデータの通信を制御する上位通信制御部と、
複数の記憶デバイスとのデータの通信を制御する下位通信制御部と、
複数の通信ポートを介してそれぞれ異なる複数の記憶デバイスと接続し、さらに前記下位通信制御部とも通信ポートを介して接続される複数のスイッチ回路と、前記各記憶デバイスと前記下位通信制御部との間のデータ転送を制御する制御回路と、を有する接続制御部と、
を備え、
前記接続制御部は、前記各通信ポートを流れるデータを前記各スイッチ回路内で監視し、前記各記憶デバイス毎のエラーを前記各スイッチ回路内でそれぞれ検出し、前記各記憶デバイス毎のエラーカウント値を含むエラー情報を前記制御回路内で記憶するエラー監視部を備え、
前記エラー監視部は、
前記下位通信制御部からの要求を受領した場合、前記エラー情報を前記制御回路から前記下位通信制御部に送信し、
前記エラーカウント値が所定の閾値を超えた場合、前記エラー情報を前記制御回路から前記下位通信制御部に送信し、
前記下位通信制御部は、前記エラーカウント値に基づいて、障害の発生した記憶デバイスを特定する
ことを特徴とする記憶制御装置。 - 前記下位通信制御部は、前記各記憶デバイスとの通信結果に基づいてエラーが発生したか否かを検出し、エラーを検出した場合は、前記エラー監視部に前記エラー情報の送信を要求する請求項1に記載の記憶制御装置。
- 前記下位通信制御部は、前記障害の発生した記憶デバイスを特定し、この障害の発生した記憶デバイスに記憶されているデータを回復させるための障害回復処理を実行する請求項1に記載の記憶制御装置。
- 前記エラー監視部は、
前記各スイッチ回路内にそれぞれ設けられ、該各スイッチ回路が有する前記各通信ポートに生じたエラーをそれぞれ検出し、エラー情報として記憶するエラー情報収集部と、
前記制御回路内に設けられ、前記各エラー収集部に記憶された前記エラー情報を所定のタイミングでそれぞれ読み出して保存する中継記憶部と、
前記制御回路内に設けられ、前記下位通信制御部からの要求に応じて、前記中継記憶部に記憶された前記エラー情報を前記下位通信制御部に送信するエラー情報送信部と、を備えて構成される請求項1に記載の記憶制御装置。 - 前記エラー監視部は、前記通信ポートを流れるデータのビットパターンが予め設定された所定のエラーパターンに一致する場合に、前記エラーカウント値を増加させるようになっている請求項4に記載の記憶制御装置。
- 前記中継記憶部は、予め設定された所定の周期で、前記エラー収集部に前記エラー情報の取得を要求し、
前記エラー情報収集部は、前記中継記憶部からの前記要求に応じて、前記各エラーカウンタのエラーカウント値を前記レジスタに転送させ、前記レジスタに記憶された前記各エラーカウント値を前記中継記憶部に転送させるようになっている請求項5に記載の記憶制御装置。 - 前記接続制御部は、前記下位通信制御部に直接的または間接的に接続される前記通信ポートを、前記各記憶デバイスにそれぞれ接続される他の通信ポートのいずれか一つに接続させる請求項1に記載の記憶制御装置。
- 前記各スイッチ回路は、前記各記憶デバイスと前記各通信ポートとの対応関係を示すポート管理テーブルをそれぞれ備えており、このポート管理テーブルを用いて、前記下位通信制御部と前記各通信ポートのうち所定の通信ポートとをスイッチ接続させるようになっている請求項4に記載の記憶制御装置。
- 前記各スイッチ回路は、直列に接続されている請求項4に記載の記憶制御装置。
- 前記各スイッチ回路は、所定のスイッチ回路を中心として、この所定のスイッチ回路に他の全てのスイッチ回路がそれぞれ接続されている請求項4に記載の記憶制御装置。
- 前記各スイッチ回路は、リング状に接続されている請求項4に記載の記憶制御装置。
- 前記エラー監視部は、予め設定された所定のエラーを検出した場合は、前記所定のエラーを検出した旨を前記下位通信制御部に直ちに通知する請求項5に記載の記憶制御装置。
- 前記エラー監視部は、予め設定された所定のテスト用パターンを発生させる信号発生器を備えており、前記各記憶デバイスのうち前記下位通信制御部に接続されていない記憶デバイスに前記テスト用パターンを供給し、このテスト用パターンに対する記憶デバイスからの応答信号に基づいて、前記エラーを検出するようになっている請求項4に記載の記憶制御装置。
- ホスト装置とのデータの通信を制御する上位通信制御部と、
複数の記憶デバイスとのデータの通信を制御する下位通信制御部と、
複数の通信ポートを介してそれぞれ異なる複数の記憶デバイスと接続し、さらに前記下位通信制御部とも通信ポートを介して接続される複数のスイッチ回路と、前記各記憶デバイスと前記下位通信制御部との間のデータ転送を制御する制御回路と、を有する接続制御部とを備えた記憶制御装置のエラー情報管理方法であって、
前記接続制御部は、
前記各記憶デバイスにそれぞれ接続される各通信ポートに、予め設定された所定のエラーパターンに一致するビットパターンが出現したか否かを前記スイッチ回路で判定するステップと、
前記エラーパターンに一致するビットパターンが出現した場合は、その通信ポートのエラーカウンタのエラーカウント値を増加させるステップと、
予め設定された所定時間が経過したか否かを判定するステップと、
前記所定時間が経過した場合は、前記各エラーカウンタのエラーカウント値をそれぞれ取得して記憶させるステップと、
前記下位通信制御部から前記各記憶デバイスのいずれかに対するアクセスエラーが検出されたか否かを判定するステップと、
前記アクセスエラーが検出された場合は、前記記憶された各エラーカウント値をそれぞれ取得し、前記取得された各エラーカウント値に基づいて、障害の発生した記憶デバイスを特定するステップと、
前記エラーカウント値が、閾値を超えた場合、前記エラー情報を前記下位通信制御部に送信し、前記取得された各エラーカウント値に基づいて、障害の発生した記憶デバイスを特定するステップと、
を含んだ記憶制御装置のエラー情報管理方法。 - さらに、前記特定された記憶デバイスに関する情報を外部の管理端末に送信させるステップを備えた請求項14に記載の記憶制御装置のエラー情報管理方法。
- さらに、前記特定された記憶デバイスに記憶されているデータを回復させるステップを備えた請求項15に記載の記憶制御装置のエラー情報管理方法。
- 前記データを回復させるステップは、
前記記憶デバイスのうち未使用の記憶デバイスをいずれか一つ選択するステップと、
前記特定された記憶デバイスとRAIDグループを構成する他の記憶デバイスに記憶されているデータに基づいて、前記特定された記憶デバイスに記憶されているデータを復元させるステップと、
前記復元されたデータを前記選択された未使用の記憶デバイスに記憶させるステップと、を含んで構成される請求項16に記載の記憶制御装置のエラー情報管理方法。 - ホスト装置とのデータの通信を制御する上位通信制御部と、
複数の記憶デバイスとのデータの通信を制御する下位通信制御部と、
前記各記憶デバイスと前記下位通信制御部とをそれぞれ一対一でスイッチ接続させ、かつ、前記各記憶デバイス毎のエラー情報をそれぞれ監視するエラー監視回路を有する接続制御部とを備え、
前記接続制御部は、複数の通信ポートを介してそれぞれ異なる複数の記憶デバイスに接続され、かつ、前記下位通信制御部とも通信ポートを介して接続される複数のスイッチ回路と、これら各スイッチ回路にそれぞれ接続され、前記各記憶デバイスと前記下位通信制御部との間のデータ転送を制御する制御回路とを備えて構成され、
前記エラー監視回路は、
前記各スイッチ回路内にそれぞれ設けられ、該各スイッチ回路が有する前記各通信ポートを流れるデータを監視して、前記各記憶デバイスに生じるエラーをそれぞれ検出し、エラー情報として記憶するエラー情報収集回路と、
前記制御回路内に設けられ、前記各エラー収集回路に記憶された前記エラー情報を所定のタイミングでそれぞれ読み出して保存する中継記憶回路と、
前記制御回路内に設けられ、前記下位通信制御部からの要求に応じて、前記中継記憶回路に記憶された前記エラー情報を前記下位通信制御部に送信するエラー情報送信回路と、を備えて構成されており、かつ、
前記エラー情報収集回路は、
前記通信ポートにそれぞれ設けられ、前記エラーの回数をカウントして記憶するエラーカウンタと、これら各エラーカウンタに記憶されたエラーカウント値を前記エラー情報としてそれぞれ記憶するレジスタとを備えており、
前記各エラーカウンタは、前記通信ポートを流れるデータのビットパターンが予め設定された所定のエラーパターンに一致する場合に、前記エラーカウント値を増加させるようになっており、
前記エラー監視回路は、
前記下位通信制御部からの要求を受領した場合、前記エラー情報を前記中継記憶回路から前記下位通信制御部に送信し、
前記エラーカウント値が所定の閾値を超えた場合、前記エラー情報を前記中継記憶回路から前記下位通信制御部に送信し、
前記下位通信制御部は、前記エラーカウント値に基づいて、障害の発生した記憶デバイスを特定する
記憶制御装置。
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