JP2005339216A - 記憶制御システム - Google Patents
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Abstract
【解決手段】 各ディスク筐体117内には、ディスク接続部111AのENCバイパス113Aと、ディスク接続部111AとENCバイパス113Aのどちらを経由してデータを転送するかを選択的に切替えるPBC101A及び103Aとが備えられる。ディスク接続部111Aに接続されたCTL5Aは、ディスク接続部111Aに異常が発生したことが検出された場合、ディスク接続部111Aをバイパスすることを、CTL5Bに依頼し、CTL5Bが、PBC101A及び103Aを制御して、データの通信経路をディスク接続部111AからENCバイパス113Aに切替える。
【選択図】図1
Description
Service I/F)等の第2のインターフェースを介して、ディスク接続部113A内のLSI23A及びディスク接続部113B内のLSI23Bに接続される。
図4は、本実施形態に係る記憶制御システムの電源系統に関わる部分の構成を示す。
Claims (9)
- データを記憶する複数の記憶デバイスと、
前記記憶デバイスにデータを書込むことや、前記記憶デバイスからデータを読み出すことを制御するコントローラと、
前記コントローラを複数の記憶デバイスに接続する接続系統と
を備え、
前記接続系統は、
前記複数の記憶デバイスに接続される2以上のデバイス接続部と、
前記2以上のデバイス接続部にそれぞれ対応した2以上のバイパスと、
前記2以上のバイパスをそれぞれ備え、前記2以上のデバイス接続部にそれぞれ接続されており、前記コントローラに対し、自分に接続されているデバイス接続部と、そのデバイス接続部のバイパスとのどちらを接続するかを選択的に切替える2以上のパス切替え部と
を備え、
前記2以上のパス切替え部は、前記コントローラが存在する上流側から、前記複数の記憶デバイスが存在する下流側にかけて、直列に接続され、
前記2以上のパス切替え部の各々は、自分に接続されているデバイス接続部が正常の場合、前記コントローラに対してそのデバイス接続部を接続し、一方、そのデバイス接続部に異常が発生した場合、前記コントローラに対して接続するパスをデバイス接続部からそれのバイパスに切替え、
前記コントローラが、前記異常が発生したデバイス接続部のバイパスを介して、それよりも下流側に存在するディスク接続部にアクセスする、
記憶制御システム。 - 前記コントローラ及び前記接続系統はそれぞれ多重化されており、
多重化されたコントローラには、第1と第2のコントローラが含まれ、
多重化された接続系統には、第1のコントローラに接続される第1の接続系統と、第2のコントローラに接続される第2の接続系統とが含まれ、
第1の接続系統に含まれる2以上のディスク接続部には、第1のディスク接続部が含まれ、
前記第2の接続系統に含まれる2以上のディスク接続部には、前記第1のディスク接続部に対応した第2のディスク接続部が含まれ、
前記第1のディスク接続部には、それに対応した第1のパス切替え部が備えられ、
前記第2のディスク接続部には、それに対応した第2のパス切替え部が備えられ、
前記第1のパス切替え部は、前記第2のコントローラに接続され、
前記第2のパス切替え部は、前記第1のコントローラに接続され、
前記第1のコントローラは、前記第1のディスク接続部に異常が発生したことを検出し、前記第2のコントローラに、前記第1のディスク接続部をバイパスすることの指示を意味するバイパス命令を送信し、
前記第2のコントローラは、前記第1のコントローラから前記バイパス命令を受信し、前記第1のディスク接続部のバイパスを前記第1のコントローラに対して接続することの要求を意味するバイパス要求信号を、前記前記第1のパス切替え部に送信し、
前記第1のパス切替え部は、前記バイパス要求信号を受信し、前記第1のコントローラに対して接続するパスを、前記第1のデバイス接続部からそれのバイパスに切替える、
請求項1記載の記憶制御システム。 - 前記コントローラ及び前記接続系統はそれぞれ多重化されており、
多重化されたコントローラには、第1と第2のコントローラが含まれ、
多重化された接続系統には、第1のコントローラに接続される第1の接続系統と、第2のコントローラに接続される第2の接続系統とが含まれ、
第1の接続系統に含まれる2以上のディスク接続部には、第1のディスク接続部が含まれ、
前記第2の接続系統に含まれる2以上のディスク接続部には、前記第1のディスク接続部に対応した第2のディスク接続部が含まれ、
前記第1のディスク接続部には、それに対応した第1のパス切替え部が備えられ、
前記第2のディスク接続部には、それに対応した第2のパス切替え部が備えられ、
前記第1のディスク接続部は、前記第2のパス切替え部に接続され、
前記第2のディスク接続部は、前記第1のパス切替え部に接続され、
前記第1のコントローラは、前記第1のディスク接続部に異常が発生したことを検出し、前記第2のコントローラに、前記第1のディスク接続部をバイパスすることの指示を意味するバイパス命令を送信し、
前記第2のコントローラは、前記第1のコントローラから前記バイパス命令を受信し、前記第1のディスク接続部のバイパスを前記第1のコントローラに対して接続することの要求を意味するバイパス要求信号を、前記第2のディスク接続部を介して前記第1のパス切替え部に送信し、
前記第1のパス切替え部は、前記バイパス要求信号を受信し、前記第1のコントローラに対して接続するパスを、前記第1のデバイス接続部からそれのバイパスに切替える、
請求項1記載の記憶制御システム。 - 前記第1と第2のコントローラは、互いに接続されており、且つ、前記記憶制御システムの上位装置と接続されており、
前記第1のコントローラは、前記上位装置からライト対象データを受信し、前記受信したライト対象データの書込み先が、前記第1のディスク接続部に接続されている記憶デバイスの場合、前記受信したライト対象データを前記第2のコントローラに転送し、
前記第2のコントローラは、前記第1のコントローラからライト対象データを受信し、前記受信したライト対象データを、前記第2のディスク接続部を介して、前記第1のディスク接続部に接続されている前記記憶デバイスに書込む、
請求項2記載の記憶制御システム。 - 前記2以上のディスク接続部及び前記2以上のパス切替え部にそれぞれ対応した2以上の電源と、
前記2以上の電源の状態をそれぞれ検出する2以上の電源検出部と、
前記2以上のパス切替え部にそれぞれ対応した2以上の電源切替え部と
を更に備え、
前記2以上の電源検出部の各々は、自分に対応した電源がオフになったことを検出して、その旨を、その電源に対応したパス切替え部の電源切替え部に通知し、且つ、その電源に対応したパス切替え部に、そのパス切替え部に対応したディスク接続部のバイパスを前記コントローラに対して接続することの要求を意味するバイパス要求信号を送信し、
前記2以上の電源切替え部の各々は、自分に対応したパス切替え部に対して、そのパス切替え部に対応した電源と、それとは別のパス切替え部に対応した電源とのどちらを採用するかを選択的に切替えるようになっており、自分に対応したパス切替え部の電源がオフした旨の通知を前記電源検出部から受けて、自分に対応したパス切替え部に対して、そのパス切替え部とは別のパス切替え部に対応した電源を接続する、
請求項1記載の記憶制御システム。 - 前記2以上のパス切替え部の各々は、前記バイパスの両端に接続された2つのバイパス回路を備え、
前記2つのバイパス回路は、上流側のバイパス回路と下流側のバイパス回路であり、
上流側のバイパス回路は、自分に対応したディスク接続部と、それよりも上流側のディスク接続部に対応したパス切替え部の下流側のバイパス回路とに接続され、
下流側のバイパス回路は、自分に対応したディスク接続部と、それよりも下流側のディスク接続部に対応したパス切替え部の上流側のバイパス回路とに接続される、
請求項1記載の記憶制御システム。 - 前記2以上のパス切替え部の各々は、自分に接続されている、異常のあったデバイス接続部が回復した場合、前記コントローラに対して接続するパスを、バイパスからデバイス接続部に切替える、
請求項1記載の記憶制御システム。 - 2以上のディスク接続部の各々は、記憶デバイスに接続されるファイバチャネルループを備え、
2以上のファイバチャネルループは、前記上流側から下流側にかけて直列に接続され、
前記ファイバチャネルループとそれの隣のファイバチャネルループとの間に、前記ファイバチャネルループのバイパスを備えた前記パス切替え部を備える、
請求項1記載の記憶制御システム。 - 記憶制御システムの動作方法において、
前記記憶制御システムが、
データを記憶する複数の記憶デバイスと、
前記記憶デバイスにデータを書込むことや、前記記憶デバイスからデータを読み出すことを制御するコントローラと、
前記コントローラを複数の記憶デバイスに接続する接続系統と
を備え、
前記接続系統は、
前記複数の記憶デバイスに接続される2以上のデバイス接続部と、
前記2以上のデバイス接続部にそれぞれ対応した2以上のバイパスと、
前記2以上のバイパスをそれぞれ備え、前記2以上のデバイス接続部にそれぞれ接続されており、前記コントローラに対し、自分に接続されているデバイス接続部と、そのデバイス接続部のバイパスとのどちらを接続するかを選択的に切替える2以上のパス切替え部と
を備え、
前記2以上のパス切替え部は、前記コントローラが存在する上流側から、前記複数の記憶デバイスが存在する下流側にかけて、直列に接続され、
前記動作方法は、
前記デバイス接続部に異常が発生した場合、前記コントローラに対して接続するパスをデバイス接続部からそれのバイパスに切替えるステップと、
前記異常が発生したデバイス接続部のバイパスを介して、それよりも下流側に存在するディスク接続部にアクセスするステップと
を有する、
記憶制御システムの動作方法。
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