JP4774441B2 - 無線通信システムにおいて順方向リンクホッピングの順列を生成する方法及び装置 - Google Patents

無線通信システムにおいて順方向リンクホッピングの順列を生成する方法及び装置 Download PDF

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Description

[米国特許法第119条に基づく優先権の主張]
本特許出願は、2005年10月27日に出願され、本願の譲受人に譲渡された「WIRELESS COMMUNICATION」と題する米国仮特許出願第60/731128号明細書の優先権を主張し、これを明示的に参照により本明細書に援用する。
[背景]
・分野
本開示は、包括的には無線通信に関し、特に、順方向リンクホッピングの順列を生成する方法及び装置に関する。
・背景
無線通信システムは広く普及した手段になっており、無線通信システムによって世界中の大多数の人々が通信するようになっている。無線通信装置は、消費者のニーズを満たし、可搬性及び利便性を向上させるために、より小型且つより強力になっている。携帯電話のような移動装置の処理能力の増大は、無線ネットワーク伝送システムに対する需要の増大に繋がっている。通常、このようなシステムは、そのシステムを介して通信するセルラ装置ほど容易には更新されない。移動装置の能力が拡大するにつれて、無線装置の新規の能力及び改良された能力の十分な利用を促進するように旧式の無線ネットワークシステムを維持することが難しくなる可能性がある。
無線通信システムは、一般に、様々な手法を利用して、チャネルの形で伝送リソースを生成する。これらのシステムは、符号分割多重(CDM)システム、周波数分割多重(FDM)システム、及び時分割多重(TDM)システムであり得る。FDMの一般的に利用される一変形は、システム帯域幅全体を複数の直交サブキャリアに効率的に分割する直交周波数分割多重(OFDM)である。これらのサブキャリアはトーン、ビン、あるいは周波数チャネルとも呼ばれ得る。各サブキャリアを変調してデータをのせることができる。時分割ベースの技法では、各サブキャリアは連続するタイムスライス又はタイムスロットの部分を含むことができる。各ユーザには、規定のバースト期間又はフレーム中に情報を送受信するために、タイムスロットとサブキャリアとの組み合わせを1つ又は複数提供することができる。ホッピング方式は、一般的にはシンボルレートホッピング方式またはブロックホッピング方式である。
符号分割ベースの技法は、通常、ある範囲内の任意の時間に利用可能ないくつかの周波数を介してデータを伝送する。一般に、データはデジタル化され、利用可能な帯域幅にわたって拡散し、複数のユーザをチャネルに重ね、各ユーザに一意のシーケンスコードを割り当てることができる。これらのユーザは、同一の広帯域スペクトルチャンクにおいて伝送することができ、各ユーザの信号は、それぞれ固有の拡散コードによって帯域幅全体にわたって拡散する。この技法は共有を規定することができ、これによって1人又は複数のユーザが同時に送受信を行うことができる。このような共有はスペクトル拡散デジタル変調を通じて実現することができ、ユーザのビットストリームは符号化され、擬似ランダム的に非常に広いチャネルにわたって拡散する。受信機は、関連する一意のシーケンスコードを認識し、ランダム化を取り消して、特定のユーザのビットをコヒーレントに収集するように設計される。
一般的な無線通信ネットワーク(例えば、周波数分割技法、時分割技法、及び/又は符号分割技法を利用するもの)は、カバレッジ領域を提供する1つ又は複数の基地局と、そのカバレッジ領域内でデータを送受信することができる1つ又は複数の移動端末(例えば無線端末)とを含む。一般的な基地局は、ブロードキャストサービス、マルチキャストサービス、及び/又はユニキャストサービスに向けて複数のデータストリームを同時に伝送することができ、データストリームは、移動端末が独立して受信することを意図するデータのストリームであることができる。その基地局のカバレッジ領域内の移動端末は、基地局から送信される1つのデータストリーム、1つ以上のデータストリーム、又はすべてのデータストリームの受信に関心を有することができる。同様に、移動端末は、データを基地局又は別の移動端末に送信することができる。これらのシステムでは、帯域幅及び他のシステムリソースが、スケジューラを利用して割り当てられる。
本明細書において開示する信号、信号フォーマット、信号交換、方法、プロセス、及び技法は、既知の手法よりも優れたいくつかの利点を提供する。これらには、例えば、シグナリングオーバーヘッドの低減、システムスループットの向上、シグナリング柔軟性の増大、情報処理の低減、伝送帯域幅の低減、ビット処理の低減、ロバスト性の増大、効率の向上、及び伝送パワーの低減が含まれる。
[概要]
以下に、1つ又は複数の実施形態の簡略化した概要を提示して、このような実施形態の基本的な理解を提供する。この概要は、意図されるすべての実施形態の広範囲に渡る全体像ではない。また、この概要は、すべての実施形態のキーとなる要素又は重要な要素を特定することを意図するものでもなければ、いずれかの又はすべての実施形態の範囲の限定を意図するものでもない。その唯一の目的は、1つ又は複数の実施形態のいくつかの概念を簡略化した形で、後述するより詳細な説明への前置きとして提示することである。
一実施形態によれば、順方向リンクホッピングの順列を生成する方法であって、順列定数を初期化することと、第1のカウンタであるiが2p未満であるようにpの値を決定することと、第2のカウンタjを初期化して「0」にすることと、配列Aの要素のインデックスであるxをi+lにセットすることと、擬似雑音(PN)レジスタをn回クロッキングすることであって、擬似乱数を生成する、クロッキングすることと、xを擬似乱数のp個の最下位ビット(LSB)にセットすることと、jを1だけインクリメントすることと、xがiよりも大きいか否かを判断することと、xがiよりも大きい場合にxをx−iに等しくセットすることと、配列A内のi番目の要素とx番目の要素とを交換することと、カウンタiを1だけデクリメントすることと、生成されたホップ順列に基づいてホップポートのセットをサブキャリアのセットにマッピングすることとを含む、方法が提供される。
別の実施形態によれば、コンピュータ可読媒体であって、順列定数を初期化するための第1の命令のセットと、第1のカウンタであるiが2p未満であるようにpの値を決定するための第2の命令のセットと、第2のカウンタjを初期化して「0」にするための第3の命令のセットと、配列Aの要素のインデックスであるxをi+1にセットするための第4の命令のセットと、PNレジスタをn回クロッキングするための第5の命令のセットであって、擬似乱数を生成する、第5の命令のセットと、xを擬似乱数のp個の最下位ビット(LSB)にセットするための第6の命令のセットと、jを1だけインクリメントするための第7の命令のセットと、xがiよりも大きいか否かを判断するための第8の命令のセットと、xがiよりも大きい場合にxをx−iに等しくセットするための第9の命令のセットと、配列A内のi番目の要素とx番目の要素とを交換するための第10の命令のセットと、カウンタiを1だけデクリメントするための第11の命令のセットと、生成されたホップ順列に基づいてホップポートのセットをサブキャリアのセットにマッピングするための第12の命令のセットとを有する、コンピュータ可読媒体が記載される。
さらに別の実施形態によれば、無線通信システムにおいて動作可能な装置であって、順列定数を初期化する手段と、第1のカウンタであるiが2p未満であるようにpの値を決定する手段と、第2のカウンタjを初期化して「0」にする手段と、配列Aの要素のインデックスであるxをi+1にセットする手段と、PNレジスタをn回クロッキングする手段であって、擬似乱数を生成する、クロッキングする手段と、xを擬似乱数のp個の最下位ビット(LSB)にセットする手段と、jを1だけインクリメントする手段と、xがiよりも大きいか否かを判断する手段と、xがiよりも大きい場合にxをx−iに等しくセットする手段と、配列A内のi番目の要素とx番目の要素とを交換する手段と、カウンタiを1だけデクリメントする手段と、生成されたホップ順列に基づいてホップポートのセットをサブキャリアのセットにマッピングする手段とを備える、装置が記載される。
上記の目的及び関連する目的の実現のために、本願の1つ又は複数の実施形態は、以下において完全に説明され、とくに特許請求の範囲において指摘される特徴を含む。以下の説明及び添付の図面は、本願の1つ又は複数の実施形態のうちの例示的な実施形態を詳細に説明する。しかし、これらの実施形態は、さまざまな実施形態の原理を利用することができる各種方法のうちの少数を示すにすぎず、説明する実施形態は、このような実施形態及びそれらの均等物をすべて包含することを意図する。
[詳細な説明]
これより、図面を参照してさまざまな実施形態を説明する。図面において、同様の参照符号は全体を通じて同様の要素を指すために使用される。以下の記載では、1つ又は複数の実施形態の完全な理解を提供するために、説明を目的として、多くの特定の詳細が述べられる。しかしながら、このような特定の詳細なしでこのような実施形態(複数可)を実施することができることは明らかである。他の場合では、周知である構造及び装置は、1つ又は複数の実施形態の説明を容易にするためにブロック図の形で示される。
図1を参照すると、一実施形態による多重接続無線通信システムが示されている。多重接続無線通信システム100は複数のセルを含み、例えばセル102、104、及び106を含む。図1の実施形態では、各セル102、104、及び106は、複数のセクタを含むアクセスポイント150を含むことができる。複数のセクタは複数のアンテナ群によって形成される。アンテナ群のそれぞれは、セルの一部分においてアクセス端末との通信を担う。セル102では、アンテナ群112、114、及び116はそれぞれ異なるセクタに対応する。セル104では、アンテナ群118、120、及び122はそれぞれ異なるセクタに対応する。セル106では、アンテナ群124、126、及び128はそれぞれ異なるセクタに対応する。
各セルは、各アクセスポイントの1つ又は複数のセクタと通信するいくつかのアクセス端末を含む。例えば、アクセス端末130及び132は基地142と通信し、アクセス端末134及び136はアクセスポイント144と通信し、アクセス端末138及び140はアクセスポイント146と通信する。
コントローラ130はセル102、104、及び106のそれぞれに結合される。コントローラ130は、複数のネットワークへの1つまたは複数の接続を含むことができる。この複数のネットワークは、例えばインターネット、他のパケットベースのネットワーク、又は回線交換音声ネットワークであり、多重接続無線通信システム100のセルと通信するアクセス端末に情報を提供すると共に、アクセス端末から情報が提供されるものである。コントローラ130は、アクセス端末からの送信及びアクセス端末への送信をスケジュールするスケジューラを含むか、又はこのようなスケジューラに結合される。他の実施形態では、スケジューラは、個々のセル内にあってもよく、セルの各セクタ内にあってもよく、又はこれらの組み合わせであってもよい。
本明細書において使用される場合、アクセスポイントは、端末との通信に使用される固定局とすることができる。アクセスポイントは、基地局、ノードB、又は他の何らかの用語で呼ばれる場合があり、またこれらの機能のうちのいくつか又はすべてを含んでもよい。アクセス端末は、ユーザ機器(UE)、無線通信装置、端末、移動局、又は他の何らかの用語で呼ばれる場合があり、またこれらの機能のいくつか又はすべてを含んでもよい。
図1は物理的なセクタ、すなわち、異なるセクタについて異なるアンテナ群を有するセクタを示すが、他の手法を利用してもよいことに留意されたい。例えば、周波数空間においてセルの異なる領域をそれぞれカバーする複数の固定「ビーム」を利用することを、物理的なセクタに代えて、又はこれと組み合わせて利用してもよい。このような手法は、「Adaptive Sectorization in Cellular System」と題する同時係属中の米国特許出願第11/260895号明細書に図示され開示されている。
図2を参照すると、MIMOシステム200内の送信機システム210及び受信機システム250の一実施形態のブロック図が示されている。送信機システム210において、データソース212から送信(TX)データプロセッサ214へ、多数のデータストリームに対するトラフィックデータが提供される。一実施形態では、各データストリームは、それぞれの送信アンテナを経由して送信される。TXデータプロセッサ214は、各データストリームに対して選択された特定の符号化スキームに基づいて、データストリームに対するトラフィックデータをフォーマットし、符号化し、インターリーブして、符号化されたデータを提供する。
各データストリームに対して符号化されたデータは、OFDM又は他の直交化技法若しくは非直交化技法を使用して、パイロットデータと多重化することができる。パイロットデータは通常、既知の方法で処理される既知のデータパターンであり、チャネル応答を推定するために受信機システムにおいて使用することができる。各データストリームに対して多重化されたパイロットデータ及び符号化されたデータは、その後、そのデータストリームに対して選択された1つ又は複数の特定の変調スキーム(例えば、BPSK,QSPK,M−PSK,又はM−QAM)に基づいて変調されて(すなわち、シンボルマッピングされて)、変調シンボルを提供する。各データストリームに対するデータレート、符号化、及び変調は、プロセッサ230によって提供され実施される命令によってすることができる。
その後、全てのデータストリームに対する変調シンボルが、TXプロセッサ220に提供される。TXプロセッサ220は、(例えば、OFDMに対して)変調シンボルをさらに処理することができる。TXプロセッサ220は、その後、NT個の変調シンボルストリームをNT個の送信機(TMTR)222a〜222tに提供する。各送信機222は、それぞれ1つのシンボルストリームを受信し、処理して、1つ又は複数のアナログ信号を提供し、アナログ信号をさらに調整して(例えば、増幅、フィルタリング、及びアップコンバート)、MIMOチャネル経由の送信に適した変調信号を提供する。送信機222a〜222tからのNT個の変調信号は、その後、それぞれNT個のアンテナ224a〜224tから送信される。
受信機システム250において、送信された変調信号は、NR個のアンテナ252a〜252rによって受信され、各アンテナ252から受信された信号は、それぞれの受信機(RCVR)254に提供される。各受信機254は、それぞれの受信された信号を調整し(例えば、フィルタリング、増幅、及びダウンコンバート)、調整された信号をデジタル化してサンプルを提供し、サンプルをさらに処理して、対応する「受信された」シンボルストリームを提供する。
RXデータプロセッサ260は、その後、特定の受信機処理技術に基づいてNR個の受信機254からのNR個の受信されたシンボルストリームを受信し、処理して、NT個の「検出された」シンボルストリームを提供する。RXデータプロセッサ260による処理は、以下にさらに詳細に述べられる。検出されたシンボルストリームのそれぞれは、対応するデータストリームに対して送信された変調シンボルの推定値であるシンボルを含む。RXデータプロセッサ260は、その後、検出されたシンボルストリームのそれぞれを復調し、デインターリーブし、復号して、そのデータストリームに対するトラフィックデータを回復する。RXデータプロセッサ218による処理は、送信機システム210においてTXプロセッサ220及びTXデータプロセッサ214によって実施されたものに対して補完的である。
RXデータプロセッサ260は、同時に復調することができるサブキャリア数が、例えば512個のサブキャリア又は5MHzに制限される場合があり、このような受信機は単一のキャリア上でスケジュールされるべきである。この制限は、FFT範囲(FFT range)の関数であり得る。FFT範囲は、例えば、プロセッサ260が動作することができるサンプルレート、FFTに利用可能なメモリ、又は復調に利用可能な他の機能の関数であり得る。さらに、利用されるサブキャリアの数が多いほど、アクセス端末の費用は大きくなる。
RXプロセッサ260によって生成されるチャネル応答推定値を、受信機における空間処理、空間/時間処理の実施、電力レベルの調整、変調レート若しくは変調スキームの変更、又は他の動作のために使用することができる。RXプロセッサ260は、検出されたシンボルストリームの信号対雑音・干渉比(SNR)、及び場合によっては他のチャネル特性をさらに推定することができ、これらの量をプロセッサ270に提供することができる。RXデータプロセッサ260又はプロセッサ270は、システムに対する「オペレーティング」SNRの推定値をさらに導出することができる。プロセッサ270は、その後、チャネル状態情報(CSI)を提供する。チャネル状態情報は、通信リンク及び/又は受信されたデータストリームに関する様々なタイプの情報を含むことができる。例えば、CSIは、オペレーティングSNRのみを含む場合がある。他の実施形態では、CSIは、チャネル品質指標(CQI)を含んでもよく、これは、1つ又は複数のチャネル状況を示す数値とすることができる。CSIは、その後、TXデータプロセッサ278によって処理され、変調器280によって変調され、送信機254a〜254rによって調整され、そして、送信機システム210へ返信される。
送信機システム210において、受信機システム250からの変調信号は、アンテナ224によって受信され、受信機222によって調整され、復調器240によって復調され、そしてRXデータプロセッサ242によって処理されて、受信機システムによって報告されたCSIを回復する。報告されたCSIは、その後、プロセッサ230に提供され、そして、(1)データストリームに対して使用されるべきデータレート、符号化スキーム、及び変調スキームを決定するために、及び、(2)TXデータプロセッサ214及びTXプロセッサ220に対する様々な制御を生成するために使用される。代替的に、プロセッサ270は、CSIを利用して、送信用の変調スキーム及び/又は符号化レートを他の情報と共に決定することができる。次に、これを送信機に提供することができ、送信機は、受信機への後の送信を提供するために、この情報(量子化されてもよい)を使用する。
プロセッサ230及び270は、それぞれ送信機システム及び受信機システムにおけるオペレーションを指示する。メモリ232及び272は、それぞれプロセッサ230及び270によって使用されるプログラムコード及びデータに対するストレージを提供する。
受信機において、様々な処理技法を使用してNR個の受信された信号を処理し、NT個の送信されたシンボルストリームを検出することができる。これらの受信機処理技法は、2つの主なカテゴリー、すなわち(i)空間的及び空間−時間受信機処理技法(これは、イコライゼーション技法(equalization techniques)とも呼ばれる)、及び(ii)「連続的なヌリング/イコライゼーション及び干渉除去(successive nulling/equalization and interference cancellation)」受信機処理技法(これは、「連続的な干渉除去」又は「連続的な除去」受信機処理技法とも呼ばれる)にグループ化される場合がある。
図2はMIMOシステムを説明するが、同じシステムを、複数の送信アンテナ(例えば基地局の複数の送信アンテナ)が単一のアンテナ装置(例えば移動局)に1つ又は複数のシンボルストリームを送信する、多入力単出力システムに適用することも可能である。また、単出力単入力アンテナシステムを、図2に関連して説明した様式と同じ様式で利用することが可能である。
本明細書で説明される送信技法は、様々な手段によって実施することができる。例えば、これらの技法は、ハードウェア、ファームウェア、ソフトウェア、又はこれらの組み合わせで実施することができる。ハードウェア実施に関して、送信機における処理ユニットは、1つ又は複数の、特定用途向け集積回路(ASIC)、デジタル信号プロセッサ(DSP)、デジタル信号処理装置(DSPD)、プログラマブルロジックデバイス(PLD)、フィールドプログラマブルゲートアレイ(FPGA)、プロセッサ、コントローラ、マイクロコントローラ、マイクロプロセッサ、電子機器、本明細書で説明した機能を実行するために設計された他の電子ユニット、又はこれらの組み合わせ内に実装することができる。受信機における処理ユニットもまた、1つ又は複数のASIC、DSP、プロセッサ等の中に実装することができる。
ソフトウェア実施に関して、送信技法は、本明細書で説明された機能を実施するモジュール(例えば、プロシージャ、関数等)を使用して実施することができる。ソフトウェアコードは、メモリ(例えば、図2のメモリ230、272x又は270y)内に記憶することができ、プロセッサ(例えば、プロセッサ232、270x又は270y)によって実行することができる。メモリは、プロセッサ内に、若しくはプロセッサの外部に実装することができる。
本明細書において、チャネルの概念は、アクセスポイント又はアクセス端末によって送信することができる情報又は伝送タイプを指すことに留意されたい。サブキャリア、時間期間、又はこのような伝送専用の他のリソースの、固定の又はあらかじめ定められたブロックは、必要ではないし利用もされない。
図3A及び図3Bを参照すると、多重接続無線通信システムのスーパーフレーム構造の実施形態が示されている。図3Aは、周波数分割複信(FDD)多重接続無線通信システムのスーパーフレーム構造の実施形態を示し、図3Bは、時分割複信(TDD)多重接続無線通信システムのスーパーフレーム構造の実施形態を示す。スーパーフレームプリアンブルは、各キャリアで別個に送信してもよく、又はそのセクタのすべてのキャリアに跨ってもよい。
図3A及び図3Bの両方において、順方向リンク送信はスーパーフレーム単位に分けられる。スーパーフレームは、スーパーフレームプリアンブルと、その後に続く複数の連続するフレームとからなってもよい。FDDシステムでは、逆方向リンクの伝送と順方向リンクの伝送とが異なる周波数帯域幅を占めることができるため、リンク上の伝送はいかなる周波数サブキャリア上でもオーバラップしないか、又は大部分でオーバラップしない。TDDシステムでは、N個の順方向リンクフレーム及びM個の逆方向リンクフレームが、逆のタイプのフレームの伝送が可能になる前にいくつの連続する順方向リンクフレーム及び逆方向リンクフレームを継続して送信することができるかを規定する。N及びMの数は、1つのスーパーフレーム内で、又はスーパーフレーム間で異なり得ることに留意されたい。
FDD及びTDDの両システムにおいて、各スーパーフレームはスーパーフレームプリアンブルを含み得る。特定の実施形態では、スーパーフレームプリアンブルは、アクセス端末がチャネル推定に使用することができるパイロットを含むパイロットチャネルと、アクセス端末が順方向リンクフレームに含まれている情報を復調するために利用することができる構成情報を含むブロードキャストチャネルとを含む。タイミングや、アクセス端末がキャリアの1つで通信するのに十分な他の情報を、スーパーフレームプリアンブルに含めることができ、また、基本電力制御やオフセット情報等もスーパーフレームプリアンブルに含めることができる。他の場合では、上記及び/又は他の情報のいくつかのみがこのスーパーフレームプリアンプルに含められてもよい。
図3A及び図3Bに示すように、スーパーフレームプリアンブルの後にはフレームシーケンスが続く。各フレームは、同じ数又は異なる数のOFDMシンボルから成ってもよく、この数が、或る規定の期間にわたる送信に同時に利用できるサブキャリアの数となってもよい。さらに、各フレームは、ある順方向リンク又は逆方向リンク上で1ユーザに対して1つ又は複数の連続しないOFDMシンボルが割り当てられるシンボルレートホッピングモードに従って、又は、1つのOFDMシンボルブロック内で複数のユーザがホッピングするブロックホッピングモードに従って、動作することができる。実際のブロック又はOFDMシンボルは、フレーム間でホッピングしてもしなくてもよい。
アクセス端末及びアクセスネットワークは、所定のタイミング、システム状況、又は他の判断基準に基づいて通信リンクを使用して互いに通信し、アクセス端末及びアクセスネットワークは互いに通信する。通信リンクは、通信プロトコル/規格を使用して実装することができ、たとえばWiMAX(World Interoperability for Microwave Access)、IrDA(Infrared Data Association)等の赤外線プロトコル、短距離無線プロトコル/テクノロジ、ブルートゥース(登録商標)技術、ジグビー(ZigBee)(登録商標)プロトコル、超広帯域(UWB)プロトコル、HomeRF(home radio frequency)、共有無線アクセスプロトコル(SWAP)、WECA(wireless Ethernet(登録商標) compatibility alliance)等の広帯域技術、Wi−Fiアライアンス(wireless fidelity alliance)、802.11ネットワーク技術、公衆交換電話網技術、インターネット等の公衆異種通信ネットワーク技術、私設無線通信ネットワーク、陸上移動無線ネットワーク、符号分割多重接続(CDMA)、広帯域符号分割多重接続(WCDMA)、汎用移動通信システム(UMTS)、高度移動電話サービス(AMPS)、時分割多重接続(TDMA)、周波数分割多重接続(FDMA)、直交周波数分割多重(OFDM)、直交周波数分割多重接続(OFDMA)、直交周波数分割多重接続FLASH(OFDMAーFLASH)、GSM(global system for mobile communications)、シングルキャリア(1X)無線伝送技術(RTT)、EV−DO(evolution data only)技術、汎用パケット無線サービス(GPRS)、EDGE(enhanced data GSM environment)、高速ダウンリンクデータパケットアクセス(HSPDA)、アナログ衛星システム及びデジタル衛星システム、並びに他の任意の技術/プロトコル(無線通信ネットワーク及びデータ通信ネットワークのうちの少なくとも一方で使用することができるもの)等を使用して実装することができる。
ホップポートのセットをサブキャリアのセットにマッピングするために、ホップ順列が使用される。順方向リンク(FL)ホッピングに使用されるすべての順列は、後述する共通の順列生成アルゴリズムを使用して生成することができる。順列アルゴリズムは20ビットのシード(seed)及び順列サイズMを入力とすることができ、集合{0,1,...,M−1}の順列を出力する。このアルゴリズムは、線形フィードバックシフトレジスタを使用して擬似乱数を生成し、擬似乱数を使用して擬似ランダム順列が生成される。
この共通の順列生成アルゴリズムは、サイズMの順列を生成することができる。このアルゴリズムの初期化ステップは、M≦2nであるように整数nを仮定することを含む。次に、サイズMの配列Aが数0,1,2,...,M−1を使用して初期化される。PNレジスタが、20ビットのシードを使用してさらに初期化され、カウンタiが初期化されてM−1になる。このアルゴリズムは、i<2pであるような最小のpを見つけるステップと、カウンタjを初期化して0にするステップと、xをi+1にセットするステップと、PNレジスタをn回クロッキングするステップであって、擬似乱数を生成する、クロッキングするステップと、xをその数のp個のLSBにセットするステップと、jを1だけインクリメントするステップと、PNレジスタをクロッキングするステップ及びjの値をインクリメントするステップをj=3になるか又はx≦iになるまで繰り返すステップと、x>iの場合にx=x−iにセットするステップと、配列A内のi番目の要素とx番目の要素とを交換するステップと、カウンタiを1だけデクリメントするステップとを、i=0になるまで繰り返すことをさらに含む。結果として生成される配列Aは出力順列Pである。
FLホップ順列は、MultiCarrierOnモード及びMultiCarrierOffモードの両方について規定される。MultiCarrierOffモードでは、ホップ順列はオーバーヘッドメッセージプロトコルから取得されるいくつかのパラメータに依存する。MultiCarrierOnモードでは、キャリアc(cは{0,1,...,NCARRIERS−1}にある)についてのホップ順列は、キャリアcについてオーバーヘッドメッセージプロトコルから取得されるいくつかのパラメータに依存する。これらのパラメータは、キャリアごとに変化し得る。キャリアごとに変化するパラメータに、キャリアインデックスcによってインデックスを付与することができる。
図4Aは、一実施形態によるプロセス400の流れ図を示す。402において、整数nの値が、M≦2nであるように決定される。404において、サイズMの配列Aが初期化される。406において、擬似雑音(PN)レジスタが20ビットのシードを使用して初期化される。408において、第1のカウンタiが初期化されてM−1になる。410において、整数pの値が、i<2pであるように決定される。412において、第2のカウンタjが初期化されて「0」になる。414において、整数xが値i+1にセットされる。416において、PNレジスタがn回クロッキングされて、擬似乱数が生成される。418において、xが擬似乱数のp個のLSBにセットされる。420において、jの値が1だけインクリメントされる。416、418、及び420におけるプロセスは、j=3であるか、又はx≦iであると判断されなくなるまで繰り返される。さらに、426において、x>iであるか否かが判断される。428において、xの値は、xがiよりも大きい場合にx−iにセットされる。430において、配列A内のi番目の要素とx番目の要素とが交換される。432において、カウンタiが1だけデクリメントされる。410、412、414、416、418、420、426、428、430、及び432におけるプロセスは、i=「0」であると判断されなくなるまで繰り返される。434において、生成されたホップ順列に基づいてホップポートのセットがサブキャリアのセットにマッピングされる。
図4Bは、順方向リンクホッピングの順列を生成するプロセッサ450を示す。一実施形態によれば、参照されるプロセッサは電子装置とすることができ、順列を生成するように構成される1つ又は複数のプロセッサを含むことができる。プロセッサ451は、順列定数を初期化するように構成される。プロセッサ451は、M≦2nであるように整数nの値を決定するプロセッサ452、サイズMの配列Aを初期化するプロセッサ454、20ビットのシードを使用して擬似雑音(PN)レジスタを初期化するプロセッサ456、及び第1のカウンタiを初期化してM−1にするプロセッサ458を含むことができる。プロセッサ460は、i<2pであるように整数pの値を決定するように構成される。プロセッサ462は、第2のカウンタjを初期化して「0」にするように構成される。プロセッサ464は、xを値i+1にセットするように構成される。プロセッサ466は、PNレジスタをn回クロッキングして擬似乱数を生成するように構成される。プロセッサ468は、xを擬似乱数のp個のLSBにセットするように構成される。プロセッサ470は、jの値を1だけインクリメントするように構成される。プロセッサは、PNレジスタをn回クロッキングして擬似乱数を生成することと、xを擬似乱数のp個のLSBにセットすることと、jの値を1だけインクリメントすることとを、j=3であるか、又はx≦iであると判断されなくなるまで繰り返すように構成される。さらに、プロセッサ476は、x>iであるか否かを判断するように構成される。プロセッサ478は、xがiよりも大きい場合にxの値をx−iにセットするように構成される。プロセッサ480は、配列A内のi番目の要素とx番目の要素とを交換するように構成される。プロセッサ482は、カウンタiを1だけデクリメントするように構成される。さらに、プロセッサが、i<2pであるように整数pの値を決定することと、第2のカウンタjを初期化して0にすることと、xを値i+1にセットすることと、PNレジスタをn回クロッキングして擬似乱数を生成することと、xを擬似乱数のp個のLSBにセットすることと、jを1だけインクリメントすることと、x>iであるか否かを判断することと、xがiよりも大きい場合にxをx−iにセットすることと、配列A内のi番目の要素とx番目の要素とを交換することと、カウンタiを1だけデクリメントすることとを、i=「0」であると判断されなくなるまで繰り返すように構成される。プロセッサ484は、生成されたホップ順列に基づいてホップポートのセットをサブキャリアのセットにマッピングするように構成される。図面に示される離散的なプロセッサ452〜484の機能を組み合わせて、単一のプロセッサ450にすることができる。メモリ486もプロセッサ450に結合される。
一実施形態では、順列定数を初期化する手段を備える装置が記載される。初期化する手段は、M≦2nであるように整数nの値を決定する手段と、サイズMの配列Aを初期化する手段と、20ビットのシードを使用して擬似雑音(PN)レジスタを初期化する手段と、第1のカウンタiを初期化してM−1にする手段とをさらに備えることができる。装置は、i<2pであるように整数pの値を決定する手段と、第2のカウンタjを初期化して「0」にする手段と、xを値i+1にセットする手段と、PNレジスタをn回クロッキングして擬似乱数を生成する手段と、xを擬似乱数のp個のLSBにセットする手段と、jの値を1だけインクリメントする手段とをさらに備える。PNレジスタをn回クロッキングして擬似乱数を生成することと、xを擬似乱数のp個のLSBにセットすることと、jの値を1だけインクリメントすることとを、j=3であるか、又はx≦iであると判断されなくなるまで繰り返す手段が設けられる。さらに、x>iであるか否かを判断する手段と、xがiよりも大きい場合にxの値をx−iにセットする手段とが設けられる。装置は、配列A内のi番目の要素とx番目の要素とを交換する手段と、カウンタiを1だけデクリメントする手段と、i<2pであるように整数pの値を決定することと、第2のカウンタjを初期化して0にすることと、xを値i+1にセットすることと、PNレジスタをn回クロッキングして擬似乱数を生成することと、xを擬似乱数のp個のLSBにセットすることと、jを1だけインクリメントすることと、x>iであるか否かを判断することと、xがiよりも大きい場合にxをx−iにセットすることと、配列A内のi番目の要素とx番目の要素とを交換することと、カウンタiを1だけデクリメントすることとを、i=「0」であると判断されなくなるまで繰り返す手段とをさらに備える。生成されたホップ順列に基づいてホップポートのセットをサブキャリアのセットにマッピングする手段も設けられる。本明細書において記載した手段は、1つ又は複数のプロセッサを含むことができる。
さらに、実施形態は、ハードウェア、ソフトウェア、ファームウェア、ミドルウェア、マイクロコード、又はこれらの任意の組み合わせで実施することができる。ソフトウェア、ファームウェア、ミドルウェア、又はマイクロコードに実装される場合、必要なタスクを実行するプログラムコード又はコードセグメントは、図示していない別個のストレージ(複数可)等の機械可読媒体に記憶してもよい。必要なタスクはプロセッサが実行することができる。コードセグメントは、プロシージャ、関数、サブプログラム、プログラム、ルーチン、サブルーチン、モジュール、ソフトウェアパッケージ、又はクラスを表してもよく、命令、データ構造、又はプログラムステートメントの任意の組み合わせを表してもよい。コードセグメントは、情報、データ、引数、パラメータ、又はメモリ内容を渡し、且つ/又は受け取ることによって、別のコードセグメント又はハードウェア回路に結合することができる。情報、引数、パラメータ、データ等は、メモリ共有、メッセージ受け渡し、トークンパッシング、ネットワーク伝送等を含む任意の適した手段を介して受け渡し、転送し、又は伝送することができる。
当業者には、これらの実施形態に対する様々な変更が容易に明白となる。また、本明細書で規定された一般的な原理は他の実施形態にも適用することができる。それゆえ、本明細書は、本明細書に示された実施形態に限定されることを意図したものではなく、本明細書に開示された原理及び新規な特徴と整合する最も広い範囲に適用されるものである。
多重接続無線通信システムの実施形態を示す図である。 多重続無線通信システム内の送信機及び受信機の実施形態を示す図である。 多重接続無線通信システムのスーパーフレーム構造の実施形態を示す図である。 多重接続無線通信システムのスーパーフレーム構造の実施形態を示す図である。 アクセスネットワークが使用するプロセスの流れ図を示す図である。 順方向リンクホッピングの順列を生成するように構成される1つ又は複数のプロセッサを示す図である。

Claims (12)

  1. 無線通信システムにおいて順方向リンクホッピングの順列を生成する方法であって、
    前記方法は、順列定数を初期化することを含み、
    前記順列定数を初期化することは、
    Mが2 n 以下であるような整数nを決定することと、
    サイズMの配列Aを初期化することと、
    シードを使用して擬似雑音(PN)レジスタを初期化することと、
    第1のカウンタiを初期化してM−1にすることと
    を含み、
    前記方法は、第1の動作のセットを実行することを含み、
    前記第1の動作のセットは、
    iが2p未満であるように整数pの値を決定することと、
    第2のカウンタjを初期化してにすることと、
    配列Aの要素のインデックスである整数xをi+1にセットすることと、
    第2の動作のセットを実行することと、
    jが3に等しくなるか、又はxがi以下になるまで前記第2の動作のセットを実行することを繰り返すことと、
    xがiよりも大きいか否かを判断することと、
    xがiよりも大きい場合にxをx−iに等しくセットすることと、
    前記配列A内のi番目の要素とx番目の要素とを交換することと、
    を1だけデクリメントすることと、
    を含み、
    前記第2の動作のセットは、
    擬似乱数を生成するために、前記PNレジスタにクロック信号をn回入力することと、
    xを前記擬似乱数のp個の最下位ビット(LSB)にセットすることと、
    jを1だけインクリメントすることと、
    を含み、
    前記方法は、iが0に等しくなるまで第1の動作のセットを実行することを繰り返すことを含み、
    前記方法は、前記配列Aに基づいてホップポートのセットをサブキャリアのセットにマッピングすることにより、ホップ順列を生成することを含む
    方法。
  2. ンピュータ可読媒体であって、
    前記コンピュータ可読媒体は、コンピュータに処理を実行させる命令を記憶し、
    前記処理は、順列定数を初期化することを含み、
    前記順列定数を初期化することは、
    Mが2 n 以下であるような整数nを決定することと、
    サイズMの配列Aを初期化することと、
    シードを使用して擬似雑音(PN)レジスタを初期化することと、
    第1のカウンタiを初期化してM−1にすることと
    を含み、
    前記処理は、第1の動作のセットを実行することを含み、
    前記第1の動作のセットは、
    が2p未満であるように整数pの値を決定することと、
    第2のカウンタjを初期化してにすることと、
    配列Aの要素のインデックスである整数xをi+1にセットすることと、
    第2の動作のセットを実行することと、
    jが3に等しくなるか、又はxがi以下になるまで前記第2の動作のセットを実行することを繰り返すことと、
    xがiよりも大きいか否かを判断することと、
    xがiよりも大きい場合にxをx−iに等しくセットすることと、
    前記配列A内のi番目の要素とx番目の要素とを交換することと、
    iを1だけデクリメントすることと、
    を含み、
    前記第2の動作のセットは、
    擬似乱数を生成するために、前記PNレジスタにクロック信号をn回入力することと、
    xを前記擬似乱数のp個の最下位ビット(LSB)にセットすることと、
    jを1だけインクリメントすることと、
    を含み、
    前記処理は、iが0に等しくなるまで第1の動作のセットを実行することを繰り返すことを含み、
    前記処理は、前記配列Aに基づいてホップポートのセットをサブキャリアのセットにマッピングすることにより、順方向リンク(FL)ホッピングのためのホップ順列を生成することを含む
    コンピュータ可読媒体。
  3. 置であって、
    前記装置は、順列定数を初期化する手段を含み
    前記順列定数は、
    Mが2 n 以下であるような整数nと、
    サイズMの配列Aと、
    シードを使用する擬似乱数(PN)レジスタと、
    M−1に初期化される第1のカウンタiと
    を含み、
    前記装置は、第1の動作のセットを実行する手段を含み、
    前記第1の動作のセットは、
    が2p未満であるようにpの値を決定することと、
    第2のカウンタjを初期化してにすることと、
    前記配列Aの要素のインデックスである整数xをi+1にセットすることと、
    第2の動作のセットを実行することと、
    jが3に等しくなるか、又はxがi以下になるまで前記第2の動作のセットを実行することを繰り返すことと、
    xがiよりも大きいか否かを判断することと、
    xがiよりも大きい場合にxをx−iに等しくセットすることと、
    前記配列A内のi番目の要素とx番目の要素とを交換することと、
    iを1だけデクリメントすることと、
    を含み、
    前記第2の動作のセットは、
    擬似乱数を生成するために、前記PNレジスタにクロック信号をn回入力することと、
    xを前記擬似乱数のp個の最下位ビット(LSB)にセットすることと、
    jを1だけインクリメントすることと、
    を含み、
    前記第1の動作のセットを実行する手段は、iが0に等しくなるまで第1の動作のセットを実行することを繰り返し、
    前記装置は、配列Aに基づいて、順方向リンクホッピングのためにホップポートのセットをサブキャリアのセットにマッピングする手段を含む
    装置。
  4. 前記シードは20ビットのシードである、請求項3に記載の装置。
  5. 前記PNレジスタは線形フィードバックシフトレジスタである、請求項3に記載の装置。
  6. 前記配列Aは出力ホップ順列Pである、請求項3に記載の装置。
  7. 前記マッピングする手段は、前記ホップポートの前記セットを、順方向リンク(FL)ホッピングのためにサブキャリアのセットにマッピングする、請求項3に記載の装置。
  8. 前記FLホッピングはMultiCarrierOffモードにおけるものである、請求項7に記載の装置。
  9. 前記配列Aは、オーバーヘッドメッセージプロトコルから取得される1つ以上のパラメータに依存する、請求項8に記載の装置。
  10. 前記FLホッピングはMultiCarrierOnモードにおけるものである、請求項7に記載の装置。
  11. キャリアcに対する前記配列Aは、キャリアcに対するオーバーヘッドメッセージプロトコルから取得される1つ以上のパラメータに依存する、請求項10に記載の装置。
  12. システムであって、
    前記システムは、順列定数を初期化するよう構成される第1のプロセッサを含み、
    前記順列定数は、
    Mが2 n 以下であるような整数nと、
    サイズMの配列Aと、
    シードを使用する擬似乱数(PN)レジスタと、
    M−1に初期化される第1のカウンタiと
    を含み、
    前記システムは、第1の動作のセットを実行するよう構成される第2のプロセッサを含み、
    前記第1の動作のセットは、
    iが2 p 未満であるようにpの値を決定することと、
    第2のカウンタjを初期化して0にすることと、
    前記配列Aの要素のインデックスである整数xをi+1にセットすることと、
    第2の動作のセットを実行することと、
    jが3に等しくなるか、又はxがi以下になるまで前記第2の動作のセットを実行することを繰り返すことと、
    xがiよりも大きいか否かを判断することと、
    xがiよりも大きい場合にxをx−iに等しくセットすることと、
    前記配列A内のi番目の要素とx番目の要素とを交換することと、
    iを1だけデクリメントすることと、
    を含み、
    前記第2の動作のセットは、
    擬似乱数を生成するために、前記PNレジスタにクロック信号をn回入力することと、
    xを前記擬似乱数のp個の最下位ビット(LSB)にセットすることと、
    jを1だけインクリメントすることと、
    を含み、
    前記第2のプロセッサは、iが0に等しくなるまで第1の動作のセットを実行することを繰り返し、
    前記システムは、配列Aに基づいて、順方向リンクホッピングのためのホップポートのセットをサブキャリアのセットにマッピングするよう構成される第3のプロセッサを含む
    システム。
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