JP4638161B2 - 電子装置をプログラムする方法及び回路並びにデータ構造 - Google Patents

Description

本発明は一般的に電子分野に係り、特に、電子装置をプログラムする方法及び装置並びにデータ構造に関する。

モニター、プリンター、携帯電話のような電子装置は、コンピュータプログラム（すなわち、ソフトウェア）の動作を通じて前記電子装置に対するユーザインターフェースのような機能を提供できる。前記ソフトウェアは、前記電子装置の内部のプログラマブルメモリのような不揮発性メモリに保存される。例えば、ユーザが内部プログラマブルメモリに保存されたソフトウェアの制御によってコンピュータモニターの輝度のような設定を選択可能にするユーザインターフェースを提供すると知られている。あるシステムでは、プログラマブルメモリを新しいソフトウェアでプログラムすることによって電子装置の動作が変更されうる。

あるシステムでは、プログラマブルメモリを再プログラムする前に予備段階が行われうる。例えば、あるモニターで、前記モニターに含まれるスイッチ及び／またはジャンパーが前記プログラマブルメモリのプログラミングをイネーブルさせるために設定された位置にセッティングされる。また、（前記モニター内部に位置した）前記スイッチ及びジャンパーがアクセスできるようにモニターの外部ケースが除去される。また、前記プログラマブルメモリは、前記モニターの内部に位置したソケットを通じてだけアクセス可能である。したがって、前記モニターの前記プログラマブルメモリをプログラムするためにモニターの外部ケースが除去され、前記ジャンパーが適当な位置にセッティングされ、（前記ソケットを通じて前記プログラマブルメモリに連結された）外部プログラマーが前記プログラマブルメモリをプログラムする。

あるモニターで、ビデオグラフィックアダプター（ＶＧＡ：Ｖｉｄｅｏ Ｇｒａｐｈｉｃｓ Ａｄａｐｔｅｒ）インターフェースを通じて内部プログラマブルメモリをアクセスすると知られている。標準ＶＧＡインターフェースに含まれるＶ_ｓｙｎｃ、Ｈ_ｓｙｎｃ、ＳＤＡ及びＳＣＬのような信号ラインが前記プログラマブルメモリに記入されるデータを伝送するのに使用されうる。

一般的に、前記プログラマブルメモリに記入される前記データは、モニター外部からモニター内のプロセッサー回路に伝送され、再び前記プロセッサー回路がランダムアクセスメモリ（ＲＡＭ：Ｒａｎｄａｍ Ａｃｃｅｓｓ Ｍｅｍｏｒｙ）に前記データを保存する。以後、前記プロセッサー回路は、前記ＲＡＭに保存された前記データをＲＯＭ（Ｒｅａｄ Ｏｎｌｙ Ｍｅｍｏｒｙ）に保存された変換プログラムを使用して他のフォーマット（すなわち、前記データを前記プログラマブルメモリに記入するのに使用できるフォーマット）に変換する。前記データが一回再フォーマットされれば、前記再フォーマットされたデータは、例えば前記モニターに対する新しいユーザインターフェースを提供するように前記プロセッサー回路によって前記プログラマブルメモリに記入されうる。例えば、特許文献１でモニターのプログラマブル制御が議論され、前記特許文献１の公開は、ここに参照として結合される。
米国特許第６,２９５,０５３号公報（Ｔｓａｉ ｅｔ ａｌ.）

本発明が解決しようとする課題は、電子装置のプログラマブルメモリにデータを記入するコントローラ回路を提供ことである。

前記課題を達成するために本発明は、特に、前記コントローラ回路は、前記電子装置の一般的な動作を制御する一般動作処理回路から分離されうる。また、前記コントローラ回路は、前記一般動作処理回路によって制御されるＲＡＭまたはＲＯＭを使用せずに前記プログラマブルメモリにデータを伝送できる。また、本発明による一実施例で、前記一般動作処理回路は、データが前記プログラマブルメモリに伝送される（すなわち、プログラムされる）間、前記コントローラ回路によってディセーブルされうる。ＲＡＭとＲＯＭとを使用しないことによって本発明の実施例による前記コントローラ回路が従来のシステムに比べてさらに低コストで実行されうる。

本発明による一実施例で、前記電子装置内のプログラマブルメモリのプログラミングを制御するコントローラ回路を通じて前記電子装置の外部から前記電子装置内のプログラマブルメモリにプログラムデータが伝送されうる。前記コントローラは、前記電子装置の一般の動作を提供するのに使われる一般動作処理回路から機能的に分離できる。

本発明による一実施例で、前記伝送段階は、前記コントローラ回路から分離できるＲＡＭ及びＲＯＭ装置を使用せずに前記プログラムデータを伝送する段階を含みうる。本発明による一実施例で、前記ＲＡＭとＲＯＭとは、前記コントローラ回路の制御を受けずに前記一般動作処理回路の制御を受けて動作できる。

本発明による一実施例で、前記伝送段階は、前記電子装置をインターフェースするＶＧＡを通じて前記プログラムデータを伝送する段階を含みうる。本発明による一実施例で、前記伝送段階は、内部集積回路（ＩＩＣ：Ｉｎｔｅｒ−Ｉｎｔｅｇｒａｔｅｄ Ｃｉｒｃｕｉｔ）インターフェースを通じて前記プログラムデータを前記電子装置に伝送する段階を含みうる。本発明による一実施例で、前記伝送段階は、直列インターフェースを通じて前記プログラムデータを前記電子装置に伝送する段階を含みうる。本発明による一実施例で、前記一般動作処理回路は、前記プログラマブルメモリに前記プログラムデータを伝送する段階以後に、前記電子装置の一般的な動作を提供するために前記プログラマブルメモリの前記プログラムデータをアクセスできる。本発明による一実施例で、前記一般動作処理回路は、前記電子装置の一般動作を提供するためにＲＡＭとＲＯＭとを個別的にアクセスできる。

本発明による一実施例は、前記プログラマブルメモリにプログラムデータ伝送する段階のうち、前記一般動作処理回路が前記プログラマブルメモリをアクセスすることを防止する段階を含みうる。本発明による一実施例で、前記プログラマブルメモリにプログラムが完了したことを表す指示が前記電子装置の外部に伝送されうる。本発明による一実施例で、前記システムが前記プログラマブルメモリにプログラムされる新しいプログラムデータを使用して動作するように前記システムを再始動させるためにリセット信号（またはコマンド）が前記コントローラ回路に伝送されうる。本発明による一実施例で、前記リセット信号は、前記コントローラ回路及び／または前記システムに電源を再循環させることによって（すなわち、前記コントローラ回路に電源をターンオン／オフさせることによって）前記コントローラ回路に提供されうる。

本発明による一実施例で、プログラマブルメモリをプログラムするために電子装置の外部から前記プログラマブルメモリにプログラムデータを伝送する間、前記電子装置内の一般動作処理装置が前記電子装置内の前記プログラマブルメモリをアクセスすることを防止する段階を含みうる。本発明による一実施例で、前記プログラムデータをプログラマブルメモリに伝送する段階以後、前記一般動作処理回路が前記電子装置の一般的な動作を提供できる。本発明による一実施例で、前記一般動作処理回路は、前記プログラマブルメモリに前記プログラムデータを伝送する段階以後、前記電子装置の一般的な動作を提供するために前記プログラマブルメモリの前記プログラムデータをアクセスできる。

本発明による一実施例で、プログラムデータは、前記電子装置の外部から前記一般動作処理回路から分離できる前記電子装置内のコントローラ回路に伝送され、その後に前記プログラムデータが前記プログラマブルメモリにプログラムされうる。

本発明による一実施例は、前記電子装置の一般的な動作を制御するのに使われる前記電子装置の一般動作処理回路が前記電子装置のプログラマブルメモリをアクセスすることを防止する段階を含みうる。データは、前記電子装置の外部から一般動作処理回路から分離できる前記電子装置内のコントローラ回路に伝送され、その後に前記プログラムデータが前記プログラマブルメモリにプログラムされうる。

本発明による一実施例で、前記プログラムデータのプログラミングが完了したことを表す指示が前記電子装置の外部に伝送されうる。本発明による一実施例で、前記プログラマブルメモリにプログラムされた新しいプログラムデータを使用して前記システムが連続的に動作するように前記システムを再始動させるためにリセット信号（またはコマンド）が前記コントローラ回路に伝送されうる。本発明による一実施例で、前記コントローラ回路及び／または前記システムに電源を再循環させることによって（すなわち、前記コントローラ回路及び／または前記システムに電源をターンオン／オフさせることによって）前記コントローラ回路に前記リセット信号が提供されうる。本発明による一実施例で、プログラムされる前記プログラマブルメモリの位置を表すアドレス情報が提供されないこともある。

本発明による一実施例は、前記プログラマブルメモリにプログラミングのためのデータとしてヘッドデータと関連した他のフィールドに含まれるデータを識別する情報を含むように構成されうるヘッドデータを前記電子装置に提供する段階を含みうる。関連したデータを使用して前記プログラマブルメモリで行われるプログラミング動作を含むように構成されうる前記ヘッドデータと関連したコマンドデータが提供されうる。前記コマンドヘッドデータと関連したデータは、前記コマンドによって前記プログラマブルメモリにプログラムされるデータを含むように構成され、前記プログラマブルメモリをプログラムするのに使われるアドレス情報は、前記データから欠如される。

本発明による一実施例で、前記電子装置の前記プログラマブルメモリにデータをプログラムするのに使われるデータ構造は、前記プログラマブルメモリにプログラミングのためのプログラムデータとしてヘッドフィールドと関連した他のフィールド内に含まれるデータを識別する情報を含むように構成されるヘッドフィールドを含みうる。コマンドフィールドは、関連したデータを使用して前記プログラマブルメモリで行われるプログラミング動作を含むように構成される前記ヘッドフィールドと関連できる。データフィールドは、前記コマンドフィールド及び前記ヘッドフィールドと関連でき、前記コマンドによって前記プログラマブルメモリにプログラムされるデータを含むように構成され、前記プログラマブルメモリのアドレスを指定するのに使われるアドレス情報は、前記データから欠如される。

本発明による一実施例で、モニターをプログラムする回路は、前記モニターの外部から前記モニター内のプログラマブルメモリにプログラムデータを伝送するように構成されるコントローラ回路を含みうる。前記コントローラ回路は、前記プログラマブルメモリに前記プログラムデータを伝送する段階以後に、前記モニターの一般的な動作を提供するのに使われる一般動作処理回路から分離されうる。

本発明による一実施例で、前記コントローラ回路は、インターフェースに連結されるデコーダ回路を含むことができ、前記インターフェースを通じて前記プログラムデータが前記モニターに伝送されうる。前記デコーダ回路は、前記インターフェースを通じて受信されたデータが前記コントローラ回路のアドレス範囲内のアドレスを含むか否かに対する決定に応答して第１信号を提供するように構成されうる。本発明による一実施例で、前記インターフェースを通じて受信されたデータが前記プログラマブルメモリをプログラムするのに使われるか否かに対する判断段階で他のデータが使用されうる。

プログラマブルメモリコントローラは、前記デコーダ回路に連結されることができ、前記第１信号に応答して前記プログラマブルメモリに少なくとも一つの制御信号を提供するように構成されうる。本発明による一実施例で、前記コントローラ回路は、前記デコーダ回路及び前記プログラマブルメモリに連結され、前記プログラマブルメモリに／からデータを提供するように構成されるバッファ回路をさらに含みうる。

本発明による実施例は、電子装置のプログラマブルメモリにデータを記入させるコントローラ回路を提供できる。特に、前記コントローラ回路は、前記電子装置の一般的な動作を制御する一般動作処理回路から分離されうる。また、前記コントローラ回路は、前記一般動作処理回路によって制御されるＲＡＭまたはＲＯＭを使用せずに前記プログラマブルメモリにデータの伝送を許容できる。また、本発明による一実施例で、データがプログラマブルメモリに伝送される（すなわち、プログラムされる）間、前記一般動作処理回路は、前記コントローラ回路によってディセーブルされうる。ＲＡＭとＲＯＭとを使用しないことによって、本発明の実施例による前記コントローラ回路を従来のシステムに比べてさらに低コストで実行できる。

本発明の望ましい実施例を示す添付された図面を参考として本発明をさらに詳細に説明する。しかし、本発明は、多様な他の形態に具現されることができ、ここで説明される実施例に制限されると解釈されてはならない。むしろ、これら実施例はこの公開が完全になり、当業者に本発明の概念を十分に伝達するように提供される。全体的に同じ参照符号は同じ部材を表す。

ここで、本発明の説明に使われる用語は、特定実施例を説明するための目的にだけ使われ、本発明を制限するものと意図されていない。
“含む”及び／または“含み”という用語が明細書で使われる時に明示された特徴、整数、段階、動作、要素及び／または構成要素の存在を詳述するが、一つまたはそれ以上の他の特徴、整数、段階、動作、要素、構成要素及び／またはそのグループの存在または追加を排除しないということも分かる。

別途に定義されないとすれば、ここに使われた全ての技術的及び科学的用語は、当業者が一般的に分かるような意味を有する。ここに記述された全ての公開、特許出願、特許及び他の参照は、それら全体で参照として統合される。

当業者が分かるように、本発明は、方法、モニターのような電子装置及び／またはデータ構造として具現されうる。したがって、本発明は、ハードウェア実施例、ソフトウェア実施例またはソフトウェアとハードウェアとが結合された実施例の形態を有しうる。

本発明は、（ブロック及びフローチャート）図面を使用して開示される。（前記フローチャート例及びブロック図の）各ブロックとブロックとの結合は、コンピュータプログラムインストラクションを使用して実行されうると理解される。前記処理回路で実行される前記インストラクションが前記ブロックまたはブロックで指定された機能を実行する手段を生成するように、これらプログラムインストラクションが前記電子装置内の処理回路に提供されうる。

前記処理回路で実行される前記インストラクションが前記ブロックまたはブロックで指定された前記機能を実行する段階を提供するようにコンピュータ実行プロセスを生成する前記処理回路によって行われる連続動作段階を発生するために前記コンピュータプログラムインストラクションが前記処理回路によって実行されうる。

したがって、前記ブロックは、前記指定された機能を行う手段の結合、前記指定された機能を行う段階の結合及び前記指定された機能を行うプログラムインストラクションを支援する。各ブロック及びブロックの結合は、指定された機能または段階を行う特殊目的ハードウェア基盤システムまたは特殊目的ハードウェアとコンピュータインストラクションとの結合によって実行されうることも理解される。

また、本発明はコンピュータ使用可能保存媒体内に具現されたコンピュータ使用可能プログラムコードを有するコンピュータ使用可能保存媒体のコンピュータプログラムの製品の形態をとりうる。ハードディスク、ＣＤ−ＲＯＭ、光学保存装置または磁気保存装置を含むいかなるコンピュータ再生可能媒体も利用されうる。

本ハツメイニヨル動作を行うコンピュータプログラムコードまたは“コード”またはインストラクションは、ＪＡＶＡ（登録商標）のような客体指向的なプログラミング言語、または多様な他のプログラミング言語で記入されうる。本発明のソフトウェア実施例は、特定なプログラミング言語への実行に依存しない。

前記コンピュータ再生可能メモリに保存されるインストラクションが前記図面ブロックまたはブロックで指定された前記機能を実行するインストラクション手段を含む製造物品を生成するように、これらコンピュータプログラムインストラクションは、コンピュータまたは他のプログラマブルデータ処理装置が特定方式で機能するように指示できるコンピュータ再生可能メモリに保存されうる。

本発明による実施例は、電子装置内のプログラマブルメモリにデータを記入させるコントローラ回路を提供できる。特に、前記コントローラ回路は、前記電子装置の一般的な動作を制御する一般動作処理回路から分離されうる。また、前記コントローラ回路は、前記一般動作処理回路によって制御されるＲＡＭまたはＲＯＭを使用せずに前記プログラマブルメモリにデータを伝送させる。さらに、本発明による一実施例で、プログラマブルメモリにデータが伝送される（すなわち、プログラムされる）間、前記一般動作処理回路は、前記コントローラ回路によってディセーブルされうる。ＲＡＭとＲＯＭとを使用しないことによって、本発明の実施例による前記コントローラ回路が従来のシステムに比べてさらに低コストで具現される。

図１は、本発明によるコントローラ回路の実施例を説明するブロック図である。特に、プログラミングシステム１０５は、モニター、セルホン、ＰＤＡ（Ｐｅｒｓｏｎａｌ Ｄｉｇｉｔａｌ Ａｓｓｉｓｔａｎｔ）のような電子装置１００のある動作または特徴を制御できるプログラムを作成するのに使用されうる。前記プログラミングシステム１０５が前記電子装置１００の外部に位置され、前記電子装置１００を取り囲むカバーまたはケースを除去せず、ここに説明された構成要素に電気的に連結されうる。前記電子装置１００は、電子動作制御回路１０１を含み、前記電子動作制御回路１０１内のプログラマブルメモリ１２０には前記プログラムシステム１０５を利用して前記プログラムが保存される。前記プログラマブルメモリ１２０は、データが記入されて消去されるか、または他のデータに再記入されるまで維持させるＥＥＰＲＯＭ、フラッシュメモリのような不揮発性メモリになりうることが分かる。

本発明に他の一実施例で、プログラミングシステム１０５の作成されたプログラムは、ＩＩＣ標準インターフェースのようなインターフェースを通じて電子装置動作制御回路１０１に（データとして）伝送される。ＩＩＣ標準インターフェースは、公知されているので、さらに議論されない。本発明による一実施例で、前記インターフェースは、ＶＧＡインターフェースになりうる。本発明による一実施例で、無線インターフェースのような他の形態のインターフェースが使用されうる。

前記インターフェースは、一般動作処理回路１１０と制御回路１２５とに連結される。前記一般動作処理回路１１０は、プログラマブルメモリ１２０をアクセスでき、前記プログラマブルメモリ１２０は、前記電子装置１００の動作及び特徴を制御するプログラムを保存できる。例えば、本発明による一実施例で、前記一般動作処理回路１１０は、モニターに対するオンスクリーンユーザインターフェースを提供するために（前記プログラマブルメモリ１２０の）前記プログラムをアクセスできる。

前記制御回路１２５は、前記インターフェースを通じて前記プログラミングシステム１０５で前記プログラマブルメモリ１２０に前記プログラムを伝送できる。本発明による一実施例で、前記制御回路１２５が前記プログラムデータを前記プログラマブルメモリ１２０に伝送する間、前記制御回路１２５は、前記一般動作処理回路１１０が前記プログラマブルメモリ１２０をアクセスすることをディセーブルさせる。前記一般動作処理回路１１０が前記プログラマブルメモリ１２０をアクセスすることをディセーブルさせることによって、前記一般動作処理回路１１０と前記制御回路１２５間の前記プログラマブルメモリ１２０に対するアクセス衝突を避けらせうる。

図２は、本発明による制御回路の実施例を説明するブロック図である。特に、電子装置制御回路２２５は、例えば、前記プログラムデータが外部プログラミングシステムによって提供されうるインターフェースに連結されるデコーダ回路２３０を含みうる。本発明による一実施例で、前記インターフェースに含まれるクロック信号直列クロックラインＳＣＬＫによって同期化される直列データラインＳＤＡＴを通じて前記データが伝送される。

前記インターフェースを通じて提供される前記プログラムデータは、図３に示されたデータ構造によって整理されうる。前記ヘッドフィールド３５０は、前記電子装置動作制御回路２２５と関連したアドレス範囲内で指定された所定のアドレスに対応するように選択されるアドレス情報を含みうる。前記プログラミングシステムは、例えば、前記電子装置動作制御回路２２５に対して指定されたアドレス範囲内のアドレスを伝送することによって受信されたデータが前記プログラマブルメモリ２２０の再プログラミングのためのものであるか否かを判断する。

前記デコーダ回路２３０は、前記情報が前記電子装置動作制御回路２２５と関連したアドレスを含むか否かを判断するために前記ヘッドフィールド３５０を処理する。前記ヘッドフィールド３５０が前記電子装置動作制御回路２２５に指示されるもので前記デコーダ回路２５０が判断すれば、前記デコーダ回路２３０は、前記ヘッドフィールド３５０と関連した前記データ構造のコマンド／アドレスフィールド３５５を処理する。前記コマンド／アドレスフィールド３５５は、前記プログラマブルメモリ２２０で行われる再生／記入／消去コマンドと関連したアドレス情報を含む。

前記コマンド／アドレスフィールド３５５に含まれる前記再生／記入／消去コマンドは、前記データ構造のデータフィールド３６０内に含まれるデータとして動作できる。例えば、前記コマンド／アドレスフィールド３５５が記入コマンドが行われることを表す情報を含めば、前記データフィールド３６０内に含まれる前記情報が前記プログラマブルメモリ２２０の（前記コマンド／アドレスフィールド３５５と指定される）アドレスに記入される。

また、前記コマンド／アドレスフィールド３５５が再生コマンドを表せば、前記データフィールド３６０内に含まれる前記アドレスは、前記プログラマブルメモリ２２０の対応するアドレスからデータを再生するのに使用されうる。また、前記コマンド／アドレスフィールド３５５で消去コマンドは、前記プログラマブルメモリ２２０の少なくとも一部分が消去されることを指示する。前記データフィールド３６０がアドレス情報に固定されていないこともありうると理解される。さらに、前記伝送は、初期データ構造の次の複数の連続的なデータ構造を含むことができ、前記複数の連続的なデータ構造は、アドレスとコマンド情報とに固定されていない前記プログラマブルメモリ２２０に記入されるデータを含む。

再び図２を参考すれば、前記データが前記プログラマブルメモリ２２０に指示されることを表す情報を前記ヘッドフィールド３５０が含んでいると前記デコーダ回路２３０が判断すれば、前記データ構造内に含まれるアドレス及びデータ情報は、前記プログラマブルメモリ２２０に連結されるバッファ回路２３５に伝送される。前記バッファ回路２３５は、例えば、優先するワードまたはセクターサイズによる前記プログラマブルメモリ２２０に記入されるデータを整理するのに使用されうる。前記バッファ回路２３５はまた、前記プログラマブルメモリ２２０の適当な位置がアクセスされるように前記プログラマブルメモリ２２０にアドレスインターフェースを提供できる。
前記プログラマブルメモリ２２０に／からデータが提供されるように前記バッファ回路２３５は、両方向インターフェースを提供できることが分かる。

前記デコーダ回路２３０は、前記コマンド／アドレスフィールド３５５に含まれる情報に基づいて前記データ構造に含まれるコマンド情報をプログラマブルメモリコントローラ回路２４０に提供する。前記プログラマブルメモリコントローラ回路２４０は、前記バッファ回路２３５によって前記プログラマブルメモリ２２０に提供されるアドレス及び／またはデータと結合するのに使われる制御信号を前記プログラマブルメモリ２２０に提供する。したがって、前記アドレス、データ及び制御信号は、前記インターフェースから前記プログラマブルメモリ２２０にプログラムデータの伝送を行える。本発明による一実施例で、記入に連続して前記プログラムデータが前記プログラマブルメモリ２２０内に正確に保存されたことを確認するように再生が行われうる。

また、一般動作処理回路２１０が前記インターフェースに連結されうることが分かる。前記一般動作プロセッサー回路２１０は、前記プログラマブルメモリ２２０に保存されたプログラムが前記一般動作処理回路２１０によって実行されうるように前記バッファ回路２３５を通じて前記プログラマブルメモリ２２０をアクセスできる。この時、前記バッファ回路２３５は、単に直列対並列信号コンバータとしての機能を行う。例えば、本発明に他の一実施例で、前記一般動作処理回路２１０は、前記モニターの動作の具現に使用されうるモニターに対するオンスクリーンユーザインターフェースを提供するために前記プログラマブルメモリ２２０のプログラムをアクセスできる。前記一般動作処理回路２１０が前記電子装置の他の動作を処理するためにアクセスできるＲＡＭ及びＲＯＭ（図示せず）に前記一般動作処理回路２１０が連結されうることが分かる。

前記プログラマブルメモリ２２０に前記伝送が行われる間、前記デコーダ回路２３０は、前記一般動作処理回路２１０が前記プログラマブルメモリ２２０をアクセスすることをディセーブルさせうる。前記デコーダ回路２３０は、前記インターフェースを通じて受信されるデータが前記プログラマブルメモリ２２０に指示されると判断するのに応答して前記一般動作処理回路２１０が前記プログラマブルメモリ２２０をアクセスすることを防止できる。前記伝送が完了すれば、前記デコーダ回路２３０は、前記一般動作処理回路２１０を再びイネーブルさせて、前記一般動作処理回路２１０が前記プログラマブルメモリ２２０をアクセスし、前記プログラマブルメモリ２２０に保存されたプログラムの制御によって指定された動作を開始するようにする。

図４は、本発明による方法実施例の動作を示すフローチャートである。図４に示されたように、前記プログラマブルメモリに保存されるデータは、ここで説明されたようなデータ構造フォーマットによって前記電子装置に伝送される（ブロック４０５）。前記受信されたデータが前記データ構造のヘッドフィールド内に含まれる情報に基づいて前記伝送と関連するか否かが決定される（ブロック４１０）。前記データ構造フォーマットのコマンド／アドレスフィールド内に含まれるコマンドタイプに対する決定がなされる（ブロック４１５）。特に、前記データ構造で前記コマンド／アドレスフィールド内に含まれるコマンド形態が記入動作、再生動作のように前記プログラマブルメモリで行われる動作、または前記プログラマブルメモリで行われる消去動作を指定する。

前記プログラマブルメモリへのデータ伝送が完了するまで前記一般動作処理回路が前記プログラマブルメモリをアクセスすることがディセーブルされる（ブロック４２０）。前記データ構造のデータフィールド内に含まれるデータが（記入動作の場合）前記プログラマブルメモリに伝送される（ブロック４２５）。前記データが（ブロック４２５）前記プログラマブルメモリに正確に記入されたか否かを判断するように前記再生動作が行われうる（ブロック４３０）。前記電子装置制御回路は、前記一般動作処理回路が前記プログラマブルメモリをアクセスするようにリセットされ、その結果、新しく伝送されたプログラムによって前記電子装置の動作をイネーブルさせる（ブロック４４０）。

図面及び明細書で本発明による実施例が開示され、特定な用語が使われたが、特定な用語は、包括的かつ技術的な意味としてだけ使われ、制限の目的で使われるものではない。本発明の範囲に対しては、当業者によって特許請求の範囲によって定義される本発明の精神及び範囲を外れずに多様な形態及び項目に変更されうることが分かる。

本発明による電子装置をプログラムする方法及び回路並びにデータ構造は、電子装置のプログラマブルメモリに対するプログラミングを制御する制御回路に適用されうる。

本発明による実施例を説明するブロック図である。 本発明による実施例を説明するブロック図である。 本発明によるデータ構造の例を説明する概念図である。 本発明による方法実施例の動作を説明するフローチャートである。

符号の説明

１００ 電子装置
１０１ 電子装置動作制御回路
１０５ プログラミングシステム
１１０ 一般動作処理回路
１２０ プログラマブルメモリ
１２５ 制御回路

Claims (17)

1. プログラマブルメモリにプログラムデータを伝送する段階以後に電子装置の一般的な動作を提供するのに使われる一般動作処理回路から分離できる前記電子装置の前記プログラマブルメモリのプログラミングを制御するコントローラ回路を通じて前記電子装置の外部から前記電子装置内の前記プログラマブルメモリに前記プログラムデータを伝送する段階と、
   前記プログラマブルメモリに前記プログラムデータを伝送する間、前記コントローラ回路によって前記一般動作処理回路をディスエーブルさせ、前記一般動作処理回路が前記プログラマブルメモリをアクセスすることを防止する段階を含み、
   前記プログラムデータを伝達する段階は、前記一般動作処理回路によって制御されるランダムアクセスメモリ（ＲＡＭ）とリードオンリメモリ（ＲＯＭ）装置を使用せず、
   前記プログラムデータを伝送する段階は、
   前記プログラムデータに含まれるアドレスとデータ値を前記電子装置内で前記プログラマブルメモリに連結されるバッファ回路に伝送する段階と、
   前記プログラムデータに含まれるコマンドを前記電子装置内で前記プログラマブルメモリのプログラムを制御するプログラマブルメモリコントローラに伝送する段階と、
   前記バッファに貯蔵されたデータ及びアドレスと前記プログラマブルメモリコントローラから発生する制御信号を前記プログラマブルメモリに提供する段階と、を含むことを特徴とする電子装置をプログラムする方法。
2. 前記伝送段階は、
   前記コントローラ回路から分離されるＲＡＭ及びＲＯＭ装置を使用せずに前記プログラムデータを伝送する段階をさらに含むことを特徴とする請求項１に記載の電子装置をプログラムする方法。
3. 前記ＲＡＭとＲＯＭとは、前記一般動作処理回路によって制御されて動作し、前記コントローラ回路によって制御されないことを特徴とする請求項２に記載の電子装置をプログラムする方法。
4. 前記伝送段階は、
   前記電子装置の信号ケーブルを通じて前記電子装置に前記プログラムデータを伝送する段階をさらに含むことを特徴とする請求項１に記載の電子装置をプログラムする方法。
5. 前記伝送段階は、
   内部集積回路インターフェースを通じて前記電子装置に前記プログラムデータを伝送する段階をさらに含むことを特徴とする請求項１に記載の電子装置をプログラムする方法。
6. 前記伝送段階は、
   直列インターフェースを通じて前記電子装置に前記プログラムデータを伝送する段階をさらに含むことを特徴とする請求項１に記載の電子装置をプログラムする方法。
7. 前記一般動作処理回路は、前記プログラマブルメモリに前記プログラムデータを伝送する段階以後に、前記プログラマブルメモリの前記プログラムデータをアクセスして前記電子装置の一般的な動作を提供することを特徴とする請求項１に記載の電子装置をプログラムする方法。
8. 前記一般動作処理回路は、ＲＡＭとプログラマブルメモリとを個別的にアクセスして前記電子装置の一般的な動作を提供することを特徴とする請求項６に記載の電子装置をプログラムする方法。
9. 前記プログラマブルメモリに前記プログラムデータを伝送する間、前記一般動作処理回路が前記プログラマブルメモリをアクセスすることを防止する段階をさらに含むことを特徴とする請求項１に記載の電子装置をプログラムする方法。
10. 前記プログラマブルメモリに前記プログラムデータの前記伝送が完了したことを表す指示を前記電子装置の外部に伝送する段階をさらに含むことを特徴とする請求項１に記載の電子装置をプログラムする方法。
11. 前記プログラマブルメモリに伝送された前記プログラムデータをアクセスするように前記一般動作処理回路をイネーブルさせるために前記コントローラ回路にリセット信号を伝送する段階をさらに含むことを特徴とする請求項１０に記載の電子装置をプログラムする方法。
12. 前記プログラマブルメモリに伝送された前記プログラムデータをアクセスするように前記一般動作処理回路をイネーブルさせる前記コントローラ回路をリセットさせるために前記コントローラ回路に供給される電源を再循環させる段階をさらに含むことを特徴とする請求項１０に記載の電子装置をプログラムする方法。
13. 電子装置の一般的な動作を制御するのに使われる前記電子装置の一般動作処理回路が前記電子装置のプログラマブルメモリをアクセスすることを防止する段階と、
    前記電子装置の外部から前記一般動作処理回路から分離できる前記電子装置のコントローラ回路にプログラムデータを伝送する段階と、
    前記コントローラ回路で前記プログラマブルメモリに前記プログラムデータをプログラムする段階と、を含み、
    前記プログラマブルメモリをアクセスすることを防止する段階は、前記プログラマブルメモリに前記プログラムデータをプログラムする間、前記コントローラ回路によって前記一般動作処理回路をディスエーブルさせる段階と、を含み、
    前記プログラムデータをプログラムする段階は、
    前記プログラムデータに含まれるアドレスとデータ値を前記電子装置内で前記プログラマブルメモリに連結されるバッファ回路に伝達する段階と、
    前記プログラムデータに含まれるコマンドを前記電子装置内で前記プログラマブルメモリのプログラミングを制御するプログラマブルメモリコントローラに伝送する段階と、
    前記バッファに貯蔵されたデータ及びアドレスと前記プログラマブルメモリコントローラから発生する制御信号を前記プログラマブルメモリに提供する段階と、を含むことを特徴とする電子装置をプログラムする方法。
14. 前記プログラムデータのプログラムが完了したことを表す指示を前記電子装置の外部に伝送する段階をさらに含むことを特徴とする請求項１３に記載の電子装置をプログラムする方法。
15. 前記電子装置の一般的な動作を提供するために、前記プログラマブルメモリにプログラムされた前記プログラムデータをアクセスするように前記一般動作処理回路をイネーブルさせる前記コントローラ回路にリセット信号を伝送する段階をさらに含むことを特徴とする請求項１４に記載の電子装置をプログラムする方法。
16. 前記電子装置の一般的な動作を提供するために、前記プログラマブルメモリにプログラムされた前記プログラムデータをアクセスするように前記一般動作処理回路をイネーブルさせる前記コントローラ回路をリセットさせるために前記コントローラ回路に電源を再循環させる段階をさらに含むことを特徴とする請求項１４に記載の電子装置をプログラムする方法。
17. 電子装置の外部から前記電子装置のプログラマブルメモリにプログラムデータを伝送するように形成されるコントローラ回路を備え、前記コントローラ回路は、前記プログラマブルメモリに前記プログラムデータを伝送する段階以後に前記電子装置の一般的な動作を提供するのに使われる一般動作処理回路から分離でき、
    前記コントローラ回路は、
    インターフェースに連結され、前記インターフェースを通じて前記電子装置の外部で受信されるプログラムデータをデコーディングしてアドレス、データ値、及びコマンドを出力するデコーダ回路と、
    前記デコーダ回路から前記アドレス及びデータ値を受信して貯蔵し、貯蔵されたアドレス及びデータ値を前記プログラマブルメモリに提供するバッファ回路と、
    前記デコーダ回路から前記コマンドを受信して制御信号を発生し、前記制御信号を前記プログラマブルメモリに提供するプログラマブルメモリコントローラを含み、
    前記プログラマブルメモリに前記プログラムデータの伝送が行われる間、前記デコーダ回路は前記一般動作処理回路をディスエーブルさせ、前記一般動作処理回路が前記プログラマブルメモリをアクセスすることを防止することを特徴とする電子装置をプログラムする回路。

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