JP4593575B2 - 埋め込み型コンピュータシステムの各構成部材のための共通化インターフェース - Google Patents
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Description
本発明は、一般的には、コンピュータシステムに関し、特に、コンピュータシステムの各構成部材を接続するための改良されたシステムおよび方法に関するものである。
携帯電話、PDA、携帯型音楽プレイヤー、携帯型の電子機器などの、現代の数多くの電子デバイスは、通常、埋め込み型コンピュータシステムが組み入れられている。埋め込み型コンピュータシステムは、通常、コンピュータプロセッサ(以降、ホストとして記述)、非揮発性メモリ(NANDフラッシュメモリおよび/またはROMメモリといった))、ダイナミックランダムアクセスメモリ(DRAM)といった揮発性メモリを含んでいる。上記ホストは、中央処理ユニット(CPU)、デジタルシグナルプロセッサ(DSP)、マイクロ制御ユニット(MCU)、または、ダイレクトメモリアクセス(DMA)といったデータ伝送デバイスを含んでもよい。
本発明の各実施形態は、共通化インターフェースを介して、非揮発性メモリコントローラ、および揮発性メモリをアクセスするための方法および装置を提供する。一実施形態では、本発明の方法は、共通化インターフェースの共通化された各制御信号を介して、非揮発性メモリコントローラ、および揮発性メモリの一方を選択することを含み、上記共通化された各制御信号は、非揮発性メモリコントローラ、および揮発性メモリに対して出力される。本発明の方法は、また、上記共通化された各制御信号を介して、選択された非揮発性メモリコントローラ、および揮発性メモリの一方に対して、各コマンドを共通化インターフェースを介して出力することを含む。
本発明の上述した各特徴は、上述した要旨によって簡潔に理解され、また、本各実施形態や、添付された各図面の図示により参照されてもよい本発明の詳細な説明によってより詳細に理解されるであろう。しかし、添付した各図面は、本発明の典型的な各実施形態を図示するためだけのものであり、よって、本発明の権利範囲を限定するものではない。これにより、本発明は、同等な効果を発揮できる他の各実施形態も受け入れることが可能なものである。
本発明の各実施形態は、一般的には、共通化インターフェースを介して、非揮発性メモリコントローラ、および揮発性メモリをアクセスするための方法および装置を提供する。一実施形態では、本発明の方法は、共通化インターフェースの共通化された各制御信号を介して、非揮発性メモリコントローラ、および揮発性メモリの一方を選択することを含み、上記共通化された各制御信号は、非揮発性メモリコントローラ、および揮発性メモリに対してそれぞれ出力される。
図1は、本発明の一実施形態に係る、模範的なコンピュータシステム100を示すブロック図である。図示されているように、上記コンピュータシステム100は、ホスト102、揮発性メモリ104(例えば、DRAM、SDRAM、DDR−SDRAM、LP−SDRAM、および/または他の何れかのタイプの揮発性メモリ)、非揮発性メモリコントローラ106、および非揮発性メモリ108(例えば、ROM、PROM、EE−ROM、NANDフラッシュメモリ、NANフラッシュメモリ、および/または他の何れかのタイプの非揮発性メモリ)を含むことができる。
本発明の一実施形態では、共通化インターフェース140は、複数の各モードの内の一つにてメモリアクセスを実行するために利用されてもよい。各図2A〜2Cは、本発明の一実施形態に係る上記コンピュータシステム100の動作の各モードをそれぞれ図示するものである。
図3は、本発明の一実施形態に係る、埋め込み型のコンピュータシステム100のための共通化インターフェース140を示すブロック図である。図示されているように、上記共通化インターフェース140は、共通化されたアドレスおよび制御のライン112、並びにシンクロナスシリアルコネクション110のための各コネクションを含むことができる。図示されているように、上記共通化インターフェース140は、ホスト102または、非揮発性メモリコントローラ106に対して接続されてもよい。
本発明の一実施形態では、ホスト102、および非揮発性メモリコントローラ106は、上記共通化インターフェース140のCS#、CE#、およびMA#の各信号を用いて、上記共通化インターフェース140のマスターを選択し、かつ上記共通化インターフェース140を介して制御されるチップが何れであるかを選択するようになっている。
本発明の一実施形態によれば、共通化インターフェース140は、例えば、非揮発性メモリ108から揮発性メモリ104への、DMAトランスファを実行するために利用される。また、場合によっては、DMAトランスファは、揮発性メモリ104から、後述するように、非揮発性メモリコントローラ106内のバッファへと実行されてもよい。
本発明の一実施形態では、共通化インターフェース140は、揮発性メモリ104に対し、複数の各アクセスを、互いに同時に実行するために利用されるようになっていてもよい。揮発性メモリ104に対する複数の各アクセスが同時に可能となることによって、揮発性メモリ104の利用効率、メモリの実効性能(例えば、揮発性メモリ104から、または揮発性メモリ104へのデータの読み出しや書き込みの速度)を向上できる。
Claims (19)
- 共通化インターフェースを介して、非揮発性メモリコントローラ、および揮発性メモリをアクセスするための方法であって、
上記非揮発性メモリコントローラ、および上記揮発性メモリに対して出力される上記共通化インターフェースの共通化された各制御信号を介して、上記非揮発性メモリコントローラ、および上記揮発性メモリの一方を選択し、
上記共通化された各制御信号を介して、上記非揮発性メモリコントローラ、および上記揮発性メモリの選択された一方に対して、各コマンドを共通化インターフェースを介して出力し、
上記非揮発性メモリコントローラの非揮発性メモリと上記揮発性メモリとの間でのデータのトランスファの実行要求を受け取ると、ホストプロセッサが上記共通化インターフェースを使用しているか否かがチェックされ、上記ホストプロセッサが上記共通化インターフェースを使用していないとき、上記非揮発性メモリコントローラにより上げられるマスター信号を検出することを含み、
上記マスター信号が、上記非揮発性メモリコントローラについて上記共通化インターフェースのマスターとして機能していることを示している間、上記非揮発性メモリコントローラは、非揮発性メモリと上記揮発性メモリとの間にてデータをトランスファすることを含む方法。 - さらに、上記非揮発性メモリコントローラ、および上記揮発性メモリの選択された一方からデータを受け取ることを含む、請求項1に記載の方法。
- 上記非揮発性メモリコントローラを選択し、
上記各コマンドを上記共通化インターフェースを介して上記非揮発性メモリコントローラに出力し、
上記データを上記非揮発性メモリコントローラのアシンクロナスポートを介して受け取る、請求項2に記載の方法。 - 上記揮発性メモリを選択し、
上記各コマンドを上記共通化インターフェースを介して上記揮発性メモリに出力し、
上記データを上記揮発性メモリのシンクロナスポートを介して受け取る、請求項2に記載の方法。 - 非揮発性メモリコントローラを介して非揮発性メモリをアクセスするための方法であって、
非揮発性メモリインターフェースを介して非揮発性メモリに対してアクセスコマンドを出力し、
上記非揮発性メモリインターフェースを介してデータを受け取り、
共通化インターフェースの共通化された各制御信号を用いて上記受け取ったデータをトランスファすることを含み、
上記共通化された各制御信号は、ホストプロセッサおよび揮発性メモリに出力され、
上記受け取ったデータは、上記ホストプロセッサおよび上記揮発性メモリの一方にトランスファされ、
さらに、上記受け取ったデータをトランスファする前に、上記非揮発性メモリコントローラの非揮発性メモリと上記揮発性メモリとの間でのデータのトランスファの実行要求を受け取ると、ホストプロセッサが上記共通化インターフェースを使用しているか否かがチェックされ、上記ホストプロセッサが上記共通化インターフェースを使用していないとき、上記共通化インターフェースの、上記共通化された各制御信号において、マスター信号を上げることを含み、
上記マスター信号は、上記非揮発性メモリコントローラが、上記共通化インターフェースのマスターとして機能していることを示すものである、方法。 - さらに、共通化インターフェースの共通化された各制御信号を介して受け取った選択信号を検出し、
上記選択信号に対応して、共通化インターフェースの共通化された各制御信号を介して第1コマンドを受け取ることを含み、
上記アクセスコマンドは、上記第1コマンドに対応して出力される、請求項5に記載の方法。 - 上記第1コマンドは、ホストプロセッサにより出力され、
上記受け取ったデータは、上記第1コマンドに対応して上記ホストプロセッサにトランスファされる、請求項6に記載の方法。 - 上記受け取ったデータは、上記揮発性メモリのアシンクロナスポートを介して上記揮発性メモリにトランスファされる、請求項5に記載の方法。
- 上記トランスファは、上記ホストプロセッサからの第1コマンドに対応して実行されるダイレクトメモリアクセス(DMA)トランスファである、請求項5に記載の方法。
- 揮発性メモリと、
非揮発性メモリと、
非揮発性メモリインターフェースを介して上記非揮発性メモリをアクセスするように設定された非揮発性メモリコントローラと、
共通化された各制御信号を有する共通化インターフェースと、
ホストプロセッサとを含み、
上記共通化された各制御信号は、上記共通化インターフェースを介して、上記非揮発性メモリコントローラおよび上記揮発性メモリによって受け取られ、
上記ホストプロセッサは、
上記非揮発性メモリコントローラおよび上記揮発性メモリの一方を選択し、
上記共通化インターフェースの上記共通化された各制御信号を介して、アクセスコマンドを、上記非揮発性メモリコントローラおよび上記揮発性メモリの選択された一方に出力することが設定され、
上記非揮発性メモリコントローラは、さらに、
上記非揮発性メモリコントローラが上記ホストプロセッサにより選択されたか否かを決定し、
もし、選択されている場合、上記共通化インターフェースの上記共通化された各制御信号を介して、各アクセスコマンドを受け取り、
上記各アクセスコマンドの受け取りに対応して、上記非揮発性メモリコントローラ内のデータをアクセスするように設定され、
上記非揮発性メモリコントローラは、さらに、上記各アクセスコマンドの受け取りに対応して、上記ホストプロセッサが上記共通化インターフェースを使用しているか否かがチェックされ、上記ホストプロセッサが上記共通化インターフェースを使用していないとき、上記非揮発性メモリコントローラが、上記共通化インターフェースのマスターであることを示すマスター信号を上げ、
上記非揮発性メモリから上記揮発性メモリのアシンクロナスポートを介して上記揮発性メモリへの、上記アクセスされたデータのDMAトランスファを実行するように設定されている、システム。 - 上記揮発性メモリは、
上記揮発性メモリが上記ホストプロセッサにより選択されたか否かを決定し、
もし、選択されている場合、上記共通化インターフェースの上記共通化された各制御信号を介して、各アクセスコマンドを受け取り、
シンクロナスポートを介して上記ホストプロセッサに対し、データをトランスファするように設定されている、請求項10に記載のシステム。 - 上記非揮発性メモリコントローラは、さらに、
上記アクセスされたデータを、上記ホストプロセッサに対して、上記ホストプロセッサのアシンクロナスポートを介してトランスファするように設定されている、請求項11に記載のシステム。 - 非揮発性メモリインターフェースと、
非揮発性メモリおよび揮発性メモリに対し、ホストプロセッサにより出力される共通化された各制御信号を受け取るための共通化インターフェースと、
回路とを含む非揮発性メモリコントローラであって、
上記回路は、
上記共通化された各制御信号が、上記非揮発性メモリコントローラを上記共通化インターフェースを介して選択したことを示すか否かを決定し、
もし、選択しているとき、上記共通化インターフェースの共通化された各制御信号を介して各アクセスコマンドを受け取り、
上記各アクセスコマンドの受け取りに対応して、上記非揮発性メモリインターフェースを介して、非揮発性メモリに対して各アクセスコマンドを出力し、
上記非揮発性メモリインターフェースを介して上記非揮発性メモリから要求されたデータを受け取るように設定され、
上記回路は、さらに、
上記非揮発性メモリコントローラの非揮発性メモリと上記揮発性メモリとの間でのデータのトランスファの実行要求を受け取ると、上記要求されたデータを上記揮発性メモリに対しトランスファする前に、上記ホストプロセッサが上記共通化インターフェースを使用しているか否かをチェックし、上記ホストプロセッサが上記共通化インターフェースを使用していないとき、上記共通化インターフェースの、上記共通化された各制御信号において、マスター信号を上げ、
上記マスター信号は、上記非揮発性メモリコントローラが、上記共通化インターフェースのマスターであることを示すものであるように設定されている非揮発性メモリコントローラ。 - 上記回路は、さらに、
上記共通化インターフェースを介して、上記要求されたデータを上記ホストプロセッサに対しトランスファするように設定されている、請求項13に記載の非揮発性メモリコントローラ。 - 上記回路は、さらに、
上記揮発性メモリのアシンクロナスポートを介して上記揮発性メモリに対して上記要求されたデータをトランスファするように設定されている、請求項14に記載の非揮発性メモリコントローラ。 - 記憶するための揮発性手段と、
記憶するための非揮発性手段と、
上記非揮発性手段のためのメモリインターフェースを介して、上記記憶するための非揮発性手段をアクセスするように構成された制御するための手段と、
共通化された各制御信号を有するインターフェースのための共通化手段と、
処理のための手段とを含み、
上記共通化された各制御信号は、上記インターフェースのための共通化手段を介して、上記制御するための手段、および上記記憶するための揮発性手段により受け取られるものであり、
上記処理のための手段は、
上記制御するための手段、および上記記憶するための揮発性手段の一方を選択し、
上記インターフェースのための共通化手段の上記共通化された各制御信号を介して、各アクセスコマンドを、上記制御するための手段、および上記記憶するための揮発性手段の選択された一方に出力するように設定され、
上記制御するための手段は、さらに、上記各アクセスコマンドの受け取りに対応して、上記処理のための手段が上記インターフェースのための共通化手段を使用しているか否かをチェックし、上記処理のための手段が上記インターフェースのための共通化手段を使用していないとき、
上記制御するための手段が、上記インターフェースのための共通化手段のマスターであることを示すマスター信号を上げ、
上記記憶するための揮発性手段のトランスファするためのアシンクロナス手段を介して、上記アクセスされたデータを、上記記憶するための非揮発性手段から上記記憶するための揮発性手段に対するDMAトランスファを実行するように設定されているシステム。 - 上記記憶するための揮発性手段は、
上記記憶するための揮発性手段が、上記処理のための手段により選択されているか否かを決定し、
もし、選択されているとき、上記インターフェースのための共通化手段の上記共通化された各制御信号を介して各アクセスコマンドを受け取り、
上記処理するための手段に対し、トランスファのためのシンクロナス手段を介してデータをトランスファするように設定されている、請求項16に記載のシステム。 - 上記制御するための手段は、さらに、
上記制御するための手段が、上記処理するための手段により選択されているか否かを決定し、
もし、選択されているとき、上記インターフェースのための共通化手段の上記共通化された各制御信号を介して各アクセスコマンドを受け取り、
上記各アクセスコマンドを受け取りに対応して、上記記憶するための非揮発性手段内のデータをアクセスするように設定されている、請求項16に記載のシステム。 - 上記制御するための手段は、さらに、
上記処理するための手段のトランスファのアシンクロナス手段を介して、上記アクセスされたデータを、上記処理のための手段に対しトランスファするように設定されている、請求項18に記載のシステム。
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