JP4571492B2 - 光センサを備えた表示回路 - Google Patents
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Description
光センサ115nmの出力にそれぞれ対応し、光学フレーム走査から得られるデジタル値Dnmは、プログラムされたコンピュータにより(あるいは専用プログラムが施されたマイクロプロセッサすなわちASIC)により処理されて、ユーザが入出力マトリクス102の近くに指をもっていくことにより入力が行われたかどうかの判定が行われる。デジタル値Dnmが処理され、平均値Dが算出される。
光センサ115nmの出力にそれぞれ対応し、光学フレーム走査から得られるデジタル値Dnmは、プログラムされたコンピュータ(または専用プログラムが施されたマイクロプロセッサすなわちASIC)により処理されて、ユーザは入出力マトリクス102の正面で身振りを行うことにより入力が行われたかどうかの判定が行われる。入出力マトリクス102の正面での身振りによって、明るい環境ではセンサマトリクス上にシャドウパターンが作成され、あるいは暗い環境では、表示マトリクスにより照射された手から生じる反射光の空間分布が作成される。このシャドウパターンは"タッチ入力"に対して上述のように検出される。上記シャドウパターン内の時間分散値は入力された身振りとして画像認識エンジンにより特定される。
光センサ115nmの出力にそれぞれ対応し、光学フレーム走査から得られるデジタル値Dnmが処理されて、平均値Dが算出される。照明が強いとき、照射された透過型表示または放射型表示が低コントラストで現れることはよく知られていることである。一般に、この低コントラストは、補正の必要がない表示領域内でも表示輝度全体のブーストを行うことにより補正される。この結果、消費電力が不必要に高くなり、耐用期間が不必要に短くなる。この実施形態によれば、Dnm>Dの場合、画素回路15ab内の画素の輝度は上昇する。
Claims (28)
- 基板と、
複数の行と複数の列とを有するマトリクス表示装置を構成するように前記基板上に集積された、複数の画素回路からなる画素回路複合体と、
複数の行と複数の列とを有するセンサマトリクスを構成するように前記基板上に集積された、複数のセンサからなるセンサ複合体と、
前記基板上に集積された複数の第1導電線であって、該複数の第1導電線に属する個々の導電線が、それぞれ、
・ 前記マトリクス表示装置の異なる行に関連付けられると共に該関連付けられた行の全ての前記画素回路と接続するように、且つ、
・ 前記センサマトリクスの異なる行に関連付けられると共に該関連付けられた行の全ての前記センサと接続するように配される、
前記複数の第1導電線と、
前記基板上に集積された複数の第2導電線であって、前記複数の第2導電線に属する個々の導電線が、それぞれ前記マトリクス表示装置の異なる列に関連付けられると共に該関連付けられた列の全ての前記画素回路と接続するように配された、前記複数の第2導電線と、
前記基板上に集積された、前記複数の第2導電線とは異なる複数の第3導電線であって、前記複数の第3導電線に属する個々の導電線が、それぞれ前記センサマトリクスの異なる列に関連付けられると共に該関連付けられた列の全ての前記センサと接続するように配された前記複数の第3導電線と、
を備え、前記複数の第1導電線のうちの1つにおける第1の電圧が、該1つの第1導電線に関連する前記画素回路を選択的に動作可能にするが該1つの第1導電線に関連する前記センサに対してはそのように作用せず、前記複数の第1導電線のうちの1つにおける第2の電圧が、該1つの第1導電線に関連する前記センサを選択的に動作可能にするが該1つの第1導電線に関連する前記画素回路に対してはそのように作用しないように構成される、集積回路。 - 前記複数の第1の導電線には行選択ラインが含まれ、
前記複数の第2の導電線にはデータラインが含まれ、
前記複数の第3の導電線には列選択ラインが含まれる、
請求項1に記載の集積回路。 - 前記複数の画素回路は、各々、ゲート電極を有するスイッチングトランジスタを有し、
前記複数のセンサは、各々、ゲート電極を有するフォトトランジスタを有し、
前記マトリクス表示装置または前記センサマトリクスの行に関連付けられる前記第1導電線は、関連する行における各前記画素回路の前記ゲート電極と、関連する行における各前記センサの前記ゲート電極とに接続される、
請求項1または2に記載の集積回路。 - 前記複数の画素回路は、各々、ソース電極を有するスイッチングトランジスタを有し、
前記複数のセンサは、各々、ソース電極を有するフォトトランジスタを有し、
前記マトリクス表示装置の列に関連付けられる前記第2導電線は、関連する列における各前記画素回路の前記ソース電極に接続され、
前記センサマトリクスの列に関連付けられる前記第3導電線は、関連する列における各前記センサの前記ソース電極に接続される、
請求項1から3のいずれかに記載の集積回路。 - 前記複数の画素回路は、各々、ドレイン電極を有するスイッチングトランジスタを有し、
前記複数のセンサは、各々、ドレイン電極を有するフォトトランジスタを有し、
各前記画素回路の前記ドレイン電極は、液晶素子に接続され、
前記複数の第2の導電線は、それぞれ、前記センサマトリクスの異なる列に関連付けられると共に、該関連付けられた列の各前記センサの前記ドレイン電極に接続されるように配される、
請求項1から4のいずれかに記載の集積回路。 - 前記複数の第2導電線が、それぞれ、前記センサマトリクスの異なる列に関連付けられると共に、該関連付けられた列の全ての前記センサと接続するように配される、請求項1から5のいずれかに記載の集積回路。
- 前記マトリクス表示装置がアクティブマトリクス表示装置であり、個々の画素回路がスイッチングトランジスタを備えた請求項1乃至6のいずれか1項に記載の集積回路。
- 前記スイッチングトランジスタの各々が薄膜トランジスタである請求項7に記載の集積回路。
- 前記薄膜トランジスタの各々が水素添加アモルファスシリコンを含む請求項8に記載の集積回路。
- 個々のセンサがフォトトランジスタを備えた請求項1乃至9のいずれか1項に記載の集積回路。
- 個々のフォトトランジスタが薄膜トランジスタである請求項10に記載の集積回路。
- 前記薄膜トランジスタの各々が水素添加アモルファスシリコンを含む請求項9乃至11のいずれか1つの請求項に記載の集積回路。
- 前記マトリクス表示装置がアクティブマトリクス表示装置であり、個々の画素回路がスイッチングトランジスタを備え、さらに、個々のセンサがフォトトランジスタを備え、さらに、前記スイッチングトランジスタとフォトトランジスタとは、前記スイッチングトランジスタの各々が光ブロッキング層をさらに有するという点を除いて、実質的に同一の設計である請求項1乃至12のいずれか1項に記載の集積回路。
- 前記スイッチングトランジスタとフォトトランジスタとが薄膜トランジスタである請求項13に記載の集積回路。
- 前記スイッチングトランジスタとフォトトランジスタとが水素添加アモルファスシリコンを含む請求項14に記載の集積回路。
- 前記マトリクス表示装置がアクティブマトリクス表示装置であり、個々の画素回路がスイッチングトランジスタを備え、個々のセンサがフォトトランジスタを備え、さらに、前記スイッチングトランジスタと前記フォトトランジスタとがゲート電極を有すると共に対を成して配され、個々の対を成す前記スイッチングトランジスタとフォトトランジスタとの前記ゲート電極用として共通の電極が用いられる請求項1乃至13のいずれか1項に記載の集積回路。
- 前記センサと前記画素回路とが対を成し、個々の対がセンサと、隣接する画素とを含む請求項1乃至16のいずれか1項に記載の集積回路。
- 前記センサ複合体の方が前記画素回路複合体よりも数が少ない請求項1乃至17のいずれか1項に記載の集積回路。
- マトリクス表示装置として作動する表示モードと、光入力を受け取る検知モードとを備えた組合せ入出力装置であって、
請求項1から18のいずれか1項に記載の集積回路と、
前記複数の第1導電線に対して少なくとも3つの異なる制御信号のうちのいずれかの制御信号を印加する制御回路と、を備え、
前記第1導電線に印加される第1の制御信号は前記センサを作動不能にすると共に前記画素回路を作動可能にし、前記第1導電線に印加される第2の制御信号は前記センサを作動不能にすると共に前記画素回路も作動不能にし、前記第1導電線に印加される第3の制御信号は前記センサを作動可能にすると共に前記画素回路を作動不能にし、
前記検知モードと前記表示モードは時間的にオーバーラップしないように構成される、
組合せ入出力装置。 - 表示モード中、前記制御回路が前記複数の第1導電線に属する1本の導電線に対して第1の制御信号を印加すると共に前記複数の第1導電線のその他の導電線に対しては第2の制御信号を印加する請求項19に記載の組合せ入出力装置。
- 検知モード中、前記制御回路が前記複数の第1導電線に属する1本の導電線に対して第3の制御信号を印加すると共に前記複数の第1導電線のその他の導電線に対しては第4の制御信号を印加する請求項19または20に記載の組合せ入出力装置。
- 前記第2の制御信号と前記第4の制御信号とが同じ信号である請求項21に記載の組合せ入出力装置。
- 前記制御回路が、前記表示モード中に前記複数の第2導電線から入力信号を出力し、前記検知モード中に出力信号を受け取るように配された請求項19から22のいずれか1項に記載の組合せ入出力装置。
- 前記検知モード中、前記制御回路が前記複数の第3導電線に属する個々の導電線から入力信号を供給するように配された請求項19から23のいずれか1項に記載の組合せ入出力装置。
- 前記検知モード中は前記センサ複合体の各々によって出力信号が供給され、前記表示モード中は前記画素回路複合体の各々へ入力信号が供給され、
さらに、前記検知モードの前記出力信号に応動して、前記表示モードにおいて前記画素回路複合体の各々へ供給される前記入力信号を調節する手段をさらに備える、
請求項19乃至24のいずれか1項に記載の組合せ入出力装置。 - 請求項1乃至18のいずれか1項に記載の集積回路又は請求項19乃至25のいずれか1項に記載の組合せ入出力装置を備えたタッチスクリーン装置。
- 様々な入力としてユーザにより行われる様々な身振りを識別するためのヒューマン・マシーンインタフェース装置であって、請求項1乃至18のいずれか1項に記載の集積回路又は請求項19乃至25のいずれか1項に記載の組合せ入出力装置を備えたヒューマン・マシーンインタフェース装置。
- 請求項1から18のいずれか1項に記載の集積回路について、
画素回路を有効にすると共にセンサを無効にする第1の電圧を、前記画素回路と前記センサに共通の前記第1導電線に印加することと;
前記画素回路を無効にすると共に前記センサを有効にする第2の電圧を、前記画素回路と前記センサに共通の前記第2導電線に印加することと;
を含む、方法。
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