JP4568440B2 - フリップチップ型半導体素子および半導体装置 - Google Patents
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Description
【発明の属する技術分野】
本発明はフリップチップ型半導体素子に関し、詳しくは、フェースダウンボンディング法により基板に実装して、優れた耐熱衝撃性を有する半導体装置を作成できるフリップチップ型半導体素子に関する。
【0002】
【従来の技術】
フリップチップ型半導体素子表面のボンディングパッド上に形成されたハンダバンプにより、前記半導体素子を基板にフェースダウンボンディングして作成された半導体装置は、前記半導体素子の大型化に伴い、ヒートサイクルテストやヒートショックテスト等の信頼性試験において、ハンダクラック、ハンダバンプのルーズコンタクト、および接続抵抗の増加(導通不良)が生じるという問題があった。
【0003】
このため、半導体素子表面のボンディングパッドと基板の回路配線を導電性シリコーンゴムによりフェースダウンボンディングした半導体装置が特開平1−232735号公報、および特開平4−91448号公報等により提案されているが、このような半導体装置は接続信頼性が十分でないという問題があった。
【0004】
【発明が解決しようとする課題】
本発明者らは、上記の課題を解決するために鋭意研究した結果、本発明に到達した。
すなわち、本発明の目的は、フェースダウンボンディング法により基板に実装して、優れた耐熱衝撃性を有する半導体装置を作成できるフリップチップ型半導体素子を提供することにある。
【0005】
【課題を解決するための手段】
本発明のフリップチップ型半導体素子は、半導体チップ表面のボンディングパッドに、該チップを基板にフェースダウンボンディングするための導体が導電性エラストマーにより接着されていることを特徴とする。
【0006】
【発明の実施の形態】
本発明のフリップチップ型半導体素子を図面により詳細に説明する。
図1は本発明の一実施例である半導体素子の断面図を示す。また、図2は本発明の別の一実施例である半導体素子の断面図を示す。さらに、図3は本発明の一実施例である半導体素子の斜視図を示す。
【0007】
図1において、本発明のフリップチップ型半導体素子は、基板にフェースダウンボンディングして半導体装置を作成するためのものであり、半導体チップ1の表面電極であるボンディングパッド2上に導電性エラストマー3により導体4が接着されていることを特徴とする。この半導体チップ1は、シリコン、ガリウム砒素、硫化カドミウム等の材質からなるものであり、一般にはシリコンからなるものである。
【0008】
この半導体チップ1表面には、一般にパッシベーション膜が形成されており、また、ボンディングパッド(あるいはランド)2と呼ばれる表面電極が形成されている。このボンディングパッド2は、アルミニウム製ボンディングパッド、金製バンプ等からなるものである。このボンディングパッド2は、例えば、半導体チップの表面にアルミニウムを蒸着した後、エッチングすることにより形成することができる。
【0009】
このボンディングパッド2には、本発明の半導体素子を基板にフェースダウンボンディングするための導体4(あるいは接続電極)が導電性エラストマー3により接着されている。この導体4は、金、銅、ニッケル、アルミニウム、ハンダ等の材質からなるものである。また、この導体4の形状は限定されず、図1においては円柱状であり、図2においては端部に円板を有する円柱状であるが、その他、角柱状、紡錘形柱状、らせん状、球状が例示される。この導体4としては、直径が10〜500μmである金属線が好ましく、さらには、直径が20〜200μmである金属線が好ましい。特に、この金属線としてはニッケル被覆銅線が好ましい。この導体4は、例えば、図2で示されるようにボンディングパッド2に直接接していてもよく、また、図1で示されるように導電性エラストマー3を介してボンディングパッド2に接していてもよい。
【0010】
半導体チップ1表面のボンディングパッド2と導体4を接着する導電性エラストマー3は特に限定されず、導電性シリコーンエラストマー、導電性エポキシ樹脂エラストマーが例示され、特に導電性シリコーンエラストマーであることが好ましい。この導電性エラストマーとしては、導電性ゴム、導電性ゲルが例示され、これらの体積固有抵抗率は1×102Ω・cm以下であることが好ましく、特に、1×10-2Ω・cm以下であることが好ましい。この導電性エラストマーの25℃におけるヤング率は1000kgf/cm2以下であることが好ましく、特に、400kgf/cm2以下であることが好ましい。このような導電性エラストマーによれば、ボンディングパッドや導体への応力集中を緩和し、かつ低接続抵抗値を維持することができる。特に、この導電性エラストマーは、銀粉、金粉等の導電性フィラーを含有する自己接着性の付加反応硬化型導電性シリコーンエラストマー組成物の硬化物であることが好ましい。このような導電性シリコーンエラストマー組成物として、東レ・ダウコーニング・シリコーン株式会社製のDA6524を用いることができる。
【0011】
図4において、本発明のフリップチップ型半導体素子を基板にフェースダウンボンディングして実装した半導体装置の断面図を示した。図4において、半導体チップ1は、その表面のボンディングパッド2に導電性エラストマー3により接着した導体4を介して基板5上に形成された回路配線6の電極に電気的に接続されている。この基板5としては、ガラス基板、セラミック基板、金属複合基板、プラスチック基板が例示される。また、この基板5上に形成された回路配線6の電極と前記半導体チップ1の導体4を電気的に接続するために、図4においては導電性エラストマー7が用いられているが、ハンダを用いてもよい。回路配線の電極や導体への応力集中を緩和し、かつ低接続抵抗値を維持することができることから、導電性エラストマーを用いることが好ましい。この導電性エラストマーとしては前記と同様のものが例示され、特に、導電性シリコーンエラストマーが好ましい。
【0012】
さらに、本発明のフリップチップ型半導体素子が実装された半導体装置において、前記の半導体素子を外的応力から保護して、信頼性試験において低接続抵抗を長期間維持するために、前記半導体素子を封止樹脂により封止することが好ましい。この封止樹脂としては、エポキシ樹脂、フェノール樹脂、シリコーン樹脂、シリコーンエラストマー、ポリイミド樹脂が例示され、好ましくはシリコーン樹脂またはシリコーンエラストマーであり、特に好ましくはシリコーンエラストマーである。このシリコーンエラストマーとしては、シリコーンゴム、シリコーンゲルが例示され、特に、高純度で、自己接着性の付加反応硬化型シリコーンエラストマー組成物を硬化したものが好ましい。
【0013】
本発明のフリップチップ型半導体素子が実装された半導体装置としては、動作原理の点からバイポーラ、MOS、HEMT等が挙げられ、機能の点からロジックIC、メモリIC等が挙げられ、集積度の点から集積回路(IC)、混成IC、個別半導体(例えば、トランジスター、サイリスター)等が挙げられる。
【0014】
【実施例】
本発明のフリップチップ型半導体素子を実施例により詳細に説明する。
【0015】
[実施例1]
チップサイズが14mm×10mmであるシリコンチップ表面に形成したアルミニウム製ボンディングパッド上に銀粉末を含有する付加反応硬化型導電性シリコーンゴム組成物(東レ・ダウコーニングシリコーン株式会社製のDA6524:硬化して得られるシリコーンゴムの体積固有抵抗率は1×10-4Ω・cmであり、ヤング率は100kgf/cm2である。)を塗布した後、直径が80μmであり、長さが4mmであるニッケルメッキ銅線を突き立て、150℃で1時間加熱することにより前記組成物を硬化させて、前記パッドとニッケルメッキ銅線を導電性シリコーンゴムにより接着した、図1で示されるフリップチップ型シリコン素子を作成した。
【0016】
次に、基板上に形成された回路配線の電極に上記と同じ付加反応硬化型導電性シリコーンゴム組成物を塗布した後、上記シリコン素子に接着されたニッケルメッキ銅線を突き立て、150℃で1時間加熱することにより前記組成物を硬化させて、上記のシリコン素子をフェースダウンボンディング法により実装した、図4で示される半導体装置を作成した。
【0017】
上記と同様にして作成した半導体装置30個を、−65℃で30分間、+150℃で30分間を1サイクルとするヒートサイクル試験した。このようにして半導体装置の半数に異常が発生するまでのサイクル数により半導体装置の耐熱衝撃性を評価した。この評価結果を表1に示した。
【0018】
[比較例1]
チップサイズが14mm×10mmであるシリコンチップ表面に形成したアルミニウム製ボンディングパッド上にハンダボールを形成してフリップチップ型シリコン素子を作成した。
【0019】
次に、上記で作成したシリコン素子を回路基板上に置き、ハンダリフローして前記回路基板上の電極に上記のシリコン素子をフェースダウンボンディング法により実装した半導体装置を作成した。実施例1と同様にして、この半導体装置の耐熱衝撃性を評価した。この評価結果を表1に示した。
【0020】
【表1】
【0021】
【発明の効果】
本発明のフリップチップ型半導体素子は、フェースダウンボンディング法により基板に実装して、優れた耐熱衝撃性を有する半導体装置を作成できるという特徴がある。
【図面の簡単な説明】
【図1】本発明の一実施例のフリップチップ型半導体素子の断面図である。
【図2】本発明の別の一実施例のフリップチップ型半導体素子の断面図である。
【図3】本発明の一実施例のフリップチップ型半導体素子の斜視図である。
【図4】本発明の一実施例のフリップチップ型半導体素子を基板に実装した半導体装置の断面図である。
【符号の説明】
1 半導体チップ
2 ボンディングパッド
3 導電性エラストマー
4 導体
5 基板
6 回路配線
7 導電性エラストマー
Claims (4)
- 半導体チップ表面のボンディングパッドに、該チップを基板にフェースダウンボンディングするための導体が導電性エラストマーにより接着されているフリップチップ型半導体素子であって、前記導体が直径10〜500μmの金属線であることを特徴とするフリップチップ型半導体素子。
- 導体がニッケル被覆銅線であることを特徴とする、請求項1記載のフリップチップ型半導体素子。
- 導電性エラストマーが導電性シリコーンエラストマーであることを特徴とする、請求項1記載のフリップチップ型半導体素子。
- 半導体チップ表面のボンディングパッドに、該チップを基板にフェースダウンボンディングするための導体が導電性エラストマーにより接着されているフリップチップ型半導体素子を基板に実装してなる半導体装置であって、前記導体が直径10〜500μmの金属線であり、前記基板上の電極と前記導体が導電性エラストマーにより電気的に接続されていることを特徴とする半導体装置。
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