JP4550641B2 - データ照合装置及び方法 - Google Patents
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なお、上記の各機能は、専用のハードウェアを用いて実現されても良い。
図3は、チェック用PC600が、PLCネットワークL上のPLC300の入出力用メモリ(以下、データメモリという)の内容であるデータメモリ情報(入出力情報)を読み出して、内容を検証する動作を示すフローチャートである。
一方、ステップS16の比較の結果、チェックシートファイル611の入力メモリアドレスのビット値と、中間ファイル502内の対応する入力メモリアドレスのデータ値が一致した場合、比較部652は、チェックシートファイルのイメージ画像503の試験項目番号“001”において出力メモリアドレス“5000”(図4の505a)とそのビット値を読み出す。次いで、中間ファイル502内における対応する出力メモリアドレス“DM5000”のデータ値と比較する(ステップS18)。この時、比較の結果、一致していない場合は、チェックシートファイル611内に、比較失敗を示すフラグを、試験項目番号と出力メモリアドレスに対応付けて書き込む。そして、チェックシートファイル611の試験項目番号“001”において全ての出力メモリアドレス(図4の505b等)のビット値について、中間ファイル502のデータ値との比較を繰り返す。
また、上述の実施形態において、PLC300が有線によってPLCネットワークL及びネットワークNと接続した場合について説明したが、無線通信I/Fを搭載し、アクセスポイント800を介して、無線接続しても良い。
200…ガス漏れ検知器
300…PLC
400…上位監視PC
410…音声合成ユニット
500…接続装置
600…チェック用PC
610…メモリ
611…チェックシートファイル
620…入力部
630…表示部
640…通信I/F
650…制御部
651…中間ファイル生成部
652…比較部
653…チェックシートファイル書き込み部
700…パトライト(登録商標)
800…アクセスポイント
900…監視盤
A…試験対象エリア
N…ネットワーク
L…PLCネットワーク
Claims (3)
- 入出力信号制御装置に対する一つの試験項目の試験が実施されて当該入出力信号制御装置が正常に動作した場合に当該入出力信号制御装置の入力メモリアドレスに書き込まれるビット値、及び、当該入出力信号制御装置の一つまたは複数の出力メモリアドレスに書き込まれるビット値の対応関係を示す期待値情報を、試験項目毎に記憶する期待値情報記憶手段と、
前記入出力信号制御装置に対する一つの試験項目の試験が完了した後に前記入出力信号制御装置が保持するメモリの情報であって、当該入出力信号制御装置が前記試験項目の試験の実施によって入力されたビット値及び出力したビット値が書き込まれたメモリにおけるアドレスとビット値の対応関係を示す入出力情報を前記入出力信号制御装置から受信し、入出力情報記憶手段に格納する受信手段と、
前記入出力情報記憶手段内の入出力情報、及び、前記期待値情報記憶手段内の前記試験を実施した試験項目に関連付けられた期待値情報を読み出し、それら入出力情報と期待値情報とを比較する比較手段と、
前記比較手段による比較の結果、前記期待値情報が示す入力メモリアドレスとビット値との対応関係と、前記入出力情報が示す前記入力メモリアドレスに対応するメモリアドレスとビット値との対応関係とが一致し、かつ、前記期待値情報が示す一つまたは複数の出力メモリアドレスとビット値との対応関係と、前記入出力情報が示す前記出力メモリアドレスに対応するメモリアドレスとビット値との対応関係とが全て一致した場合に合格を示し、一つでも一致しなかったものがある場合に不合格を示す比較結果情報を生成する生成手段と、
前記生成手段が生成した比較結果情報を前記試験項目毎に対応付けて表示する表示手段と、
を具備することを特徴とするデータ照合装置。 - 前記入出力情報記憶手段内の入出力情報を読み出し、前記入出力信号制御装置の識別情報と、前記期待値情報記憶手段内の期待値情報が示す入力メモリアドレス及び出力メモリアドレスと、当該入力メモリアドレス及び出力メモリアドレスに対応する前記入出力情報のビット値と、を格納する中間データを生成する中間データ生成手段を有し、
前記比較手段は、前記中間データ生成手段が生成した中間データを読み出し、前記期待値情報記憶手段内の期待値情報と比較する
ことを特徴とする請求項1に記載のデータ照合装置。 - 受信手段は、入出力信号制御装置に対する一つの試験項目の試験が完了した後に前記入出力信号制御装置が保持するメモリの情報であって、当該入出力信号制御装置が前記試験項目の試験の実施によって入力されたビット値及び出力したビット値が書き込まれたメモリにおけるアドレスとビット値の対応関係を示す入出力情報を前記入出力信号制御装置から受信して入出力情報記憶手段に格納し、
比較手段は、前記入出力情報記憶手段内の入出力情報、及び、前記入出力信号制御装置に対する一つの試験項目の試験が実施されて当該入出力信号制御装置が正常に動作した場合に当該入出力信号制御装置の入力メモリアドレスに書き込まれるビット値、及び、当該入出力信号制御装置の一つまたは複数の出力メモリアドレスに書き込まれるビット値の対応関係を示す期待値情報を、試験項目毎に記憶する期待値情報記憶手段内の前記試験を実施した試験項目に関連付けられた期待値情報を読み出し、それら入出力情報と期待値情報とを比較し、
生成手段は、前記比較手段による比較の結果、前記期待値情報が示す入力メモリアドレスとビット値との対応関係と、前記入出力情報が示す前記入力メモリアドレスに対応するメモリアドレスとビット値との対応関係とが一致し、かつ、前記期待値情報が示す一つまたは複数の出力メモリアドレスとビット値との対応関係と、前記入出力情報が示す前記出力メモリアドレスに対応するメモリアドレスとビット値との対応関係とが全て一致した場合に合格を示し、一つでも一致しなかったものがある場合に不合格を示す比較結果情報を生成し、
表示手段は、前記生成手段が生成した比較結果情報を前記試験項目毎に対応付けて表示する、
ことを特徴とするデータ照合方法。
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