JP4364041B2 - データ転送回路 - Google Patents
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Description
図3(a)〜(c)は、従来の非同期インタフェースの問題点を示す説明図である。
このデータ転送回路は、送信部10及び受信部20と、これらの間を接続するストローブ信号用の転送路3及び複数のデータを並列に転送する転送路4とで構成されている。
ストローブ生成カウンタ11は、設定値value と、書込制御信号weと、送信クロック信号clk1が与えられ、ストローブ信号strobeo を出力するものである。このストローブ生成カウンタ11では、書込制御信号weがアクティブになると、次の送信クロック信号clk1の立上がりのタイミングでストローブ信号strobeo をアクティブにして出力し、送信クロック信号clk1のカウントを開始する。そして、そのカウント値が設定値value に達したときに、ストローブ信号strobeo を非アクティブにするものである。ストローブ信号strobeo は、この送信部10に接続された転送路3に出力されるようになっている。
エッジ検出器21は、ストローブ信号strobei と受信クロック信号clk2が与えられ、確定信号valid を出力するものである。このエッジ検出器21では、転送路3から受信したストローブ信号strobeiが非アクティブになった後の、次の受信クロック信号clk2の立上がりのタイミングで、この受信クロック信号clk2の1周期分のパルス幅を有する確定信号valid を出力するようになっている。
図4(a)は、送信クロック信号clk1の周期が受信クロック信号clk2よりも短い場合の動作を示している。
このデータ転送回路は、図1中の受信部20に代えて、構成の異なる受信部20Aを設けたものである。この図5において、図1中の要素と共通の要素には共通の符号が付されている。
このデータ転送回路の動作は、確定信号valid が“H”の期間でのみ、転送データdatai がレジスタ22へ取込まれて受信データreg2の更新が行われることであり、その他の動作は、図1における動作と同じである。
このデータ転送回路は、nビットのデータを並列に転送するもので、送信側には、各データビットに対応した送信部30i(i=1〜n)と、各データビットに共通の取込指示手段(例えば、ストローブ生成器33)を備え、受信側には、各データビットに対応した受信部40iと、各データビットに共通の確定信号生成手段(例えば、確定信号生成器43)を備えている。
この図8は、2ビットの転送データの遅延時間が異なる場合について説明している。
11 ストローブ生成カウンタ
12,22,23,31,41,42 レジスタ
21 エッジ検出器
24 ゲート
30 送信部
32 トグル検出器
33 ストローブ生成器
40 受信部
43 確定信号生成器
Claims (2)
- 送信側と受信側の間で周波数の異なる送信クロック信号と受信クロックをそれぞれ用いてデータの転送を行うデータ転送回路であって、
送信側は、
書込許可信号が与えられたときに、前記送信クロック信号のタイミングに従って送信データを取込んで転送路に出力する第1のレジスタと、
前記書込許可信号が与えられたときに、ストローブ信号の送信と前記送信クロック信号のカウントを開始し、該送信クロック信号のカウント値が設定値に達したときに該ストローブ信号の送信を停止するストローブ生成部とを備え、
受信側は、
前記ストローブ信号を受信して該ストローブ信号の停止を検出したときに、前記受信クロック信号の1周期分のパルス幅を有する確定信号を出力するエッジ検出部と、
前記確定信号が与えられているときに、前記受信クロック信号を受信タイミング信号として出力するゲートと、
前記ゲートから出力される前記受信タイミング信号に従って前記転送路上のデータを取込んで受信データとして出力する第2のレジスタとを備えた、
ことを特徴とするデータ転送回路。 - 前記設定値は任意に設定できることを特徴とする請求項1記載のデータ転送回路。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004109062A JP4364041B2 (ja) | 2004-04-01 | 2004-04-01 | データ転送回路 |
KR1020040098451A KR101034338B1 (ko) | 2004-04-01 | 2004-11-29 | 데이터 전송회로 |
US10/999,957 US7424059B2 (en) | 2004-04-01 | 2004-12-01 | Data transfer circuit |
CNB2004101020507A CN100449518C (zh) | 2004-04-01 | 2004-12-15 | 数据传送电路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004109062A JP4364041B2 (ja) | 2004-04-01 | 2004-04-01 | データ転送回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2005293353A JP2005293353A (ja) | 2005-10-20 |
JP4364041B2 true JP4364041B2 (ja) | 2009-11-11 |
Family
ID=35049901
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004109062A Expired - Fee Related JP4364041B2 (ja) | 2004-04-01 | 2004-04-01 | データ転送回路 |
Country Status (4)
Country | Link |
---|---|
US (1) | US7424059B2 (ja) |
JP (1) | JP4364041B2 (ja) |
KR (1) | KR101034338B1 (ja) |
CN (1) | CN100449518C (ja) |
Families Citing this family (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4841927B2 (ja) * | 2005-10-20 | 2011-12-21 | 富士通株式会社 | 非同期伝送装置、非同期伝送方法 |
JP2008068459A (ja) * | 2006-09-13 | 2008-03-27 | Seiko Epson Corp | 画像形成装置および画像形成方法 |
DE102008004857B4 (de) * | 2008-01-17 | 2013-08-22 | Entropic Communications, Inc. | Verfahren zur Übertragung von Daten zwischen wenigstens zwei Taktdomänen |
KR100932139B1 (ko) | 2008-04-02 | 2009-12-16 | 주식회사 동부하이텍 | 데이터 수신 장치 |
US8156365B2 (en) | 2008-04-02 | 2012-04-10 | Dongbu Hitek Co., Ltd. | Data reception apparatus |
JP5483172B2 (ja) * | 2009-10-19 | 2014-05-07 | 横河電機株式会社 | データ転送装置およびデータ転送方法 |
JP5451318B2 (ja) | 2009-10-29 | 2014-03-26 | ラピスセミコンダクタ株式会社 | 伝送装置、信号送信装置、信号受信装置及び伝送方法、信号送信方法、信号受信方法 |
JP6254394B2 (ja) * | 2013-09-09 | 2017-12-27 | 株式会社メガチップス | 同期システムおよび分周回路 |
KR102138110B1 (ko) * | 2013-10-04 | 2020-07-27 | 삼성전자주식회사 | 플래시 메모리를 기반으로 하는 저장 장치 및 그것의 동작 방법 |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6186860A (ja) | 1984-10-05 | 1986-05-02 | Ricoh Co Ltd | デ−タ送信方法 |
US6308077B1 (en) * | 1992-10-02 | 2001-10-23 | Motorola, Inc. | Apparatus and method for providing synchronization of base-stations in a communication system |
KR100230451B1 (ko) * | 1997-04-08 | 1999-11-15 | 윤종용 | 디지털 신호처리 프로세서의 비동기방식 직렬데이터 송수신 방법 |
JP2000278252A (ja) | 1999-03-25 | 2000-10-06 | Nec Corp | 非同期信号同期化装置および非同期信号同期化方法 |
JP3461483B2 (ja) * | 2000-02-22 | 2003-10-27 | 埼玉日本電気株式会社 | データ転送方法及び装置 |
JP2002215568A (ja) | 2001-01-23 | 2002-08-02 | Ricoh Co Ltd | 非同期データ転送方法 |
US6728126B1 (en) * | 2002-12-20 | 2004-04-27 | Actel Corporation | Programming methods for an amorphous carbon metal-to-metal antifuse |
JP3998532B2 (ja) * | 2002-08-07 | 2007-10-31 | 株式会社ルネサステクノロジ | データ転送装置 |
US7436918B2 (en) * | 2003-03-21 | 2008-10-14 | D2Audio Corporation | Output stage synchronization |
US7170316B2 (en) * | 2004-11-05 | 2007-01-30 | International Business Machines Corporation | Programmable logic array latch |
-
2004
- 2004-04-01 JP JP2004109062A patent/JP4364041B2/ja not_active Expired - Fee Related
- 2004-11-29 KR KR1020040098451A patent/KR101034338B1/ko active IP Right Grant
- 2004-12-01 US US10/999,957 patent/US7424059B2/en active Active
- 2004-12-15 CN CNB2004101020507A patent/CN100449518C/zh not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
KR20050097449A (ko) | 2005-10-07 |
CN1677377A (zh) | 2005-10-05 |
KR101034338B1 (ko) | 2011-05-16 |
JP2005293353A (ja) | 2005-10-20 |
US20050220196A1 (en) | 2005-10-06 |
CN100449518C (zh) | 2009-01-07 |
US7424059B2 (en) | 2008-09-09 |
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20060825 |
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A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20080807 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20081104 |
|
A521 | Request for written amendment filed |
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A711 | Notification of change in applicant |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20090721 |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20090818 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120828 Year of fee payment: 3 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 Ref document number: 4364041 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120828 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130828 Year of fee payment: 4 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
S533 | Written request for registration of change of name |
Free format text: JAPANESE INTERMEDIATE CODE: R313533 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
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LAPS | Cancellation because of no payment of annual fees |