JP4353841B2 - ショック音抑制回路 - Google Patents
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- 基準電圧を発生させる基準電圧発生部と、
入力音声信号及び前記基準電圧が印加され、前記入力音声信号に基づく出力音声信号を出力する第1のオペアンプと、
前記出力音声信号及び前記基準電圧が印加され、前記出力音声信号を反転した反転出力信号を出力する第2のオペアンプと、
前記第1のオペアンプの出力端子側と接続し、前記基準電圧を印加する抵抗と、
を有し、
前記抵抗を介する前記基準電圧の印加によって、前記第1のオペアンプ及び第2のオペアンプの動作開始及び停止時において、これらの出力端子間に差電圧を生じないようにしたことを特徴とするショック音抑制回路。
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