JP4353263B2 - 半導体装置の製造方法及び半導体装置 - Google Patents

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Description

本発明は、半導体チップを配線基板に接合する半導体装置の製造方法及び半導体装置に関する。特に本発明は、非破壊で半導体チップと配線基板の接合の良否を判断することができる半導体装置の製造方法及び半導体装置に関する。
図5は、半導体チップ110を配線基板に搭載した半導体装置の構成を説明するための断面図である。本図に示す例において、配線基板のベース基板120上には、銅配線122が形成されている。銅配線122は、端部122aを除いて保護樹脂層124によって被覆されている。銅配線122の端部122aはメッキ層(図示せず)によって被覆されている。半導体チップ110のバンプ110aは、端部122aに形成されたメッキ層と共晶合金を形成することにより、銅配線122に接合している(例えば特許文献1参照)。
特開2006−344780号公報(図4)
半導体チップのバンプと配線基板の配線の接合の良否を非破壊で検査することは、半導体装置の信頼性を向上させるために重要である。しかし、従来は、接合の良否を非破壊で検査することは難しかった。本発明は上記のような事情を考慮してなされたものであり、その目的は、非破壊で半導体チップと配線基板の接合の良否を判断することができる半導体装置の製造方法及び半導体装置を提供することにある。
上記課題を解決するため、本発明に係る半導体装置の製造方法は、表面がメッキ金属でメッキされた配線をベース基板上に有する配線基板を準備する工程と、
半導体チップの能動面に形成されたバンプを、前記配線基板の前記配線の端部に押し付けることにより、前記配線の端が前記ベース基板に接合した状態を維持しつつ、前記配線のうち前記バンプに当接している部分の周囲を、前記ベース基板から剥離させる工程と、
前記配線の端部に位置する前記メッキ金属を溶融させることにより、前記メッキ金属と前記バンプとで合金を形成して前記バンプと前記配線を接合し、かつ前記配線と前記ベース基板の間の空間に前記メッキ金属を浸透させる工程と、
前記配線と前記ベース基板の間の空間に浸透した前記メッキ金属の浸透面積、浸透幅、又は浸透長さが基準値以上の場合に、前記バンプと前記配線の接続が良好であると判断する工程とを具備する。
この半導体装置の製造方法によれば、非破壊で半導体チップと配線基板の接合の良否を判断することができる。
前記配線基板の前記基板上に形成され、前記配線の端部以外の領域を覆う保護層を具備している場合、前記配線のうち前記バンプに当接する部分から前記配線の先端までの距離は、40μm以上であり、前記配線の厚さは10μm以下であるのが好ましい。前記配線の端部に形成され、前記バンプが当接されるべき領域の近傍に位置する切欠部をさらに具備してもよい。前記配線が銅配線である場合、前記メッキ金属は例えばSnである。
本発明に係る半導体装置は、表面がメッキ金属でメッキされた配線を基板上に有する配線基板と、
前記配線基板に実装され、能動面にバンプを有する半導体チップと、
を具備し、
前記バンプは、前記配線に接合しており、
前記配線は、前記バンプと接合している部分の周囲に位置する切欠部を有する。
以下、図面を参照して本発明の実施形態について説明する。図1の各図は本発明の第1の実施形態に係る半導体装置の製造方法を説明するための断面図である。本図に示す半導体装置の製造方法は、半導体チップのバンプを配線基板の配線に接合し、その後接合の良否を非破壊で検査するものである。
まず図1(A)に示すように、ベース基板20、配線21及び保護樹脂層22を有する配線基板を準備する。ベース基板20は例えばフレキシブル基板であるが、リジッド基板であってもよいし、リジッドフレキシブル基板であってもよい。ベース基板20の材質は特に限定されず、またベース基板20の内部に配線層を有していてもよい。
配線21はベース基板20の上に形成されている。配線21はベース基板20に直接形成されていてもよいし、接着剤を介してベース基板20に貼り付けられていてもよい。配線21は、例えばCu、Cr、Ti、Ni、Ti−Wのうちいずれかが単層又は複数層積層された構造である。配線21の表面には、メッキ層21bが形成されている。メッキ層21bは、例えばSnであり、配線21及び後述するバンプ双方と合金を形成する金属により形成されている。配線21の厚さは、10μm以下であるのが好ましい。このようにすると、後述する接合工程で端部21aの先端がベース基板20から剥離することを抑制できる。なお配線21は、配線21となる金属層をベース基板20の全面に形成し、その後金属層を選択的に除去することにより形成される。金属層の形成方法としては、例えばスパッタリング法により金属層を形成する方法、または金属箔を接着層を用いてベース基板20に貼り付ける方法がある。
保護樹脂層22は、配線21のうち端部21a以外の領域を被覆している。保護樹脂層22は、例えばソルダーレジストである。
また配線基板は、吸湿していた水分を除去することを目的として、あらかじめ熱処理(プリキュア)が行われることがある。この熱処理工程で熱が過剰に加わると、メッキ層21bと配線21の合金化が進み、後述する接合工程で接合が不良になる。
次いで、半導体チップ10をボンディングツール1に保持させ、半導体チップ10の能動面を配線基板のベース基板20のうち配線を有する面に対向させる。半導体チップ10は、複数のパッド(図示せず)及びこれらパッド上それぞれに形成されたバンプ12を能動面に有している。バンプ12は、例えば金バンプである。半導体チップ10の能動面をベース基板20に対向させた状態において、配線21の端部21aは、バンプ12と対向している。配線基板のベース基板20に対して垂直な方向から見た場合、端部21aの先端から、バンプ12のうち端部21aの先端に最も近い部分までの距離Lは、40μm以上あるのが好ましい。このようにすると、後述する接合工程で端部21aの先端がベース基板20から剥離することを抑制できる。
次いで図1(B)に示すように、ボンディングツール1を配線基板に向けて移動し、半導体チップ10のバンプ12を配線基板の配線21の端部21a上に一定の力で押し付ける。このときの押し付け力は、例えば10mgf/μm以上である。これにより配線21の端部21aのうち、バンプ12の周囲に位置する部分は剥離する。ただし、端部21aの先端はベース基板20に接合したままである。
そして図1(C)に示すように、バンプ12を端部21aに押し付けた状態で、これらに熱を加える。これにより、端部21aのメッキ層21bは溶融する。溶融したメッキ層21bの一部はバンプ12及び配線21の端部21aそれぞれと共晶合金を形成してフィレット21cとなり、バンプ12と端部21aを接合する。また溶融したメッキ層21bの他の一部は、配線21の端部21aとベース基板20の剥離によって生じた空間に流入し、メッキ這い回り部21dを形成する。
上記した水分除去のための熱処理工程(プリキュア工程)においてメッキ層21bと配線21の合金化が進んでいる場合、接合工程においてメッキ層21bは溶融しないため、メッキ這い回り部21dは形成されないか、又は形成された場合でも基準値未満になる。従って、メッキ這い回り部21dの面積、幅又は長さが基準値以上である場合に、配線21の端部21aとバンプ12の接合が良好であると判断できる。なおメッキ這い回り部21dの面積、幅又は長さは、光学顕微鏡を用いることにより非破壊で目視測定できる。
図2の各図は、メッキ這い回り部21dの長さkと、バンプ12及び配線21の接合性の良否を説明するための模式図である。図2(A)に示すように、メッキ這い回り部21dの面積が十分に大きい場合、例えばメッキ這い回り部21dの長さkが基準値以上になる。このような場合、配線21の端部21aとバンプ12の接合性は良好であると判断できる。
図2(B)は、メッキ這い回り部21dがほとんどない場合を示している。このような場合、配線21の端部21aとバンプ12の接合強度は低く、接合性は不良であると判断できる。
図3は、図2に示したメッキ這い回り部21dの長さkと配線剥離率の相関の一例を示すグラフである。k=0の場合、ほぼすべてのサンプルにおいて、配線21の端部21aとバンプ12に剥離が生じていた。これに対し、k=1.4μmの場合は、ほぼすべてのサンプルにおいて端部21aとバンプ12で剥離は生じていなかった。このため、例えば図3の測定を行った条件では、k≧1.4μmの場合は配線21の端部21aとバンプ12の接合が良好であると判断できる。
以上、本発明の第1の実施形態によれば、半導体チップ10のバンプ12と配線基板の配線21の端部21aを接合した後、バンプ12と端部21aの接合部の周囲に形成されたメッキ這い回り部21dの面積、幅又は長さを測定し、この測定結果が基準値以上であるか否かを判断することにより、バンプ12と端部21aの接合が良好であるか否かを非破壊で検査することができる。バンプ12と端部21aの接合が不良である場合、例えば水分除去のための熱処理工程で用いられる装置に異常が生じたと判断することができる。
図4は、本発明の第2の実施形態に係る半導体装置の製造方法を説明するための模式図である。本図は、配線21の端部21aの平面形状を示している。本実施形態に係る半導体装置の製造方法は、端部21aが、バンプ12と接合する部分の近傍に位置する切欠部21eを有する点を除いて、第1の実施形態と同様である。切欠部21eは、例えば金属層を選択的に除去して配線21を形成する工程で形成される。
本実施形態によれば、第1の実施形態と同様の効果を得ることができる。また接合時に切欠部21eに溶融したメッキ層21bが集まりやすくなり、その結果フィレット21cが大きくなって配線21の端部21aとバンプ12の接合強度が高くなる。
また、バンプ12を端部21aに押し付け、端部21aのうちバンプ12の周囲に位置する部分をベース基板20から剥離させる際に、バンプ12を押し付けることにより端部21aに生成した歪が端部21aの先端に伝播することを抑制できる。このため、端部21aの先端がベース基板20から剥離することを抑制できる。
尚、本発明は上述した実施形態に限定されるものではなく、本発明の主旨を逸脱しない範囲内で種々変更して実施することが可能である。
各図は第1の実施形態に係る半導体装置の製造方法を説明するための断面図。 各図はメッキ這い回り部21dの長さkとバンプ12及び配線21の接合性の良否を説明するための模式図。 メッキ這い回り部21dの長さkと配線剥離率の相関の一例を示すグラフ。 第2の実施形態に係る半導体装置の製造方法を説明するための模式図。 半導体チップ110を配線基板に搭載した半導体装置の構成を説明する断面図。
符号の説明
1…ボンディングツール、10,110…半導体チップ、12,110a…バンプ、20,120…ベース基板、21…配線、21a…端部、21b…メッキ層、21c…フィレット、21d…メッキ這い回り部、21e…切欠部、22,124…保護樹脂層、122…銅配線、122a…端部

Claims (5)

  1. 表面がメッキ金属でメッキされた配線をベース基板上に有する配線基板を準備する工程と、
    半導体チップの能動面に形成されたバンプを、前記配線基板の前記配線の端部に押し付けることにより、前記配線の端が前記ベース基板に接合した状態を維持しつつ、前記配線のうち前記バンプに当接している部分の周囲を、前記ベース基板から剥離させる工程と、
    前記配線の端部に位置する前記メッキ金属を溶融させることにより、前記メッキ金属と前記バンプとで合金を形成して前記バンプと前記配線を接合し、かつ前記配線と前記ベース基板の間の空間に前記メッキ金属を浸透させる工程と、
    前記配線と前記ベース基板の間の空間に浸透した前記メッキ金属の浸透面積、浸透幅、又は浸透長さが基準値以上の場合に、前記バンプと前記配線の接続が良好であると判断する工程と、
    を具備し、
    前記浸透面積、浸透幅、又は浸透長さは、光学顕微鏡を用いることにより非破壊で測定される半導体装置の製造方法。
  2. 前記ベース基板及び前記配線上に形成され、前記配線の端部以外の領域を覆う保護層を具備し、
    前記配線のうち前記バンプに当接する部分から前記配線の先端までの距離は、40μm以上であり、
    前記配線の厚さは10μm以下である請求項1に記載の半導体装置の製造方法。
  3. 前記配線の端部に形成され、前記バンプが当接されるべき領域の近傍に位置する切欠部をさらに具備する請求項1又は2に記載の半導体装置の製造方法。
  4. 前記配線は銅配線であり、前記メッキ金属はSnである請求項1〜3のいずれか一項に記載の半導体装置の製造方法。
  5. 表面がメッキ金属でメッキされた配線をベース基板上に有する配線基板と、
    前記配線基板に実装され、能動面にバンプを有する半導体チップと、
    を具備し、
    前記バンプは、前記配線に接合しており、
    前記配線は、前記バンプと接合している部分の周囲に位置する切欠部を有し、
    前記配線と前記ベース基板の間の空間には、前記メッキ金属が浸透している半導体装置。
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Publication number Priority date Publication date Assignee Title
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JP4322508B2 (ja) * 2003-01-15 2009-09-02 新光電気工業株式会社 半導体装置の製造方法
JP4146826B2 (ja) * 2004-09-14 2008-09-10 カシオマイクロニクス株式会社 配線基板及び半導体装置
US7041591B1 (en) * 2004-12-30 2006-05-09 Phoenix Precision Technology Corporation Method for fabricating semiconductor package substrate with plated metal layer over conductive pad
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