JP4284272B2 - レーザーマスク、レーザーマスクを利用したレーザー結晶化方法、及び平板表示装置の製造方法 - Google Patents

レーザーマスク、レーザーマスクを利用したレーザー結晶化方法、及び平板表示装置の製造方法 Download PDF

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Description

本発明は、レーザーマスク及びこれを利用した結晶化方法に関し、特に、レーザーマスクの形状を改善して、2−ショットが可能であると共に、チャネルオリエンテーションによる素子の不均一を解決するレーザーマスク及びこれを利用した結晶化方法に関する。
最近、情報ディスプレイへの関心が高まり、携帯可能な情報媒体を利用しようとする要求が高まることによって、既存の表示装置であるブラウン管(Cathode Ray Tube;CRT)を代替する、軽量の薄膜型平板表示装置(Flat Panel Display;FPD)に関する研究及び商業化が重点的に行われている。特に、このような平板表示装置のうち液晶表示装置(Liquid Crystal Display;LCD)は、液晶の光学的異方性を利用してイメージを表示する装置であって、解像度、カラー表示及び画質などに優れており、ノートブックやデスクトップモニタなどに活発に適用されている。
前記液晶表示装置に主に用いられる駆動方式である能動マトリックス(Active Matrix;AM)方式は、非晶質シリコン薄膜トランジスタ(Thin Film Transistor;TFT)をスイッチング素子として使用して、画素部の液晶を駆動する方式である。
非晶質シリコン薄膜トランジスタ技術は、1979年英国のLeComberらにより概念が確立され、1986年に3インチ液晶の携帯用テレビとして実用化され、最近、50インチ以上の大面積の薄膜トランジスタ液晶表示装置が開発された。
しかしながら、前記非晶質シリコン薄膜トランジスタの電気的移動度(<1cm/Vsec)としては、1Mhz以上の高速動作を要求する周辺回路に利用するには限界がある。これにより、前記非晶質シリコン薄膜トランジスタに比べて電界効果移動度の大きい、多結晶シリコン薄膜トランジスタを利用して、ガラス基板上に画素部と駆動回路部を同時に集積する研究が活発に進行している。
多結晶シリコン薄膜トランジスタ技術は、1982年に液晶カラーテレビが開発された以来、カムコーダのような小型モジュールに適用されており、低い感光度及び高い電界効果移動度を有しており、駆動回路を基板に直接製作できるという利点がある。
移動度の増加は、駆動画素数を決定する駆動回路部の動作周波数を向上させることができ、これにより、表示装置の高精細化が容易になる。且つ、画素部の信号電圧の充電時間の減少により伝達信号の歪曲が減り、画質の向上を期待することができる。
一方、このような多結晶シリコン薄膜トランジスタを製作する方法としては、多結晶シリコン薄膜を基板上に直接蒸着する方法、及び基板上に非晶質シリコン薄膜を蒸着した後に熱処理して結晶化する方法などがある。特に、低価のガラス基板を使用するためには、低温工程が要求され、駆動回路部の素子に利用するためには、薄膜トランジスタの電界効果移動度を向上させる方法が要求される。
このとき、非晶質シリコン薄膜を結晶化する熱処理方法としては、固相結晶化(Solid Phase Crystallization;SPC)方法、及びエキシマレーザーアニール(Eximer Laser Annealing;ELA)方法などがある。
前記固相結晶化は、例えば、約600℃の温度で多結晶シリコン薄膜を形成するための方法であって、ガラス基板上に非晶質シリコン薄膜を形成した後、約600℃で数時間〜数十時間の間加熱処理を施すことにより、非晶質シリコン薄膜を結晶化する方法である。前記固相結晶化方法により得られた多結晶シリコン薄膜は、通常、数μm水準の比較的大きいグレイン(粒径)を有するが、前記グレイン内に欠陥が多く形成されるという欠点がある。このような欠陥は、多結晶シリコン薄膜トランジスタのグレイン境界としては悪くないが、薄膜トランジスタの性能に良くない影響を及ぼすことが知られている。
エキシマレーザーアニール方法は、低温で多結晶シリコン薄膜トランジスタを製造する核心的な方法であって、高いエネルギーを有するレーザービームを、非晶質シリコン薄膜に、数十nsecで瞬間的に照射することにより、前記非晶質シリコン薄膜を結晶化する方法である。非常に短い時間に非晶質シリコンの溶融及び結晶化がなされるので、ガラス基板が全く損傷を受けないという利点がある。
また、エキシマレーザーを利用して製作された多結晶シリコン薄膜は、他の一般的な熱処理方法により製作された多結晶シリコン薄膜より電気的特性が優れているという利点がある。例えば、一般的に、非晶質シリコン薄膜トランジスタの電界効果移動度は、0.1〜0.2cm/Vsec程度で、一般的な熱処理方法により製作された多結晶シリコン薄膜トランジスタの電界効果移動度は、10〜20cm/Vsec程度であるのに対し、前記エキシマレーザーを利用して製作された多結晶シリコン薄膜トランジスタは、100cm/Vsecを超える電界効果移動度を有する(IEEE Trans. Electron Devices, vol.36, no.12, p.2868, 1989)。
以下、レーザーを利用した結晶化方法について詳細に説明する。
図15は、照射されるレーザーエネルギー密度に対する結晶化したシリコン薄膜のグレインサイズを示すグラフである。
図に示すように、第1領域I及び第2領域IIでは、レーザーエネルギー密度が増加するほど、結晶化した多結晶シリコン薄膜のグレインサイズが増加していることが分かる(IEEE Electron Dev. Lett., DEL-7, 276, 1986)。しかしながら、第3領域III(特定のエネルギー密度Ec以上のエネルギーが照射される領域)では、結晶化した多結晶シリコン薄膜のグレインサイズが急激に減少することが分かる。
即ち、照射されるレーザーエネルギー密度によってシリコン薄膜の結晶化メカニズムが異なることが分かり、これを詳細に説明すると次のようになる。
図16〜図18は、図15に示したレーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図で、各レーザーエネルギー密度による結晶化過程を順次示している。
このとき、レーザーアニールによる非晶質シリコンの結晶化メカニズムは、レーザー照射条件(レーザーエネルギー密度、照射圧力、基板温度など)、及び非晶質シリコン薄膜の物性的、幾何学的特性(吸収係数、熱伝導度、質量、不純物含有度、厚さなど)など、様々な要因により影響を受ける。
まず、図16A〜図16Cは、図15に示すグラフの第1領域Iに対するシリコン結晶化メカニズムを順次示す断面図で、前記第1領域Iは、部分溶融領域であり、非晶質シリコン薄膜12は、点線部分まで結晶化がなされ、このとき形成されるグレイン30のサイズは、数百Å程度である。
即ち、バッファ層11が形成された基板10上の非晶質シリコン薄膜12に第1領域Iのレーザーが照射されると、前記非晶質シリコン薄膜12は溶けるが、レーザービームに直接露出する非晶質シリコン薄膜12の表面には強いレーザーエネルギーが照射され、非晶質シリコン薄膜12の下部には相対的に弱いレーザーエネルギーが照射されることによって、非晶質シリコン薄膜12の一定部分のみが溶融されて部分的な結晶化が起こる。
このとき、レーザー結晶化による結晶成長過程は、第1過程がレーザーの照射による非晶質シリコン表面層の1次溶融で、第2過程が1次溶融層の固相化による潜熱の発生及びこれによる下部層の2次溶融で、第3過程が固相化を通しての結晶成長であり、以下にこのような結晶成長過程について詳細に説明する。
レーザーが照射された非晶質シリコン薄膜は、溶融温度(1000℃)を上回るようになって液相状態に1次溶融される。次いで、前記1次溶融層は、下部シリコン及び基板との高い温度差が発生して固相核生成及び固相化が発生するまで急激に冷却される。レーザーの照射による溶融層は、固相核生成及び固相化が起こるまで維持され、このような溶融状態は、蒸発が起こらない範囲では、レーザーエネルギー密度が高いほど、または外部への熱放出が少ないほど長い間持続する。また、1次溶融層は、結晶質シリコンの溶融温度(1400℃)より低い温度(1000℃)で溶融されるので、前記溶融層は、冷却されて相変化以下の温度に下がる過冷却状態に維持され、このような過冷却状態が大きいほど、即ち、薄膜の溶融温度が低いか、または冷却速度が速いほど、固相化時における核生成率の増加をもたらし、微細な結晶成長をなすようになる。
1次溶融層が冷却されて固相化が開始すると、結晶核を中心に上方に結晶成長がなされ、このとき、1次溶融層の液相から固相への相変化による潜熱が放出されて、固体状態の下部非晶質シリコン薄膜を2次溶融させ、再び固相化を通してのこのような過程が繰り返されて結晶が成長する。このとき、下部の2次溶融層は、1次溶融層に比べて、さらに過冷却された状態で、核生成率が増加して結晶の大きさが小さくなる。
従って、レーザーアニールによる結晶化時に結晶化特性を向上させるためには、固相化による冷却速度を遅らせることが効果的な方法であり、これにより、基板の加熱、二重ビームの照射、バッファ絶縁層の挿入などのように、吸収されたレーザーエネルギーの外部への熱放出を抑制して冷却速度を遅らせる方法を用いることができる。
図17A〜図17Cは、図15に示すグラフの第2領域IIに対するシリコン結晶化メカニズムを順次示す断面図で、前記第2領域IIは、準完全溶融領域を示す。
図に示すように、3000〜4000Å程度の比較的大きいサイズのグレイン30A〜30Cを有する多結晶シリコン薄膜が下部バッファ層11の界面まで形成されている。
即ち、完全な溶融エネルギーでないほぼ完全な溶融エネルギーを非晶質シリコン薄膜12に照射すると、バッファ層11と近接した領域まで非晶質シリコン薄膜12が溶融される。このとき、前記溶融された非晶質シリコン薄膜12´とバッファ層11との界面に溶けない固体シード35が存在して、前記シードが結晶化核として作用して側面成長を誘導することにより、比較的大きいグレイン30A〜30Cが形成される(J. Appl. Phys.82,4086)。
しかしながら、前記結晶化は、溶けない固体シード35がバッファ層11との界面に残っているようなレーザーエネルギーを照射しなければ可能でない方法であるので、製法する手段が非常に狭いという欠点を有する。且つ、前記固体シード35が不均一に生成されるため、結晶化した多結晶シリコン薄膜のグレイン30A〜30Cが、互いに異なる結晶化方向、即ち、互いに異なる結晶化特性を有するようになるという欠点を有する。
最後に、図18A〜図18Cは、図15に示すグラフの第3領域IIIに該当する完全溶融領域に対する結晶化メカニズムを示す断面図である。
図に示すように、前記第3領域IIIに該当するエネルギー密度では、非常に小さいサイズのグレイン30が不規則に形成されている。
即ち、レーザーエネルギー密度が一定水準(Ec)以上になるときは、非晶質シリコン薄膜12に充分なエネルギーが加えられて、前記非晶質シリコン薄膜12が全て溶融され、グレインに成長することができる固体シードが残らないようになる。その後、強いエネルギーのレーザーの照射により溶融されたシリコン薄膜12´は、急激な冷却過程を経ながら多数の均一な核35が生成され、その結果、微細なグレイン30が形成されるようになる。
一方、前記レーザー結晶化としては、パルス状のレーザーを利用したエキシマレーザーアニール方法が主に用いられるが、近来、グレインを横方向に成長させて結晶化特性を画期的に向上させた順次的横方向結晶化(Sequential Lateral Solidification;SLS)方法が提案されて広く研究されている。
前記順次的横方向結晶化は、グレインが、液相シリコンと固相シリコンとの境界面で、前記境界面に対し垂直方向に成長することを利用したもので(Robert S. Sposilli, M. A. Crowder, and James S. Im, Mat. Res. Soc. Symp. Proc. Vol.452,956〜957,1997)、レーザーエネルギーの大きさ及びレーザービームの照射範囲を適宜調節して、グレインを所定の長さだけ側面成長させることにより、シリコングレインのサイズを向上させることができる結晶化方法である。
このような順次的横方向結晶化は、横方向結晶化の一例であり、以下に前記横方向結晶化に対する結晶化メカニズムについて図を参照して説明する。
図19A〜図19Cは、一般的な横方向結晶化による結晶化過程を順次示す断面図である。
まず、図19Aに示すように、非晶質シリコン薄膜112が完全に溶融されるエネルギー密度以上(即ち、前述の図15における第3領域III)のレーザーが照射されると、前記レーザーの照射を受けた部分の非晶質シリコン薄膜112は、完全に溶融される。
このとき、レーザーが照射される照射領域と照射されない非照射領域とは、予めパターン化されたマスクを利用することで可能になる。
このとき、図19B及び図19Cに示すように、非晶質シリコン薄膜112に充分なエネルギーのレーザーが照射されるため、前記非晶質シリコン薄膜112を完全に溶かすが、一定の間隔のビームを用いて溶かすため、レーザーが照射されない非照射領域のシリコン薄膜112と溶融されたシリコン薄膜112´との境界面に存在する固相シリコンを核として結晶が成長するようになる。
即ち、レーザーエネルギーの照射が終わった直後から、溶融されたシリコン薄膜112´は、左右面、即ち、レーザーが照射されない非照射領域を通して冷却されるようになる。これは、シリコン薄膜112、112´下部のバッファ層111またはガラス基板110より、左右面の固相非晶質シリコン薄膜112がさらに大きな熱伝導度を有するためである。
従って、溶融されたシリコン薄膜112´は、中央部より左右の固相と液相との界面で優先的に核形成温度に到達し、その部分で結晶核が形成される。結晶核が形成された後は、温度の低い側から高い側に、即ち、界面から中央部にグレイン130A、130Bの横方向成長が起こる。
このような側面結晶成長により、大きいグレイン130A、130Bが形成され、且つ、第3領域IIIのエネルギーで工程を進行するので、製造手段が広いという利点を有する。
しかしながら、このような順次的横方向結晶化においては、グレインのサイズを増加させるために、マスクまたはステージを複数回繰り返して微少移動させて結晶化を進行させるため、所望の領域全体に対し結晶化をなすためには、結晶化に多大な時間を要し、これにより、全体工程時間が増加して工程収率が減少するという問題点があった。
本発明は、このような問題を解決するためのもので、従来に比べて同面積に対する結晶化をさらに迅速に進行させることにより、生産収率を向上させることができるレーザーマスク及びこれを利用した結晶化方法を提供することを目的とする。
また、本発明の他の目的は、所定のパターンを有するスリットを第1のブロックに設定し、第2のブロックには、前記パターンの逆形状に構成した2−ブロックマスクを適用して、2−ショットのレーザー結晶化を進行させることにより、チャネルオリエンテーションによる素子の不均一を解決することができるレーザーマスク及びこれを利用した結晶化方法を提供することにある。
また、本発明のさらに他の目的は、前述の均一な結晶化特性を有するシリコン薄膜を用いて製作した平板表示装置及びその製造方法を提供することにある。
このような目的を達成するために、本発明によるレーザーマスクは、第1のブロックと第2のブロックの2つのブロックにより構成され、前記第1のブロックに形成された基準パターンと、前記第2のブロックに形成された、前記基準パターンの反転パターンとを含み、前記基準パターンは、複数の第1透過領域と1つの第1遮断領域とから構成され、前記反転パターンは、複数の第2遮断領域と1つの第2透過領域とから構成される
そして、本発明によるレーザー結晶化方法は、第1のブロックに形成された基準パターンと、第2のブロックに形成された、前記基準パターンの反転パターンとを含み、前記基準パターンは、複数の第1透過領域と1つの第1遮断領域とから構成され、前記反転パターンは、複数の第2遮断領域と1つの第2透過領域とから構成されるレーザーマスクを用いた結晶化方法であって、シリコン薄膜が形成された基板を提供する段階と、前記シリコン薄膜の所定領域上に、前記レーザーマスクの前記第1のブロックを位置させ、前記第1のブロックを通して1次レーザービームを照射して1次結晶化領域を形成する段階と、前記レーザーマスクまたは基板を、前記照射されたシリコン薄膜の所定領域上に前記レーザーマスクの第2のブロックが位置するように移動させ、前記第2のブロックを通して2次レーザービームを照射して2次結晶化領域を形成する段階とを含み、前記1次レーザービームが照射される領域と前記2次レーザービームが照射される領域とはオーバーラップしない
また、スイッチング素子として薄膜トランジスタを含む本発明による平板表示装置の製造方法は、シリコン薄膜が形成された基板を提供する段階と、前記薄膜トランジスタのアクティブ層を形成するために、第1のブロックと第2のブロックの2つのブロックにより構成され、前記第1のブロックに形成された基準パターンと、前記第2のブロックに形成された、前記基準パターンの反転パターンとを含み、前記基準パターンは、複数の第1透過領域と1つの第1遮断領域とから構成され、前記反転パターンは、複数の第2遮断領域と1つの第2透過領域とから構成されるレーザーマスクを用いて、前記シリコン薄膜を多結晶シリコン薄膜に結晶化する段階とを含み、前記シリコン薄膜を多結晶シリコン薄膜に結晶化する段階は、前記シリコン薄膜の所定領域上に、前記レーザーマスクの第1のブロックを位置させ、前記第1のブロックを通して1次レーザービームを照射して1次結晶化領域を形成する段階と、前記レーザーマスクまたは基板を、前記照射されたシリコン薄膜の所定領域上に前記レーザーマスクの第2のブロックが位置するように移動させ、前記第2のブロックを通して2次レーザービームを照射して2次結晶化領域を形成する段階とをさらに含み、前記1次レーザービームが照射される領域と前記2次レーザービームが照射される領域とはオーバーラップしない
本発明によるレーザーマスク及びこれを利用した結晶化方法においては、所定のパターンを有するスリットを第1のブロックに設定し、前記パターンの逆形状に構成された反転パターンを第2のブロックに設定してレーザーマスクを形成した後、2−ショットで結晶化を進行させることによって、X−オーバーラップ及びY−オーバーラップが除去されると共に、均一に結晶化した多結晶シリコン薄膜が得られる。
また、このような均一な結晶化特性を有する多結晶シリコン薄膜を利用して平板表示装置を製作する場合は、均一な素子特性が得られ、これにより、前記平板表示装置の信頼性が向上するという効果が得られる。
また、本発明は、2−ショットで基板の全面を結晶化することができるので、収率の向上及びそれによる製造費用の削減を図ることができるという効果が得られる。
以下、本発明について詳細に説明する。
図1Aは、本発明の順次的横方向結晶化に使用されるレーザーマスクを示す例示図で、一般的な結晶化工程に比べて結晶化時間を短縮できるように設計されたマスクを示す。
図に示すように、レーザーマスク270は、縦方向及び横方向に所定の長さを有する矩形状の透過領域273を有するスリット状のパターン275を含んでいる。
前記レーザーマスク270は、光を透過させる矩形状の2つの透過領域273と、光を遮断する遮断領域274とからなり、前記スリット275の透過領域273を透過したレーザービームは、透過領域273の形状(即ち、矩形)に従って、所定のシリコン薄膜を結晶化する。
しかしながら、図1Bに示すように、このように結晶化したシリコン薄膜のエッジ部Eは、レーザービームの回折により、実質的にマスクパターン、即ち、スリット275状に結晶化することなくラウンド状を有するようになるが、以下にこれを詳細に説明する。
参考として、図1Bにおいて、結晶化したシリコン薄膜のエッジ部E内の点線は、前記結晶化に使用されたレーザーマスク270のスリット275の形状を示している。
図2は、図1Bに示す結晶化したシリコン薄膜のエッジ部Eを拡大して示す平面図で、図に示すように、前記エッジ部Eの中央であるA領域には、シリコン薄膜を十分に溶かす程度の完全溶融エネルギーが照射されて、スリット275と類似した形状に結晶化パターンが形成されるが、前記エッジ部Eの角部であるB領域に対応するスリット275のエッジ部には、レーザービームの回折によりシリコン薄膜を十分に溶かすことができる部分溶融エネルギー以下のレーザービームが照射されることとなり、結果的に、エッジ部Eは、凸状のラウンド状を有するようになる。
これは、前記ラウンド状を有する結晶化したシリコン薄膜のエッジ部Eにおけるグレインが、前記ラウンド状に溶融された境界面に位置した非晶質シリコン薄膜を核として成長するので、第1グレイン230Aと異なる方向に成長した第2グレイン230Bが形成されるためである。即ち、前記第2グレイン230Bは、第1グレイン230Aと異なる結晶化特性を有し、その結果、結晶化したシリコン薄膜内に不連続的な領域が存在するようになる。
このとき、前記結晶化したシリコン薄膜の凸状のエッジ部Eである不連続領域は、その幅Wだけ異なる結晶化特性を有するので、前記シリコン薄膜を液晶表示素子に適用するためには、前記不連続領域の幅Wを減らすことが重要である。
以下、このようなマスクを利用してシリコン薄膜を結晶化する結晶化工程を説明する。
図3A〜図3Cは、図1Aに示すレーザーマスク270を用いてシリコン薄膜を結晶化する過程を順次示す平面図である。
まず、図3Aに示すように、前述の図1Aに示すレーザーマスク270を基板210上に位置させ1次レーザービームを照射して、前記基板210上に蒸着された非晶質シリコン薄膜212の結晶化を進行させる。
このとき、結晶化する領域は、前記レーザーマスク270の透過領域273に対応する部分であり、レーザーマスク270の透過領域が2つであると、結晶化領域も、横方向に所定の長さを有するように2つ形成される。
即ち、矩形状のスリット275が形成されているレーザーマスク270を適用して、基板210の表面に1次レーザービームを照射すると、前記スリット275を通してレーザーが照射されたシリコン薄膜は、上下境界面に位置した非晶質シリコン薄膜212を核として横方向に成長した第1グレイン230Aを有するようになる。
このとき、前記結晶化したシリコン薄膜212´のエッジ部は、前述したように、レーザービームの回折により、実質的にマスクパターン、即ち、スリット275の形状に結晶化することなくラウンド状を有するようになるが、前記ラウンド状を有する結晶化したシリコン薄膜212´のエッジ部では、前記ラウンド状に溶融された境界面に位置した非晶質シリコン薄膜212を核として成長するので、前記第1グレイン230Aと異なる方向に成長した第2グレイン230Bが形成される。
即ち、前記第2グレイン230Bは、第1グレイン230Aと異なる結晶化特性を有し、結晶化したシリコン薄膜に不連続的な領域が存在するようになる。
このような1次結晶化が完了すると、前記基板210が載置されたステージ(図示せず)またはレーザーマスク270を、前記レーザーマスク270パターン(即ち、スリット275パターン)の横方向の長さより短く移動させた後、2次レーザービームを照射して、連続的にX軸方向への結晶化を進行させる。
例えば、前記レーザーマスク270をX軸方向に移動させて、前記スリット275パターンが結晶化したシリコン薄膜212´の不連続領域280に重なるようにし、基板210の表面に2次レーザービームを照射すると、図3Bに示すように、1次結晶化により結晶化したシリコン薄膜212´パターンと同一の2次結晶化パターン212´´が、前記1次結晶化シリコン薄膜212´の不連続領域280と重なるようにX軸方向に形成される。
その後、前記基板210の表面に同様の方法で3次レーザービームを照射すると、前記2次結晶化により結晶化したシリコン薄膜212´´パターンと同一の3次結晶化パターン212´´´が、前記2次結晶化シリコン薄膜212´´の不連続領域280と重なるように形成される。
このとき、前記不連続領域280の幅Wが広いほど、次のショットのためのレーザービームのオーバーラップ領域が広くなり、その結果、全体結晶化時間が増加するという問題点が発生する。前記結晶化したシリコン薄膜212´、212´´、212´´´の不連続領域280は、互いに異なる結晶化特性を有し、且つ、前記不連続領域280周囲のシリコン薄膜212は、結晶化することなく非晶質状態で残っているため、次のショットは、前記不連続領域280が重なるようにオーバーラップさせるべきである。
次いで、前述の方法によるX軸方向への結晶化が完了すると、前記レーザーマスク270またはステージをY軸方向に(ステージを移動させる場合は−Y軸方向に)所定距離移動させる。
その後、図3Cに示すように、1次結晶化工程が終わった部分から、再びX軸方向へのレーザー照射工程を進行する。
前述の結晶化を繰り返して進行させると、多結晶シリコン薄膜は、定常状態のグレインを有する複数の第1領域P1と、これらの第1領域P1間に存在し、結晶化特性が異なる不連続領域である第2領域P2とが存在するようになるという問題点がある。
このとき、前記不連続領域周囲のシリコン薄膜は、結晶化することなく非晶質シリコン状態で残っているため、次のショットは、前記不連続領域が重なるようにオーバーラップさせるべきである。一方、前記不連続領域が重なったオーバーラップ領域(即ち、X−オーバーラップ領域)は、前述のレーザー結晶化工程によるショットマークで、液晶表示装置や有機EL(Organic Light Emitting Diodes;OLED)の素子への適用時に画質不良や素子の特性不均一をもたらすという問題を発生させる。
一方、前記の結晶化には適用していないが、前記グレインをY軸方向に成長させてグレインサイズを増加させるために、マスクをY軸方向にオーバーラップさせて繰り返して結晶化を進行させることもできるが、このとき、Y軸方向へのオーバーラップ領域(即ち、Y−オーバーラップ)によるショットマークが問題となり得る。
また、前述の結晶化特性の不均一の問題は、前述した移行方式を利用するレーザーマスクパターンだけでなく、シングルスキャン方式のレーザーマスクの場合にも重要な問題となっている。
特に、前述したような結晶化特性の不均一は、前記結晶化したシリコン薄膜により製作される薄膜トランジスタにおいて、チャネルオリエンテーション(即ち、チャネルが形成される方向)による素子特性の不均一をもたらし、その結果、液晶表示装置の画質を低下させるという問題点があった。
従って、本発明においては、所定形状のスリットパターンを、レーザーマスクに2つのブロックに分けて構成し、前記パターンの反復性を利用して、レーザービームを2−ショットで照射するが、このとき、前記2−ショットにより結晶化したシリコン薄膜は、前記パターンの周期性により、X−オーバーラップ及びY−オーバーラップなしに全面が結晶化するようになる。
即ち、本発明によるレーザーマスクにおいては、第1のブロックに、所定のパターン(規則性を有するものでも不規則性を有するものでも良い)を有するスリットを設定し、第2のブロックには、前記パターンの逆形状になるようにパターンを設定することにより、2−ショットのレーザー結晶化により全面が結晶化し、その結果、シリコン薄膜は、放射状のグレインを有し、均一な結晶化特性を有する多結晶シリコン薄膜に結晶化するようになる。これにより、前記均一に結晶化したシリコン薄膜を利用して素子を製作することにより、前述したようなチャネルオリエンテーションによる素子の不均一を解決することができる。
以下、添付の図面を参照して、本発明によるレーザーマスク及びこれを利用した結晶化方法の好ましい実施形態を詳細に説明する。
本発明においては、前述した2−ブロックマスクを構成するとき、第1のブロック(または、第2のブロック)に、規則性を有するパターンを構成することもでき、不規則性を有するパターンを構成することもできるが、まず、スリットパターンが規則的に構成されたレーザーマスクについて説明する。
図4は、本発明の第1実施形態によるレーザーマスクに周期性を有するパターンを構成する方法を示す例示図である。本実施形態のレーザーマスクは、規則性を有する2つのパターンに区分される2−ブロックにより構成することができる。
図に示すように、本実施形態は、2−ショットによりシリコン薄膜の全面が結晶化するように2つのパターンを構成する際に、レーザーマスクを大きく2つに分け、第1のブロックには、A位置を有するレーザービーム通過領域(即ち、円形状のマスクパターン)375Aを形成し、第2のブロックには、前記A位置を除いた残り領域をビーム通過領域として構成し、2−ショットで結晶化を進行させる。
ここで、本発明の核心は、前述したように、第1のブロックには所定形状のスリットパターンを設定し、第2のブロックには前記パターンの逆形状に構成されたパターンを設定することにあり、図に示す第1実施形態のように、規則性を有するA位置のマスクパターン375Aを第1のブロックに構成することは、単に一例に過ぎず、本発明はこれに限定されない。
一方、前記隣接する3つのA位置のビーム通過領域、即ち、マスクパターン375Aの中心は正三角形をなし、このとき、これらのA位置のマスクパターン375Aの中心は、それぞれ前記正三角形の3つの頂点に位置するが、前述したように、本発明はこれに限定されず、前記A位置のマスクパターン375Aが形成される位置に関係なく、第2のブロックに前記A位置のマスクパターン375Aを除いた残り領域をマスクパターンとして構成すれば良い。
一方、前記ビーム通過領域、即ち、A位置のマスクパターン375Aは、本発明によってショットマークなしに2−ショットにより全ての領域が結晶化するために、前記A位置のマスクパターン375Aのサイズと、隣接するA位置のマスクパターン375Aとの隔間は、所定の関係式を満足すべきであるが、これを図に基づいて説明する。
図5は、図4において、本実施形態の規則性を有するレーザーマスクのビーム通過領域の大きさを示す例示図で、円形状を有するA位置のビーム通過領域を示している。
図に示すように、前記A位置のビーム通過領域375Aの半径をRとし、前記ビーム通過領域375Aの中心間の距離をLとすると、前記ビーム通過領域375Aの半径Rは、全体領域を2−ショットで結晶化するために次の数式を満足すべきである。
R<L/2 (1)
即ち、A位置のビーム通過領域、即ち、マスクパターン375Aは、その半径Rが、隣接するA位置のマスクパターン375Aが互いに接触する条件であるL/2より小さければ良い。
その理由は、本実施形態の規則性を有するレーザーマスクは、前述したように、第2のブロックに前記A位置のマスクパターン375Aを除いた残り領域を構成するため、本実施形態のビーム通過領域375Aが有し得る大きさの最大値である、隣接するA位置のマスクパターン375Aが互いに接触する条件であるL/2より小さければ、2−ショットにより全面積を結晶化することができるからである。
一方、このように構成された円形状及びその逆形状から構成されたマスクパターンを、2つのブロックに分けてレーザーマスクに適用して、2−ショットで結晶化すると、チャネルオリエンテーションに関係なく、均一な結晶質シリコン薄膜が得られるが、以下にこれを詳細に説明する。
図6A及び図6Bは、図4に示すパターン構成方法により製作した2−ブロックレーザーマスクの一部を各ブロック別に示す例示図で、第1のブロック480´には、A位置を有するマスクパターン475A(以下、基準パターンという)を構成し、第2のブロック480´´には、前記第1のブロック480´に構成された基準パターン475Aの逆形状にデザインしたマスクパターン475B(以下、反転パターンという)を構成した場合を示している。
このとき、本実施形態においては、図4に示すパターン構成方法により、第1のブロック480´に、基準パターンとしてA位置のマスクパターン475Aを構成したが、前述したように、本発明はこれに限定されず、位置に関係なくマスクパターンを構成することができる。
一方、図に示すように、前記第1のブロック480´は、円形状の光を透過させる複数の第1透過領域473Aと、光を遮断する第1遮断領域474Aとからなり、前記第2のブロック480´´は、前記第1のブロック480´に形成されたパターンの逆形状を有する、即ち、前記第1遮断領域474Aに対応して(即ち、逆形状の)光を透過させる第2透過領域473Bと、前記第1透過領域473Aに対応して光を遮断する第2遮断領域474Bとからなる。
このとき、図においては、前記第1透過領域473A及び第2遮断領域474Bが円形状のスリットにより構成されているが、本発明はこれに限定されず、正三角形、正四角形、正六角形、正八角形などのような正多角形状に構成することができる。
また、図においては、前記円形状のスリットが全て同一の大きさを有するように構成されているが、本発明はこれに限定されず、前記円形状のスリットが必ず同一の大きさを有する必要はない。
一方、図7A及び図7Bは、それぞれ図6A及び図6Bに示すレーザーマスクを順に適用して、シリコン薄膜を結晶化する過程を順次示す例示図で、前述したような2−ブロックマスクを使用して結晶化した結果、シリコン薄膜の全面が均一に結晶化する。
まず、図7Aに示すように、図6Aの第1のブロック480´を適用して基板410に1次結晶化を進行させると、前記第1のブロック480´に形成された基準パターン475Aを通して(即ち、前記マスクパターン475Aの第1透過領域473Aを通して)レーザーが照射されたシリコン薄膜412は、円周の境界面に位置した非晶質シリコン薄膜412を核として、円形状の基準パターン475Aの中心側に結晶が成長し、放射状のグレインを有する1次結晶である多結晶シリコン薄膜412´が形成される。
一方、1次結晶化により結晶化する領域は、前記マスクの第1透過領域473Aに対応する部分であり、マスクの透過領域が7つであると、結晶化領域も、円形状を有する7つの多結晶シリコン薄膜412´が形成されるようになる。
前記1次結晶化が完了すると、前記1次多結晶シリコン薄膜412´が形成された基板410に図6Bの第2のブロック480´´を適用して、2次レーザービームを照射して2次結晶化を進行させる。
このとき、前記2次結晶化は、反転パターン475Bが形成された第2のブロック480´´を1次結晶化したシリコン薄膜412´上に適用して進行するが、前記結晶化の結果、図7Bに示すように、1次結晶化により結晶化したシリコン薄膜412´パターンの円周を開始点として(即ち、結晶成長のシードとして)、前記円形状に結晶化したシリコン薄膜の外部方向に結晶が成長して、2次結晶である多結晶シリコン薄膜412´´が形成される。
このとき、本実施形態に使用された前記2−ブロックマスク480´、480″は、パターン475A、475Bが規則性を有するように形成されており、図に示すように、前記1次結晶化したシリコン薄膜412´を中心に、正六角形状のグレイン境界490が形成されるようになる。
このように規則性を有する2−ブロックからなるマスクを適用して、2−ショット結晶化を進行させた結果、図に示すように、基板410の全領域のシリコン薄膜412が、X−オーバーラップ及びY−オーバーラップなしに、即ち、ショットマークなしに結晶化する。
且つ、このように結晶化したシリコン薄膜412´、412´´は、前記パターン475A、475Bが規則性を有しており、全領域で同一のグレイン境界490を有する、即ち、均一な結晶化特性を有する薄膜として結晶化するようになる。
以下、前述のマスクパターンを構成する方法を用いて設計したレーザーマスクについて説明する。
図8は、本発明の第1実施形態によるレーザーマスクを構成する方法を示す例示図である。図に示すように、第1のブロック580´には、前述した基準パターン575Aを位置させ、第2のブロック580´´には、前記基準パターン575Aの反転パターン575Bを位置させる。
このとき、前記マスクパターン575A、575Bは、図4に示す第1実施形態のパターン構成方法によって、マスクにブロック580´と580´´とを個別に設定するが、第1のブロック580´には、円形状の第1透過領域573Aが、前述したように正六角形状に位置しており、第2のブロック580´´には、前記第1遮断領域574Aの逆形状を有する第2遮断領域574Bが、前記第1透過領域573Aと同一の正六角形状に位置している。
しかしながら、本発明は、このような規則性により制限されるものではなく、前記実施形態は、本発明の規則性を有するレーザーマスクを構成する一例に過ぎず、後述する本発明の不規則性を有するレーザーマスクは、このような規則性により制限されることはない。
一方、本実施形態のレーザーマスクは、第1のブロック580´に基準パターン575Aを位置させ、第2のブロック580´´には前記基準パターンの反転パターン575Bを位置させて構成したが、前記第1のブロック580´に反転パターン575Bを位置させ、第2のブロック580´´に基準パターン575Aを位置させて構成することもできる。即ち、本発明の2−ブロックマスクにおいて、前記各ブロック間の順序は任意的なものであり、前記順序に関係なく、1つのブロックには基準パターンを、他の1つのブロックには前記基準パターンの反転パターンを位置させて構成して、2−ショットで結晶化すれば良い。
一方、前記ブロック580´、580´´は、X軸方向のステッピングのための移動距離(即ち、X−ステップ距離Dx)、及びY軸方向のステッピングのための移動距離(即ち、Y−ステップ距離Dy)の基準となり得るが、このとき、前記X−ステッピングのためのX−ステップ距離Dxは、X軸方向への2−ショットのためのマスクまたはステージの移動距離を意味し、前記Y−ステッピングのためのY−ステップ距離Dyは、X軸方向へのレーザービームの照射を完了した後、基板のY軸方向への結晶化を進行させるためのY軸方向へのマスクまたはステージの移動距離を意味する。
且つ、前記X−ステッピングのためのX−ステップ距離Dx、及びY−ステッピングのためのY−ステップ距離Dyは、それぞれX−オーバーラップ及びY−オーバーラップをなくすために、前記ブロック580´、580´´が有する周期性を考慮して設定される。
以下、前述の特徴を有するようにパターンが構成されたマスクについて説明する。図9は、図8に示すレーザーマスク構成方法により製作したレーザーマスクを示す例示図で、前述したように、前記実施形態によるマスク構成方法により構成したレーザーマスクの一部を示している。
図に示すように、前記レーザーマスク570は、第1透過領域573A及び第1遮断領域574Aからなる基準パターン575Aと、第2透過領域573B及び第2遮断領域574Bからなる反転パターン575Bとが位置している。
このとき、前記2つのブロックにより構成されるレーザーマスク570は、一定の規則性を有して形成されたマスクパターン575A及び575Bの透過領域573A及び573Bを除いた遮断領域574A及び574Bに入射する全てのレーザービームを遮断する役割をし、前記レーザーマスク570の材質としては、レーザービームの遮断効果が優れ、反射率の良いアルミニウム系の金属を使用することができる。
一方、図に示す2−ブロックにより構成されたレーザーマスク570は、前述した実施形態(特に、図8に示すブロックの境界領域)と異なる形状を有するが、これは、前記第2のブロック580´´に位置した反転パターン575Bの第2透過領域573Bの形状を考慮してレーザーマスク570を製作すべきであるためである。即ち、前記反転パターン575Bの第2透過領域573Bは、その形状のままマスクの境界を形成することができないため、これを考慮して、マスクの境界領域に、図に示すように所定の遮断領域を形成すべきである。
以下、このようなレーザーマスクを利用してシリコン薄膜を結晶化する過程を説明する。このとき、結晶化する過程は、図7A及び図7Bで説明したような順序で進行し、これに基づいてX軸及びY軸方向への結晶化を説明する。
まず、非晶質シリコンが蒸着されている基板上に、前述の図8または図9に示すレーザーマスクを適用して、1次結晶化を進行させる。
このとき、照射されるレーザーは、前述した完全溶融領域のエネルギー密度を有するレーザーで、前記レーザービームの照射を受けた前記非晶質シリコン薄膜は、円周の境界面に位置した非晶質シリコン薄膜を核として円の中心に結晶が成長し、その結果、放射状のグレインを有する1次結晶である多結晶シリコン薄膜が形成される。
前記1次結晶化が完了すると、前記基板が載置されたステージまたはマスクを、前述したX−ステップ距離DxだけX軸方向に移動した後、2次レーザービームを照射する。
このとき、前記2次レーザービームの照射による2次結晶化は、前記1次結晶化により結晶化したシリコン薄膜を結晶成長のシードとして結晶化が進行することによって、前述したように、前記1次結晶化したシリコン薄膜を中心に、正六角形状のグレイン境界を有する均一な多結晶シリコン薄膜が形成されるようになる。
一方、このような結晶化過程をX軸方向に繰り返して進行させて、前記X軸方向へのレーザーショットが全て行われると、前記マスクまたはステージをY軸方向に(ステージを移動する場合は−Y軸方向に)所定の距離(即ち、Y−ステップ距離Dy)だけ移動した後、前記X軸方向の結晶化工程が終わった部分から開始して、−X軸方向への結晶化工程を進行させる。
その後、前述の方法を繰り返してX軸及びY軸方向への結晶化を進行させると、任意の領域全体に対し結晶化が完了する。
一方、前述のレーザーマスク及びこれを利用した結晶化方法においては、図4または図8に示す第1実施形態による正六角形状を有する基準パターンを例えて説明しているが、本発明はこれに限定されず、図10に示すように、正四角形状に基準パターンを位置させてマスクを構成することもできる。
即ち、図10は、本発明の第2実施形態によるレーザーマスクを示す例示図で、図に示すように、第1のブロック680´には、円形状の第1透過領域673Aと第1遮断領域674Aとからなる正四角形状(詳しくは、前記複数の第1透過領域673Aが集まってなす形状)の基準パターン675Aが位置し、第2のブロック680´´には、前記基準パターン675Aの逆形状を有する、即ち、前記第1透過領域673Aの逆形状を有する第2遮断領域674Bと前記第1遮断領域674Aの逆形状である円形状の第2透過領域673Bとからなる反転パターン675Bが位置している。
このとき、図においては、前記第1透過領域673A及び第2遮断領域674Bが円形状のスリットにより構成されているが、前述したように、本発明はこれに限定されず、正三角形、正四角形、正六角形、正八角形などのような正多角形状に構成することができる。
且つ、前記円形状の第1透過領域673A及び第2遮断領域674Bは、全て同一の大きさを有する必要はない。
以上、規則性を有する基準パターンとこれに対応する反転パターンとから構成された2−ブロックレーザーマスクについて説明したが、本発明はこれに限定されず、不規則的に位置した基準パターンとこれに対応する反転パターンとから構成された2−ブロックレーザーマスクにも適用可能であり、これを、図11を参照して説明する。
図11は、本発明の第3実施形態による不規則性を有するレーザーマスクを示す例示図で、図に示すように、前記レーザーマスク770は、円形状の第1透過領域773A及び第1遮断領域774Aからなる基準パターン775Aが位置する第1のブロック780´と、前記第1透過領域773Aの逆形状を有する第2遮断領域774B及び前記第1遮断領域774Aの逆形状である円形状の第2透過領域773Bからなる反転パターン775Bが位置する第2のブロック780´´とから構成されている。
このとき、前記第1透過領域773A及び第2遮断領域774Bは、前述した第2実施形態とは異なって、その大きさ及び形成位置が異なるように、即ち、不規則的に構成されるが、これを利用して2−ショットで結晶化を進行させることによって、前述した第1及び第2実施形態と同様に、基板の全面に対し均一に結晶化したシリコン薄膜が得られる。
即ち、本発明の2−ショットレーザー結晶化方法は、これに利用される2−ブロックレーザーマスクに構成されるパターンの形状及び位置に関係なく、即ち、規則的でなくても適用可能であり、これにより、シリコン薄膜は、2−ショットにより全面が結晶化するようになる。
一方、図12は、本発明のレーザー結晶化のためのレーザー結晶化エネルギー領域を示すグラフで、ドットパターンの直径が5μmのレーザーマスクに対するレーザー結晶化エネルギー領域を示している。
このとき、図12のグラフは、前記第1実施形態の正六角形パターンのマスクを使用して得た結果であるが、前記第2及び第3実施形態においても同一の結果が得られるはずである。
図に示すように、レーザーマスクのドットパターンの直径が5μmの場合は、レーザーエネルギーが1100mJ/cm以上では、下部に結晶化したパターンが5μm以上可能であることを示し、約1300mJ/cmでは、結晶化した薄膜のドットの直径が5.4μmに増加したことが分かる。
即ち、ステージまたはマスクをX軸またはY軸方向に移動時、0.4μmの2倍の0.8μm以下のアライン誤差が発生しても、本発明の2−ショット結晶化により基板の全面が結晶化するようになる。
例えば、約1300mJ/cmのレーザーエネルギーの場合は、第1のブロックにおいて、マスクの基準パターンよりも0.4μm分だけ大きな結晶化パターンが得られ、その後、第2のブロックにおいても、マスクの基準パターンよりも0.4μm分だけ大きな結晶化パターンが得られるため、各ショット間にステージまたはマスクのアライメント誤差が0.8μm以下であると、本発明の2−ショット結晶化工程が可能である。
以下、本発明により結晶化特性が向上したシリコン薄膜を利用して液晶表示素子を製作する方法を説明する。
まず、図13は、一般的な液晶表示パネルの構造を概略的に示す平面図で、アレイ基板に駆動回路部を集積させた駆動回路一体型液晶表示パネルを示している。
図に示すように、駆動回路一体型液晶表示パネルは、アレイ基板820と、カラーフィルタ基板830と、前記アレイ基板820とカラーフィルタ基板830との間に形成された液晶層(図示せず)とからなっている。
前記アレイ基板820は、複数の単位画素がマトリックス状に配列された画像表示領域の画素部825と、前記画素部825の外郭に位置したゲート駆動回路部824及びデータ駆動回路部823により構成された駆動回路部とからなっている。
このとき、図には示していないが、前記アレイ基板820の画素部825は、基板820上に縦横に配列されて複数の画素領域を定義する複数のゲートライン及びデータラインと、前記ゲートラインとデータラインとの交差領域に形成されたスイッチング素子の薄膜トランジスタと、前記画素領域に形成された画素電極とから構成される。
前記薄膜トランジスタは、画素電極に信号電圧を印加及び遮断するスイッチング素子であり、電界によって電流の流れを調節する一種の電界効果トランジスタ(Field Effect Transistor;FET)である。
一方、アレイ基板820の駆動回路部823、824は、カラーフィルタ基板830に比べて突出した、前記アレイ基板820の長辺の一辺にデータ駆動回路部823が位置し、前記アレイ基板820の短辺の一辺にゲート駆動回路部824が位置する。
このとき、前記ゲート駆動回路部824及びデータ駆動回路部823は、入力される信号を適宜出力させるために、インバータであるCMOS(Complementary Metal Oxide Semiconductor)構造の薄膜トランジスタを用いる。
参考として、前記CMOSは、高速信号処理が要求される駆動回路部の薄膜トランジスタに用いられるMOS構造からなる集積回路の一種で、Pチャネル及びNチャネルのトランジスタを必要とし、速度及び密度の特性は、NMOSとPMOSとの中間形態を示す。
前記ゲート駆動回路部824及びデータ駆動回路部823は、それぞれゲートライン及びデータラインを介して画素電極に走査信号及びデータ信号を供給するための回路であって、外部信号入力端(図示せず)に接続されており、前記外部信号入力端を通して入力される外部信号を調節して前記画素電極に出力する役割をする。
一方、図には示していないが、前記カラーフィルタ基板830の画像表示領域825には、カラーを実現するカラーフィルタと、前記アレイ基板820に形成された画素電極の対向電極である共通電極が形成されている。
このように構成された前記アレイ基板820とカラーフィルタ基板830とは、スペーサにより所定間隔離隔するようにセルギャップが設けられ、画像表示領域の外郭に形成されたシールパターンにより貼り合わされて、単位液晶表示パネルをなす。このとき、前記両基板の貼り合わせは、アレイ基板またはカラーフィルタ基板に形成された貼り合わせキーを通して行われる。
一方、このように、多結晶シリコン薄膜を利用した駆動回路一体型液晶表示パネルは、素子特性に優れており、画像品質が優秀で高精細化が可能で電力の消費が少ないという利点を有する。
以下、このように構成された駆動回路一体型液晶表示パネルに使用される、本発明により製作された結晶化したシリコン薄膜を利用したCMOS液晶表示素子について、その製造工程を通して詳細に説明する。
図14は、本発明の結晶化方法により結晶化したシリコン薄膜を利用して製作したCMOS液晶表示素子を示す例示図である。
ここで、画素部に形成される薄膜トランジスタは、NタイプとPタイプの両方とも可能であり、駆動回路部は、前記画素部と同一のNタイプの薄膜トランジスタまたはPタイプの薄膜トランジスタの何れか1つのタイプも可能で、前記Nタイプの薄膜トランジスタとPタイプの薄膜トランジスタの両方とも形成されたCMOS構造も可能であるが、図においては、便宜上、CMOS液晶表示素子が製作されている場合を示している。
以下、このように構成されるCMOS液晶表示素子の製造方法を説明する。
まず、ガラスのような透明な絶縁物質からなる基板820上に、シリコン酸化膜(SiO)により構成されるバッファ層821を形成する。
次いで、前記バッファ層821が形成された基板820上に、多結晶シリコンからなるアクティブ層824N、824Pを形成する。
前記アクティブ層824N、824Pは、基板820の全面に非晶質シリコン薄膜を蒸着した後、本発明の2−ブロックレーザーマスクを利用して、2−ショットで横方向結晶化することにより、ショットマークなしに均一な結晶化特性を有する多結晶シリコン薄膜を形成し、その後、フォトリソグラフィ工程を通して前記結晶化した多結晶シリコン薄膜をパターニングすることにより、それぞれNMOS及びPMOS領域に形成する。
その後、アクティブ層824N、824Pが形成された基板820の全面にゲート絶縁膜825Aを蒸着する。
次いで、前記ゲート絶縁膜825Aが蒸着された基板820の所定領域(即ち、アクティブ層824N、824Pのチャネル形成領域)上に、モリブデン(Mo)、アルミニウム(Al)またはアルミニウム合金などから構成されるゲート電極850N、850Pを形成する。
前記ゲート電極850N、850Pは、ゲート絶縁膜825Aが形成された基板820の全面にゲートメタルを蒸着した後、フォトリソグラフィ工程を通して形成する。
次いで、Nドーピング工程及びPドーピング工程を順次施して、それぞれNタイプの薄膜トランジスタ(即ち、アクティブ層824Nの所定領域にNイオンが注入されてソース/ドレイン領域822N、823Nが形成された薄膜トランジスタ)及びPタイプの薄膜トランジスタを形成する。
このとき、Nタイプの薄膜トランジスタのソース領域822N及びドレイン領域823Nは、電子を供与できる燐(P)などの5族元素を注入して形成する。
また、Pタイプの薄膜トランジスタのソース/ドレイン領域822P、823Pは、正孔を供与できるホウ素(B)などの3族元素を注入して形成する。
次いで、前記基板820の全面に層間絶縁膜825Bを蒸着した後、フォトリソグラフィ工程を通して、ソース/ドレイン領域822N、822P、823N、823Pの一部を露出させるコンタクトホール(図示せず)を形成する。
最後に、前記コンタクトホールを介してソース/ドレイン領域822N、822P、823N、823Pと電気的に接続するソース/ドレイン電極851N、851P、852N、852Pを形成すると、図に示すようにCMOS液晶表示素子が完成する。
一方、前記実施形態では、本発明により結晶化したシリコン薄膜を利用して、液晶表示素子及び液晶表示パネルを製作する方法について説明しているが、本発明はこれに限定されず、有機ELなどの素子にも適用可能である。
順次的横方向結晶化に使用されるレーザーマスクの一例を示す例示図である。 図1Aに示すレーザーマスクを使用して結晶化したシリコン薄膜を概略的に示す平面図である。 図1Bに示す結晶化したシリコン薄膜のエッジ部Eを拡大して示す平面図である。 図1Aに示すレーザーマスクを使用してシリコン薄膜を結晶化する工程を順次示す平面図である。 図1Aに示すレーザーマスクを使用してシリコン薄膜を結晶化する工程を順次示す平面図である。 図1Aに示すレーザーマスクを使用してシリコン薄膜を結晶化する工程を順次示す平面図である。 本発明の第1実施形態によるレーザーマスクに周期性を有するパターンを構成する方法を示す例示図である。 図4において、第1実施形態の規則性を有するレーザーマスクのビーム通過領域の大きさを示す例示図である。 図4に示すパターン構成方法により製作した2−ブロックレーザーマスクの一部を各ブロック別に示す例示図である。 図4に示すパターン構成方法により製作した2−ブロックレーザーマスクの一部を各ブロック別に示す例示図である。 図6Aに示すレーザーマスクを適用して、シリコン薄膜を結晶化する過程を示す例示図である。 図6Bに示すレーザーマスクを適用して、シリコン薄膜を結晶化する過程を示す例示図である。 本発明の第1実施形態によるレーザーマスクを構成する方法を示す例示図である。 図8に示すレーザーマスク構成方法により製作したレーザーマスクを示す例示図である。 本発明の第2実施形態によるレーザーマスクを示す例示図である。 本発明の第3実施形態による不規則性を有するレーザーマスクを示す例示図である。 本発明によるレーザー結晶化のためのレーザー結晶化エネルギー領域を示すグラフである。 液晶表示パネルの構造を概略的に示す平面図である。 本発明による結晶化方法により結晶化したシリコン薄膜を利用して製作した液晶表示素子を示す例示図である。 照射されるレーザーエネルギー密度に対する結晶化したシリコン薄膜のグレインサイズを示すグラフである。 図15に示すグラフにおいて、レーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図である。 図15に示すグラフにおいて、レーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図である。 図15に示すグラフにおいて、レーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図である。 図15に示すグラフにおいて、レーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図である。 図15に示すグラフにおいて、レーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図である。 図15に示すグラフにおいて、レーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図である。 図15に示すグラフにおいて、レーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図である。 図15に示すグラフにおいて、レーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図である。 図15に示すグラフにおいて、レーザーエネルギー密度によるシリコン結晶化メカニズムを示す断面図である。 一般的な横方向結晶化による結晶化過程を順次示す断面図である。 一般的な横方向結晶化による結晶化過程を順次示す断面図である。 一般的な横方向結晶化による結晶化過程を順次示す断面図である。
符号の説明
375A ビーム通過領域、410 基板、412 非晶質シリコン薄膜、412´ 多晶質シリコン薄膜、473A 第1透過領域、473B 第2透過領域、474A 第1遮断領域、474B 第2遮断領域、475A マスクパターン(基準パターン)、475B マスクパターン(反転パターン)、480´ 第1のブロック、480´´ 第2のブロック、490 グレイン境界、570 レーザーマスク、573A 第1透過領域、573B 第2透過領域、574A 第1遮断領域、574B 第2遮断領域、575A マスクパターン(基準パターン)、575B マスクパターン(反転パターン)、580´ 第1のブロック、580´´ 第2のブロック、670 レーザーマスク、673A 第1透過領域、673B 第2透過領域、674A 第1遮断領域、674B 第2遮断領域、675A マスクパターン(基準パターン)、675B マスクパターン(反転パターン)、680´ 第1のブロック、680´´ 第2のブロック、770 レーザーマスク、773A 第1透過領域、773B 第2透過領域、774A 第1遮断領域、774B 第2遮断領域、775A マスクパターン(基準パターン)、775B マスクパターン(反転パターン)、780´ 第1のブロック、780´´ 第2のブロック、820 アレイ基板、824N、824P アクティブ層。

Claims (21)

  1. 第1のブロックと第2のブロックの2つのブロックにより構成され、前記第1のブロックに形成された基準パターンと、前記第2のブロックに形成された、前記基準パターンの反転パターンとを含み、
    前記基準パターンは、複数の第1透過領域と1つの第1遮断領域とから構成され、前記反転パターンは、複数の第2遮断領域と1つの第2透過領域とから構成される
    ことを特徴とするレーザーマスク。
  2. 前記第1透過領域と前記第2遮断領域とは、互いに同一の形状を有し、前記第1遮断領域と前記第2透過領域とは、互いに同一の形状を有することを特徴とする請求項1に記載のレーザーマスク。
  3. 前記第1透過領域及び前記第2遮断領域は、円形状に構成されることを特徴とする請求項1に記載のレーザーマスク。
  4. 前記第1透過領域の半径は、隣接する2つの前記第1透過領域の中心間の距離の1/2より小さいことを特徴とする請求項3に記載のレーザーマスク。
  5. 前記隣接する複数の第1透過領域の中心は、正三角形、正四角形、正六角形及び正八角形のような正多角形状を構成することを特徴とする請求項1に記載のレーザーマスク。
  6. 前記基準パターンは、規則性を有するように構成されることを特徴とする請求項1に記載のレーザーマスク。
  7. 前記複数の第1透過領域は、前記第1のブロックに大きさ及び形成位置が異なるように形成されていることを特徴とする請求項1に記載のレーザーマスク。
  8. 第1のブロックに形成された基準パターンと、第2のブロックに形成された、前記基準パターンの反転パターンとを含み、前記基準パターンは、複数の第1透過領域と1つの第1遮断領域とから構成され、前記反転パターンは、複数の第2遮断領域と1つの第2透過領域とから構成されるレーザーマスクを利用した結晶化方法であって、
    (a)シリコン薄膜が形成された基板を提供する段階と、
    (b)前記シリコン薄膜の所定領域上に、前記レーザーマスクの前記第1のブロックを位置させ、前記第1のブロックを通して1次レーザービームを照射して1次結晶化領域を形成する段階と、
    (c)前記レーザーマスクまたは基板を、前記照射されたシリコン薄膜の所定領域上に前記レーザーマスクの第2のブロックが位置するように移動させ、前記第2のブロックを通して2次レーザービームを照射して2次結晶化領域を形成する段階と
    を含み、
    前記1次レーザービームが照射される領域と前記2次レーザービームが照射される領域とはオーバーラップしない
    ことを特徴とするレーザー結晶化方法。
  9. 前記第1透過領域と前記第2遮断領域とは、互いに同一の形状を有し、前記第1遮断領域と前記第2透過領域とは、互いに同一の形状を有することを特徴とする請求項8に記載のレーザー結晶化方法。
  10. 前記第1透過領域及び前記第2遮断領域は、円形状に構成されることを特徴とする請求項8に記載のレーザー結晶化方法。
  11. 前記第1透過領域の半径は、隣接する2つの前記第1透過領域の中心間の距離の1/2より小さいことを特徴とする請求項10に記載のレーザー結晶化方法。
  12. 前記隣接する複数の第1透過領域の中心は、正三角形、正四角形、正六角形及び正八角形のような正多角形状を構成することを特徴とする請求項8に記載のレーザー結晶化方法。
  13. 前記第1透過領域の全ては、同一の大きさを有することを特徴とする請求項8に記載のレーザー結晶化方法。
  14. 前記第1透過領域は、互いに異なる大きさを有することを特徴とする請求項8に記載のレーザー結晶化方法。
  15. 前記基準パターンは、規則性を有するように構成されることを特徴とする請求項8に記載のレーザー結晶化方法。
  16. 前記複数の第1透過領域は、前記第1のブロックに大きさ及び形成位置が異なるように形成されていることを特徴とする請求項8に記載のレーザー結晶化方法。
  17. 前記1次レーザービーム及び前記2次レーザービームは、前記シリコン薄膜を完全溶融するエネルギー密度を有することを特徴とする請求項8に記載のレーザー結晶化方法。
  18. 前記1次結晶化領域を形成する段階および前記2次結晶化領域を形成する段階における結晶化は、順次的横方向結晶化であることを特徴とする請求項8に記載のレーザー結晶化方法。
  19. 前記(b)及び(c)の段階をX軸方向に繰り返す段階と、
    レーザーマスクまたは基板をY軸方向に移動させる段階と、
    前記(b)及び(c)の段階を−X軸方向に繰り返す段階と
    をさらに含むことを特徴とする請求項8に記載のレーザー結晶化方法。
  20. スイッチング素子として薄膜トランジスタを含む平板表示装置の製造方法において、
    シリコン薄膜が形成された基板を提供する段階と、
    前記薄膜トランジスタのアクティブ層を形成するために、第1のブロックと第2のブロックの2つのブロックにより構成され、前記第1のブロックに形成された基準パターンと、前記第2のブロックに形成された、前記基準パターンの反転パターンとを含み、前記基準パターンは、複数の第1透過領域と1つの第1遮断領域とから構成され、前記反転パターンは、複数の第2遮断領域と1つの第2透過領域とから構成されるレーザーマスクを用いて、前記シリコン薄膜を多結晶シリコン薄膜に結晶化する段階と
    を含み、
    前記シリコン薄膜を多結晶シリコン薄膜に結晶化する段階は、
    前記シリコン薄膜の所定領域上に、前記レーザーマスクの第1のブロックを位置させ、前記第1のブロックを通して1次レーザービームを照射して1次結晶化領域を形成する段階と、
    前記レーザーマスクまたは基板を、前記照射されたシリコン薄膜の所定領域上に前記レーザーマスクの第2のブロックが位置するように移動させ、前記第2のブロックを通して2次レーザービームを照射して2次結晶化領域を形成する段階と
    をさらに含み、
    前記1次レーザービームが照射される領域と前記2次レーザービームが照射される領域とはオーバーラップしない
    ことを特徴とする平板表示装置の製造方法。
  21. 前記平板表示装置は、液晶表示装置または有機EL素子であることを特徴とする請求項20に記載の平板表示装置の製造方法。
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Families Citing this family (17)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100400510B1 (ko) * 2000-12-28 2003-10-08 엘지.필립스 엘시디 주식회사 실리콘 결정화 장치와 실리콘 결정화 방법
US6792029B2 (en) * 2002-03-27 2004-09-14 Sharp Laboratories Of America, Inc. Method of suppressing energy spikes of a partially-coherent beam
US7611577B2 (en) * 2004-03-31 2009-11-03 Nec Corporation Semiconductor thin film manufacturing method and device, beam-shaping mask, and thin film transistor
KR100662782B1 (ko) * 2004-04-14 2007-01-02 엘지.필립스 엘시디 주식회사 레이저 마스크 및 이를 이용한 결정화방법
TWI299431B (en) * 2005-08-23 2008-08-01 Au Optronics Corp A mask for sequential lateral solidification (sls) process and a method thereof
KR100721957B1 (ko) * 2005-12-13 2007-05-25 삼성에스디아이 주식회사 다결정 실리콘층, 상기 다결정 실리콘층을 이용한 평판표시 장치 및 이들을 제조하는 방법
US8488668B2 (en) * 2007-06-15 2013-07-16 Qualcomm Incorporated Adaptive coefficient scanning for video coding
CN101599495B (zh) * 2008-06-04 2013-01-09 清华大学 薄膜晶体管面板
CN101582450B (zh) * 2008-05-16 2012-03-28 清华大学 薄膜晶体管
CN101582445B (zh) * 2008-05-14 2012-05-16 清华大学 薄膜晶体管
CN101587839B (zh) * 2008-05-23 2011-12-21 清华大学 薄膜晶体管的制备方法
US7980997B2 (en) * 2008-10-23 2011-07-19 University Of Southern California System for encouraging a user to perform substantial physical activity
JP5093815B2 (ja) * 2009-02-13 2012-12-12 株式会社日本製鋼所 アモルファス膜の結晶化方法および装置
KR101135537B1 (ko) * 2010-07-16 2012-04-13 삼성모바일디스플레이주식회사 레이저 조사 장치
US8129215B1 (en) * 2011-04-01 2012-03-06 James P Campbell Method for producing high temperature thin film silicon layer on glass
CN102520576B (zh) * 2011-11-18 2014-02-05 中国电子科技集团公司第五十五研究所 图形化衬底工艺用步进光刻掩膜版数据拼接方法和修正法
CN105185694A (zh) * 2015-08-20 2015-12-23 京东方科技集团股份有限公司 多晶硅薄膜形成方法、掩膜版、多晶硅薄膜和薄膜晶体管

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3658213B2 (ja) * 1998-11-19 2005-06-08 富士通株式会社 半導体装置の製造方法
JP4402225B2 (ja) * 1999-11-18 2010-01-20 大日本印刷株式会社 パタンデータの作成方法および付加パタン付きフォトマスクの描画方法
JP2002151408A (ja) 2000-11-15 2002-05-24 Sony Corp 半導体薄膜の製造方法
KR100424593B1 (ko) 2001-06-07 2004-03-27 엘지.필립스 엘시디 주식회사 실리콘 결정화방법
JP4109026B2 (ja) 2001-07-27 2008-06-25 東芝松下ディスプレイテクノロジー株式会社 アレイ基板を製造する方法およびフォトマスク
US7192479B2 (en) 2002-04-17 2007-03-20 Sharp Laboratories Of America, Inc. Laser annealing mask and method for smoothing an annealed surface
JP2004111527A (ja) * 2002-09-17 2004-04-08 Matsushita Electric Ind Co Ltd 半導体装置の製造方法/マスクパターンの生成方法
AU2003283833A1 (en) * 2002-11-27 2004-06-18 Canon Kabushiki Kaisha Producing method for crystalline thin film
KR100997971B1 (ko) 2003-11-19 2010-12-02 삼성전자주식회사 결정화용 마스크, 이를 이용한 결정화 방법 및 이를포함하는 박막 트랜지스터 표시판의 제조 방법

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