JP4283014B2 - 固体撮像装置、固体撮像装置の駆動方法およびカメラ - Google Patents
固体撮像装置、固体撮像装置の駆動方法およびカメラ Download PDFInfo
- Publication number
- JP4283014B2 JP4283014B2 JP2003075769A JP2003075769A JP4283014B2 JP 4283014 B2 JP4283014 B2 JP 4283014B2 JP 2003075769 A JP2003075769 A JP 2003075769A JP 2003075769 A JP2003075769 A JP 2003075769A JP 4283014 B2 JP4283014 B2 JP 4283014B2
- Authority
- JP
- Japan
- Prior art keywords
- register
- unit register
- unit
- shift
- transistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
- 238000003384 imaging method Methods 0.000 title claims description 41
- 238000000034 method Methods 0.000 title claims description 10
- 230000002457 bidirectional effect Effects 0.000 claims description 15
- 238000010586 diagram Methods 0.000 description 24
- 101100328957 Caenorhabditis elegans clk-1 gene Proteins 0.000 description 8
- 239000003990 capacitor Substances 0.000 description 7
- 101100113692 Caenorhabditis elegans clk-2 gene Proteins 0.000 description 6
- 238000007599 discharging Methods 0.000 description 4
- 230000006870 function Effects 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 230000009977 dual effect Effects 0.000 description 2
- 230000003321 amplification Effects 0.000 description 1
- 239000000284 extract Substances 0.000 description 1
- 238000003199 nucleic acid amplification method Methods 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
- 230000035945 sensitivity Effects 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/50—Control of the SSIS exposure
- H04N25/53—Control of the integration time
- H04N25/531—Control of the integration time by controlling rolling shutters in CMOS SSIS
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/70—SSIS architectures; Circuits associated therewith
- H04N25/71—Charge-coupled device [CCD] sensors; Charge-transfer registers specially adapted for CCD sensors
- H04N25/74—Circuitry for scanning or addressing the pixel array
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/70—SSIS architectures; Circuits associated therewith
- H04N25/76—Addressed sensors, e.g. MOS or CMOS sensors
- H04N25/77—Pixel circuitry, e.g. memories, A/D converters, pixel amplifiers, shared circuits or shared components
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/70—SSIS architectures; Circuits associated therewith
- H04N25/76—Addressed sensors, e.g. MOS or CMOS sensors
- H04N25/779—Circuitry for scanning or addressing the pixel array
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Shift Register Type Memory (AREA)
- Transforming Light Signals Into Electric Signals (AREA)
- Solid State Image Pick-Up Elements (AREA)
Description
【０００１】
【発明の属する技術分野】
ダイナミック型シフトレジスタを含むＭＯＳ型固体撮像装置に関し、特にダイナミック型シフトレジスタのリセット動作の改良に関する。
【０００２】
【従来の技術】
近年、固体撮像装置の一つとして、増幅型ＭＯＳセンサを用いた固体撮像装置が注目されている。この固体撮像装置は、画素を表すセル毎にフォトダイオードで検出した信号をトランジスタで増幅するものであり、高感度という特徴を持つ。
【０００３】
このような固体撮像装置では、二次元に配列された画素を有する撮像素子を水平走査又は垂直走査する回路としてダイナミック型シフトレジスタが用いられ、回路の簡素化、高密度化及び低消費電力化を図っている。
【０００４】
図１０は、従来の一般的な固体撮像装置の概略構成を示すブロック図である。この固体撮像装置は、二次元に配列された画素を有する撮像部６１と、撮像部６１の一行を選択するための行選択信号を出力するシフトレジスタ６２と、選択された行内の一画素するための画素選択信号を出力するシフトレジスタ６３と、選択された画素から画素信号を取り出す画素処理部６４と、取り出された画素信号を増幅するプリアンプ６５とを備える。
【０００５】
図１１は、従来のＮＭＯＳダイナミック型のシフトレジスタの構成を示すブロック図であり、シフトレジスタ６２、６３として利用される。同図では４段しか示していないが、実際には数百〜数千段ある。
【０００６】
図中の、クロック信号Clk1及びClk2はシフト動作の基準となる二相クロック信号である。Clk1信号は奇数番目の単位レジスタに、Clk2信号は偶数番目の単位レジスタに入力される。これにより、奇数番目の単位レジスタと偶数番目の単位レジスタとが交互に動作する。
【０００７】
同図において、Res１、Res２・・・（何れか１つを指す場合はResと略す）は、入力信号Inの論理値をクロック信号Clkに同期して内部に記憶し、記憶した論理値を出力信号Out及び出力信号Nextとして出力する単位レジスタである。出力信号Outは、行選択信号又は列選択信号として撮像部６１に出力される。
【０００８】
トランジスタTr3-1、3-2、・・・（同Tr3）は、単位レジスタへの入力信号Inをリセットするリセットトランジスタである。ここで、入力信号のリセットというのは、入力信号をローレベルにすることによって、当該入力信号線に接続された容量（トランジスタのゲート容量など）を放電することをいう。すなわち、トランジスタTr3は、それが接続された入力信号Inを有する単位レジスタの次段の単位レジスタの出力Outがハイレベルのときに、当該入力信号Inをローレベルにすることによって、当該単位レジスタと前段の単位レジスタ内の記憶素子に蓄積された電荷を放電することによって入力信号Inをリセットする。もし、リセットしなければ単位レジスタ内部にいつまでも電荷が残りハイレベルを保ち続けるからである。リセットされた後ローレベル又はハイインピーダンスとなる。
【０００９】
トランジスタTr7-1、7-2、・・・（同Tr7）は、リセット制御信号RSがハイレベルになったときオンし、全単位レジスタの入力信号を一斉にリセットする。リセット制御信号RSは、単位レジスタRes1の入力信号In1にスタートパルスに同期して、その直前にリセットパルスとして入力される。これによりスタートパルス印加前に全ての単位レジスタがリセット（オールクリア）される。
【００１０】
図１２（ａ）は、単位レジスタResの構成を示す回路図である。同図のように単位レジスタは、ＮＭＯＳ型トランジスタTr1、Tr2、キャパシタC1からなる。入力信号Inがハイレベルである場合の単位レジスタの動作説明図を図１２（ｂ）に示す。入力信号Inがハイレベルであるので、クロック信号Clkの立ち上がり（図中▲１▼）の前に、トランジスタTr1のゲート容量及びキャパシタＣ１の電位によってトランジスタTr1のゲート電極は既にハイレベルになっている。この状態で、クロック信号Clkがローレベルからハイレベルに立ち上がると、トランジスタTr１のゲート電圧InがキャパシタＣ１を介して昇圧（ブートと呼ぶ）される（同▲２▼）。また、トランジスタTr１はゲートにハイレベルよりも高電圧が印加されることから、ゲート下のポテンシャルがクロック信号（clk）のハイレベル以上になりOut信号にClk信号のハイレベルが出力される（同▲３▼）。Clk信号が立ち下がると、Out信号にClk信号のローレベルが出力される。このとき、Next信号は、一方向性トランジスタTr２のゲート容量にハイレベルが保持されているので、Clk信号が立ち下がった後もハイレベルを出力する。
【００１１】
一方、入力信号Inがローレベル（又はフローティング）である場合にはブートトランジスタTr1がオンしないので、クロック信号Clkが入力されても、Out信号、Next信号は何れもローレベル（又はフローティング）のままである。
【００１２】
図１３は、図１１におけるトランジスタTr3によるリセット動作を示すタイムチャートである。同図においてクロック信号Clk1、Clk2、入力信号(又は内部データ)In1〜In4、出力信号Out1〜Out4は、図１１、図１２に示した信号である。
【００１３】
まず、単位レジスタRes1は、Clk1信号（図中▲１▼）に同期して、ハイレベル状態の入力信号In1をブートして内部に保持する（同▲２▼）。これと同時に画素選択信号としてOut1信号を出力し（同▲３▼）、Next1信号をハイレベルにする。ハイレベルになったNext1信号は入力信号In2として次段の単位レジスタRes2に入力される。このとき、Clk1信号が入力された他の奇数番目の単位レジスタは、その入力がローレベル（又はハイインピーダンス状態)であり、内部にハイレベルを取り込まない。
【００１４】
このようにして、クロック信号Clk1が供給されている奇数番目の単位レジスタのシフト動作がなされる。次のクロック信号Clk2によって、偶数番目の単位レジスタのシフト動作がなされる。
【００１５】
また、出力信号Out2がハイレベルになると、リセットトランジスタTr3-1がオンになり、入力信号In1をローレベルにするので、単位レジスタRes1内部のトランジスタTr1のゲート容量及びキャパシタC1の電荷が放電し、単位レジスタRes1の入力信号In1がリセットされる。
【００１６】
出力信号Out3がハイレベルになると、リセットトランジスタTr3-2がオンになり、単位レジスタRes2内のトランジスタTr1のゲート容量及びキャパシタC1が放電すると共に、Next1信号線を介して単位レジスタRes1内の一方向性トランジスタTr2のゲート容量の電荷も放電する。これにより単位レジスタRes2の入力信号In2がリセットされる。
【００１７】
このようにして、ＮＭＯＳ型ダイナミックシフトレジスタは、ハイレベルを出力した単位レジスタが、前段の単位レジスタへの入力信号Inをリセットする。
このようなシフトレジスタの先行技術として特許文献１がある。特許文献１では、単位レジスタ間を順方向に接続するトランジスタ群と、逆方向に接続するトランジスタ群を備えることによりシフト方向を選択可能な双方向シフトレジスタを開示している。
【００１８】
図１４は、従来の双方向レジスタの構成を示すブロック図である。同図は、図１０に示したシフトレジスタと比較して、トランジスタTr4-1、Tr4-2、・・・（何れか１つを指す場合はTr4と略す）と、トランジスタTr5-1、Tr5-2、・・・（同Tr5）と、トランジスタTr8-1、Tr8-2、・・・（同Tr8）と、トランジスタTr9-1、Tr9-2、・・・（同Tr9）と、トランジスタTr10-1、Tr10-2、・・・（同Tr10）とが追加されている点と、制御信号Norm及びRevが指定される点とが異なるので、異なる点を中心に説明する。
【００１９】
制御信号Norm、Revは、シフト方向を指定する信号であり、(Norm、Rev)＝（ハイレベル、ローレベル）である場合には順方向シフト動作を指定し、(Norm、Rev)＝（ローレベル、ハイレベル）である場合には逆方向シフト動作を指定する。
【００２０】
トランジスタTr4は、制御信号Normがハイレベルのときオンになり、単位レジスタの入出力を順方向に接続する。また、トランジスタTr10も、制御信号Normがハイレベルのときオンになり、単位レジスタの出力をリセットトランジスタTr3に伝達する。
【００２１】
トランジスタTr5は、制御信号Revがハイレベルのときオンになり、単位レジスタの入出力を逆に接続する。また、トランジスタTr9も、制御信号Revがハイレベルのときオンになり、単位レジスタの出力をリセットトランジスタTr8に伝達する。
【００２２】
順方向シフト動作では、トランジスタTr4及びTr10がオン、Tr5及びTr9がオフになっている。この状態で、出力信号をハイレベルに出力した単位レジスタは、前段（シフト方向後方）の単位レジスタの入力信号に接続されたトランジスタTr3をトランジスタTr10を介してオンにする。これにより前段の単位レジスタの入力信号をリセットする。
【００２３】
逆方向シフト動作では、トランジスタTr5及びTr9がオンに、Tr4及びTr10がオフになっている。この状態で、出力信号をハイレベルに出力した単位レジスタは、前段（シフト方向後方）の単位レジスタの入力信号に接続されたトランジスタTr8をトランジスタTr9を介してオンにする。これにより前段の単位レジスタの入力信号をリセットする。
【００２４】
トランジスタTr7は、図１１と同様にオールクリア用のトランジスタであり、スタートパルスに同期してその直前にリセット制御信号RSによってオンする。
また、特許文献２は、ズームモード等に対応するためシフトレジスタの途中からスタートを開始するシフトレジスタを開示している。例えば、シフトレジスタの１／４の位置からスタートし３／４の位置までを走査することを可能にしている。
【００２５】
【特許文献１】
特開昭６４−４４１７８号公報
【００２６】
【特許文献２】
特開平６−１０４２９２号公報
【００２７】
【発明が解決しようとする課題】
上記従来技術によれば、スタートパルスを印加した後レジスタ信号（出力信号Outのパルス）が最終段に到達するまでに、次のスタートパルスを印加することができないという問題がある。
【００２８】
言い換えれば、従来のシフトレジスタは、シフト動作時に撮像素子に対して単位レジスタの１つだけがパルスを出力しながらシフトするという通常の走査を行うことができるが、２つのパルスを同時に出力しながらシフトするという特殊な走査を行うことができない。ここで、特殊な走査は、例えば、２つのパルスを同時に出力し、１つ目のパルスによって撮像素子をリセットし２つの目のパルスによって撮像素子から画素値の読み出しを行う電子シャッタ機能等に利用される。この場合の電子シャッタ機能とは、1つ目のパルスから２つ目のパルスまでの間隔によって撮像素子の露光時間を調整することをいう。
【００２９】
また、上記従来技術における双方向レジスタでは、上記の問題に加えて、通常シフト用のリセット回路（図１４中のトランジスタTr3、Tr10）、逆方向シフト用のリセット回路（トランジスタTr8、Tr9）、オールリセット用回路（トランジスタTr7）を備えるので、数多くのトランジスタを必要とし回路規模が大きくなるという問題がある。
【００３０】
上記問題に鑑み本発明は、簡単な回路構成でシフト動作の途中で次のスタートパルスを印加することができるシフトレジスタを備えた固体撮像装置、固体撮像装置の方法及びカメラを提供することを目的とする。
【００３１】
【課題を解決するための手段】
上記課題を解決するため本発明の固体撮像装置は、ダイナミックロジック回路により形成され、二次元に配列された撮像素子の行又は列を順次選択するためのシフトレジスタを有する固体撮像装置であって、前記シフトレジスタは、信号を保持する複数段の単位レジスタと、複数の第１リセット回路と、複数の第２リセット回路とを有し、各第１リセット回路は、単位レジスタの１つに対応して備えられ、当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に位置する後方単位レジスタの入力信号をリセットし、各第２リセット回路は、単位レジスタの１つに対応して備えられ、当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向前方に位置する前方単位レジスタの入力信号をリセットするよう構成されている。
【００３２】
この構成によれば、第２リセット回路が前方の単位レジスタの入力信号をリセットするので、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。その結果、任意の間隔で２つのパルスを走査する特殊走査をすることができ、例えば電子シャッタに利用することができる。
【００３３】
ここで、前記各第１リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンする第１トランジスタを有し、前記後方単位レジスタへの入力信号線を第１トランジスタを介してローレベルにし、前記各第２リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンする第２トランジスタを有し、前記前方単位レジスタの入力信号線を第２トランジスタを介してローレベルにする構成であってもよい。
【００３４】
この構成によれば、第１、第２リセット回路はそれぞれトランジスタ１つで構成されるので、簡単な回路構成にすることができる。
また、前記前方単位レジスタは、各第２リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタであるように構成してもよい。この構成によれば、前記前方単位レジスタは、例えば、３段、１０段、２０段などシフト方向の前方に位置する任意のレジスタとしておくことができる。
【００３５】
また、本発明の固体撮像装置は、ダイナミックロジック回路により形成され、二次元に配列された撮像素子の行又は列を順次選択するための双方向シフトレジスタを有する固体撮像装置であって、前記双方向シフトレジスタは、信号を保持する複数段の単位レジスタと、複数の第１リセット回路と、複数の第２リセット回路とを有し、各第１リセット回路は、単位レジスタの１つに対応して備えられ、順方向シフト動作時に当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に位置する順方向後方単位レジスタの入力信号をリセットし、逆方向シフト動作時に対応する単位レジスタがハイレベルを出力したとき、当該単位レジスタからシフト方向前方に位置する逆方向前方単位レジスタの入力信号をリセットし、各第２リセット回路は、単位レジスタの１つに対応して備えられ、順方向シフト動作時に、当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向前方に位置する順方向前方単位レジスタの入力信号をリセットし、逆方向シフト動作時に対応する単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に位置する逆方向後方単位レジスタの入力信号をリセットするよう構成されている。
【００３６】
この構成によれば、順方向シフト動作時には、第２リセット回路がシフト方向前方の単位レジスタの入力信号をリセットし、逆方向シフト動作時には、第１リセット回路がシフト方向前方の単位レジスタの入力信号をリセットする。このことから、順方向シフト動作と逆方向シフト動作の何れにおいてもシフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。その結果、順方向シフト動作と逆方向シフト動作の何れにおいても任意の間隔で２つのパルスを走査する特殊走査をすることができ、例えば電子シャッタに利用することができる。
【００３７】
ここで、前記双方向シフトレジスタは、順方向シフト動作において前記複数段の単位レジスタの入出力を順方向に接続する複数の順接続用トランジスタと、逆方向シフト動作において前記複数段の単位レジスタの入出力を逆方向に接続する複数の逆接続用トランジスタとを有し、各第１リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンになりかつグラウンド線に接続された第１トランジスタを有し、前記順方向後方単位レジスタへの入力信号線と第１トランジスタとの間を前記順接続用トランジスタを介して接続するとともに、前記逆方向前方単位レジスタの入力信号線と第１トランジスタとの間を前記逆接続用トランジスタを介して接続し、各第２リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンになりかつグラウンド線に接続された第２トランジスタを有し、前記順方向前方単位レジスタへの入力信号線と第２トランジスタとの間を前記順接続用トランジスタを介して接続するとともに、前記逆方向後方単位レジスタの入力信号線と第２トランジスタとの間を前記逆接続用トランジスタを介して接続している構成としてもよい。
【００３８】
第１、第２ランジスタの各々が順方向シフト動作時におけるリセットトランジスタと逆方向シフト動作時におけるリセットトランジスタを兼用しているので、回路規模を小さくすることができ、通常撮影と電子シャッタ機能のいずれでも上下反転画像を得ることができる。
【００３９】
また、前記順方向前方単位レジスタは、各第２リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタであり、前記逆方向前方単位レジスタは、各第１リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタである構成としてもよい。
【００４０】
また、順方向前方単位レジスタ、逆方向前方単位レジスタは、各第２リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタであるように構成してもよい。この構成によれば、順方向前方単位レジスタ、逆方向前方単位レジスタはそれぞれ例えば、３段、１０段、２０段などシフト方向の前方に位置する任意のレジスタとしておくことができる。
【００４１】
また、本発明の固体撮像装置の駆動方法及びカメラも上記と同様の手段、作用、効果を有する。
【００４２】
【発明の実施の形態】
＜実施の形態１＞
図１は、本発明の実施の形態１におけるシフトレジスタの構成を示すブロック図である。このシフトレジスタは、図１０に示した固体撮像装置を備えるカメラにおいて、行選択信号を出力するシフトレジスタ６２、画素選択信号を出力するシフトレジスタ６３の何れか、又は両者として備えられる。図１では便宜上４段しか図示していないが、実際には画素数に応じて数百〜数千の段数が存在する。
【００４３】
図１のようにシフトレジスタは、単位レジスタRes1、Res2、・・・（何れか１つを指す場合はResと略す）と、トランジスタTr3-1、Tr3-2・・・（同Tr3）と、トランジスタTr8-3、Tr8-4・・・（同Tr8）とを備え、シフト方向後方の単位レジスタに加えて、シフト方向前方にある単位レジスタの入力信号をリセットするように構成されている。
【００４４】
単位レジスタResは、入力信号Inの論理値をクロック信号Clkに同期して内部に記憶し、記憶した論理値を出力信号Out及び出力信号Nextとして出力する。ここで論理値はハイレベルとフローティングの２状態の何れか又はハイレベルとローレベルの２つの状態の何れかである。ただし、入力信号Inに現れる電圧は、単位レジスタ内部でブートされるので一時的にハイレベルよりも高電圧になる。単位レジスタresの個々の構成は図１２（ａ）に示した構成と同じであり、内部動作タイミングも図１２（ｂ）と同じであるので説明を省略する。
【００４５】
トランジスタTr3は、当該トランジスタTr3が入力信号Inに接続された単位レジスタの次段の単位レジスタの出力Outがハイレベルのときに、当該入力信号Inをローレベルにすることによって、単位レジスタ内の記憶素子に蓄積された電荷を放電するためのリセットトランジスタである。もし、リセットしなければ単位レジスタ内部にいつまでも電荷が残りハイレベルを出力し続けるからである。リセットされた次のクロック信号では出力信号Out及びNextは、ローレベル出力又はハイインピーダンスとなる。
【００４６】
トランジスタTｒ8は、当該トランジスタTr8が入力信号Inに接続された単位レジスタの前々段の単位レジスタの出力Outがハイレベルのときに、当該入力信号Inをローレベルにすることによって、単位レジスタ内の記憶素子に蓄積された電荷を放電するためのリセットトランジスタである。その結果、各単位レジスタは、出力信号Outをハイレベルにしたとき、３段前方の単位レジスタの入力信号Inをリセットすることになる。
【００４７】
図２（ａ）は、図１に示したシフトレジスタにおいて１つの単位レジスタだけが出力信号を出力する通常走査モードにおける動作タイミングを示すタイムチャートである。同図においてクロック信号Clk1、Clk2、出力信号Outは、図１に示した信号である。出力信号Outはクロック信号Clk1、Clk2に同期して、順にシフトされる。同図のように通常走査モードでは、スタートパルスは１つのみが印加された結果、シフトレジスタの出力信号Out中の１つのみがパルスを出力することになる。
【００４８】
同図（ｂ）は、図１に示したシフトレジスタにおいて２つ単位レジスタが出力信号を出力する特殊走査モードにおける動作タイミングを示すタイムチャートである。同図では、４クロックの間隔をおいて２つのスタートパルスが印加された場合の様子を示している。その結果、各出力Outには、２つのパルスがスタートパルスと同じ間隔をおいて出力される。例えば、本シフトレジスタが、図１０に示したシフトレジスタ６２である場合、1つ目のパルスは、撮像素子の１行をリセットするためのパルスとして、２つ目のパルスは、当該１行から画素値を読み出すためのパルスとして利用され、電子シャッタに利用できる。
【００４９】
以上説明してきたように本実施の形態におけるシフトレジスタは、単位レジスタResがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に隣接する単位レジスタの入力信号をリセットするためのトランジスタTr3と、単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向前方に位置する単位レジスタの入力信号をリセットするためのトランジスタTr8を備える。これにより、前方の単位レジスタの入力信号をクリアするので、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。その結果、任意の間隔で２つのパルスを走査する特殊走査をすることができ、例えば電子シャッタに利用することができる。
【００５０】
＜実施の形態２＞
図３は、本発明の実施の形態２における双方向シフトレジスタの構成を示す図である。同図の双方向レジスタは、単位レジスタRes1、Res2、・・・（何れか１をResと略す）トランジスタTr4-1、Tr4-2、・・・（同Tr4）と、トランジスタTr5-1、Tr5-2、・・・（同Tr5）と、トランジスタTr3-1、Tr3-2、・・・（同Tr3）と、トランジスタTr8-1、Tr8-2、・・・（同Tr8）とを備える。また、図中の制御信号Norm、Revは、シフト方向を指定する信号であり、(Norm、Rev)＝（ハイレベル、ローレベル）である場合には順方向シフト動作を指定し、(Norm、Rev)＝（ローレベル、ハイレベル）である場合には逆方向シフト動作を指定する。
【００５１】
トランジスタTr4は、順方向シフト動作時に（制御信号Normがハイレベルのとき）オンになり、単位レジスタの入出力を順方向に接続する。
トランジスタTr5は、逆方向シフト動作時に（制御信号Revがハイレベルのとき）オンになり、単位レジスタの入出力を逆方向に接続する。
【００５２】
トランジスタTr3及びトランジスタTr8は、順方向シフト動作の場合も逆方向シフト動作の場合も、出力信号をハイレベルにした単位レジスタから見てシフト方向後方の単位レジスタの入力信号と、シフト方向の前方の単位レジスタの入力信号とをリセットするために備えられている。以下、（Ａ）順方向シフトにおけるシフト方向前方、（Ｂ）順方向シフトにおけるシフト方向後方、（Ｃ）逆方向シフトにおけるシフト方向前方、（Ｄ）逆方向シフトにおけるシフト方向後方のそれぞれの場合の単位レジスタの入力信号のリセットに分けて説明する。
【００５３】
（Ａ）各トランジスタTr8は、順方向シフト動作時には、ゲートに接続された出力信号Outがハイレベルになったとき、その出力信号Outを出力した単位レジスタのシフト方向前方に位置する単位レジスタ（以下、順方向前方単位レジスタと呼ぶ）の入力信号Inをリセットする。図４は、単位レジスタRes2の出力信号がハイレベルになったとき順方向前方単位レジスタがリセットされる様子を示す説明図である。同図のように、単位レジスタRes2の出力信号Out2がハイレベルになるとトランジスタTr8-5がオンする（同図▲１▼）。その結果、順方向前方単位レジスタ（この場合、単位レジスタRes5）の入力信号がトランジスタTr8-5を介してグランドレベルになりリセットされる（同図▲２▼）。
【００５４】
（Ｂ）各トランジスタTr3は、順方向シフト動作時には、ゲートに接続された出力信号Outがハイレベルになったとき、その出力信号Outを出力した単位レジスタのシフト方向後方に隣接する単位レジスタ（以下、順方向後方単位レジスタと呼ぶ）の入力信号Inをリセットする。図５は、単位レジスタRes2の出力信号がハイレベルになったときの順方向後方単位レジスタの入力信号がリセットされる様子を示す説明図である。同図のように、単位レジスタRes2の出力信号Out2がハイレベルになるとトランジスタTr3-1がオンする（同図▲１▼）。その結果、順方向後方単位レジスタ（この場合、単位レジスタRes1）の入力信号がトランジスタTr3を介してグランドレベルになりリセットされる（同図▲２▼）。
【００５５】
（Ｃ）各トランジスタTr3は、逆方向シフト動作時には、ゲートに接続された出力信号Outがハイレベルになったとき、その出力信号Outを出力した単位レジスタからシフト方向前方に位置する単位レジスタ（以下、逆方向前方単位レジスタと呼ぶ）の入力信号をリセットする。図６は、単位レジスタRes4の出力信号がハイレベルになったとき逆方向前方単位レジスタがリセットされる様子を示す説明図である。同図のように、単位レジスタRes4の出力信号Out4がハイレベルになるとトランジスタTr3-3がオンする（同図▲１▼）。その結果、逆方向前方単位レジスタ（この場合、単位レジスタRes1）の入力信号がトランジスタTr3-3とトランジスタTr5-2とを介してグランドレベルになりリセットされる（同図▲２▼）。
【００５６】
（Ｄ）各トランジスタTr8は、逆方向シフト動作時には、ゲートに接続された出力信号Outがハイレベルになったとき、その出力信号Outを出力した単位レジスタからシフト方向後方に隣接する単位レジスタ（以下、逆方向後方単位レジスタと呼ぶ）の入力信号をリセットする。図７は、単位レジスタRes1の出力信号がハイレベルになったとき逆方向後方単位レジスタがリセットされる様子を示す説明図である。同図のように、単位レジスタRes1の出力信号Out1がハイレベルになるとトランジスタTr8-4がオンする（同図▲１▼）。その結果、逆方向後方単位レジスタ（この場合、単位レジスタRes2）の入力信号がトランジスタTr8-4とトランジスタTr5-3とを介してグランドレベルになりリセットされる（同図▲２▼）。
【００５７】
このように、上記（Ａ）（Ｂ）（Ｃ）（Ｄ）のリセットは、トランジスタTr8、Tr3、Tr3、Tr8によりなされる。言い換えれば、トランジスタTr8は、（Ａ）と（Ｄ）の場合に兼用のリセットトランジスタ、トランジスタTr3は、（Ｂ）と（Ｃ）の場合に兼用のリセットトランジスタとして利用されている。
【００５８】
以上のように構成された本実施の形態における双方向シフトレジスタによれば、順方向シフト動作においても、逆方向シフト動作においても、前方の単位レジスタの入力信号をクリアするので、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。これにより、順方向シフト動作においても、逆方向シフト動作においても、単位レジスタの１つだけが出力信号を出力する通常操作と、単位レジスタの２つが出力信号を出力する特殊走査とを行うことができる。
【００５９】
順方向シフト動作時における通常走査及び特殊走査のタイムチャートは、図２（ａ）、（ｂ）に示したものと同様である。
図８（ａ）は、逆方向シフト動作時における通常走査のタイムチャートを示す。同図（ａ）は、図２（ａ）と比較して、シフト方向のみが異なっている。
【００６０】
図８（ｂ）は、逆方向シフト動作時における特殊走査のタイムチャートを示す。同図（ｂ）は、図２（ｂ）と比較して、シフト方向のみが異なっている。図８（ｂ）において、１つの出力信号Outから出力される２つのパルスの間隔は、２つのスタートパルスの入力タイミングによって任意に設定することができる。本シフトレジスタが、図１０に示したシフトレジスタ６２である場合、1つ目のパルスは、撮像素子の１行をリセットするためのパルスとして、２つ目のパルスは、当該１行から画素値を読み出すためのパルスとして利用され、電子シャッタに利用できる。しかも、図８（ｂ）では逆方向シフトをしているので、固体撮像装置では、上下が反転した画像を得ることができる。
【００６１】
以上説明してきたように本実施の形態における固体撮像装置によれば、順方向シフトの場合も、逆方向シフトの場合も前方の単位レジスタの入力信号をクリアするので、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。しかも、トランジスタTr3、Tr8は、順方向シフトと逆方向シフトとのどちらの場合もリセットトランジスタとして兼用しているので、回路規模を小さくすることができる。
【００６２】
なお、図１に示したシフトレジスタにおいて、トランジスタTr8は、各単位レジスタから３段前方の単位レジスタの入力信号Inをリセットするように設けられているが、２段以上であればよい。例えば、１０段、２０段等任意に設計してもよい。
【００６３】
また、図１及び３のシフトレジスタにおいてトランジスタTr3-1は、入力信号In1がハイレベルとローレベルの２状態をとる場合は、省略してもよい。
また、図３における各単位レジスタへの入力信号Inの直前にトランジスタTr6を挿入し、トランジスタTr6のゲートに単位レジスタとは異なる方のクロック信号を入力したとてもよい。こうすれば、トランジスタTr6は、単位レジスタからみた入力信号Inの負荷容量をトランジスタTr6の一個分に制限し、単位レジスタ内部のブート電圧の低下を防止することができる。例えば、上記の双方向シフトレジスタのように、１つの単位レジスタに対して前段のレジスタ信号を入力するトランジスタと後段のレジスタ信号を入力するトランジスタとが接続される場合に、トランジスタTr6を介して単位レジスタの入力に接続すれば、負荷容量を増大させることを防止することができる。その結果ブート電圧の低下を防止することができる。
【００６４】
また、図９は、他の実施の形態におけるシフトレジスタの構成を示すブロック図である。図１に示したシフトレジスタでは、トランジスタTr8によってハイレベルを出力した単位レジスタの３段前方の単位レジスタの入力信号をリセットしているのに対して、図９に示すシフトレジスタでは、トランジスタTr8によってハイレベルを出力した単位レジスタの2段前方の単位レジスタの入力信号をリセットしている。
【００６５】
【発明の効果】
本発明によれば、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。これにより２つのパルスを同時に出力しながら走査する電子シャッタ機能を実現することができる。
【００６６】
しかも、順方向シフトと逆方向シフトとを選択可能な双方向シフトレジスタにおいて、２つのリセットトランジスタの各々を順方向シフト動作時と逆方向シフト動作時で兼用しているので、回路規模を小さくすることができ、通常撮影と電子シャッタ機能のいずれでも上下反転画像を得ることができる。
【００６７】
また、本発明の固体撮像装置の駆動方法及びカメラも上記と同様の効果を有する。
【図面の簡単な説明】
【図１】実施の形態１におけるシフトレジスタの構成を示すブロック図である。
【図２】（ａ）１つの単位レジスタだけが出力信号を出力する通常走査モードにおける動作タイミングを示すタイムチャートである。
（ｂ）２つの単位レジスタが出力信号を出力する特殊走査モードにおける動作タイミングを示すタイムチャートである。
【図３】実施の形態２における双方向シフトレジスタの構成を示す図である。
【図４】順方向後方単位レジスタがリセットされる様子を示す説明図である。
【図５】順方向シフトにおいて前方にある単位レジスタの入力信号をリセットする様子を示す説明図である。
【図６】 順方向シフトにおいて後方に隣接する単位レジスタの入力信号をリセットする様子を示す説明図である。
【図７】逆方向シフトにおいて前方にある単位レジスタの入力信号をリセットする様子を示す説明図である。
【図８】逆方向シフトにおいて後方に隣接する単位レジスタの入力信号をリセットする様子を示す説明図である。
【図９】他の実施の形態におけるシフトレジスタの構成を示すブロック図である。
【図１０】一般的な固体撮像装置の概略構成を示すブロック図である。
【図１１】従来のＮＭＯＳダイナミック型のシフトレジスタの構成を示すブロック図である。
【図１２】（ａ）単位レジスタの構成を示す回路図である。
（ｂ）単位レジスタの動作説明図である。
【図１３】図１０におけるトランジスタによるリセット動作を示すタイムチャートである。
【図１４】従来の双方向レジスタの構成を示すブロック図である。
【符号の説明】
６１ 撮像部
６２ シフトレジスタ
６３ シフトレジスタ
６４ 信号処理部
６５ プリアンプ
Res1〜Res4 単位レジスタ
Tr1 トランジスタ
Tr2 トランジスタ
Tr3-1〜Tr3-4 トランジスタ
Tr6-1〜Tr6-4 トランジスタ
Tr8-1〜Tr8-4 トランジスタ
C1 キャパシタ
【発明の属する技術分野】
ダイナミック型シフトレジスタを含むＭＯＳ型固体撮像装置に関し、特にダイナミック型シフトレジスタのリセット動作の改良に関する。
【０００２】
【従来の技術】
近年、固体撮像装置の一つとして、増幅型ＭＯＳセンサを用いた固体撮像装置が注目されている。この固体撮像装置は、画素を表すセル毎にフォトダイオードで検出した信号をトランジスタで増幅するものであり、高感度という特徴を持つ。
【０００３】
このような固体撮像装置では、二次元に配列された画素を有する撮像素子を水平走査又は垂直走査する回路としてダイナミック型シフトレジスタが用いられ、回路の簡素化、高密度化及び低消費電力化を図っている。
【０００４】
図１０は、従来の一般的な固体撮像装置の概略構成を示すブロック図である。この固体撮像装置は、二次元に配列された画素を有する撮像部６１と、撮像部６１の一行を選択するための行選択信号を出力するシフトレジスタ６２と、選択された行内の一画素するための画素選択信号を出力するシフトレジスタ６３と、選択された画素から画素信号を取り出す画素処理部６４と、取り出された画素信号を増幅するプリアンプ６５とを備える。
【０００５】
図１１は、従来のＮＭＯＳダイナミック型のシフトレジスタの構成を示すブロック図であり、シフトレジスタ６２、６３として利用される。同図では４段しか示していないが、実際には数百〜数千段ある。
【０００６】
図中の、クロック信号Clk1及びClk2はシフト動作の基準となる二相クロック信号である。Clk1信号は奇数番目の単位レジスタに、Clk2信号は偶数番目の単位レジスタに入力される。これにより、奇数番目の単位レジスタと偶数番目の単位レジスタとが交互に動作する。
【０００７】
同図において、Res１、Res２・・・（何れか１つを指す場合はResと略す）は、入力信号Inの論理値をクロック信号Clkに同期して内部に記憶し、記憶した論理値を出力信号Out及び出力信号Nextとして出力する単位レジスタである。出力信号Outは、行選択信号又は列選択信号として撮像部６１に出力される。
【０００８】
トランジスタTr3-1、3-2、・・・（同Tr3）は、単位レジスタへの入力信号Inをリセットするリセットトランジスタである。ここで、入力信号のリセットというのは、入力信号をローレベルにすることによって、当該入力信号線に接続された容量（トランジスタのゲート容量など）を放電することをいう。すなわち、トランジスタTr3は、それが接続された入力信号Inを有する単位レジスタの次段の単位レジスタの出力Outがハイレベルのときに、当該入力信号Inをローレベルにすることによって、当該単位レジスタと前段の単位レジスタ内の記憶素子に蓄積された電荷を放電することによって入力信号Inをリセットする。もし、リセットしなければ単位レジスタ内部にいつまでも電荷が残りハイレベルを保ち続けるからである。リセットされた後ローレベル又はハイインピーダンスとなる。
【０００９】
トランジスタTr7-1、7-2、・・・（同Tr7）は、リセット制御信号RSがハイレベルになったときオンし、全単位レジスタの入力信号を一斉にリセットする。リセット制御信号RSは、単位レジスタRes1の入力信号In1にスタートパルスに同期して、その直前にリセットパルスとして入力される。これによりスタートパルス印加前に全ての単位レジスタがリセット（オールクリア）される。
【００１０】
図１２（ａ）は、単位レジスタResの構成を示す回路図である。同図のように単位レジスタは、ＮＭＯＳ型トランジスタTr1、Tr2、キャパシタC1からなる。入力信号Inがハイレベルである場合の単位レジスタの動作説明図を図１２（ｂ）に示す。入力信号Inがハイレベルであるので、クロック信号Clkの立ち上がり（図中▲１▼）の前に、トランジスタTr1のゲート容量及びキャパシタＣ１の電位によってトランジスタTr1のゲート電極は既にハイレベルになっている。この状態で、クロック信号Clkがローレベルからハイレベルに立ち上がると、トランジスタTr１のゲート電圧InがキャパシタＣ１を介して昇圧（ブートと呼ぶ）される（同▲２▼）。また、トランジスタTr１はゲートにハイレベルよりも高電圧が印加されることから、ゲート下のポテンシャルがクロック信号（clk）のハイレベル以上になりOut信号にClk信号のハイレベルが出力される（同▲３▼）。Clk信号が立ち下がると、Out信号にClk信号のローレベルが出力される。このとき、Next信号は、一方向性トランジスタTr２のゲート容量にハイレベルが保持されているので、Clk信号が立ち下がった後もハイレベルを出力する。
【００１１】
一方、入力信号Inがローレベル（又はフローティング）である場合にはブートトランジスタTr1がオンしないので、クロック信号Clkが入力されても、Out信号、Next信号は何れもローレベル（又はフローティング）のままである。
【００１２】
図１３は、図１１におけるトランジスタTr3によるリセット動作を示すタイムチャートである。同図においてクロック信号Clk1、Clk2、入力信号(又は内部データ)In1〜In4、出力信号Out1〜Out4は、図１１、図１２に示した信号である。
【００１３】
まず、単位レジスタRes1は、Clk1信号（図中▲１▼）に同期して、ハイレベル状態の入力信号In1をブートして内部に保持する（同▲２▼）。これと同時に画素選択信号としてOut1信号を出力し（同▲３▼）、Next1信号をハイレベルにする。ハイレベルになったNext1信号は入力信号In2として次段の単位レジスタRes2に入力される。このとき、Clk1信号が入力された他の奇数番目の単位レジスタは、その入力がローレベル（又はハイインピーダンス状態)であり、内部にハイレベルを取り込まない。
【００１４】
このようにして、クロック信号Clk1が供給されている奇数番目の単位レジスタのシフト動作がなされる。次のクロック信号Clk2によって、偶数番目の単位レジスタのシフト動作がなされる。
【００１５】
また、出力信号Out2がハイレベルになると、リセットトランジスタTr3-1がオンになり、入力信号In1をローレベルにするので、単位レジスタRes1内部のトランジスタTr1のゲート容量及びキャパシタC1の電荷が放電し、単位レジスタRes1の入力信号In1がリセットされる。
【００１６】
出力信号Out3がハイレベルになると、リセットトランジスタTr3-2がオンになり、単位レジスタRes2内のトランジスタTr1のゲート容量及びキャパシタC1が放電すると共に、Next1信号線を介して単位レジスタRes1内の一方向性トランジスタTr2のゲート容量の電荷も放電する。これにより単位レジスタRes2の入力信号In2がリセットされる。
【００１７】
このようにして、ＮＭＯＳ型ダイナミックシフトレジスタは、ハイレベルを出力した単位レジスタが、前段の単位レジスタへの入力信号Inをリセットする。
このようなシフトレジスタの先行技術として特許文献１がある。特許文献１では、単位レジスタ間を順方向に接続するトランジスタ群と、逆方向に接続するトランジスタ群を備えることによりシフト方向を選択可能な双方向シフトレジスタを開示している。
【００１８】
図１４は、従来の双方向レジスタの構成を示すブロック図である。同図は、図１０に示したシフトレジスタと比較して、トランジスタTr4-1、Tr4-2、・・・（何れか１つを指す場合はTr4と略す）と、トランジスタTr5-1、Tr5-2、・・・（同Tr5）と、トランジスタTr8-1、Tr8-2、・・・（同Tr8）と、トランジスタTr9-1、Tr9-2、・・・（同Tr9）と、トランジスタTr10-1、Tr10-2、・・・（同Tr10）とが追加されている点と、制御信号Norm及びRevが指定される点とが異なるので、異なる点を中心に説明する。
【００１９】
制御信号Norm、Revは、シフト方向を指定する信号であり、(Norm、Rev)＝（ハイレベル、ローレベル）である場合には順方向シフト動作を指定し、(Norm、Rev)＝（ローレベル、ハイレベル）である場合には逆方向シフト動作を指定する。
【００２０】
トランジスタTr4は、制御信号Normがハイレベルのときオンになり、単位レジスタの入出力を順方向に接続する。また、トランジスタTr10も、制御信号Normがハイレベルのときオンになり、単位レジスタの出力をリセットトランジスタTr3に伝達する。
【００２１】
トランジスタTr5は、制御信号Revがハイレベルのときオンになり、単位レジスタの入出力を逆に接続する。また、トランジスタTr9も、制御信号Revがハイレベルのときオンになり、単位レジスタの出力をリセットトランジスタTr8に伝達する。
【００２２】
順方向シフト動作では、トランジスタTr4及びTr10がオン、Tr5及びTr9がオフになっている。この状態で、出力信号をハイレベルに出力した単位レジスタは、前段（シフト方向後方）の単位レジスタの入力信号に接続されたトランジスタTr3をトランジスタTr10を介してオンにする。これにより前段の単位レジスタの入力信号をリセットする。
【００２３】
逆方向シフト動作では、トランジスタTr5及びTr9がオンに、Tr4及びTr10がオフになっている。この状態で、出力信号をハイレベルに出力した単位レジスタは、前段（シフト方向後方）の単位レジスタの入力信号に接続されたトランジスタTr8をトランジスタTr9を介してオンにする。これにより前段の単位レジスタの入力信号をリセットする。
【００２４】
トランジスタTr7は、図１１と同様にオールクリア用のトランジスタであり、スタートパルスに同期してその直前にリセット制御信号RSによってオンする。
また、特許文献２は、ズームモード等に対応するためシフトレジスタの途中からスタートを開始するシフトレジスタを開示している。例えば、シフトレジスタの１／４の位置からスタートし３／４の位置までを走査することを可能にしている。
【００２５】
【特許文献１】
特開昭６４−４４１７８号公報
【００２６】
【特許文献２】
特開平６−１０４２９２号公報
【００２７】
【発明が解決しようとする課題】
上記従来技術によれば、スタートパルスを印加した後レジスタ信号（出力信号Outのパルス）が最終段に到達するまでに、次のスタートパルスを印加することができないという問題がある。
【００２８】
言い換えれば、従来のシフトレジスタは、シフト動作時に撮像素子に対して単位レジスタの１つだけがパルスを出力しながらシフトするという通常の走査を行うことができるが、２つのパルスを同時に出力しながらシフトするという特殊な走査を行うことができない。ここで、特殊な走査は、例えば、２つのパルスを同時に出力し、１つ目のパルスによって撮像素子をリセットし２つの目のパルスによって撮像素子から画素値の読み出しを行う電子シャッタ機能等に利用される。この場合の電子シャッタ機能とは、1つ目のパルスから２つ目のパルスまでの間隔によって撮像素子の露光時間を調整することをいう。
【００２９】
また、上記従来技術における双方向レジスタでは、上記の問題に加えて、通常シフト用のリセット回路（図１４中のトランジスタTr3、Tr10）、逆方向シフト用のリセット回路（トランジスタTr8、Tr9）、オールリセット用回路（トランジスタTr7）を備えるので、数多くのトランジスタを必要とし回路規模が大きくなるという問題がある。
【００３０】
上記問題に鑑み本発明は、簡単な回路構成でシフト動作の途中で次のスタートパルスを印加することができるシフトレジスタを備えた固体撮像装置、固体撮像装置の方法及びカメラを提供することを目的とする。
【００３１】
【課題を解決するための手段】
上記課題を解決するため本発明の固体撮像装置は、ダイナミックロジック回路により形成され、二次元に配列された撮像素子の行又は列を順次選択するためのシフトレジスタを有する固体撮像装置であって、前記シフトレジスタは、信号を保持する複数段の単位レジスタと、複数の第１リセット回路と、複数の第２リセット回路とを有し、各第１リセット回路は、単位レジスタの１つに対応して備えられ、当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に位置する後方単位レジスタの入力信号をリセットし、各第２リセット回路は、単位レジスタの１つに対応して備えられ、当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向前方に位置する前方単位レジスタの入力信号をリセットするよう構成されている。
【００３２】
この構成によれば、第２リセット回路が前方の単位レジスタの入力信号をリセットするので、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。その結果、任意の間隔で２つのパルスを走査する特殊走査をすることができ、例えば電子シャッタに利用することができる。
【００３３】
ここで、前記各第１リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンする第１トランジスタを有し、前記後方単位レジスタへの入力信号線を第１トランジスタを介してローレベルにし、前記各第２リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンする第２トランジスタを有し、前記前方単位レジスタの入力信号線を第２トランジスタを介してローレベルにする構成であってもよい。
【００３４】
この構成によれば、第１、第２リセット回路はそれぞれトランジスタ１つで構成されるので、簡単な回路構成にすることができる。
また、前記前方単位レジスタは、各第２リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタであるように構成してもよい。この構成によれば、前記前方単位レジスタは、例えば、３段、１０段、２０段などシフト方向の前方に位置する任意のレジスタとしておくことができる。
【００３５】
また、本発明の固体撮像装置は、ダイナミックロジック回路により形成され、二次元に配列された撮像素子の行又は列を順次選択するための双方向シフトレジスタを有する固体撮像装置であって、前記双方向シフトレジスタは、信号を保持する複数段の単位レジスタと、複数の第１リセット回路と、複数の第２リセット回路とを有し、各第１リセット回路は、単位レジスタの１つに対応して備えられ、順方向シフト動作時に当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に位置する順方向後方単位レジスタの入力信号をリセットし、逆方向シフト動作時に対応する単位レジスタがハイレベルを出力したとき、当該単位レジスタからシフト方向前方に位置する逆方向前方単位レジスタの入力信号をリセットし、各第２リセット回路は、単位レジスタの１つに対応して備えられ、順方向シフト動作時に、当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向前方に位置する順方向前方単位レジスタの入力信号をリセットし、逆方向シフト動作時に対応する単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に位置する逆方向後方単位レジスタの入力信号をリセットするよう構成されている。
【００３６】
この構成によれば、順方向シフト動作時には、第２リセット回路がシフト方向前方の単位レジスタの入力信号をリセットし、逆方向シフト動作時には、第１リセット回路がシフト方向前方の単位レジスタの入力信号をリセットする。このことから、順方向シフト動作と逆方向シフト動作の何れにおいてもシフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。その結果、順方向シフト動作と逆方向シフト動作の何れにおいても任意の間隔で２つのパルスを走査する特殊走査をすることができ、例えば電子シャッタに利用することができる。
【００３７】
ここで、前記双方向シフトレジスタは、順方向シフト動作において前記複数段の単位レジスタの入出力を順方向に接続する複数の順接続用トランジスタと、逆方向シフト動作において前記複数段の単位レジスタの入出力を逆方向に接続する複数の逆接続用トランジスタとを有し、各第１リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンになりかつグラウンド線に接続された第１トランジスタを有し、前記順方向後方単位レジスタへの入力信号線と第１トランジスタとの間を前記順接続用トランジスタを介して接続するとともに、前記逆方向前方単位レジスタの入力信号線と第１トランジスタとの間を前記逆接続用トランジスタを介して接続し、各第２リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンになりかつグラウンド線に接続された第２トランジスタを有し、前記順方向前方単位レジスタへの入力信号線と第２トランジスタとの間を前記順接続用トランジスタを介して接続するとともに、前記逆方向後方単位レジスタの入力信号線と第２トランジスタとの間を前記逆接続用トランジスタを介して接続している構成としてもよい。
【００３８】
第１、第２ランジスタの各々が順方向シフト動作時におけるリセットトランジスタと逆方向シフト動作時におけるリセットトランジスタを兼用しているので、回路規模を小さくすることができ、通常撮影と電子シャッタ機能のいずれでも上下反転画像を得ることができる。
【００３９】
また、前記順方向前方単位レジスタは、各第２リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタであり、前記逆方向前方単位レジスタは、各第１リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタである構成としてもよい。
【００４０】
また、順方向前方単位レジスタ、逆方向前方単位レジスタは、各第２リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタであるように構成してもよい。この構成によれば、順方向前方単位レジスタ、逆方向前方単位レジスタはそれぞれ例えば、３段、１０段、２０段などシフト方向の前方に位置する任意のレジスタとしておくことができる。
【００４１】
また、本発明の固体撮像装置の駆動方法及びカメラも上記と同様の手段、作用、効果を有する。
【００４２】
【発明の実施の形態】
＜実施の形態１＞
図１は、本発明の実施の形態１におけるシフトレジスタの構成を示すブロック図である。このシフトレジスタは、図１０に示した固体撮像装置を備えるカメラにおいて、行選択信号を出力するシフトレジスタ６２、画素選択信号を出力するシフトレジスタ６３の何れか、又は両者として備えられる。図１では便宜上４段しか図示していないが、実際には画素数に応じて数百〜数千の段数が存在する。
【００４３】
図１のようにシフトレジスタは、単位レジスタRes1、Res2、・・・（何れか１つを指す場合はResと略す）と、トランジスタTr3-1、Tr3-2・・・（同Tr3）と、トランジスタTr8-3、Tr8-4・・・（同Tr8）とを備え、シフト方向後方の単位レジスタに加えて、シフト方向前方にある単位レジスタの入力信号をリセットするように構成されている。
【００４４】
単位レジスタResは、入力信号Inの論理値をクロック信号Clkに同期して内部に記憶し、記憶した論理値を出力信号Out及び出力信号Nextとして出力する。ここで論理値はハイレベルとフローティングの２状態の何れか又はハイレベルとローレベルの２つの状態の何れかである。ただし、入力信号Inに現れる電圧は、単位レジスタ内部でブートされるので一時的にハイレベルよりも高電圧になる。単位レジスタresの個々の構成は図１２（ａ）に示した構成と同じであり、内部動作タイミングも図１２（ｂ）と同じであるので説明を省略する。
【００４５】
トランジスタTr3は、当該トランジスタTr3が入力信号Inに接続された単位レジスタの次段の単位レジスタの出力Outがハイレベルのときに、当該入力信号Inをローレベルにすることによって、単位レジスタ内の記憶素子に蓄積された電荷を放電するためのリセットトランジスタである。もし、リセットしなければ単位レジスタ内部にいつまでも電荷が残りハイレベルを出力し続けるからである。リセットされた次のクロック信号では出力信号Out及びNextは、ローレベル出力又はハイインピーダンスとなる。
【００４６】
トランジスタTｒ8は、当該トランジスタTr8が入力信号Inに接続された単位レジスタの前々段の単位レジスタの出力Outがハイレベルのときに、当該入力信号Inをローレベルにすることによって、単位レジスタ内の記憶素子に蓄積された電荷を放電するためのリセットトランジスタである。その結果、各単位レジスタは、出力信号Outをハイレベルにしたとき、３段前方の単位レジスタの入力信号Inをリセットすることになる。
【００４７】
図２（ａ）は、図１に示したシフトレジスタにおいて１つの単位レジスタだけが出力信号を出力する通常走査モードにおける動作タイミングを示すタイムチャートである。同図においてクロック信号Clk1、Clk2、出力信号Outは、図１に示した信号である。出力信号Outはクロック信号Clk1、Clk2に同期して、順にシフトされる。同図のように通常走査モードでは、スタートパルスは１つのみが印加された結果、シフトレジスタの出力信号Out中の１つのみがパルスを出力することになる。
【００４８】
同図（ｂ）は、図１に示したシフトレジスタにおいて２つ単位レジスタが出力信号を出力する特殊走査モードにおける動作タイミングを示すタイムチャートである。同図では、４クロックの間隔をおいて２つのスタートパルスが印加された場合の様子を示している。その結果、各出力Outには、２つのパルスがスタートパルスと同じ間隔をおいて出力される。例えば、本シフトレジスタが、図１０に示したシフトレジスタ６２である場合、1つ目のパルスは、撮像素子の１行をリセットするためのパルスとして、２つ目のパルスは、当該１行から画素値を読み出すためのパルスとして利用され、電子シャッタに利用できる。
【００４９】
以上説明してきたように本実施の形態におけるシフトレジスタは、単位レジスタResがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に隣接する単位レジスタの入力信号をリセットするためのトランジスタTr3と、単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向前方に位置する単位レジスタの入力信号をリセットするためのトランジスタTr8を備える。これにより、前方の単位レジスタの入力信号をクリアするので、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。その結果、任意の間隔で２つのパルスを走査する特殊走査をすることができ、例えば電子シャッタに利用することができる。
【００５０】
＜実施の形態２＞
図３は、本発明の実施の形態２における双方向シフトレジスタの構成を示す図である。同図の双方向レジスタは、単位レジスタRes1、Res2、・・・（何れか１をResと略す）トランジスタTr4-1、Tr4-2、・・・（同Tr4）と、トランジスタTr5-1、Tr5-2、・・・（同Tr5）と、トランジスタTr3-1、Tr3-2、・・・（同Tr3）と、トランジスタTr8-1、Tr8-2、・・・（同Tr8）とを備える。また、図中の制御信号Norm、Revは、シフト方向を指定する信号であり、(Norm、Rev)＝（ハイレベル、ローレベル）である場合には順方向シフト動作を指定し、(Norm、Rev)＝（ローレベル、ハイレベル）である場合には逆方向シフト動作を指定する。
【００５１】
トランジスタTr4は、順方向シフト動作時に（制御信号Normがハイレベルのとき）オンになり、単位レジスタの入出力を順方向に接続する。
トランジスタTr5は、逆方向シフト動作時に（制御信号Revがハイレベルのとき）オンになり、単位レジスタの入出力を逆方向に接続する。
【００５２】
トランジスタTr3及びトランジスタTr8は、順方向シフト動作の場合も逆方向シフト動作の場合も、出力信号をハイレベルにした単位レジスタから見てシフト方向後方の単位レジスタの入力信号と、シフト方向の前方の単位レジスタの入力信号とをリセットするために備えられている。以下、（Ａ）順方向シフトにおけるシフト方向前方、（Ｂ）順方向シフトにおけるシフト方向後方、（Ｃ）逆方向シフトにおけるシフト方向前方、（Ｄ）逆方向シフトにおけるシフト方向後方のそれぞれの場合の単位レジスタの入力信号のリセットに分けて説明する。
【００５３】
（Ａ）各トランジスタTr8は、順方向シフト動作時には、ゲートに接続された出力信号Outがハイレベルになったとき、その出力信号Outを出力した単位レジスタのシフト方向前方に位置する単位レジスタ（以下、順方向前方単位レジスタと呼ぶ）の入力信号Inをリセットする。図４は、単位レジスタRes2の出力信号がハイレベルになったとき順方向前方単位レジスタがリセットされる様子を示す説明図である。同図のように、単位レジスタRes2の出力信号Out2がハイレベルになるとトランジスタTr8-5がオンする（同図▲１▼）。その結果、順方向前方単位レジスタ（この場合、単位レジスタRes5）の入力信号がトランジスタTr8-5を介してグランドレベルになりリセットされる（同図▲２▼）。
【００５４】
（Ｂ）各トランジスタTr3は、順方向シフト動作時には、ゲートに接続された出力信号Outがハイレベルになったとき、その出力信号Outを出力した単位レジスタのシフト方向後方に隣接する単位レジスタ（以下、順方向後方単位レジスタと呼ぶ）の入力信号Inをリセットする。図５は、単位レジスタRes2の出力信号がハイレベルになったときの順方向後方単位レジスタの入力信号がリセットされる様子を示す説明図である。同図のように、単位レジスタRes2の出力信号Out2がハイレベルになるとトランジスタTr3-1がオンする（同図▲１▼）。その結果、順方向後方単位レジスタ（この場合、単位レジスタRes1）の入力信号がトランジスタTr3を介してグランドレベルになりリセットされる（同図▲２▼）。
【００５５】
（Ｃ）各トランジスタTr3は、逆方向シフト動作時には、ゲートに接続された出力信号Outがハイレベルになったとき、その出力信号Outを出力した単位レジスタからシフト方向前方に位置する単位レジスタ（以下、逆方向前方単位レジスタと呼ぶ）の入力信号をリセットする。図６は、単位レジスタRes4の出力信号がハイレベルになったとき逆方向前方単位レジスタがリセットされる様子を示す説明図である。同図のように、単位レジスタRes4の出力信号Out4がハイレベルになるとトランジスタTr3-3がオンする（同図▲１▼）。その結果、逆方向前方単位レジスタ（この場合、単位レジスタRes1）の入力信号がトランジスタTr3-3とトランジスタTr5-2とを介してグランドレベルになりリセットされる（同図▲２▼）。
【００５６】
（Ｄ）各トランジスタTr8は、逆方向シフト動作時には、ゲートに接続された出力信号Outがハイレベルになったとき、その出力信号Outを出力した単位レジスタからシフト方向後方に隣接する単位レジスタ（以下、逆方向後方単位レジスタと呼ぶ）の入力信号をリセットする。図７は、単位レジスタRes1の出力信号がハイレベルになったとき逆方向後方単位レジスタがリセットされる様子を示す説明図である。同図のように、単位レジスタRes1の出力信号Out1がハイレベルになるとトランジスタTr8-4がオンする（同図▲１▼）。その結果、逆方向後方単位レジスタ（この場合、単位レジスタRes2）の入力信号がトランジスタTr8-4とトランジスタTr5-3とを介してグランドレベルになりリセットされる（同図▲２▼）。
【００５７】
このように、上記（Ａ）（Ｂ）（Ｃ）（Ｄ）のリセットは、トランジスタTr8、Tr3、Tr3、Tr8によりなされる。言い換えれば、トランジスタTr8は、（Ａ）と（Ｄ）の場合に兼用のリセットトランジスタ、トランジスタTr3は、（Ｂ）と（Ｃ）の場合に兼用のリセットトランジスタとして利用されている。
【００５８】
以上のように構成された本実施の形態における双方向シフトレジスタによれば、順方向シフト動作においても、逆方向シフト動作においても、前方の単位レジスタの入力信号をクリアするので、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。これにより、順方向シフト動作においても、逆方向シフト動作においても、単位レジスタの１つだけが出力信号を出力する通常操作と、単位レジスタの２つが出力信号を出力する特殊走査とを行うことができる。
【００５９】
順方向シフト動作時における通常走査及び特殊走査のタイムチャートは、図２（ａ）、（ｂ）に示したものと同様である。
図８（ａ）は、逆方向シフト動作時における通常走査のタイムチャートを示す。同図（ａ）は、図２（ａ）と比較して、シフト方向のみが異なっている。
【００６０】
図８（ｂ）は、逆方向シフト動作時における特殊走査のタイムチャートを示す。同図（ｂ）は、図２（ｂ）と比較して、シフト方向のみが異なっている。図８（ｂ）において、１つの出力信号Outから出力される２つのパルスの間隔は、２つのスタートパルスの入力タイミングによって任意に設定することができる。本シフトレジスタが、図１０に示したシフトレジスタ６２である場合、1つ目のパルスは、撮像素子の１行をリセットするためのパルスとして、２つ目のパルスは、当該１行から画素値を読み出すためのパルスとして利用され、電子シャッタに利用できる。しかも、図８（ｂ）では逆方向シフトをしているので、固体撮像装置では、上下が反転した画像を得ることができる。
【００６１】
以上説明してきたように本実施の形態における固体撮像装置によれば、順方向シフトの場合も、逆方向シフトの場合も前方の単位レジスタの入力信号をクリアするので、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。しかも、トランジスタTr3、Tr8は、順方向シフトと逆方向シフトとのどちらの場合もリセットトランジスタとして兼用しているので、回路規模を小さくすることができる。
【００６２】
なお、図１に示したシフトレジスタにおいて、トランジスタTr8は、各単位レジスタから３段前方の単位レジスタの入力信号Inをリセットするように設けられているが、２段以上であればよい。例えば、１０段、２０段等任意に設計してもよい。
【００６３】
また、図１及び３のシフトレジスタにおいてトランジスタTr3-1は、入力信号In1がハイレベルとローレベルの２状態をとる場合は、省略してもよい。
また、図３における各単位レジスタへの入力信号Inの直前にトランジスタTr6を挿入し、トランジスタTr6のゲートに単位レジスタとは異なる方のクロック信号を入力したとてもよい。こうすれば、トランジスタTr6は、単位レジスタからみた入力信号Inの負荷容量をトランジスタTr6の一個分に制限し、単位レジスタ内部のブート電圧の低下を防止することができる。例えば、上記の双方向シフトレジスタのように、１つの単位レジスタに対して前段のレジスタ信号を入力するトランジスタと後段のレジスタ信号を入力するトランジスタとが接続される場合に、トランジスタTr6を介して単位レジスタの入力に接続すれば、負荷容量を増大させることを防止することができる。その結果ブート電圧の低下を防止することができる。
【００６４】
また、図９は、他の実施の形態におけるシフトレジスタの構成を示すブロック図である。図１に示したシフトレジスタでは、トランジスタTr8によってハイレベルを出力した単位レジスタの３段前方の単位レジスタの入力信号をリセットしているのに対して、図９に示すシフトレジスタでは、トランジスタTr8によってハイレベルを出力した単位レジスタの2段前方の単位レジスタの入力信号をリセットしている。
【００６５】
【発明の効果】
本発明によれば、シフト動作の途中の任意のタイミングで２つ目のスタートパルスを印加することができる。これにより２つのパルスを同時に出力しながら走査する電子シャッタ機能を実現することができる。
【００６６】
しかも、順方向シフトと逆方向シフトとを選択可能な双方向シフトレジスタにおいて、２つのリセットトランジスタの各々を順方向シフト動作時と逆方向シフト動作時で兼用しているので、回路規模を小さくすることができ、通常撮影と電子シャッタ機能のいずれでも上下反転画像を得ることができる。
【００６７】
また、本発明の固体撮像装置の駆動方法及びカメラも上記と同様の効果を有する。
【図面の簡単な説明】
【図１】実施の形態１におけるシフトレジスタの構成を示すブロック図である。
【図２】（ａ）１つの単位レジスタだけが出力信号を出力する通常走査モードにおける動作タイミングを示すタイムチャートである。
（ｂ）２つの単位レジスタが出力信号を出力する特殊走査モードにおける動作タイミングを示すタイムチャートである。
【図３】実施の形態２における双方向シフトレジスタの構成を示す図である。
【図４】順方向後方単位レジスタがリセットされる様子を示す説明図である。
【図５】順方向シフトにおいて前方にある単位レジスタの入力信号をリセットする様子を示す説明図である。
【図６】 順方向シフトにおいて後方に隣接する単位レジスタの入力信号をリセットする様子を示す説明図である。
【図７】逆方向シフトにおいて前方にある単位レジスタの入力信号をリセットする様子を示す説明図である。
【図８】逆方向シフトにおいて後方に隣接する単位レジスタの入力信号をリセットする様子を示す説明図である。
【図９】他の実施の形態におけるシフトレジスタの構成を示すブロック図である。
【図１０】一般的な固体撮像装置の概略構成を示すブロック図である。
【図１１】従来のＮＭＯＳダイナミック型のシフトレジスタの構成を示すブロック図である。
【図１２】（ａ）単位レジスタの構成を示す回路図である。
（ｂ）単位レジスタの動作説明図である。
【図１３】図１０におけるトランジスタによるリセット動作を示すタイムチャートである。
【図１４】従来の双方向レジスタの構成を示すブロック図である。
【符号の説明】
６１ 撮像部
６２ シフトレジスタ
６３ シフトレジスタ
６４ 信号処理部
６５ プリアンプ
Res1〜Res4 単位レジスタ
Tr1 トランジスタ
Tr2 トランジスタ
Tr3-1〜Tr3-4 トランジスタ
Tr6-1〜Tr6-4 トランジスタ
Tr8-1〜Tr8-4 トランジスタ
C1 キャパシタ
Claims (9)
- ダイナミックロジック回路により形成され、二次元に配列された撮像素子の行又は列を順次選択するためのシフトレジスタを有する固体撮像装置であって、
前記シフトレジスタは、信号を保持する複数段の単位レジスタと、複数の第１リセット回路と、複数の第２リセット回路とを有し、
各第１リセット回路は、単位レジスタの１つに対応して備えられ、当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に位置する後方単位レジスタの入力信号をリセットし、
各第２リセット回路は、単位レジスタの１つに対応して備えられ、当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向前方に位置する前方単位レジスタの入力信号をリセットする
ことを特徴とする固体撮像装置。 - 前記各第１リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンする第１トランジスタを有し、前記後方単位レジスタへの入力信号線を第１トランジスタを介してローレベルにし、
前記各第２リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンする第２トランジスタを有し、前記前方単位レジスタの入力信号線を第２トランジスタを介してローレベルにする
ことを特徴とする請求項１記載の固体撮像装置。 - 前記前方単位レジスタは、各第２リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタである
ことを特徴とする請求項１又は２記載の固体撮像装置。 - ダイナミックロジック回路により形成され、二次元に配列された撮像素子の行又は列を順次選択するための双方向シフトレジスタを有する固体撮像装置であって、
前記双方向シフトレジスタは、信号を保持する複数段の単位レジスタと、複数の第１リセット回路と、複数の第２リセット回路とを有し、
各第１リセット回路は、単位レジスタの１つに対応して備えられ、順方向シフト動作時に当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に位置する順方向後方単位レジスタの入力信号をリセットし、逆方向シフト動作時に対応する単位レジスタがハイレベルを出力したとき、当該単位レジスタからシフト方向前方に位置する逆方向前方単位レジスタの入力信号をリセットし、
各第２リセット回路は、単位レジスタの１つに対応して備えられ、順方向シフト動作時に、当該単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向前方に位置する順方向前方単位レジスタの入力信号をリセットし、逆方向シフト動作時に対応する単位レジスタがハイレベルを出力したとき、当該単位レジスタのシフト方向後方に位置する逆方向後方単位レジスタの入力信号をリセットする ことを特徴とする固体撮像装置。 - 前記双方向シフトレジスタは、順方向シフト動作において前記複数段の単位レジスタの入出力を順方向に接続する複数の順接続用トランジスタと、逆方向シフト動作において前記複数段の単位レジスタの入出力を逆方向に接続する複数の逆接続用トランジスタとを有し、
各第１リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンになりかつグラウンド線に接続された第１トランジスタを有し、前記順方向後方単位レジスタへの入力信号線と第１トランジスタとの間を前記順接続用トランジスタを介して接続するとともに、前記逆方向前方単位レジスタの入力信号線と第１トランジスタとの間を前記逆接続用トランジスタを介して接続し、
各第２リセット回路は、対応する単位レジスタの出力信号がハイレベルであるときにオンになりかつグラウンド線に接続された第２トランジスタを有し、前記順方向前方単位レジスタへの入力信号線と第２トランジスタとの間を前記順接続用トランジスタを介して接続するとともに、前記逆方向後方単位レジスタの入力信号線と第２トランジスタとの間を前記逆接続用トランジスタを介して接続している
ことを特徴とする請求項４記載の固体撮像装置。 - 前記順方向前方単位レジスタは、各第２リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタであり、
前記逆方向前方単位レジスタは、各第１リセット回路に対応する単位レジスタから少なくとも２段以上シフト方向前方に位置する何れかの単位レジスタである
ことを特徴とする請求項４又は５記載の固体撮像装置。 - ダイナミックロジック回路により形成され、二次元に配列された撮像素子の行又は列を順次選択するためのシフトレジスタを有する固体撮像装置における撮像素子の駆動方法であって、
前記シフトレジスタは、複数段の単位レジスタを有し、
前記駆動方法は、
前記シフトレジスタを１段シフトするステップと、
１段シフトによってハイレベルを出力した単位レジスタについて、当該単位レジスタからシフト方向後方に位置する後方単位レジスタの入力信号をリセットする第１リセットステップと、
１段シフトによってハイレベルを出力した単位レジスタについて、当該単位レジスタに対してシフト方向前方に位置する前方単位レジスタの入力信号をリセットする第２リセットステップと
を有することを特徴とする駆動方法。 - ダイナミックロジック回路により形成され、二次元に配列された撮像素子の行又は列を順次選択するためのシフトレジスタを有する固体撮像装置における撮像素子の駆動方法であって、
前記シフトレジスタは、複数段の単位レジスタと、順方向シフト動作において前記複数段の単位レジスタの入出力を順方向に接続する複数の順接続用トランジスタと、逆方向シフト動作において前記複数段の単位レジスタの入出力を逆方向に接続する複数の逆接続用トランジスタとを有し、
前記駆動方法は、
順方向シフト動作モードにおいて各順接続用トランジスタをオンに各逆接続用トランジスタをオフに、逆方向シフト動作モードにおいて各順接続用トランジスタをオフに各逆接続用トランジスタをオンに設定する設定ステップと、
前記シフトレジスタを１段シフトするステップと、
１段シフトによってハイレベルを出力した単位レジスタについて、当該単位レジスタからシフト方向後方に隣接する後方単位レジスタの入力信号をリセットする第１リセットステップと、
１段シフトによってハイレベルを出力した単位レジスタについて、当該単位レジスタに対してシフト方向前方に位置する前方単位レジスタの入力信号をリセットする第２リセットステップと
を有することを特徴とする駆動方法。 - 請求項１から６の何れかに記載の固体撮像装置を備えることを特徴とするカメラ。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2003075769A JP4283014B2 (ja) | 2003-03-19 | 2003-03-19 | 固体撮像装置、固体撮像装置の駆動方法およびカメラ |
| US10/802,939 US7379108B2 (en) | 2003-03-19 | 2004-03-18 | Image sensor, driving method and camera |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2003075769A JP4283014B2 (ja) | 2003-03-19 | 2003-03-19 | 固体撮像装置、固体撮像装置の駆動方法およびカメラ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2004289251A JP2004289251A (ja) | 2004-10-14 |
| JP4283014B2 true JP4283014B2 (ja) | 2009-06-24 |
Family
ID=33156599
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2003075769A Expired - Fee Related JP4283014B2 (ja) | 2003-03-19 | 2003-03-19 | 固体撮像装置、固体撮像装置の駆動方法およびカメラ |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US7379108B2 (ja) |
| JP (1) | JP4283014B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4298685B2 (ja) * | 2004-09-02 | 2009-07-22 | キヤノン株式会社 | シフトレジスタ、及び同シフトレジスタを用いた固体撮像装置、カメラ |
| JP4650056B2 (ja) * | 2005-03-30 | 2011-03-16 | エプソンイメージングデバイス株式会社 | 表示装置 |
| US10313641B2 (en) * | 2015-12-04 | 2019-06-04 | Google Llc | Shift register with reduced wiring complexity |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6444178U (ja) | 1987-09-10 | 1989-03-16 | ||
| JPH06104292A (ja) | 1992-09-19 | 1994-04-15 | Hitachi Ltd | シフトレジスタ |
| JP4035194B2 (ja) * | 1996-03-13 | 2008-01-16 | キヤノン株式会社 | Ｘ線検出装置及びｘ線検出システム |
| US5973311A (en) * | 1997-02-12 | 1999-10-26 | Imation Corp | Pixel array with high and low resolution mode |
| US6606122B1 (en) * | 1997-09-29 | 2003-08-12 | California Institute Of Technology | Single chip camera active pixel sensor |
| JP3466886B2 (ja) * | 1997-10-06 | 2003-11-17 | キヤノン株式会社 | 固体撮像装置 |
-
2003
- 2003-03-19 JP JP2003075769A patent/JP4283014B2/ja not_active Expired - Fee Related
-
2004
- 2004-03-18 US US10/802,939 patent/US7379108B2/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| US7379108B2 (en) | 2008-05-27 |
| JP2004289251A (ja) | 2004-10-14 |
| US20040207741A1 (en) | 2004-10-21 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US8054361B2 (en) | Increasing readout speed in CMOS aps sensors through block readout | |
| US20060103748A1 (en) | Solid state imaging apparatus | |
| JPWO2006090633A1 (ja) | Ｍｏｓ型固体撮像装置およびその駆動方法、カメラ | |
| JP3501743B2 (ja) | 固体撮像装置および撮像システム | |
| JPH09163244A (ja) | 固体撮像装置 | |
| JP2001008109A (ja) | 固体撮像素子およびその駆動方法並びにカメラシステム | |
| JP4286091B2 (ja) | 固体撮像装置 | |
| JP4283014B2 (ja) | 固体撮像装置、固体撮像装置の駆動方法およびカメラ | |
| JP4334950B2 (ja) | 固体撮像装置 | |
| CN101309350A (zh) | 固态成像装置和照相机 | |
| JP4391107B2 (ja) | 固体撮像装置、固体撮像装置の駆動方法およびカメラ | |
| JP3379652B2 (ja) | 固体撮像素子 | |
| JP5460342B2 (ja) | 固体撮像素子および固体撮像素子の駆動方法 | |
| JP4230259B2 (ja) | 固体撮像装置、固体撮像装置の駆動方法およびカメラ | |
| JPH09224196A (ja) | 固体撮像装置 | |
| JP4387684B2 (ja) | 固体撮像装置、その駆動方法及びカメラ | |
| US20040201762A1 (en) | Solid-state imaging apparatus | |
| JP2001054021A (ja) | 固体撮像装置及びその駆動方法 | |
| JP4902308B2 (ja) | 撮像素子 | |
| KR100619551B1 (ko) | 고체 촬상 장치 및 화소 데이터 판독 전압 인가 방법 | |
| JP4209367B2 (ja) | 固体撮像装置、電荷転送装置、及び電荷転送装置の駆動方法 | |
| JP4323849B2 (ja) | 固体撮像装置及びカメラ | |
| US20040169756A1 (en) | Charge-coupled device of XY addressing type | |
| JP3432002B2 (ja) | 撮像装置 | |
| JPH10178589A (ja) | 固体撮像装置 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20050926 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20080801 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20090217 |
|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20090318 |
|
| R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120327 Year of fee payment: 3 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120327 Year of fee payment: 3 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130327 Year of fee payment: 4 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130327 Year of fee payment: 4 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140327 Year of fee payment: 5 |
|
| S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313113 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| LAPS | Cancellation because of no payment of annual fees |