JP4184345B2 - スイング低減信号回路のための適応ヒステリシス - Google Patents
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Description
− より小型でより薄いカラムドライバ基板を可能にするためのバス幅の縮小
− 表示システムの実行時間を延長するための低消費電力
− 電磁干渉(EMI)抑制部品および従来の遮蔽装置を不要とする、電磁干渉(EMI)の発生の低減
− 高解像度ディスプレイを実現可能にする高処理能力
最も広く使用されているプロトコルの1つに、いわゆるRSDS(商標)(スイング低減差動信号)規格がある。RSDSは、ナショナル・セミコンダクタ・コーポレーションの商標である。このRSDSプロトコルは、上記の基準を満たすものである。
Vmin=(Vin+−Vin−)
Vcm=(Vin++Vin−)/2
電圧VminおよびVcmはともに、コンプレッサ53に供給される。本実施形態におけるこのコンプレッサ53は、これら2つの電圧VminおよびVcmの電流関数g(枠53内の曲線25によって示されている)、すなわちg=f(Vmin,Vcm)を実行する。コンプレッサ53は、2つの電圧VminおよびVcmを、以下のように定義されるトリム電流Ifbに変換する。
Itb=g*(Vcm−Vmin)
Claims (17)
- 差動入力信号を処理する装置であって、
差動入力を有し、前記差動入力における平均電圧ピークに比例する第1の電圧を供給するピーク検出器と、
第2の電圧を供給するために前記第1の電圧を処理するコンプレッサと、
前記第2の電圧によって調整可能なトリム電流を供給する電圧制御可能な電流源と、
前記トリム電流によってヒステリシス特性が調整可能なヒステリシス具備回路とを備え、
前記ピーク検出器は、前記コンプレッサに動作可能に結合され、前記コンプレッサは、前記電圧制御可能な電流源に動作的に結合されることを特徴とする装置。 - 前記ピーク検出器は、積分器を備えることを特徴とする請求項1に記載の装置。
- 前記ピーク検出器は、前記差動入力に印加される差動入力信号の包絡線に対して作用することを特徴とする請求項1に記載の装置。
- 前記ピーク検出器は、前記ピーク検出器の差動入力における前記平均電圧ピークを絶えず追跡するように設計されていることを特徴とする請求項1または請求項2に記載の装置。
- 前記ピーク検出器の差動入力における前記平均電圧ピークに応じたヒステリシス特性を提供することを特徴とする請求項1または請求項2に記載の装置
- 前記ピーク検出器は、その差動入力において差動入力トランジスタ対を含むことを特徴とする請求項1または請求項2に記載の装置。
- 前記平均電圧ピークが変化するときに、前記差動入力トランジスタ対の負荷状態が変化することを特徴とする請求項6に記載の装置。
- 前記ヒステリシス具備回路のトリップ・レベルを、前記差動入力信号が低レベル信号である場合にはより低レベルにシフトし、前記差動入力信号が高レベル信号である場合にはより高レベルにシフトすることによって、前記ヒステリシス特性が調整されることを特徴とする請求項1または請求項2に記載の装置。
- 位相感知と前記ヒステリシス特性の適切な調整とを実行するために、前記差動入力信号として差動クロック信号が使用されることを特徴とする請求項1または請求項2に記載の装置。
- 前記コンプレッサは、前記第2の電圧を供給するために前記第1の電圧を処理するときに、関数を適用することを特徴とする請求項1または請求項2に記載の装置。
- インタフェースのアレイを備える表示システム用の制御回路において、
少なくとも1つのインタフェースは、
差動入力を有し、前記差動入力に印加される差動クロック信号の平均電圧ピークに比例する第1の電圧を供給するピーク検出器と、
第2の電圧を供給するために前記第1の電圧を処理するコンプレッサと、
前記第2の電圧によって調整可能な電流(Ifb)を供給する電圧制御可能な電流源と、
前記電流(Ifb)によってヒステリシス特性が調整可能なヒステリシス具備回路とを備える制御回路。 - 他のインタフェースの前記ヒステリシス特性も調整され得るように、信号(Ifb)は、前記インタフェースのアレイの前記少なくとも1つのインタフェースによって他のインタフェースへ供給されることを特徴とする請求項11に記載の制御回路。
- 前記インタフェースのアレイの前記インタフェースは、差動RSDSインタフェースとして機能することを特徴とする請求項11または請求項12に記載の制御回路。
- 前記インタフェースのアレイの前記インタフェースは、タイミング制御器と前記表示システムの表示パネルのカラム電極にアナログ信号を駆動するために採用されたデジタル・アナログ・ラッチとの間にある低電磁干渉(EMI)/低電力のインタフェースとして機能することを特徴とする請求項11または請求項12に記載の制御回路。
- 前記インタフェースのアレイにビデオ・データを伝送する伝送回路をさらに備えることを特徴とする請求項11または請求項12に記載の制御回路。
- 前記インタフェースのアレイが、前記ビデオ・データを、前記表示システムの表示パネルのカラム電極を駆動するためのアナログ信号に変換することを特徴とする請求項15に記載の制御回路。
- 任意の種類のスイング低減シグナリングが、前記ビデオ・データを前記インタフェースのアレイに伝送するために、使用され得ることを特徴とする請求項14または請求項15に記載の制御回路。
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