JP4163877B2 - トーテムポール型プッシュプル増幅器 - Google Patents
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Description
【発明の属する技術分野】
本発明は、スイッチング電源や一般電子機器に用いられるトーテムポール型プッシュプル増幅器に関するものである。
【0002】
【従来の技術】
増幅器の一種にプッシュプル増幅器があり、その一種として増幅素子を重ねた構造のトーテムポール型のものがある。各種スイッチング電源や電子機器に用いられている。
【0003】
そのようなトーテムポール型のプッシュプル増幅器として図3に示した回路が利用されている。基本的には、極性反転トーテムポール構成の増幅回路31とドライバ32で構成されるもので、以下のような動作を行う。
【0004】
信号入力端子Sig.INに与えられる信号が高電位パルスの場合を説明する。電源入力端子Vccに電圧を印加した状態でSig.INに高電位パルス信号を入力するとドライバのトランジスタQ3はオンし、Q3のコレクタ電位は低電位(ほぼ0ボルト)になるため、トランジスタQ1のベースは正バイアス、トランジスタQ2のベースは非正バイアスとなる。したがってトランジスタQ1はオン、トランジスタQ2はオフとなり、Sig.OUTには高電位信号(ほぼVcc)が得られる。
【0005】
信号入力端子Sig.INに与えられる信号が低電位パルスの場合を説明する。電源入力端子Vccに電圧を印加した状態でSig.INに低電位パルス信号(ほぼ0ボルト)を入力するとトランジスタQ3のベースは非正バイアスのためにオフとなる。これによってトランジスタQ3のコレクタ電圧は抵抗R3とR4、R1、R2の合成抵抗値R0値で分圧された電圧になる。
R0={R4(R1+R2)}/R4+R1+R2
この電圧はトランジスタQ2がオンとなるのに必要な電圧に抵抗R0、R3を設定しているので、Q2はオンし、Sig.OUTには低電位信号(ほぼ0ボルト)が得られる。
【0006】
【発明が解決しようとする課題】
しかし、トランジスタQ2がオン状態にある場合、Q3のコレクタ電位はトランジスタQ2のベース―エミッタ間順方向電圧に等しく(一般に0.7ボルト前後)となる。このとき、トランジスタQ1のベース―エミッタは正バイアスされた状態であるためトランジスタQ1がオンし、トランジスタQ1、Q2の双方が同時にオンしてしまう可能性がある。
【0007】
このため、トランジスタQ1、 Q2の一方または双方が損傷する可能性が生ずる。本発明は、このような増幅素子の同時のオン状態を防止して、素子の損傷を防止するものである。
【0008】
【課題を解決するための手段】
本発明は、増幅素子の制御端子間にダイオードを接続することによって、上記の課題を解決するものである。
【0009】
すなわち、プッシュプル動作を行う第1および第2のトランジスタの接続点から共通コレクタフォロア出力を得るトーテムポール型プッシュプル増幅器において、2つのトランジスタのベース間に第2のトランジスタから第1のトランジスタへ順方向となるダイオードを接続したことに特徴を有するものである。トランジスタをMOSFETに代えても同様である。
【0010】
【発明の実施の形態】
増幅素子の制御端子間にダイオードを接続することによって、第2の増幅素子がオン時に第1の増幅素子がオンされることが防止され、2つの増幅素子が同時にオンされることはなくなる。
【0011】
【実施例】
以下、図面を参照して、本発明の実施例について説明する。図1は、本発明の実施例を示す回路図である。極性反転トーテムポール構成の増幅回路11とドライバ12で構成され、基本的にその動作は前記の例と同じである。前記と異なる点は、トランジスタQ2のベースとトランジスタQ1のベース間にダイオードD1D2が接続された点である。
【0012】
これによって、従来問題となっていた、入力信号が低電位(ほぼ0V)信号時にトランジスタQ1、Q2が同時にオンしてしまうことを防止する。以下、その動作を説明する。
【0013】
この回路を採用すれば、トランジスタQ3のベースに低電位信号が入力されてトランジスタQ3がオフして、抵抗R4、ダイオードD2を介してトランジスタQ2のベース―エミッタ間が正バイアスを受けてトランジスタQ2がオンしても、トランジスタQ1のベース電流はダイオードD1によって阻止される。したがって、トランジスタQ1は非正バイアスの状態が維持されてトランジスタQ1がオンすることはないので、トランジスタQ1、Q2が同時にオンとなることは皆無となる。
【0014】
なお、この回路ではダイオードD1と逆極性のダイオードD2が電源入力端子Vccに接続された抵抗R4とトランジスタQ2のベース間に接続されている。これは、トランジスタQ3のベースに高電位信号が入力されてトランジスタQ3がオンしたときに、ダイオードD1の順方向降下電圧がトランジスタQ2のベース―エミッタ間に印加されてトランジスタQ2がオンするのを確実に防止するためのものである。例えば、ダイオードD1にショットキーダイオードのような順方向降下電圧のものを使用して、
VD1<VBE2
ここでVD!:ダイオードD1の順方向降下電圧
VBE2:トランジスタQ2のベース―エミッタ間正バイアス電圧
とすれば省略することができる。あるいは、ダイオードD2に代えて抵抗を使用してもよい。
【0015】
なお、本発明は、上記のトランジスタQ1〜Q3をMOSFETに代えて図2のような回路構成とすることもできる。
【0016】
【発明の効果】
本発明によれば、ダイオードを1または2個使用することによって、第2の増幅素子がオンしたときに、第1の増幅素子が同時にオンされることを確実に防止することができる。したがって、増幅素子の損傷を防止することができ、確実に回路を動作させることができる。
【図面の簡単な説明】
【図1】 本発明の実施例を示す回路図
【図2】 本発明の他の実施例を示す回路図
【図3】 従来のトーテムポール型プッシュプル増幅器を示す回路図
【符号の説明】
11、31:極性反転型トーテムポール
12、32:ドライバ
Claims (2)
- プシュプル動作を行う第1および第2のトランジスタの接続点から共通コレクタフォロア出力を得るトーテムポール型プッシュプル増幅器において、
アノード同士を接続する第1、第2のダイオードを備え、
電圧源から第4の抵抗を介して該第1、第2のダイオードの共通アノード接続点に接続され、該第1のダイオードのカソードが第2の抵抗を介して該第1のトランジスタの制御端子に接続され、該電圧源と該第1のトランジスタの制御端子間に第1の抵抗が接続され、該第2のダイオードのカソードが該第2のトランジスタの制御端子に接続され、該第2のトランジスタの制御端子とアース間に第3の抵抗が接続され、
信号源は該第1のダイオードのカソードと第2の抵抗との共通接続点に接続されたこと、
を特徴とするトーテムポール型プッシュプル増幅器。 - プシュプル動作を行う第1および第2のMOSFETの接続点から共通ドレインフォロア出力を得るトーテムポール型プッシュプル増幅器において、
アノード同士を接続する第1、第2のダイオードを備え、
電圧源から第4の抵抗を介して該第1、第2のダイオードの共通アノード接続点に接続され、該第1のダイオードのカソードが第2の抵抗を介して該第1のMOSFETの制御端子に接続され、該電圧源と該第1のMOSFETの制御端子間に第1の抵抗が接続され、該第2のダイオードのカソードが該第2のMOSFETの制御端子に接続され、該第2のMOSFETの制御端子とアース間に第3の抵抗が接続され、
信号源は該第1のダイオードのカソードと第2の抵抗との共通接続点に接続されたこと、
を特徴とするトーテムポール型プッシュプル増幅器。
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