JP3994977B2 - 高周波スイッチ - Google Patents
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Description
この構成によれば、PINダイオードを抵抗成分と容量成分に相互に切り替えることにより、中心周波数では抵抗成分を供する経路側が分岐点から見て開放と見なせるので遮断となり、入力端子から入力した信号は容量成分を供する経路側へ流れて、スイッチとして動作させることができる。
また、中心周波数から外れるにつれて分岐点から見る遮断側の状態が開放からずれたとしても、整合部によって通過側の整合を取ることにより、出力端子での反射を改善して広帯域にわたり良好な性能を得ることができる(例えば、特許文献1参照)。
また、従来の高周波スイッチでは、PINダイオードに対するバイアス回路は経路から見て開放と見なせるように高インピーダンス線路と高抵抗の組合せやチョークコイル等により構成する必要があるが、高抵抗を用いる場合は消費電力値が上昇してしまい、チョークコイルを用いる場合は回路が大型化してしまうという問題があった。
以下、図を用いてこの発明に係る実施の形態1について説明する。
図1は実施の形態1による等価回路図である。入力端子1から出力端子2a(第1の出力端子)および出力端子2b(第2の出力端子)までの構成は対称である。
入力端子1には、一対のDCカットキャパシタ10の一方の電極が並列に接続される。各DCカットキャパシタ10の他方の電極には、伝送線路4a、4b(第1、第2の伝送線路)の一端が夫々接続される。伝送線路4a、4bの他端は、並列装荷された一対のPINダイオード3a、3b(第1、第2のスイッチング素子)のアノードに、夫々接続される。一対のPINダイオード3a、3bのカソードは、夫々接地されている。また、一対のPINダイオード3a、3bのアノードは、伝送線路5a、5bの一端に夫々接続される。伝送線路5a、5bの他端は、伝送線路6a、6bの一端に夫々接続される。伝送線路6a、6bの他端は、伝送線路7a、7bの一端に夫々接続される。伝送線路5a、5b、伝送線路6a、6b、および伝送線路7a、7bは、夫々直列に接続されて第3、第4の伝送線路を構成し、第3、第4の伝送線路はいずれも整合部として機能する。
なお、PINダイオード3a、3bの代わりに、FET(電界効果トランジスタ)を用いても良い。
この場合、PINダイオード3aにバイアス端子9aより逆バイアス電圧を印加し、PINダイオード3bにバイアス端子9bより順バイアス電圧を印加する。PINダイオード3は、逆バイアスを印加した状態を近似的にキャパシタで、順バイアスを印加した状態を近似的に抵抗で置き換えられるため、本高周波スイッチは図2に示す等価回路で表される。
一般的に抵抗13は数Ω程度の低抵抗値であり接地されたことと同等となるため、その先の伝送線路5b以降には信号は伝送されない。一方、キャパシタ12は数pF以下の低容量値であり、並列装荷されたそれはマイクロ波帯またはミリ波帯では高インピーダンスとなるため信号の伝送経路から見て無視できる。また、DCカットキャパシタ10およびバイアスキャパシタ11は低インピーダンスであるため同じく無視できる。
通常の高周波回路同様、そのインピーダンスは50Ωとする。また、各線路のインピーダンスは、伝送線路4a、4bがZ1、伝送線路5aがZ2、伝送線路6aがZ2、伝送線路7aがZ1、バイアス線路8aがZ1とする。この場合における周波数ごとの動作を説明する。
図4に図3に示した等価回路における、各部のインピーダンスを示した等価回路図を示す。出力端子2a側から伝送線路5aを見たインピーダンスをZA、伝送線路4aを見たインピーダンスをZB、並列装荷された伝送線路4bを見たインピーダンスをZCとする。また、入力端子1側から伝送線路6aを見たインピーダンスをZA'、伝送線路7aを見たインピーダンスをZB'、並列装荷されたバイアス線路8aを見たインピーダンスをZC'とする。このとき、ZAとZA'が実部のみで表され、同じ値となるようなZ1およびZ2としている。以下に周波数f0/2および3f0/2におけるZAを導出して説明する。
この周波数においては、全ての線路の線路長が1/8波長に相当する。まず、ZCは式1で表される。次にZBは式2で表される。さらに式2に式1を代入するとZBは式3で表される。伝送線路5aの線路長が1/8波長に相当する場合、式4の関係が成り立てばZAは式5で表される。
ここでZAは虚部が存在せず実部のみで表されており、同じ回路構成であるZA'についても同式で表され等しくなる。
また、ZB、ZCについても同様に定式化されて、同じ回路構成であるZB' 、Zc'とそれぞれ等しくなる。
すなわち、各伝送線路において整合が取れることを示しており、入力端子1から出力端子2aまでの経路に不整合は生じず、低損失な特性を示す。
図6に周波数3f0/2における動作説明図を示す。この周波数においては、全ての線路の線路長が3/8波長に相当する。まず、ZCは式6で表される。次にZBは式7で表される。さらに式7に式6を代入するとZBは式8で表される。ここで、伝送線路5aの線路長が3/8波長であることから、1/8波長線路と1/4波長線路に分割して考える。
ここで、ZAは虚部が存在せず実部のみで表されており、同じ回路構成であるZA'についても同式で表され等しくなる。
また、ZB、ZCについても同様に定式化されて、同じ回路構成であるZB' 、Zc'とそれぞれ等しくなる。
すなわち、周波数f0/2の場合と同じく、各伝送線路において整合が取れることを示しており、入力端子1から出力端子2aまでの経路に不整合は生じず、低損失な特性を示す。
Claims (4)
- 入力端子と、
第1、第2の出力端子と、
一端側が接地された第1、第2のスイッチング素子と、
一端側が上記入力端子にそれぞれ接続され、他端が上記第1、第2のスイッチング素子の他端にそれぞれ接続されて、各々4分の1波長の電気長に相当する導体線路で成る第1、第2の伝送線路と、
一端が上記第1、第2のスイッチング素子の他端に接続されるとともに、他端側が上記第1、第2の出力端子にそれぞれ接続された、4分の3波長の電気長に相当する導体線路で成る第3、第4の伝送線路と、
一端が上記第3、第4の伝送線路の他端にそれぞれ接続された、4分の1波長の電気長に相当するバイアス線路を有して成る第1、第2のバイアス回路と、
を備えた単極双投型の高周波スイッチ。 - 上記第3、第4の伝送線路は、4分の1波長の電気長に相当する3つの導体線路を、直列に接続して構成されることを特徴とした請求項1記載の高周波スイッチ。
- 上記第1、第2のバイアス回路は、上記バイアス線路の他端に接続された容量性素子を備えたことを特徴とする請求項1記載の高周波スイッチ。
- 上記第1、第2のスイッチング素子にPINダイオードを用いて、当該PINダイオードのカソード側を接地側としたことを特徴とする請求項1記載の高周波スイッチ。
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