JP3705312B2 - 符号化伝送のための方法及び装置並びにその利用装置 - Google Patents
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Description
【発明の属する技術分野】
本発明は、デジタルデータを通信バスに沿って或る電子回路から別の電子回路に伝送する技術に関する。本発明は、より詳細には、最少数の導体を備えるバスによる直列通信に関する。
【0002】
【従来の技術】
2つの回路間の通信は、「マスタ」回路と「スレーブ」回路の間の通信バスを介して行われることが多い。このスレーブ回路は、マスタ回路の要請があったときに限り、バスに沿ってデータを送る。これは、特に、1つのマスタ回路が、いくつかの交換可能乃至取外し可能なスレーブ回路と通信する必要がある場合に行われ、各スレーブ回路には、何らかの情報を格納することができる。
【0003】
このようなスレーブ回路は、部品を識別するのに使用されるタグであってよく、タグは、瞬間的にのみ通信バスとの接続状態がもたらされるか、或いは、通信バスと接続状態になる最初のときにそれ自身に関する何らかの情報を提供する必要がある。
【0004】
一般に、マイクロプロセッサ・マスタ回路とメモリ装置スレーブ回路との間で使用される通信バスは、少なくとも4つの導体、すなわち、接地電圧供給、電源電圧、クロック信号及び双方向データ導体を含む。チップ・セレクト指令及びチップ・デセレクト指令(チップ・セレクト解除指令)が必要な場合には、クロック及びデータ信号の専用の組合せを用いることができ、この組合せは、スレーブ回路によりチップ・セレクト乃至デセレクトとして解釈することができる。
【0005】
2線式通信バスは、ダラスセミコンダクタ(Dallas Semiconductors )の製品DS2400に関して説明されているように、よく知られている。これは、1本の接地導体及び1本の信号導体を用いる。信号は接地導体に関して0V〜5Vのパルスを含む。
【0006】
可能な限り少数の導体で通信することができる通信バスを提供することが求められている。これによって、バスの設置が簡単になり、スレーブ回路を非常に小型かつ安価なパッケージに収納することができる。よく知られた2導体バスは、スレーブ回路に供給するのに必要な電力を効率的には伝送しない。また、マスタ及びスレーブ回路に共通のクロック信号がないため、これらの2つの回路は同期化されない。
【0007】
【発明が解決しようとする課題】
本発明の目的は、最少数の導体を用いて、必要な電源、クロック信号及び制御信号を供給するマスタ回路・スレーブ回路間双方向通信方法を提供することにある。
【0008】
さらに、本発明は、電源を備えない識別タグであるが、最少数のコネクタを有し、かつ、クロック信号、電力供給、データならびに制御信号を伝送する通信バスによって駆動することができる識別タグを提供することを目的とする。
【0009】
本発明はまた、前述のような通信バスの接続によって、利用可能な物品に関する情報をタグから読み取ったり、タグ中に保存することができる前記タグを備える利用可能な物品を提供することを目的とする。
【課題を解決するための手段】
【0010】
従って、本発明は、クロック信号、電源電圧及び双方向性デジタルデータを符号化し、マスタ回路からスレーブ回路に伝送するための改良された方法及び装置並びにその利用装置を提供する。本発明による方法は、第1導体を第2導体に関して第1電圧に保持するステップ、第1導体を第2導体に関して第2電圧に周期的に上昇させるステップであって、この上昇が前回の第2電圧への上昇後或る固定された周期をもって行われるステップ、第2電圧への上昇後は或る固定された期間維持するステップ、予め定められた期間の間、第1導体を第2電圧に保持し、その後、第1導体を第1電圧に戻すステップ、及び、前記予め定められた期間を制御して、各期間に論理的な意味を与えるようにするステップを具備する方法において、さらに、
第2導体を、第1及び第2電圧とは異なる第3電圧に保持するステップ、
第1導体が第2電圧に上昇した時点に関して或る時間的なオフセットにて第1導体の電圧を計測するステップ、
前記計測された電圧を、予め定められた論理的な意味に従って解釈するステップ、及び、
第1導体を第2電圧まで上昇させるステップであって、この上昇がクロック信号として用いられるステップ
を具備することを特徴としている。
【0011】
【発明の実施の形態】
次に、本発明による所定の実施例を、一例として、添付の図面を参照して説明しよう。
【0012】
図1は、本発明のシステム全体を示す。マスタ回路であるマイクロプロセッサμPは、電源電圧Vcc及び接地電位GNDによって給電される。通常、これらは+5V及び0Vにそれぞれ設定される。通信バスBは、マスタ回路μPをスレーブ回路Mと接続する。スレーブ回路Mは、個別の電源電圧接続を持たない。マスタ回路は、入力インターフェースμPI、出力インターフェースμPOと、クロック発生回路μPCとを備える。スレーブ回路は、入力及び出力インターフェースMI、MOと、スレーブ回路の給電用の電源電圧発生回路MVと、タイミング回路MCとを備える。通信バスを構成する2本の導体は、信号線Sと接地線Gである。接地線は、アース(GND)に接続され、信号線Sは、入力及び出力インターフェース及び電源電圧発生回路MVのすべてに接続される。
【0013】
本発明によれば、信号線Sの電圧は、二つの値、すなわち、高い値V1 と低い値V0 のうちの一つを取ることができる。これらの値は、一般に、それぞれ+5V及び+3Vでよい。
【0014】
二つの導体S,G間の電圧がV0 以下に下がることは決してないため、スレーブ回路Mに対する安定した電源電圧が、電源電圧発生回路MVによって、信号線Sの電圧から容易に導き出すことができる。これは、図2〜4に示されるように、少なくとも下記の三つの方法のうちの一つで実施することができる。
【0015】
1.(図2):通信バス導体S,Gから直接、スレーブ回路の電源電圧Vcmを導き出す。これは、図示されるように、V1 及びV0 間で変動する電源電圧Vcmを与えるが、特定のケースで許容することができる。
【0016】
2.(図3):電源電圧発生回路MVは、通信バス導体S,G間に、単純な半波整流器D1 と平滑回路C1とを直列に備える。これは、前出のケースよりはるかにV1に近い平均値であるが、図示されるように大きなリップル電圧を持つダイオードD1とコンデンサC1との共通ノードにおいて、スレーブ回路電源電圧Vcmを発生する。
【0017】
3.(図4):電源電圧発生回路MVは、スレーブ回路のS導体、G導体及び電源電圧Vcm入力間で接続された三端子電圧安定器REGを備える。これは、図示されるように、非常に安定した電圧出力Vcmを与えるという利点があるが、一般にV0よりVdr低い値では、安定器によって電圧降下が起こる。しかし、この電圧降下がゼロの場合もある。
【0018】
図5(a)は、本発明の通信バスに沿った典型的な通信状態を抜出して描いたものである。本発明の通信バスによって伝送されるデジタルデータは、図2で確認できる電圧V0及びV1間を変動するパルスのシーケンスに送られる。これらパルスを孤立させるため、閾値をV0 及びV1 の間に設定し、スレーブ回路M中で電圧比較器を用いることができる。
【0019】
図5(b)に示される信号out(t)は、このような比較器によって発生させることができる。比較器は、信号線Sの高い電圧V1 を比較器の電源レベルVcm前後で高い値に移動させ、信号線Sの低い電圧V0 を接地線Gの電圧前後で低い値に移動させる。
【0020】
信号線Sの信号は、各立上り遷移(rising transition )が、図5(b)中に立上りエッジ上の矢印で示されるクロック・エッジに対応するように設計されている。従って、out(t)信号の0から1への遷移は、前の遷移から所定の遅延Tをおいて起こる。
【0021】
図5(a),(b)に示される周期P0,P1は、それぞれ0と1を表すデータ・ビットの伝送を示す。各周期は、持続時間Tであり、それぞれ、開始時点t1から時点t1+Tまでと、時点t1+Tから時点t1+2Tまで続く。
【0022】
周期P0では、時点t1に立上りエッジが存在し、クロック周期の開始を示す。信号out(t),Sは時間T0の間、それぞれの高い値にとどまり、次に、それぞれの低い値に戻る。続く周期P1は、時点t1+Tで開始し、時点t1での立上りエッジ後の1クロック周期Tである。
【0023】
周期P1では、時点t1+Tに立上りエッジが存在し、クロック周期の開始を示す。信号S,out(t)は時間T1の間、それぞれの高い値にとどまり、次に、それぞれの低い値に戻る。これらの周期P0,P1は、それぞれデータの1ビットを伝送する。続く周期は、時点t1+2Tで、時点t1+Tにおける立上りエッジ後の1クロック周期Tを開始する。
【0024】
これら信号の解釈は、スレーブ回路の入力インターフェースMIによって行われる。
【0025】
信号out(t)の値は、点線で表された時点に、各クロック・エッジ後の遅延Tdで標本化する。Tdは、T0より長く、しかもT1より短くなるように選択される。従って、この標本の値は、伝送されるデータ・ビットの値、即ち、周期P0ついては(時点t1+Tdで)「0」、また、周期P1ついては(時点t1+T+Tdで)「1」を与える。
【0026】
データ・バスが双方向性であることから、スレーブ回路Mがマスタ回路μPに情報を伝送することができるようにしなければならない。マスタ回路によって供給される信号Sは、データ・バス上にクロック・エッジを送り続けなければならない。スレーブ回路へのアドレス指定、ならびにこの回路にすでに送られた他のデータから、スレーブ回路は、必要な時点にデータを伝送する準備をする。周期Pmxは、スレーブ回路がデータを戻すことができるように、マスタ回路から伝送される可能化信号を示す。
【0027】
図5(a),(b)の周期Pmxを考慮し、立上りエッジが時点t1+3Tで起こり、信号S、out(t)は、Tsの遅延の間、高い値にとどまる。この遅延は、T1に等しいか、望ましくはT1より長い。
【0028】
データ・バスを介して双方向通信を行うことができるようにするために、マスタ回路μPの出力インターフェースμPOは、V0及びV1間の電圧については高いインピーダンス、また、V0以下の電圧については低いインピーダンスを示し、信号線Sの電圧がV─を下回ることがないようにしなければならない。
【0029】
図5(a),(b)の周期Pm0は、導体S上の信号と、スレーブ回路が0を伝送したとき、スレーブ回路によって供給された信号out(t)とを示す。out(t)に対する返答として、スレーブ回路出力インターフェースMO中の低いインピーダンス回路が、クロック・エッジt1+4T後のTmの遅延で、時間長さTm0の間、導体Sを値V0にする。この時間長さTm0は、Ts後に満了するように選択される。導体Sの電圧を低い値に引き込む様子は、太い線で示される。これは、すでに説明したが、マスタ回路の出力インピーダンスによって可能であり、スレーブ回路が信号線をV0レベル(しかし、V0以下ではない)にすることを容易にする。スレーブ回路が1を伝送したいときには、スレーブ回路は、マスタ回路によって伝送された可能化信号をそのままに〔図5(a),(b)の周期Pm1中にあるように〕しておくだけでよい。マスタ回路は、クロック・エッジ後の遅延Tmxで信号Sの値を標本化する。Tmxは、信号線の値を標本化する前にスレーブ回路によって実施される遅延Tdと等しくてよい。周期ごとにこのように取られた標本は、伝送されたデータ・ビットの値(0,1)を表す。このようにしてスレーブ回路からマスタ回路に伝送されたデータは、マスタ回路中の直列データ・レジスタに保存し、語(ワード)にアセンブルし、適宜解釈することができる。これは、スレーブ回路がすべての要求されたデータを伝送し終わるまで続く。スレーブ回路は、その伝送が終了したことを知らせるために、特定コードを送ることができる。或いは、単にマスタ回路が可能化信号を送るのを止めるだけでもよい。
【0030】
数個のスレーブ回路が同じデータ・バスに接続されているシステムでは、チップ・セレクト及びデセレクト信号が各回路をアドレス指定する必要がある。
【0031】
図6(a),(b)は、チップ・セレクト及びデセレクト信号を伝送するのに使用される信号S及びout(t)を示す。チップ・セレクト条件(周期Psel)を示すために、信号線Sの電圧は、時点t2でのクロック・エッジに続く期間Tselの間、高電圧V1に保持される。期間Tselは、望ましくはクロック周期Tより長く、しかも2クロック周期より短い。信号out(t)は、このことを、期間t2〜t2+Tselの間、1の値で表す。
【0032】
チップ・デセレクト条件(周期Pdes)を示すために、信号Sは時点t3でのクロック・エッジ後の遅延Trで、電圧V0と低くなり、期間Tdesの間低いままである。遅延Trは、図5(a),(b)を参照にしてすでに述べた遅延T0と等しくてよい。このことは、図6(b)に示すように、信号out(t)によって表される。期間Tdesは、望ましくはクロック周期Tより長く、しかも2クロック周期より短い。信号S,out(t)は、時点t3+2Tでの次のクロック・エッジまでその低い値にとどまる。セレクト及びデセレクト信号期間Tsel,Tdesも、2クロック周期より長いが、3クロック周期或いは他のそのような長さより短い。
【0033】
各チップ・セレクト又はデセレクト指令について、スレーブ回路は、時点t2+T,t3+Tにおける不明クロック・エッジを検出する。out(t)の値は、不明クロック・エッジが検出されたとき、最後のクロック・エッジ後の遅延Tcで標本化され、この標本の値が、信号がチップ・セレクト(1)か、デセレクト(0)かを示す。チップ・セレクト指令に続く直列データは、要求されたチップを選択するように、識別特徴を与えるために使用することができる。データ・バスは、一回につき一つのスレーブ・チップとしか通信できないので、デセレクト指令と共に識別データを送る必要はない。単に以前選択されたチップが、デセレクトされた状態になる。
【0034】
図7〜13は、本発明の通信バスを作成するのに用いることのできる回路図である。
【0035】
図7は、スレーブ回路電源電圧発生回路MVとして使用するのに適した回路を示す。この回路は、半波整流器及び平滑回路である。この回路は、抵抗器R1、ダイオードM1或いはダイオード接続トランジスタ、及び、通信バスBのS及びG導体間で直列に接続されたコンデンサC2を備える。
【0036】
トランジスタQ1〜Q4の直列配列が、M1及びC2の共通ノードFと導体Gとの間に接続されている。これらのn型チャネル・トランジスタは、ソースが次のトランジスタのゲート及びドレインに順次接続され、Q4のソースは、導体Gに接続され、Q1のゲート及びドレインはノードFに接続されている。
【0037】
別のトランジスタM2は、S導体とVcm出力との間に接続されたチャネルを備え、ゲートがノードFに接続される。更に別のトランジスタM3は、M2のチャネルと並列に接続されたチャネルを備え、ゲートがVcm出力に接続されている。これらのトランジスタM2、M3は、ほぼ同一の閾値電圧をもつ。
【0038】
半波整流器及び平滑回路M1,R1,C2は、ノードFに比較的一定の電圧を供給するように作動し、電圧の値は電圧V1とV0との間にある。トランジスタQ1〜Q4はダイオード接続されており、ノードFで、約3.3 Vの一定電圧を保持するように作用する。これらのトランジスタは、その閾値電圧及び要求される一定電圧に応じて、数を増やしたり減らしたりすることができる。トランジスタM2は、電圧フォロアとして作動する。これは、Vcm出力とノードFとの間の閾値電圧を保持し、Sからの電流通路を提供することにより、低いインピーダンス供給出力を与える。電源電圧Vcmは約2.8 Vに保持される。出力電圧Vcmも、S導体から直接出力Vcmに電流を送るトランジスタM3によって、約2.8 Vに保持される。
【0039】
この回路は、比較的安定している電源電圧Vcmを供給するが、この電圧はかなり低い値である。
【0040】
図8は、スレーブ回路のための入力インターフェースMIの第一の実施例を示す。抵抗R2,R3を備える分圧器が通信バスの導体S,G間に配置されている。G導体と分圧器の共通ノードF2との間には、コンデンサC3が配置される。ノードF2はトランジスタQ5のゲートに接続され、このトランジスタのチャネルは、導体GとノードXの間に接続され、電流iの電流源Soの第1端子と共通である。インバータINVは、入力がこのノードXに接続され、出力がインターフェースされる信号out(t)となる。電流iの電流源Soは、単純に、高い値の抵抗器でよい。抵抗分圧器は、信号Sの電圧の約1/4がQ5のゲートに印加されるように設計されている。コンデンサC3は、抵抗R2,R3と共同してノイズ・フィルタとして作動する。このフィルタは、望ましくは、100 ns前後の時定数を持っている。例えば、R2が300 kwの値を持ちR3が100 kwの値を持つ場合には、C3は1pF前後の値を持つ。Sが5〜3Vの間を変動する場合には、ノードF2における電圧は、1.25〜0.75Vの間を変動する。従って、SがV0のときには、ノードXにおける電圧が高く、また、SがV1のときには低くなるように、Q5は、1V前後の閾値電圧を持つよう選択する必要がある。
【0041】
図9は、スレーブ回路の入力インターフェースMIの別の実施例を示す。図8と同じ要素は同じ参照記号で示されている。ここで、通信バスの導体S,G間に接続された抵抗器R2及びコンデンサC3は、共通ノードF3を有する。所定数のダイオード接続トランジスタ、例えば、2つのトランジスタQ6,Q7が、ノードF3と別のノードYとの間に直列に接続される。ノードYはトランジスタQ5のゲートに接続され、また、電流源I8を通じて、導体Gに接続される。電流源I8は、MOSトランジスタを用いる電流ミラーでよく、飽和モードで作動する。固有n型チャネル・トランジスタQ8は、電流ミラー回路(図示せず)によって供給されるゲート電圧Vgiによって制御される。これは、一般に、100 μAの電流を供給することができる。
【0042】
コンデンサC3は、抵抗器R2と共同してノイズ・フィルタとして作動し、約1pFの値を持つ。トランジスタQ6、Q7は、各々が約1.5 Vの閾値電圧を持つp型チャネル固有トランジスタでよい。従って、ノードYにおける電圧は、ノードF3における電圧より約3V低い。これは、導体Sが5V〜3Vの間を変動することから、R2の端子電圧に応じて、2V〜0Vの間を変動する。また、トランジスタQ5は、Sが低い(VO)とき、ノードXに高い電圧を、またSが高い(V1)とき、ノードXに低い電圧を供給するように作動する。インバータINVは、論理を修正し、閾値作用によってclean out (t)信号を送る。このようにインターフェースされたデータは、スレーブ回路のクロック信号に従って、周期ごとに一度作動されるラッチを用いて、保存することができ、このようにして保存されたデータは、解釈のためにレジスタ中にまとめてアセンブルする。
【0043】
図10は、スレーブ回路Mの出力インターフェースMOの実施例を示す。抵抗器R4及びn型チャネルMOSトランジスタT3は、それぞれ、データ・バスの導体S,G間に直列に接続される。直列に出力されるべきであるデータSdmは、インバータINVAを通じて、トランジスタT3のゲートに与えられる。
【0044】
スレーブ回路が「0」ビットを伝送したい場合には、インバータINVAはT3のゲートに高い電圧を印加する。トランジスタT3は導電状態になり、導体Sの電圧は、トランジスタT3の短絡効果によって導体Gの電圧に接近し、この短絡効果に抵抗R4によって制限される。
【0045】
スレーブ回路が「1」ビットを伝送したい場合には、インバータINVAはT3のゲートに低い電圧を印加する。トランジスタT3は非導電状態になり、導体Sの電圧は影響を受けない。
【0046】
図11は、マスタ回路出力インターフェースμPOの実施例を示す。インバータINV2を介して、MOSトランジスタM4のゲートに送られるべき直列データ信号Sdμが与えられる。このトランジスタM4は、通信バスの2つの導体S,G間に、抵抗器R5と並列に接続される。直列順方向バイアス・ダイオードD4a〜D4cが電源電圧VccとS導体との間に接続される。これらのダイオードはダイオード接続MOSトランジスタでよい。抵抗器R6はこれらのダイオードと並列に接続される。
【0047】
Sdμの値が低い場合には、インバータは、トランジスタM4のゲートに高い電圧を起こし、これを導電状態にする。次にS導体の電圧は、抵抗器R5、R6によって形成される分圧器によって決定される。従って、導体Sは、R5がR6とほぼ等しければVcc/2に、また、5Vの電源Vccについては約2.5 Vとなる。
【0048】
Sdμが高いレベルにある場合には、インバータINV2によって変換され、トランジスタM4のゲートに低い電圧を印加する。このトランジスタは非導電状態になり、S導体の電圧は、引上げ(pull-up )抵抗器R6によって、Vccになるまで上昇する。スレーブ回路が導体Sを3V以下にしようとする場合には、順方向バイアス・ダイオードD4a〜D4cは、導体S上に約3Vの値を保持する。このようにして、すでに説明したように、この回路は、V1とV0の間の所望の高い出力インピーダンスを持ち、V0以下の値については低い出力インピーダンスを持つ。
【0049】
図12は、マスタ回路の入力インターフェースμPIの実施例を示す。信号線Sは、抵抗器R7を介して、比較器COM2の非変換入力に接続されている。抵抗器R8、R9から成る抵抗分圧器は、Vccと接地導体Gとの間に接続され、中央ノードNを持ち、このノードは、比較器COM2の変換入力に接続される。比較器の出力は、マスタ回路による使用のために、直列データ入力信号in(t)を供給する。この信号は、すでに述べた信号out(t)に類似するが、マスタ回路への入力用である。抵抗分圧器は、R9がR8の値の約4倍の値を持つように設計されている。G導体がマスタ回路の接地端子に接続されているので、ノードNは、4V前後の電圧を持つことになる。
【0050】
導体Sの電圧がノードNの電圧を上回る場合には、比較器の出力in(t)は高くなる。また、導体Sの電圧がこの値を下回る場合には、出力in(t)は高くなる。マスタ回路は、(例えば)送りレジスタ中に信号in(t)を保存することによって、このように受信したデータを解釈することになる。
【0051】
本発明の通信バスに送られた信号の符号解読や解釈は、導体S上の電圧の標本化及び発生の正確なタイミングに左右される。クロック・エッジがマスタ回路によって連続的に供給されるため、スレーブ回路は最新のクロック・エッジに関するタイミング遅延を計測するだけでよい。これを達成する最も単純な方法は、各クロック・エッジでリセットされるタイマを用いることである。
【0052】
図13(a)は、スレーブ回路のタイミング回路の実施例を示す。スレーブ回路では、スレーブ回路クロック発生器MCは、直列のラッチL1〜L6から成る多段階カウンタCONの入力に、例えば、2MHz前後でクロック信号CKMを発生する。各ラッチの立上りエッジ感知リセットが、out(t)信号を受信するように接続される。クロックCKM発生器MCは、環状発振器のように非常に単純な構造でよい。
【0053】
図13(b)に示すように、各ラッチの出力信号Co1〜Co6は、out(t)信号の各クロック・エッジによってリセットされた後、それぞれ、CKMの1,2,4,8,16,32周期以内に第1の立上り遷移(transition)を与える。信号out(t)のクロック・エッジはカウンタCONをリセットするが、クロック信号CKMと同期しないため、ラッチによって与えられる遷移は、信号out(t)のクロック・エッジ後、整数分のCKMクロック周期だけオフセットすることができない。各ラッチ出力信号は、本発明のプロトコルにおける事象を時間調節するのに用いられる。それぞれ調節された遅延は、マスタ回路が送る信号out(t)の最新クロック・エッジと相関することから、このタイミング回路は特に精確である必要はない。
【0054】
Co1は、信号out(t)のクロック・エッジの後(前述した2MHzについて)、500 ns以内に立上りエッジを与える。これは、遅延Tmの調節に用いることができ、この遅延の後に、「0」ビットを伝送するために、導体Sはより低い値(V0)になることができる。
【0055】
Co2は、信号out(t)のクロック・エッジ後1μs以内に立上りエッジを与える。これは、マスタ回路からの伝送における0又は1の検出のための遅延Tdの調節に用いることができる。
【0056】
Co3は、信号out(t)のクロック・エッジ後2μs以内に立上りエッジを与える。これは、スレーブ回路がデータを伝送するのを許可する可能化信号として、マスタ回路が送る高い電圧(V1)の終了T1を調節するために用いることができる。
【0057】
Co4は、信号out(t)のクロック・エッジ後4μs以内に立上りエッジを与える。これは、スレーブ回路がS導体をその低い方の値(V0)にする期間Tm0の終了を調節するために用いることができる。
【0058】
Co5は、信号out(t)のクロック・エッジ後8μs以内に立上りエッジを与える。これは、マスタ回路のクロック周期Tとほぼ等しくてよい。
【0059】
Co6は、信号out(t)のクロック・エッジ後16μs以内に立上りエッジを与える。これは、クロック周期よりはるかに長く、チップ・セレクト又はデセレクト信号を検出するのに必要な遅延Tcの調節に用いることができる。
【0060】
「0」を伝送する際、マスタ回路によって送られるパルスの持続時間T0は、Tmとほぼ等しくてよい。
【0061】
信号out(t)のクロック・エッジごとのマスタ回路タイミングと再同期化することから、通常、非常に単純なタイマで十分である。マスタ回路とスレーブ回路によって用いられるタイミングがほぼ同一であったとしても、マスタ・タイマと比較して、スレーブ・タイマの精度の30〜40%ほどの大きさの変動を許容することができる。このような変動は、中でも、プロセス変動や気温の変化によって起こる。この理由で、前述の実施例で調節される遅延は、それぞれ、その前に調節された遅延の2倍の長さになる。タイミング回路として、直列の単安定回路を用いることができ、或いは、高い精度が要求される場合には、PLLタイマを用いることができる。
【0062】
図14は、本発明の通信バス上の双方向通信の可能な内容を示す。最初に、チップ・セレクト指令が、スレーブ回路を可能化するために送られる。多数のスレーブ回路が通信バスに接続されている場合には、どのチップが可能化される必要があるのかを識別するために、このセレクト指令後にチップ・アドレスを送ることができる。次に、演算コード(“opcode")のような命令を送ることができ、これに続いて、この命令が実行されるべきメモリ・セルのアドレスが送られ、さらに、この命令を実施すべきデータが続く。要求される全データ乃至命令を転送するために、演算コード(“opcode")−アドレス・データのシーケンスが何回か繰り返される。スレーブ回路によってマスタ回路に情報を伝送することができるようにするためには、図5(a),(b)を参照にしてすでに説明したように、演算コード(“opcode")転送の代わりに、可能化信号Pm0、Pm1を用いることができる。
【0063】
本発明に従う双方向2線式通信バスは、各要素中に取り付けたタグと通信するために、好適に使用することができる。例えば、プリンタに用いられるトナーを充填したカートリッジは、タグ及び本発明のデータバスを備えることができ、このデータバスは、プリンタ内若しくはホスト・コンピュータ内の何れかで、タグとホスト・マイクロプロセッサとの間の通信を確実するために使用される。タグは、カートリッジに関する情報、例えば、カートリッジの使用年数、トナーの種類、トナー残存量及び製造者により入力された識別コード等を与えることができる。この情報は、ホスト・マイクロプロセッサによって読み取られ、適切なタイプのカートリッジを使用しているか否か、必要な印刷作業のために十分なトナーが使用可能か否か、或いは、所望の種類のトナーが存在するか否かを決定することができる。ホスト・マイクロプロセッサは、オペレータに対して、適切な警告をすることもできる。
【0064】
同様の構想は、安価で消費可能な又は交換可能な要素−電池パック、写真フィルム、更には、自動車部品のためのタグに適用することができ、そこでは、低いデータ転送速度、データ・バスの非常に簡単な設置及び非常に安価なスレーブ諸回路が組み合わせられ、非常に効果的な解決策を提供する。
【0065】
特定の実施例を参照にして説明してきたが、通信バスについては多数の変形例が可能であり、これらも本発明の範囲内にある。
【0066】
特に、信号の極性と論理的な意味は逆転することができる。負の電源電圧を伝送したり、接地導体Gをアース以外の固定電圧にしたり、或いは、差分信号を2本の導体S,Gに伝送することも可能である。
【0067】
ダイオードとして使用されるトランジスタの選択は、要求される極性及び必要な順方向電圧降下によって異なる。
【0068】
切替えに使用されるn型チャネルMOSトランジスタの代わりに、同等のpnp型バイポーラ・トランジスタを用いることもできる。また、ゲート信号の極性が逆転した場合には、p型チャネルMOS又はpnp型バイポーラを用いてもよい。同様に、切替えのためには、p型チャネルMOSトランジスタを用いることもできる。
【0069】
立上りエッジから導き出されたクロック信号は、スレーブ回路の内部作業用にはるかに高いクロック周波数を発生する位相ロックドループに送ることができる。
【図面の簡単な説明】
【図1】 本発明に従うデータ・バス・システム全体の概略図。
【図2】 図1のシステムで用いられる電圧供給を示す。
【図3】 図1のシステムで用いられる電圧供給を示す。
【図4】 図1のシステムで用いられる電圧供給を示す。
【図5】 (a)は、図1のシステムのデータ・バスに沿って伝送される信号を示し、(b)は、閾値回路を通過した後の図5(a)の信号を示す。
【図6】 (a)は、図1のシステムのデータ・バスに沿って伝送される信号を示し、(b)は、閾値回路を通過した後の図5(a)の信号を示す。
【図7】 本発明のスレーブ回路で用いられる電圧供給を示す。
【図8】 本発明のスレーブ回路で使用するための入力インターフェースを示す。
【図9】 本発明のスレーブ回路で使用するための別の入力インターフェースを示す。
【図10】 本発明のスレーブ回路で使用するための出力インターフェースを示す。
【図11】 本発明のマスタ回路で使用するための出力インターフェースを示す。
【図12】 本発明のマスタ回路で使用するための入力インターフェースを示す。
【図13】 (a)は、本発明の通信システムで使用するためのタイミング回路を示し、(b)は、(a)のタイミング回路で発生する信号を示す。
【図14】 本発明のシステム内に伝送される典型的なデータのシーケンスを示す。
【符号の説明】
μP 出力インターフェースμPO、入力インターフェースμPI及びタイミング回路μPCを備えるマスタ回路(マイクロプロセッサ)、
M 入力インターフェースMI、出力インターフェースMO、電圧発生回路MV及びタイミング回路MCを備えるスレーブ回路、
B 第1導体(信号導体)S及び第2導体(接地導体)のみから成る通信バス、V0,V1 第1及び第2電圧、
T 固定された周期、
Co1〜Co6 予め定められた遅延。
Claims (14)
- クロック信号、電源電圧及び双方向性デジタルデータを符号化し、マスタ回路(μP)からスレーブ回路(M)に伝送するための方法であって、
第1導体(S)を第2導体(G)に関して第1電圧(V0)に保持するステップ、
第1導体を第2導体に関して第2電圧(V1)に周期的に上昇させるステップであって、この上昇は、前回の第2電圧への上昇後或る固定された周期(T)をもって行われるステップ、
予め定められた期間の間、第1導体を第2電圧に保持し、その後、第1導体を第1電圧に戻すステップ、及び、
前記予め定められた期間を制御して、各期間に論理的な意味を与えるようにするステップ
を具備する方法において、さらに、
第2導体(G)を、第1及び第2電圧とは異なる第3電圧(GND)に保持するステップ、
第1導体が第2電圧に上昇した時点に関して或る時間的なオフセット(Td,Tmx)にて第1導体の電圧を計測するステップ、
前記計測された電圧を、予め定められた論理的な意味に従って解釈するステップ、及び、
第1導体を第2電圧まで上昇させるステップであって、この上昇がクロック信号として用いられるステップ
を具備することを特徴とする方法。 - 予め定められた第1の期間が「0」ビットを意味し、予め定められた第2の周期が「1」ビットを意味することを特徴とする請求項1に記載の方法。
- 前記固定周期(T)より長い期間の間、第1導体を第1及び第2電圧のうちの一方の電圧に保持して、チップ・セレクト指令を指示するようにすることを特徴とする請求項1又は2に記載の方法。
- 前記固定周期(T)より長い期間の間、第1導体を第1及び第2電圧のうちの一方の電圧に保持して、チップ・デセレクト指令を指示するようにすることを特徴とする請求項1〜3の何れか一項に請求項1に記載の方法。
- 前記マスタ回路は、前記スレーブ回路が通信することができるように、第1導体上に一連のパルスを第2電圧にて送出し、前記スレーブ回路は、第2導体を第4電圧に引込んで、伝送されたビットの第1の極性を指示するようにし、また、第2導体の電圧に影響を与えないで、伝送されたビットの第2極性を指示するようにすることを特徴とする請求項1〜4の何れか一項に記載の方法。
- 第4電圧は第1電圧に等しいことを特徴とする請求項5に記載の方法。
- 第2導体の電圧は、前記固定周期を超える延長期間の間、第2電圧まで上昇せず、この事象は、この延長期間の間、第2導体に存在する電圧に応じて、チップ・セレクト又はデセレクト信号として解釈されることを特徴とする請求項1〜6の何れか一項に記載の方法。
- 出力インターフェース(μPO)及び入力インターフェース(μPI)を備えるマスタ回路(μP)、入力インターフェース(MI)、出力インターフェース(MO)、電圧発生回路(MV)及びタイミング回路(MC)を備えるスレーブ回路(M)、並びに、二つの導体(S,G)のみから成る通信バス(B)を具備し、前記マスタ回路出力インターフェースが、予め定められた二つの電位(V0、V1)の一方に第1導体(S)を保持するデータ通信システムにおいて、
第1の導体の電位を、定期的に、しかも、或る固定された周期(T)をもって、第1電位に戻る前に第2電位とする動作を繰り返し行うための回路を具備し、第1及び第2電位は第3電位(GND)とは異なっており、前記スレーブ回路に電力を供給するために、第2の導体が第3電圧にもたらされる
ことを特徴とするデータ通信システム。 - 前記マスタ回路出力インターフェース(μPO)は、第1の電圧(V0)と第2の電圧(V1)との間の中間電圧に対する出力インピーダンスが、第1及び第2の電圧のうち低い方の電圧(V0)より低位の大きさをもつ低位電圧に比べて、実質的に高くされていることを特徴とする請求項8に記載のデータ通信システム。
- 前記スレーブ回路の出力インターフェース(MO)は、第1の導体と第2の導体との間に低いインピーダンス通路が置かれて、第1極性の信号を前記マスタ回路に伝送するようにし、また、前記スレーブ回路の出力インターフェースは、第1の導体と第2の導体との間にこのような低いインピーダンス通路が置かれないで、第2極性の信号を前記マスタ回路に伝送するようにすることを特徴とする請求項8又は9の何れか一項に記載のデータ通信システム。
- 前記スレーブ回路タイミング回路(MC)は、第1の導体上の各遷移の受信からの所定数の予め定められた遅延(Co1〜Co6)を決定し、前記スレーブ回路入力インターフェースに信号を供給することによって、第1電圧と第2電圧との間にある予め定められた基準値と比較して、第1の導体の電圧が計測されるようにすることを特徴とする請求項8〜10の何れか一項に記載のデータ通信システム。
- 入力インターフェース、出力インターフェース、タイミング回路(MC)及び電源電圧発生回路を備えるスレーブ回路を具備する識別タグにおいて、
前記スレーブ回路は、2つの外部導体に接続され、両導体間に連続的に存在するdc電圧から電力を取り出し、
前記タイミング回路は、両導体間の電圧の定期的な変化に応じた遅延を決定し、
前記出力インターフェースは、両導体間に低インピーダンス通路を提供して、第1極性の信号を伝送するようにし、また、このような低インピーダンス通路を提供しないで、第2極性の信号を伝送するようにする
ことを特徴とする識別タグ。 - 請求項12に記載の識別タグを含むプリンタ用のトナー・カートリッジ。
- 請求項12に記載の識別タグを含む利用可能な物品。
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