JP3574037B2 - 絶縁ゲイト型電界効果トランジスタの製造方法 - Google Patents

絶縁ゲイト型電界効果トランジスタの製造方法 Download PDF

Info

Publication number
JP3574037B2
JP3574037B2 JP2000106052A JP2000106052A JP3574037B2 JP 3574037 B2 JP3574037 B2 JP 3574037B2 JP 2000106052 A JP2000106052 A JP 2000106052A JP 2000106052 A JP2000106052 A JP 2000106052A JP 3574037 B2 JP3574037 B2 JP 3574037B2
Authority
JP
Japan
Prior art keywords
nickel
silicon film
silicon
film
nickel silicide
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP2000106052A
Other languages
English (en)
Other versions
JP2000306835A (ja
Inventor
宏勇 張
秀貴 魚地
徹 高山
舜平 山崎
保彦 竹村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Semiconductor Energy Laboratory Co Ltd
Original Assignee
Semiconductor Energy Laboratory Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Priority claimed from JP04853293A external-priority patent/JP3562588B2/ja
Application filed by Semiconductor Energy Laboratory Co Ltd filed Critical Semiconductor Energy Laboratory Co Ltd
Priority to JP2000106052A priority Critical patent/JP3574037B2/ja
Priority to JP2000123594A priority patent/JP3574040B2/ja
Publication of JP2000306835A publication Critical patent/JP2000306835A/ja
Application granted granted Critical
Publication of JP3574037B2 publication Critical patent/JP3574037B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Landscapes

  • Thin Film Transistor (AREA)
  • Recrystallisation Techniques (AREA)

Description

【0001】
【発明の属する技術分野】
本発明は、薄膜状の絶縁ゲイト型電界効果トランジスタ(薄膜トランジスタもしくはTFT)等の薄膜デバイスに用いられる結晶性半導体を得る方法に関するものである。
【0002】
【従来の技術】
従来、薄膜状の絶縁ゲイト型電界効果トランジスタ(TFT)等の薄膜デバイスに用いられる結晶性シリコン半導体薄膜は、絶縁基板等の絶縁表面上にプラズマCVD法や熱CVD法で形成されたアモルファスシリコン膜を電気炉等の装置の中で600℃以上の温度で12時間以上の長時間にわたって結晶化させて作製された。特に十分な特性(高い電解効果移動度や高い信頼性)を得るためにはより長時間の熱処理が求められていた。
【0003】
【発明が解決しようする課題】
しかしながら、このような従来の方法は多くの課題を抱えていた。1つはスループットが低く、したがって、コストが高くなることである。例えば、この結晶化工程に24時間の時間を要するものとすると、基板1枚当たりの処理時間を2分とすれば720枚の基板を同時に処理しなければならなかった。しかしながら、例えば、通常使用される管状炉では、1度に処理できる基板の枚数は50枚がせいぜいで、1つの装置(反応管)だけを使用した場合には1枚当たり30分も時間がかかってしまった。すなわち、1枚当たりの処理時間を2分とするには、反応管を15本も使用しなければならなかった。このことは投資規模が拡大することと、その投資の減価償却が大きく、製品のコストに跳ね返ることを意味していた。
【0004】
もう1つの問題は、熱処理の温度であった。通常、TFTの作製に用いられる基板は石英ガラスのような純粋な酸化珪素からなるものと、コーニング社7059番(以下、コーニング7059という)のような無アルカリのホウ珪酸ガラスに大別される。このうち、前者は、耐熱性が優れており、通常の半導体集積回路のウェファープロセスと同じ取扱いができるため、温度に関しては何ら問題がない。しかしながら、そのコストが高く、基板面積の増加と共に指数関数的に急激に増大する。したがって、現在のところ、比較的小面積のTFT集積回路にのみ使用されている。
【0005】
一方、無アルカリガラスは、石英に比べればコストは十分に低いが、耐熱性の点で問題があり、一般に歪み点が550〜650℃程度、特に入手しやすい材料では600℃以下であるので、600℃の熱処理では基板に不可逆的な収縮やソリという問題が生じた。特に基板が対角10インチを越えるような大きなものでは顕著であった。以上のような理由から、シリコン半導体膜の結晶化に関しては、550℃以下、4時間以内という熱処理条件がコスト削減に不可欠とされていた。本発明はこのような条件をクリアする半導体の作製方法および、そのような半導体を用いた半導体装置の作製方法を提供することを目的とする。
【0006】
【課題を解決するための手段】
本発明は、アモルファス状態、もしくは実質的にアモルファス状態と言えるような乱雑な結晶状態(例えば、結晶性のよい部分とアモルファスの部分が混在しているような状態)にあるシリコン膜の上もしくは下にニッケル、鉄、コバルト、白金を含有する島状の膜やドット、粒子、クラスター、線等を形成し、これを通常のアモルファスシリコンの結晶化温度よりも低い温度、好ましくは20〜150℃低い温度、例えば580℃以下の温度でアニールすることによって結晶性シリコン膜を得ることを特徴とする。
【0007】
従来のシリコン膜の結晶化に関しては、結晶性の島状の膜を核として、これを種結晶として固相エピタキシャル成長させる方法(例えば、特開平1−214110等)が提案されている。しかしながら、このような方法では、600℃以下の温度ではほとんど結晶成長が進行しなかった。シリコン系においては、一般にアモルファス状態から結晶状態に移行するには、アモルファス状態にある分子鎖を分断し、しかもその分断された分子が、再び他の分子と結合しないような状態としたうえで、何らかの結晶性の分子に合わせて、分子を結晶の一部に組み換えるという過程を経る。しかしながら、この過程のなかで、最初の分子鎖を分断して、他の分子と結合しない状態に保持するためのエネルギーが大きく、結晶化反応においてはここが障壁となっている。このエネルギーを与えるには、1000℃程度の温度で数分、もしくは600℃程度の温度では数10時間が必要であり、時間は温度(=エネルギー)に指数関数的に依存するので、600℃以下、例えば、550℃では、結晶化反応が進行することはほとんど観測できなかった。従来の固相エピタキシャル結晶化の考えも、この問題に対する解答を与えたものではなかった。
【0008】
本発明人は、従来の固相結晶化の考えとは全く別に、何らかの触媒作用によって、前記の過程の障壁エネルギーを低下させることを考えた。本発明人はニッケル(Ni)、白金(Pt)、鉄(Fe)、コバルト(Co)がシリコンと結合して珪化物となり、例えば、ニッケルに関しては、容易に珪化ニッケル(化学式NiSi、0.4≦x≦2.5)となり、かつ、珪化ニッケルの格子定数がシリコン結晶のものに近いことに着目した。そこで、結晶シリコン−珪化ニッケル−アモルファスシリコンという3元系のエネルギー等をシミュレーションした結果、アモルファスシリコンは珪化ニッケルとの界面で容易に反応して、
アモルファスシリコン(シリコンA)+珪化ニッケル(シリコンB) →珪化ニッケル(シリコンA)+結晶シリコン(シリコンB)
(シリコンA、Bはシリコンの位置を示す)
という反応が生じることが明らかになった。この反応のポテンシャル障壁は十分に低く、反応の温度も低い。
【0009】
この反応式は、ニッケルがアモルファスシリコンを結晶シリコンに造り変えながら進行してゆくことを示している。実際には、580℃以下で、反応が開始され、450℃でも反応が観測されることが明らかになった。典型的には、通常のアモルファスシリコンの結晶化温度に比較して20〜150℃低い温度で結晶化できることが示された。当然のことであるが、温度が高いほど反応の進行する速度が速い。その様子を図3(実施例参照)に示す。また、同様な効果は、白金(Pt)、鉄(Fe)、コバルト(Co)でも認められた。
【0010】
本発明の特徴は結晶成長が円形に進展することである。これは上記の反応のニッケル等の移動が等方的に進行するためであり、結晶格子面にそって直線的に成長する従来の結晶化とは異なる。
【0011】
本発明では、島状、ストライプ状、線状、ドット状のニッケル、鉄、コバルト、白金単体もしくはその珪化物等のニッケル、鉄、コバルト、白金の少なくとも1つを含有する膜、粒子、クラスター等を出発点として、ここからニッケル、鉄、コバルト、白金が上記の反応に伴って周囲に展開してゆくことによって、結晶シリコンの領域を拡げてゆく。なお、ニッケル、鉄、コバルト、白金を含有する材料としては、酸化物は好ましくない。これは、酸化物は安定な化合物で、上記反応を開始することができないからである。
【0012】
このように特定の場所から拡がった結晶シリコンは、従来の固相エピタキシャル成長とは異なるが、結晶性の連続性のよい、単結晶に近い構造を有するものであるので、TFT等の半導体素子に利用するうえでは都合がよい。基板上に均一にニッケル、鉄、コバルト、白金を含む材料を設けた場合には、結晶化の出発点が無数に存在して、そのため結晶性の良好な膜を得ることは難しかった。その違いは代表的にはラマン散乱分光やX線回折に明確に現れ、本発明では良好な結晶性がこれらの部積手段から明らかになった。
【0013】
また、この結晶化の出発材料としてのアモルファスシリコン膜は水素濃度が少ないほど良好な結果が得られた。ただし、結晶化の進行にしたがって、水素が放出されるので、得られたシリコン膜中の水素濃度は出発材料のアモルファスシリコン膜の水素濃度とはそれほど明確な相関は見られなかった。本発明による結晶シリコン中の水素濃度は、典型的には0.01原子%以上5原子%以下であった。さらに、良好な結晶性を得るためには、アモルファスシリコン膜中には炭素、窒素、酸素の濃度は少ないほど良く、1×1019cm−3以下であることが望まれる。したがって、発明に用いるニッケル、鉄、コバルト、白金を含む材料もこの点を考慮して選択すべきである。
【0014】
ただし、ニッケル、鉄、コバルト、白金そのものは半導体材料としてのシリコンにとっては好ましくない。そこで、これを除去することが必要であるが、ニッケルに関しては上記の反応の結果、結晶化の終端に達した珪化ニッケルはフッ酸もしくは塩酸に容易に溶解するので、これらの酸による処理によって基板からニッケルを減らすことができる。本発明によるシリコン膜中のニッケルの濃度は、典型的には0.005%以下1原子%以下であった。
【0015】
本発明によって作製した結晶シリコン膜をTFT等の半導体素子に利用する上で、上記の説明から明らかなように、結晶化の終端(ここは、複数の出発点から開始された結晶化がぶつかる部分であるが)では、大きな粒界(結晶性の不連続な部分)が存在し、また、ニッケルの濃度が高いので、半導体素子を設けることは好ましくない。したがって、本発明を利用して半導体素子を形成するにあたっては、結晶化の出発点となるニッケル含有物被膜のパターンと半導体素子のパターンとを最適化しなければならない。以下に実施例を示し、より詳細に本発明を説明する。
【0016】
【実施例】
本実施例は、コーニング7059ガラス基板上の島状の複数のニッケル膜を形成し、これらを出発点としてアモルファスシリコン膜の結晶化をおこない、得られた結晶シリコン膜を用いてTFTを作製する方法について記述する。島状のニッケル膜を形成する方法には、それをアモルファスシリコン膜の上に設けるか、下に設けるかという点で2つの方法がある。図2(A−1)は下に設ける方法であり、図2(A−2)は上に設ける方法である。特に後者について注意しなければならないことは、アモルファスシリコン膜の全面にニッケルが形成された後にこれを選択的にエッチングするという工程となるので、ニッケルとアモルファスシリコンが少量ではあるが反応して、珪化ニッケルが形成されてしまう。これを残存させたままでは、本発明が目的とするような良好な結晶性のシリコン膜は得られないので、塩酸やフッ酸等で、この珪化ニッケルを十分に除去してしまうことが求められる。また、そのため、アモルファスシリコンは初期より薄くなる。
【0017】
いずれの場合においても、ニッケル(もしくは珪化ニッケル)のパターニングには従来から知られているエッチオフ法(ニッケル膜を形成した後にフォトレジストをフォトリソグラフィー法によってパターニングし、フォトレジストがない部分をのニッケル膜をエッチングすることによって選択的にニッケル膜を形成する方法)やリフトオフ法(フォトレジストをフォトリソグラフィー法によってパターニングし、その上にニッケル膜を形成して、下地のフォトレジストを剥離させることによって選択的にニッケル膜を形成する方法)を用いればよい。
【0018】
一方、前者についてはそのような問題は生じないが、この場合もエッチングによって、島状部分以外のニッケル膜は完全に除去されることが望まれる。さらに、残存ニッケルの影響を抑えるためには、基板を酸素プラズマやオゾン等によって処理して、島状領域以外のニッケルを酸化させてしまえばよい。
【0019】
いずれの場合も、基板(コーニング7059)1A上には、厚さ2000Åの下地酸化珪素膜1BをプラズマCVD法によって形成した。また、アモルファスシリコン膜1は厚さ200〜3000Å、好ましくは500〜1500Åとし、プラズマCVD法もしくは減圧CVD法によって作製した。アモルファスシリコン膜は350〜450℃で0.1〜2時間アニールすることによって水素出しをおこなって、膜中の水素濃度を5原子%以下にしておくと結晶化しやすかった。図2(A−1)の場合には、アモルファスシリコン膜1の形成の前にスパッタ法によってニッケル膜を厚さ50〜1000Å、好ましくは100〜500Å堆積し、これをパターニングして島状ニッケル領域2を形成した。
【0020】
一方、図2(A−2)の場合には、アモルファスシリコン膜1の形成の後にスパッタ法によってニッケル膜を厚さ50〜1000Å、好ましくは100〜500Å堆積し、これをパターニングして島状ニッケル領域2を形成した。この様子を上方から見た図面を図1(A)に示す。
【0021】
島状ニッケルは一辺2μmの正方形で、その間隔は、5〜50μm、例えば20μmとした。ニッケルの代わりに珪化ニッケルを用いても同様な効果が得られる。また、ニッケルの成膜時には基板を100〜500℃、好ましくは180〜250℃に加熱しておくと良好な結果が得られた。これは下地の酸化珪素膜とニッケル膜とも密着性が向上することと、酸化珪素とニッケルが反応して、珪化ニッケルが生成するためである。酸化珪素のかわりに窒化珪素、炭化珪素、珪素を用いても同様な効果が得られる。
【0022】
次に、これを450〜580℃、例えば550℃で8時間窒素雰囲気中でアニールした。図2(B)は、その中間状態で、図2(A)において、端のほうにあった島状ニッケル膜からニッケルが珪化ニッケル3Aとして中央部に進行し、また、ニッケルが通過した部分3は結晶シリコンとなっている。やがて、図2(C)に示すように2つの島状ニッケル膜から出発した結晶化がぶつかって、中間に珪化ニッケル3Aが残って、結晶化が終了する。
図4、図5には本実施例によって得られた結晶シリコン膜のラマン散乱分光、およびX線回折の結果を示す。図4のC−Siとは,標準試料である単結晶シリコンのスペクトルであり、(a)は本実施例によって得られた結晶領域、(b)は未結晶領域のラマンスペクトルである。結晶領域のラマンスペクトルおよびX線回折より、いずれも良好な結晶が得られたことが示されている。
【0023】
図1(B)は、この状態の基板を上方から見た様子を示したもので、図2(C)の珪化ニッケル3Aとは、粒界4のことである。さらにアニールを続ければ、ニッケルは粒界4に沿って移動して、これらの島状ニッケル領域(この段階では原形を留めていることはないが)の中間領域5に集まる。
【0024】
以上の工程で結晶シリコンを得ることができるが、このときに生じる珪化ニッケル3Aからニッケルが半導体被膜中に拡散することは好ましくない。したがって、フッ酸もしくは塩酸でエッチングすることが望まれる。なお、フッ酸、塩酸ともシリコン膜には影響を与えない。エッチングした様子を図2(D)に示す。粒界のあった部分は溝4Aとなる。この溝を挟むようにTFTの半導体領域(活性層等)を形成することは好ましくない。TFTの配置に関しては、その例を図1(C)に示すが、半導体領域6は粒界4を横切らないように配置した。一方、ゲイト配線7は粒界4を横切ってもよい。
【0025】
上記の手法によってアモルファスシリコン膜の結晶化を行う際に2μm角のニッケル領域から結晶化が進行する速度のアニール温度依存性を調べた。ここでは、結晶化の先端がニッケル領域から10〜50μmの距離に到達するまでのアニール時間から結晶化速度を算出した。図3にその例を示す。図においては、アモルファシリコンの膜厚を2種類(500Åと1500Å)用意して、その比較をおこなった。当然のことながら、アニール温度が高ければ高いほど結晶化速度は大きい。また、アモルファスシリコン膜の厚さにも依存し、厚い膜ほど結晶化しやすいことが分かった。実際の半導体素子1つの典型的な大きさは50μm以下であるので、アニール時間を5時間とすると、結晶化速度は20μm/hr以上が必要で、シリコンの膜厚を1500Åとすると、図3のデータからは550℃以上の温度が必要であることが分かる。
【0026】
【発明の効果】
以上、述べたように、本発明はアモルファスシリコン結晶化の低温化、短時間化を促進するという意味で画期的なものであり、また、そのための設備、装置、手法は極めて一般的で、かつ量産性に優れたものであるので、産業にもたらす利益は図りしえないものである。
【0027】
例えば、従来の固相成長法においては、少なくとも24時間のアニールが必要とされたために、1枚当たりの基板処理時間を2分とすれば、アニール炉は15本も必要とされたのであるが、本発明によって、4時間以内に短縮することができたので、アニール炉の数を1/6以下に削減することができる。このことによる生産性の向上、設備投資額の削減は、基板処理コストの低下につながり、ひいてはTFT価格の低下とそれによる新規需要の喚起につながるものである。このように本発明は工業上、有益であり、特許されるにふさわしいものである。
【図面の簡単な説明】
【図1】実施例の工程の上面図を示す。(結晶化とTFTの配置)
【図2】実施例の工程の断面図を示す。(選択的に結晶化する工程)
【図3】結晶化速度と温度の関係を示す。
【図4】実施例で得られた結晶シリコンのラマン散乱分光結果を示す。
【図5】実施例で得られた結晶シリコンのX線回折結果を示す。
【符号の説明】
1 ・・・アモルファスシリコン
2 ・・・島状ニッケル膜
3 ・・・結晶シリコン
4 ・・・粒界
5 ・・・結晶化の進行していない領域
6 ・・・半導体領域
7 ・・・ゲイト配線

Claims (6)

  1. 基板の絶縁表面上にアモルファス状態のシリコン膜を形成し、
    前記シリコン膜の表面に選択的に接してニッケルを含有する材料を形成し、
    前記シリコン膜を熱処理して、前記ニッケルと前記シリコン膜を反応させることにより前記シリコン膜を結晶化し、
    前記結晶化の終端を除去するように前記結晶化されたシリコン膜をパターニングすることを有する絶縁ゲイト型電界効果トランジスタの製造方法であって、
    前記加熱により、前記材料に接している前記シリコン膜のアモルファス部分が前記ニッケルと反応して珪化ニッケルとなり、前記珪化ニッケル当該珪化ニッケルに接している前記シリコン膜のアモルファス部分が反応して、前記珪化ニッケルは結晶シリコンとなると共に前記アモルファス部分は珪化ニッケルとなることを特徴とする絶縁ゲイト型電界効果トランジスタの製造方法。
  2. 基板の絶縁表面に選択的に接してニッケルを含有する材料を形成し、
    前記材料に接してアモルファス状態のシリコン膜を形成し、
    前記シリコン膜を熱処理して、前記ニッケルと前記シリコン膜を反応させることにより前記シリコン膜を結晶化し、
    前記結晶化の終端を除去するように前記結晶化されたシリコン膜をパターニングすることを有する絶縁ゲイト型電界効果トランジスタの製造方法であって、
    前記加熱により、前記材料に接している前記シリコン膜のアモルファス部分が前記ニッケルと反応して珪化ニッケルとなり、前記珪化ニッケル当該珪化ニッケルに接している前記シリコン膜のアモルファス部分が反応して、前記珪化ニッケルは結晶シリコンとなると共に前記アモルファス部分は珪化ニッケルとなることを特徴とする絶縁ゲイト型電界効果トランジスタの製造方法。
  3. 請求項1または2において、前記シリコン膜を結晶化する加熱温度は、450℃〜580℃の範囲であることを特徴とする絶縁ゲイト型電界効果トランジスタの製造方法。
  4. 請求項1〜3のいずれか1項において、前記材料はNiSix(0.4≦x≦2.5)で示される珪化ニッケルであることを特徴とする絶縁ゲイト型電界効果トランジスタの製造方法。
  5. 請求項1〜3のいずれか1項において、前記材料は、スパッタ法で形成されたニッケル膜であることを特徴とする絶縁ゲイト型電界効果トランジスタの製造方法。
  6. 請求項1〜5のいずれか1項において、前記アモルファス状態のシリコン膜の酸素、炭素、窒素の濃度はそれぞれ1×1019cm-3以下の範囲であることを特徴とする絶縁ゲイト型電界効果トランジスタの製造方法。
JP2000106052A 1993-02-15 2000-04-07 絶縁ゲイト型電界効果トランジスタの製造方法 Expired - Lifetime JP3574037B2 (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP2000106052A JP3574037B2 (ja) 1993-02-15 2000-04-07 絶縁ゲイト型電界効果トランジスタの製造方法
JP2000123594A JP3574040B2 (ja) 1993-02-15 2000-04-25 半導体装置の製造方法

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP04853293A JP3562588B2 (ja) 1993-02-15 1993-02-15 半導体装置の製造方法
JP2000106052A JP3574037B2 (ja) 1993-02-15 2000-04-07 絶縁ゲイト型電界効果トランジスタの製造方法

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP04853293A Division JP3562588B2 (ja) 1993-02-15 1993-02-15 半導体装置の製造方法

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2000123594A Division JP3574040B2 (ja) 1993-02-15 2000-04-25 半導体装置の製造方法

Publications (2)

Publication Number Publication Date
JP2000306835A JP2000306835A (ja) 2000-11-02
JP3574037B2 true JP3574037B2 (ja) 2004-10-06

Family

ID=33301307

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2000106052A Expired - Lifetime JP3574037B2 (ja) 1993-02-15 2000-04-07 絶縁ゲイト型電界効果トランジスタの製造方法

Country Status (1)

Country Link
JP (1) JP3574037B2 (ja)

Also Published As

Publication number Publication date
JP2000306835A (ja) 2000-11-02

Similar Documents

Publication Publication Date Title
JP3562588B2 (ja) 半導体装置の製造方法
JPH06244103A (ja) 半導体の製造方法
TW399227B (en) Method of manufacturing a crystalline semiconductor
JP4307371B2 (ja) 薄膜トランジスタ製造方法
JP4115990B2 (ja) 薄膜トランジスタ及びその製造方法
JPH10291897A (ja) 微結晶フィルムの結晶化による多結晶フィルムの形成方法、薄膜トランジスタの形成方法、およびその方法によって形成される液晶ディスプレイ
KR970060525A (ko) 반도체 장치 및 그 제작 방법
KR100392120B1 (ko) 다결정 실리콘 막의 형성 방법
JP2001135573A (ja) 半導体装置の製造方法およびその半導体装置
TWI285429B (en) Semiconductor device production method
JP3041497B2 (ja) 半導体の製造方法
JP2852853B2 (ja) 半導体装置の製造方法
KR20060015196A (ko) 박막트랜지스터 제조 방법
KR100317620B1 (ko) 실리콘박막을결정화하는방법과이를이용한박막트랜지스터제조방법
JP3574037B2 (ja) 絶縁ゲイト型電界効果トランジスタの製造方法
JP3574040B2 (ja) 半導体装置の製造方法
JP3566623B2 (ja) 半導体装置の製造方法
JP3590366B2 (ja) 薄膜トランジスタの製造方法
JP3186621B2 (ja) 半導体装置の作製方法
JP3287558B2 (ja) 半導体装置の作製方法
JP3455721B2 (ja) 半導体装置の作製方法
JP3455695B2 (ja) 半導体装置の作製方法
JP2535654B2 (ja) 薄膜トランジスタの作製方法
JPH09148251A (ja) 半導体および半導体装置の作製方法
JP2003197524A (ja) 半導体膜の形成方法及び半導体膜、半導体装置、並びにディスプレイ装置

Legal Events

Date Code Title Description
A131 Notification of reasons for refusal

Effective date: 20040518

Free format text: JAPANESE INTERMEDIATE CODE: A131

A521 Written amendment

Effective date: 20040519

Free format text: JAPANESE INTERMEDIATE CODE: A523

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20040622

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20040630

R150 Certificate of patent (=grant) or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080709

Year of fee payment: 4

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 5

Free format text: PAYMENT UNTIL: 20090709

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090709

Year of fee payment: 5

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090709

Year of fee payment: 5

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100709

Year of fee payment: 6

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100709

Year of fee payment: 6

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 7

Free format text: PAYMENT UNTIL: 20110709

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110709

Year of fee payment: 7

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 7

Free format text: PAYMENT UNTIL: 20110709

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120709

Year of fee payment: 8

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120709

Year of fee payment: 8

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 8

Free format text: PAYMENT UNTIL: 20120709

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120709

Year of fee payment: 8

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 9

Free format text: PAYMENT UNTIL: 20130709

EXPY Cancellation because of completion of term
FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130709

Year of fee payment: 9