JP3509135B2 - 音響再生装置 - Google Patents
音響再生装置Info
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- JP3509135B2 JP3509135B2 JP20627293A JP20627293A JP3509135B2 JP 3509135 B2 JP3509135 B2 JP 3509135B2 JP 20627293 A JP20627293 A JP 20627293A JP 20627293 A JP20627293 A JP 20627293A JP 3509135 B2 JP3509135 B2 JP 3509135B2
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- Filters That Use Time-Delay Elements (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Description
【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、車室内などの非対称な
スピーカ配置でステレオ再生を行う音響再生装置におい
て、各スピーカからリスニングポジションへの音波の到
達時間差を自動的に補正することが出来る音響再生装置
に関するものである。 【０００２】 【従来の技術】車室内では、ステレオ信号の左チャンネ
ル用スピーカが車室前方の左端に、右チャンネル用スピ
ーカが右端に取付られることが多く、乗員からみると偏
ったスピーカ配置となっている。例えば、ドライバ席で
は右スピーカがより近く、左スピーカがより遠配置とな
っている。この場合、右スピーカの音波がより速く到達
し、音来正面に定位すべき音像が右に偏って定位するこ
とになる。これを解決するため右スピーカの信号を遅延
させ、左スピーカの信号と同時時刻到達させる処理が知
られている。 【０００３】図６は特開昭５９−１１５０００号公報に
示された従来のステレオ再生装置を示すブロック図であ
る。図において、１Ｌは左チャンネルソース、２Ｌは左
チャンネルプリアンプ、３Ｌは左チャンネルアナログ遅
延素子、４Ｌは左チャンネルのアッテネータ、５Ｌは左
チャンネルメインアンプ、６Ｌは左チャンネルのスピー
カであり、同様に、１Ｒは右チャンネルソース、２Ｒは
右チャンネルプリアンプ、３Ｒは右チャンネルアナログ
遅延素子、４Ｒは右チャンネルのアッテネータ、５Ｒは
右チャンネルメインアンプ、６Ｒは右チャンネルのスピ
ーカで、右チャンネルのスピーカ６Ｒが受聴者７に近い
場合には、右チャンネルの信号をアナログ遅延素子３Ｒ
で遅らせて左右のスピーカ６Ｌと６Ｒから同時に受聴者
７に音波が届くようにして音像を定位改善している。 【０００４】 【発明が解決しようとする課題】しかし、リスニングポ
ジションで、各スピーカの音波が届くように遅延時間を
測定し、更に遅延素子の遅延時間を変更するのは手間が
かかるという問題点があった。 【０００５】本発明は上記のような問題点を解消するた
めになされたもので、スピーカ位置が受聴者に対して非
対象なリスニングルームにおいて、それぞれのスピーカ
と受聴点の距離差を自動的に補正する音響再生装置を得
ることを目的とする。 【０００６】 【課題を解決するための手段】本発明に係る音響再生装
置は、Ｎ個の各々が無相関な測定信号を発生する測定信
号発生部と、Ｎ個のスピーカそれぞれに前記測定信号を
接続するスイッチ手段と、リスニングポジションに設置
され各スピーカで同時に再生した測定信号を収音する収
音マイクと、各スピーカへの入力となる測定信号と収音
された測定信号よりそれぞれのスピーカからマイクまで
のインパルスレスポンスを求めるＮ個の適応フィルタ
と、前記インパルスレスポンスの立ち上がりの遅延時間
を測定する測定手段と、遅延時間を記憶する記憶手段
と、記憶した遅延時間から各スピーカの収音マイクへの
到達時間を同じにする遅延時間を計算する計算手段と、
各スピーカに接続された遅延回路と、前記測定信号発生
部を制御するとともに、各遅延回路の遅延時間を計算し
た遅延時間に更新する制御手段とを備えるものである。 【０００７】 【０００８】 【０００９】 【００１０】 【作用】本発明に係る音響再生装置においては、各スピ
ーカよりリスニングポジションまでのインパルスレスポ
ンスを測定し、各スピーカに対して、前記ピーク値をと
る時間と音波がリスニングポジションに到達する時間と
が略一致するように遅延を与え、偏りのない音場を短時
間で作り出すことができる。 【００１１】 【００１２】 【００１３】 【００１４】 【実施例】実施例１．図１は本発明の請求項１の音響再
生装置を示すブロック回路図である。図において、１０
Ｌは左チャンネルの入力端子、１０Ｒは右チャンネル入
力端子、１１はオーディオ信号をＯＮまたはＯＦＦする
スイッチ、１２はノイズ発生部、１３はノイズ信号をＯ
ＮまたはＯＦＦするスイッチ、１４Ｌは左チャンネルの
チャンネルデバイダ、１４Ｒは右チャンネルのチャンネ
ルデバイダ、１５Ｌは左チャンネルのディレイ、１５Ｒ
は右チャンネルのディレイ、１６Ｌは左チャンネルのア
ッテネータ、１６Ｒは右チャンネルのアッテネータ、１
７Ｌは左チャンネルのＤ／Ａ変換器、１７Ｒは右チャン
ネルのＤ／Ａ変換器、１８Ｌは左チャンネルのパワーア
ンプ、１８Ｒは右チャンネルのパワーアンプ、１９Ｌは
左チャンネルのスピーカ、１９Ｒは右チャンネルのスピ
ーカ、２０は集音マイク、２１はＡ／Ｄ変換器、２２は
その係数が適応アルゴリズムにより逐次更新される可変
係数のＦＩＲ型ディジタルフィルタ（適応フィルタ）、
２３は左右チャンネルのディレイの出力を加算する加算
器、２４は２２の適応フィルタにより求めたインパルス
レスポンスから遅延時間を計算する演算部、２５はＡ／
Ｄ変換器２１の出力から適応フィルタ２２の出力を減算
する減算器、２６はスイッチ１１Ｌと１１Ｒとディレイ
１５Ｌと１５Ｒとアッテネータ１６Ｌと１６Ｒとノイズ
発生部１２を制御する制御系、２７は収音マイク２０と
Ａ／Ｄ変換器２１と適応フィルタ２２と加算器２３と演
算部２２と減算器２５で構成される測定系、２７は高速
ディジタル信号処理部である。 【００１５】以下、図１の動作を説明する。 【００１６】初めの状態はスイッチ１１がＯＮ、スイッ
チ１３がＯＦＦで、音楽信号を再生している。次に、制
御系２６がスイッチ１１をＯＦＦにし、入力端子１０Ｌ
と１０Ｒから入力されたステレオオーディオ信号はチャ
ンネルデバイダ１４Ｌと１４Ｒに入力させないように
し、再生音が無音の状態にする。この後、制御系２６は
ディレイ１５Ｌと１５Ｒの遅延時間を０ｍ秒にする。数
ｍ秒間、無音の状態を続けた後、制御系２６は、測定系
２７に測定を開始させ、スイッチ１３をＯＮにする。更
に、アッテネータ１６Ｌの減衰量を零、アッテネータ１
６Ｒの減衰量を無限大にする。 【００１７】次に、ノイズ発生部１２にノイズ信号を出
力させる。このノイズ信号は、チャンネルデバイダ１４
Ｌと１４Ｒを通り、ディレイ１５Ｌと１５Ｒを通りアッ
テネータ１６Ｌと１６Ｒに入力される。ここで、アッテ
ネータ１６Ｌの減衰量が零で、アッテネータ１６Ｒの減
衰量が無限大なので、左チャンネルのみノイズ信号が出
力される。 【００１８】アッテネータ１６Ｌを通ったノイズ信号
は、Ｄ／Ａ変換器１７Ｌでアナログ信号に変換し、スピ
ーカ１９Ｌで再生する。再生した信号は音波となって収
音マイクに到達し、アナログの電気信号に変換される。
この電気信号は、Ａ／Ｄ変換器２１によりディジタル信
号に変換し減算器２５に入力される。 【００１９】また、加算器２３にはアッテネータ１６Ｌ
とアッテネータ１６Ｒを通ったノイズ信号が入力され
る。ここで減衰量が零のアッテネータ１６Ｌの出力のみ
が加算器２３より出力され、適応フィルタ２２に入力さ
れる。 【００２０】適応フィルタ２２の出力は減算器２５に入
力され、Ａ／Ｄ変換器２１の出力より減算される。適応
フィルタ２２のフィルタ係数は、減算器２５の出力信号
を係数更新用の誤差信号として、この誤差信号が最小と
なるよう更新される。ここで誤差信号すなわち減算器２
５の出力信号を漸近的に最小とする係数更新アルゴリズ
ムは周知である。 【００２１】適応フィルタ２２は誤差信号が所定のレベ
ル以下になるまで係数更新をくり返す。誤差信号が所定
のレベル以下になった場合は、係数更新を中止しフィル
タ係数を演算部２４へ送出する。このときの適応フィル
タ２２のフィルタ係数は、Ｄ／Ａ変換器１７Ｌからパワ
ーアンプ１８Ｌを経てスピーカ１９Ｌで音波として放射
されマイクロホン２０で受音され、電気信号に変換され
てＡ／Ｄ変換器２１に至るまでの系のインパルスレスポ
ンスに最も近くなる。 【００２２】演算部２４は適応フィルタ２２より受け取
ったフィルタ係数を１つの時系列としてピーク検出を行
い、ピークを示す時刻Ｔ1を記憶するとともに、フィル
タ係数列のパワーＰ1を計算しこれを記憶する。 【００２３】図５は本発明における適応フィルタの系数
列の一例を示す図であり、サンプリング間隔Ｔs 、フィ
ルタ係数列の長さをＭ、フィルタ係数列をＡ0 ，Ａ1 ・
・・，ＡM-1 として、ピーク検出は以下のように行う。 【００２４】まず、Ａ0 ，Ａ1 ，・・・，ＡM-1 から絶
対値が最大となるＡi を求め、この大きさをＡMAX とす
る。さらに、Ａ0 ，Ａ1 ，・・・，ＡM-1 から絶対値が
ＡMAX ／Ｇをはじめて越えるＡi が現れるｉを求め、こ
れからピークを示す時刻Ｔ1をＴ1 ＝ｉ×Ｔs として求
める。 【００２５】次に、右チャンネルの測定を行う。制御系
２６は、アッテネータ１６Ｌの減衰量を無限大に、アッ
テネータ１６Ｒの減衰量を零にする。更に、前記と同じ
処理を繰り返し、収束時の適応フィルタのフィルタ係数
列のピークを示す時刻Ｔ2 とパワーＰ2 を記憶する。 【００２６】次に、演算部２４はＴ1 ，Ｔ2 の最大値を
求めこれをＴMAX として、ディレイ１５Ｌの設定値Ｄ1
＝ＴMAX −Ｔ1 、ディレイ１５Ｒの設定値Ｄ2 ＝ＴMAX
−Ｔ2 を計算し、これを制御系２６に送出し、制御系２
６は演算部２４より受信したＤ1 をディレイ１５Ｌに、
Ｄ2 をディレイ１５Ｒに設定する。 【００２７】同様に、演算部２４はＰ1 ，Ｐ2 の最大値
を求めこれをＰMAX として、アッテネータ１６Ｌの設定
値Ａ1 ＝Ｐ1 ／ＰMAX 、アッテネータ１５Ｒの設定値Ａ
2 ＝Ｐ2 ／ＰMAX を計算し、これを制御系２６に送出
し、制御系２６は演算部２４より受信したＡ1 をアッテ
ネータ１６Ｌに、Ａ2 をアッテネータ１６Ｒに設定す
る。 【００２８】この後、スイッチ１３をＯＦＦ、スイッチ
１１をＯＮにし、左右の到達時間差及び左右のレベル差
を補正したステレオオーディオ信号を再生する。 【００２９】また、スイッチ１１と１３、チャンネルデ
バイダ１４Ｌと１４Ｒ、ディレイ１５Ｌと１５Ｒ、アッ
テネータ１６Ｌと１６Ｒ、ノイズ発生部１２、適応フィ
ルタ２２、加算器２３、演算部２４、減算器２５は、例
えばＤＳＰを用いた高速ディジタル信号処理装置のプロ
グラムを書くことで実現できる。 【００３０】また、複数のスピーカに対しても同じ手順
で補正できることは明かである。 【００３１】実施例２．図２は本発明の請求項２の音響
再生装置の構成を示すブロック回路図である。図におい
て、１０Ｌは左チャンネルの入力端子、１０Ｒは右チャ
ンネル入力端子、１１はオーディオ信号をＯＮまたはＯ
ＦＦするスイッチ、１２はノイズ発生部、１３はノイズ
信号をＯＮまたはＯＦＦするスイッチ、１４Ｌは左チャ
ンネルのチャンネルデバイダ、１４Ｒは右チャンネルの
チャンネルデバイダ、１５Ｌは左チャンネルのディレ
イ、１５Ｒは右チャンネルのディレイ、１６Ｌは左チャ
ンネルのアッテネータ、１６Ｒは右チャンネルのアッテ
ネータ、１７Ｌは左チャンネルのＤ／Ａ変換器、１７Ｒ
は右チャンネルのＤ／Ａ変換器、１８Ｌは左チャンネル
のパワーアンプ、１８Ｒは右チャンネルのパワーアン
プ、１９Ｌは左チャンネルのスピーカ、１９Ｒは右チャ
ンネルのスピーカ、２０は集音マイク、２１はＡ／Ｄ変
換器、２２は適応フィルタ、２３は左右チャンネルのデ
ィレイの出力を加算する加算器、２４は２２の適応フィ
ルタにより求めたインパルスレスポンスから遅延時間を
計算する演算部、２５はＡ／Ｄ変換器２１の出力から適
応フィルタ２２の出力を減算する減算器、２６はスイッ
チ１１Ｌと１１Ｒとディレイ１５Ｌと１５Ｒとアッテネ
ータ１６Ｌと１６Ｒとノイズ発生部１２を制御する制御
系、２７は収音マイク２０とＡ／Ｄ変換器２１と適応フ
ィルタ２２と加算器２３と演算部２２と減算器２５で構
成される測定系、２７は高速ディジタル信号処理部、２
８はディレイ、２９はデータのサンプリングレートを落
とすデシメーションフィルタである。 【００３２】以下、図２の動作を説明する。 【００３３】初めの状態はスイッチ１１がＯＮ、スイッ
チ１３がＯＦＦで、音楽信号を再生している。次に、制
御系２６がスイッチ１１をＯＦＦにし、入力端子１０Ｌ
と１０Ｒから入力されたステレオオーディオ信号はチャ
ンネルデバイダ１４Ｌと１４Ｒに入力させないように
し、再生音が無音の状態にする。この後、制御系２６は
ディレイ１５Ｌと１５Ｒと２８の遅延時間を０ｍ秒にす
る。数ｍ秒間、無音の状態を続けた後、制御系２６は、
測定系２７に測定を開始させ、スイッチ１３をＯＮにす
る。更に、アッテネータ１６Ｌの減衰量を零、アッテネ
ータ１６Ｒの減衰量を無限大にする。 【００３４】次に、ノイズ発生部１２にノイズ信号を出
力させる。このノイズ信号は、チャンネルデバイダ１４
Ｌと１４Ｒを通り、ディレイ１５Ｌと１５Ｒを通りアッ
テネータ１６Ｌと１６Ｒに入力される。ここで、アッテ
ネータ１６Ｌの減衰量が零で、アッテネータ１６Ｒの減
衰量が無限大なので、左チャンネルのみノイズ信号が出
力される。 【００３５】アッテネータ１６Ｌを通ったノイズ信号
は、Ｄ／Ａ変換器１７Ｌでアナログ信号に変換し、スピ
ーカ１９Ｌで再生する。再生した信号は音波となって収
音マイクに到達し、アナログの電気信号に変換される。
この電気信号は、Ａ／Ｄ変換器２１によりディジタル信
号に変換し減算器２５に入力される。 【００３６】また、加算器２３にはアッテネータ１６Ｌ
とアッテネータ１６Ｒを通ったノイズ信号が入力され
る。ここで減衰量が零のアッテネータ１６Ｌの出力のみ
が加算器２３より出力され、ディレイ２８に入力され
る。 【００３７】ディレイ２８の出力はデシメーションフィ
ルタ２９で１／Ｍのデータレートに間引きされ、適応フ
ィルタ２２でフィルタリングされた後、減算器２５に入
力される。 【００３８】Ａ／Ｄ変換器２１はＤ／Ａ変換器１７Ｌの
１／Ｍのサンプリング周波数でマイクロホン２０の出力
信号をサンプリングし、これを減算器２５へ入力する。 【００３９】また、適応フィルタ２２のフィルタ係数
は、減算器２５の出力信号を係数更新用の誤差信号とし
て、この誤差信号が最小となるよう更新される。 【００４０】適応フィルタ２２は誤差信号が所定のレベ
ル以下になるまで係数更新をくり返す。誤差信号が所定
のレベル以下になった場合は、係数更新を中止しフィル
タ係数を演算部２４へ送出する。 【００４１】演算部２４は適応フィルタ２２より受け取
ったフィルタ係数を１つの時系列として実施例１と同様
にピーク検出を行い、ピークを示す時刻Ｔ1を記憶す
る。 【００４２】次に、ディレイ２８の遅延量を１サンプル
づつ増加しながら前記時刻Ｔ1 が適応フィルタのサンプ
ル時間で１サンプル早くなるまで前記と同様の処理を行
い、前記時刻Ｔ1を更新し、そのときのディレイ２８の
遅延量ＴD1を記憶する。 【００４３】また、演算部２４は前記フィルタ係数列の
パワーＰ1 を計算し、これを記憶する。 【００４４】次に、右チャンネルの測定を行う。制御系
２６は、アッテネータ１６Ｌを０にし、その後に、１６
Ｒを１にする。更に、前記と同じ処理を繰り返し、収束
時の適応フィルタのフィルタ係数列のピークを示す時刻
Ｔ2 と、ディレイ２３の遅延量ＴD2及び前記フィルタ系
数列のパワーＰ2 を記憶する。 【００４５】次に、演算部２４はＴ1 ＋ＴD1，Ｔ2 ＋Ｔ
D2の最大値を求めこれをＴMAX として、ディレイ１５Ｌ
の設定値Ｄ1 ＝ＴMAX −Ｔ1 −ＴD1、ディレイ１５Ｒの
設定値Ｄ2 ＝ＴMAX −Ｔ2 −ＴD2を計算し、これを制御
系２６に送出し、制御系２６は演算部２４より受信した
Ｄ1 をディレイ１５Ｌに、Ｄ2 をディレイ１５Ｒに設定
する。 【００４６】同様に、演算部２４はＰ1 ，Ｐ2 の最大値
を求めこれをＰMAX として、アッテネータ１６Ｌの設定
値Ａ1 ＝Ｐ1 ／ＰMAX 、アッテネータ１５Ｒの設定値Ａ
2 ＝Ｐ2 ／ＰMAX を計算し、これを制御系２６に送出
し、この制御系２６は演算部２４より受信したＡ1 をア
ッテネータ１６Ｌに、Ａ2 をアッテネータ１６Ｒに設定
する。 【００４７】この後、スイッチ１３をＯＦＦ、スイッチ
１１をＯＮにし、左右の到達時間差及び左右のレベル差
を補正したステレオオーディオ信号を再生する。 【００４８】また、スイッチ１１と１３、チャンネルデ
バイダ１４Ｌと１４Ｒ、ディレイ１５Ｌと１５Ｒ、アッ
テネータ１６Ｌと１６Ｒ、ノイズ発生部１２、適応フィ
ルタ２２、加算器２３、演算部２４、減算器２５、ディ
レイ２８、デシメーションフィルタ２９は、例えばＤＳ
Ｐを用いた高速ディジタル信号処理装置のプログラムを
書くことで実現できる。 【００４９】また、ディレイ２８はディレイ１５Ｌと１
５Ｒを利用することも可能である。 【００５０】また、複数のスピーカに対しても同じ手順
で補正できることは明かである。 【００５１】実施例３．図３は本発明の請求項３の音響
再生装置の構成を示すブロック回路図である。図におい
て、、１０Ｌは左チャンネルの入力端子、１０Ｒは右チ
ャンネル入力端子、１１はオーディオ信号をＯＮまたは
ＯＦＦするスイッチ、１２はノイズ発生部、１３はノイ
ズ信号をＯＮまたはＯＦＦするスイッチ、１４Ｌｌは左
チャンネル低域のチャンネルデバイダ、１４Ｌｍは左チ
ャンネル中域のチャンネルデバイダ、１４Ｌｈは左チャ
ンネル高域のチャンネルデバイダ、１４Ｒｌは右チャン
ネル低域のチャンネルデバイダ、１４Ｒｍは右チャンネ
ル中域のチャンネルデバイダ、１４Ｒｈは右チャンネル
高域のチャンネルデバイダ、１５Ｌは左チャンネルのデ
ィレイ、１５Ｒは右チャンネルのディレイ、１６Ｌは左
チャンネルのアッテネータ、１６Ｒは右チャンネルのア
ッテネータ、１７Ｌは左チャンネルのＤ／Ａ変換器、１
７Ｒは右チャンネルのＤ／Ａ変換器、１８Ｌは左チャン
ネルのパワーアンプ、１８Ｒは右チャンネルのパワーア
ンプ、１９Ｌｌは左チャンネル低域のスピーカ、１９Ｌ
ｍは左チャンネル中域のスピーカ、１９Ｌｎは左チャン
ネル高域のスピーカ、１９Ｒｌは右チャンネル低域のス
ピーカ、１９Ｒｍは右チャンネル中域のスピーカ、１９
Ｒｎは右チャンネル高域のスピーカ、２０は集音マイ
ク、２１はＡ／Ｄ変換器、２２は適応フィルタ、２３は
左右チャンネルのディレイの出力を加算する加算器、２
４は２２の適応フィルタにより求めたインパルスレスポ
ンスから遅延時間を計算する演算部、２５はＡ／Ｄ変換
器２１の出力から適応フィルタ２２の出力を減算する減
算器、２６はスイッチ１１Ｌと１１Ｒとディレイ１５Ｌ
と１５Ｒとアッテネータ１６Ｌと１６Ｒとノイズ発生部
１２を制御する制御系、２７は収音マイク２０とＡ／Ｄ
変換器２１と適応フィルタ２２と加算器２３と演算部２
４と減算器２５で構成される測定系、２７は高速ディジ
タル信号処理部である。 【００５２】以下、図３の動作を説明する。 【００５３】初めの状態はスイッチ１１がＯＮ、スイッ
チ１３がＯＦＦで、音楽信号を再生している。次に、制
御系２６がスイッチ１１をＯＦＦにし、入力端子１０Ｌ
と１０Ｒから入力されたステレオオーディオ信号をディ
レイ１４Ｌと１４Ｒに入力させないようにし、再生音が
無音の状態にする。この後、制御系２６はディレイ１５
Ｌ、１５Ｒの遅延時間を０ｍ秒にする。数ｍ秒間、無音
の状態を続けた後、制御系２６は、測定系２７に測定を
開始させて、スイッチ１３をＯＮにする。更に、アッテ
ネータ１６Ｌの減衰量を零、アッテネータ１６Ｒの減衰
量を無限大にする。 【００５４】次に、ノイズ発生部１２にノイズ信号を出
力させる。このノイズ信号は、バンドパスフィルタ３０
で中域のスピーカの再生周波数帯域に帯域制限されてか
ら、ディレイ１５Ｌと１５Ｒを通り、アッテネータ１６
Ｌと１６Ｒに入力される。ここで、アッテネータ１６Ｌ
の減衰量が零でアッテネータ１６Ｒの減衰量は無限大な
ので、左チャンネルのみノイズ信号が出力される。 【００５５】アッテネータ１６Ｌを通ったノイズ信号
は、Ｄ／Ａ変換器１７Ｌでアナログ信号に変換され、パ
ワーアンプ１８Ｌで増幅されチャンネルデバイダ１４Ｌ
ｌ、１４Ｌｍ、１４Ｌｈに入力される。 【００５６】ここで、ノイズ信号はバンドパスフィルタ
で中域のスピーカの再生周波数帯域に帯域制限されてい
るので、チャンネルデバイダ１４Ｌｌ、１４Ｌｍの出力
はチャンネルデバイダ１４Ｌｍの出力と比較すると小さ
くなる。 【００５７】スピーカ１９Ｌｌ、１９Ｌｍ、１９Ｌｈで
再生された信号は音波となって収音マイクに到達し、ア
ナログの電気信号に変換される。この電気信号は、Ａ／
Ｄ変換器２１によりディジタル信号に変換し減算器２５
に入力される。 【００５８】また、加算器２３にはアッテネータ１６Ｌ
とアッテネータ１６Ｒを通ったノイズ信号が入力され
る。ここで減衰量が零のアッテネータ１６Ｌの出力のみ
が加算器２３より出力され、適応フィルタ２２に入力さ
れる。 【００５９】適応フィルタ２２の出力は減算器２５に入
力され、Ａ／Ｄ変換器２１の出力より減算される。適応
フィルタ２２のフィルタ係数は、減算器２５の出力信号
を係数更新用の誤差信号として、この誤差信号が最小と
なるよう更新される。ここで誤差信号すなわち減算器２
５の出力信号を漸近的に最小とする係数更新アルゴリズ
ムは周知である。 【００６０】適応フィルタ２２は誤差信号が所定のレベ
ル以下になるまで係数更新をくり返す。誤差信号が所定
のレベル以下になった場合は、係数更新を中止しフィル
タ係数を演算部２４へ送出する。ここで、低域のスピー
カ１９Ｌｌ及び高域のスピーカ１９Ｌｈからの出力は中
域のスピーカ１９Ｌｍに比べ小さいので、このときの適
応フィルタ２２のフィルタ係数は、Ｄ／Ａ変換器１７Ｌ
からパワーアンプ１８Ｌ、チャンネルデバイダ１８Ｌｍ
を経てスピーカ１９Ｌｍで音波として放射されマイクロ
ホン２０で受音され、電気信号に変換されてＡ／Ｄ変換
器２１に至るまでの系のインパルスレスポンスを近似し
ている。 【００６１】演算部２４は適応フィルタ２２より受け取
ったフィルタ係数を１つの時系列として実施例１と同様
にピーク検出を行い、ピークを示す時刻Ｔ1 を記憶する
とともに、フィルタ係数列のパワーＰ1 を計算しこれを
記憶する。 【００６２】次に、右チャンネルの測定を行う。制御系
２６は、アッテネータ１６Ｌの減衰量を無限大にし、そ
の後に、アッテネータ１６Ｒの減衰量を零にする。更
に、前記と同じ処理を繰り返し、収束時の適応フィルタ
のフィルタ係数列のピークを示す時刻Ｔ2 とパワーＰ2
を記憶する。 【００６３】次に、演算部２４はＴ1 ，Ｔ2 の最大値を
求めこれをＴMAX として、ディレイ１５Ｌの設定値Ｄ1
＝ＴMAX −Ｔ1 、ディレイ１５Ｒの設定値Ｄ2 ＝ＴMAX
−Ｔ2 を計算し、これを制御系２６に送出し、制御系２
６は演算部２４より受信したＤ1 をディレイ１５Ｌに、
Ｄ2 をディレイ１５Ｒに設定する。 【００６４】同様に、演算部２４はＰ1 ，Ｐ2 の最大値
を求めこれをＰMAX として、アッテネータ１６Ｌの設定
値Ａ1 ＝Ｐ1 ／ＰMAX 、アッテネータ１５Ｒの設定値Ａ
2 ＝Ｐ2／ＰMAXを計算し、これを制御系２６に送出し、
制御系２６は演算部２４より受信したＡ1 をアッテネー
タ１６Ｌに、Ａ2 をアッテネータ１６Ｒに設定する。 【００６５】この後、スイッチ１３をＯＦＦ、スイッチ
１１をＯＮにし、左右の到達時間差及び左右のレベル差
を補正したステレオオーディオ信号を再生する。 【００６６】また、スイッチ１１と１３、ディレイ１５
Ｌと１５Ｒ、アッテネータ１６Ｌと１６Ｒ、ノイズ発生
部１２、適応フィルタ２２、加算器２３、演算部２４、
減算器２５は、例えばＤＳＰを用いた高速ディジタル信
号処理装置のプログラムを書くことで実現できる。 【００６７】また、複数のスピーカに対しても同じ手順
で補正できることは明かである。 【００６８】実施例４．図４は本発明の請求項４の音響
再生装置の構成を示すブロック回路図である。図におい
て、１０Ｌは左チャンネルの入力端子、１０Ｒは右チャ
ンネル入力端子、１１はオーディオ信号をＯＮまたはＯ
ＦＦするスイッチ、１２Ｌは左チャンネルのノイズ発生
部、１２Ｒは右チャンネルのノイズ発生部、１３はノイ
ズ信号をＯＮまたはＯＦＦするスイッチ、１４Ｌは左チ
ャンネルのチャンネルデバイダ、１４Ｒは右チャンネル
のチャンネルデバイダ、１５Ｌは左チャンネルのディレ
イ、１５Ｒは右チャンネルのディレイ、１６Ｌは左チャ
ンネルのアッテネータ、１６Ｒは右チャンネルのアッテ
ネータ、１７Ｌは左チャンネルのＤ／Ａ変換器、１７Ｒ
は右チャンネルのＤ／Ａ変換器、１８Ｌは左チャンネル
のパワーアンプ、１８Ｒは右チャンネルのパワーアン
プ、１９Ｌは左チャンネルのスピーカ、１９Ｒは右チャ
ンネルのスピーカ、２０は集音マイク、２１はＡ／Ｄ変
換器、２２Ｌは左チャンネルの適応フィルタ、２２Ｒは
右チャンネルの適応フィルタ、２４は２２Ｌ、２２Ｒの
適応フィルタにより求めたインパルスレスポンスから遅
延時間を計算する演算部、２５はＡ／Ｄ変換器２１の出
力から適応フィルタ２２Ｌ、２２Ｒの出力を減算する減
算器、２６はスイッチ１１Ｌ、１１Ｒとディレイ１５
Ｌ、１５Ｒとアッテネータ１６Ｌと１６Ｒとノイズ発生
部１２を制御する制御系、２７は収音マイク２０とＡ／
Ｄ変換器２１と適応フィルタ２２Ｌ、２２Ｒと加算器２
３と演算部２２と減算器２５で構成される測定系、２７
は高速ディジタル信号処理部である。 【００６９】以下、図４の動作を説明する。 【００７０】初めの状態はスイッチ１１がＯＮ、スイッ
チ１３がＯＦＦで、音楽信号を再生している。次に、制
御系２６がスイッチ１１をＯＦＦにし、入力端子１０Ｌ
と１０Ｒから入力されたステレオオーディオ信号はチャ
ンネルデバイダ１４Ｌと１４Ｒに入力させないように
し、再生音が無音の状態にする。この後、制御系２６は
ディレイ１５Ｌと１５Ｒの遅延時間を０ｍ秒にする。数
ｍ秒間、無音の状態を続けた後、制御系２６は、測定系
２７に測定を開始させ、スイッチ１３をＯＮにする。更
に、アッテネータ１６Ｌ、１６Ｒの減衰量をともに零に
する。 【００７１】次に、ノイズ発生部１２Ｌと１２Ｒにノイ
ズ信号を出力させる。このノイズ信号は、それぞれ無相
関であり、チャンネルデバイダ１４Ｌと１４Ｒを通り、
ディレイ１５Ｌと１５Ｒを通りアッテネータ１６Ｌと１
６Ｒに入力される。 【００７２】アッテネータ１６Ｌ、１６Ｒを通ったノイ
ズ信号は、Ｄ／Ａ変換器１７Ｌ、１７Ｒでアナログ信号
に変換し、スピーカ１９Ｌ、１９Ｒでそれぞれ再生す
る。再生した信号は音波となって収音マイクに到達し、
アナログの電気信号に変換される。この電気信号は、Ａ
／Ｄ変換器２１によりディジタル信号に変換し減算器２
５に入力される。 【００７３】また、適応フィルタ２２Ｌには左チャンネ
ルのノイズ信号が入力され、適応フィルタ２２Ｒには右
チャンネルのノイズ信号が入力される。 【００７４】適応フィルタ２２Ｌ、２２Ｒの出力は減算
器２５に入力され、Ａ／Ｄ変換器２１の出力より減算さ
れる。適応フィルタ２２Ｌ、２２Ｒのフィルタ係数は、
減算器２５の出力信号を係数更新用の誤差信号として、
それぞれこの誤差信号が最小となるよう更新される。こ
こで誤差信号すなわち減算器２５の出力信号を漸近的に
最小とする係数更新アルゴリズムは周知である。 【００７５】適応フィルタ２２Ｌ、２２Ｒは誤差信号が
所定のレベル以下になるまで係数更新をくり返す。誤差
信号が所定のレベル以下になった場合は、係数更新を中
止しそれぞれのフィルタ係数を演算部２４へ送出する。
このときの適応フィルタ２２Ｌのフィルタ係数は、Ｄ／
Ａ変換器１７Ｌからパワーアンプ１８Ｌを経てスピーカ
１９Ｌで音波として放射されマイクロホン２０で受音さ
れ、電気信号に変換されてＡ／Ｄ変換器２１に至るまで
の系のインパルスレスポンスに最も近くなり、適応フィ
ルタ２２Ｒのフィルタ係数は、Ｄ／Ａ変換器１７Ｌから
パワーアンプ１８Ｌを経てスピーカ１９Ｌで音波として
放射されマイクロホン２０で受音され、電気信号に変換
されてＡ／Ｄ変換器２１に至るまでの系のインパルスレ
スポンスに最も近くなる。 【００７６】演算部２４は適応フィルタ２２Ｌより受け
取ったフィルタ係数を１つの時系列として実施例１と同
様にピーク検出を行い、ピークを示す時刻Ｔ1 を記憶す
るとともに、フィルタ係数列のパワーＰ1を計算しこれ
を記憶する。 【００７７】同様に演算部２４は適応フィルタ２２Ｒよ
り受け取ったフィルタ係数列のピークを示す時刻Ｔ2と
パワーＰ2を記憶する。 【００７８】次に、演算部２４はＴ1 ，Ｔ2 の最大値を
求めこれをＴMAX として、ディレイ１５Ｌの設定値Ｄ1
＝ＴMAX −Ｔ1 、ディレイ１５Ｒの設定値Ｄ2 ＝ＴMAX
−Ｔ2 を計算し、これを制御系２６に送出し、制御系２
６は演算部２４より受信したＤ1 をディレイ１５Ｌに、
Ｄ2 をディレイ１５Ｒに設定する。 【００７９】同様に、演算部２４はＰ1 ，Ｐ2 の最大値
を求めこれをＰMAX として、アッテネータ１６Ｌの設定
値Ａ1 ＝Ｐ1 ／ＰMAX 、アッテネータ１５Ｒの設定値Ａ
2 ＝Ｐ2 ／ＰMAX を計算し、これを制御系２６に送出
し、この制御系２６は演算部２４より受信したＡ1 をア
ッテネータ１６Ｌに、Ａ2 をアッテネータ１６Ｒに設定
する。 【００８０】この後、スイッチ１３をＯＦＦ、スイッチ
１１をＯＮにし、左右の到達時間差及び左右のレベル差
を補正したステレオオーディオ信号を再生する。 【００８１】また、スイッチ１１と１３、チャンネルデ
バイダ１４Ｌと１４Ｒ、ディレイ１５Ｌと１５Ｒ、アッ
テネータ１６Ｌと１６Ｒ、ノイズ発生部１２Ｌと１２
Ｒ、適応フィルタ２２Ｌと２２Ｒ、演算部２４、減算器
２５は、例えばＤＳＰを用いた高速ディジタル信号処理
装置のプログラムを書くことで実現できる。 【００８２】また、複数のスピーカに対しても同じ手順
で補正できることは明かである。 【００８３】 【発明の効果】以上のように、本発明によれば、簡単に
再生音の音像の定位が改善できる。
スピーカ配置でステレオ再生を行う音響再生装置におい
て、各スピーカからリスニングポジションへの音波の到
達時間差を自動的に補正することが出来る音響再生装置
に関するものである。 【０００２】 【従来の技術】車室内では、ステレオ信号の左チャンネ
ル用スピーカが車室前方の左端に、右チャンネル用スピ
ーカが右端に取付られることが多く、乗員からみると偏
ったスピーカ配置となっている。例えば、ドライバ席で
は右スピーカがより近く、左スピーカがより遠配置とな
っている。この場合、右スピーカの音波がより速く到達
し、音来正面に定位すべき音像が右に偏って定位するこ
とになる。これを解決するため右スピーカの信号を遅延
させ、左スピーカの信号と同時時刻到達させる処理が知
られている。 【０００３】図６は特開昭５９−１１５０００号公報に
示された従来のステレオ再生装置を示すブロック図であ
る。図において、１Ｌは左チャンネルソース、２Ｌは左
チャンネルプリアンプ、３Ｌは左チャンネルアナログ遅
延素子、４Ｌは左チャンネルのアッテネータ、５Ｌは左
チャンネルメインアンプ、６Ｌは左チャンネルのスピー
カであり、同様に、１Ｒは右チャンネルソース、２Ｒは
右チャンネルプリアンプ、３Ｒは右チャンネルアナログ
遅延素子、４Ｒは右チャンネルのアッテネータ、５Ｒは
右チャンネルメインアンプ、６Ｒは右チャンネルのスピ
ーカで、右チャンネルのスピーカ６Ｒが受聴者７に近い
場合には、右チャンネルの信号をアナログ遅延素子３Ｒ
で遅らせて左右のスピーカ６Ｌと６Ｒから同時に受聴者
７に音波が届くようにして音像を定位改善している。 【０００４】 【発明が解決しようとする課題】しかし、リスニングポ
ジションで、各スピーカの音波が届くように遅延時間を
測定し、更に遅延素子の遅延時間を変更するのは手間が
かかるという問題点があった。 【０００５】本発明は上記のような問題点を解消するた
めになされたもので、スピーカ位置が受聴者に対して非
対象なリスニングルームにおいて、それぞれのスピーカ
と受聴点の距離差を自動的に補正する音響再生装置を得
ることを目的とする。 【０００６】 【課題を解決するための手段】本発明に係る音響再生装
置は、Ｎ個の各々が無相関な測定信号を発生する測定信
号発生部と、Ｎ個のスピーカそれぞれに前記測定信号を
接続するスイッチ手段と、リスニングポジションに設置
され各スピーカで同時に再生した測定信号を収音する収
音マイクと、各スピーカへの入力となる測定信号と収音
された測定信号よりそれぞれのスピーカからマイクまで
のインパルスレスポンスを求めるＮ個の適応フィルタ
と、前記インパルスレスポンスの立ち上がりの遅延時間
を測定する測定手段と、遅延時間を記憶する記憶手段
と、記憶した遅延時間から各スピーカの収音マイクへの
到達時間を同じにする遅延時間を計算する計算手段と、
各スピーカに接続された遅延回路と、前記測定信号発生
部を制御するとともに、各遅延回路の遅延時間を計算し
た遅延時間に更新する制御手段とを備えるものである。 【０００７】 【０００８】 【０００９】 【００１０】 【作用】本発明に係る音響再生装置においては、各スピ
ーカよりリスニングポジションまでのインパルスレスポ
ンスを測定し、各スピーカに対して、前記ピーク値をと
る時間と音波がリスニングポジションに到達する時間と
が略一致するように遅延を与え、偏りのない音場を短時
間で作り出すことができる。 【００１１】 【００１２】 【００１３】 【００１４】 【実施例】実施例１．図１は本発明の請求項１の音響再
生装置を示すブロック回路図である。図において、１０
Ｌは左チャンネルの入力端子、１０Ｒは右チャンネル入
力端子、１１はオーディオ信号をＯＮまたはＯＦＦする
スイッチ、１２はノイズ発生部、１３はノイズ信号をＯ
ＮまたはＯＦＦするスイッチ、１４Ｌは左チャンネルの
チャンネルデバイダ、１４Ｒは右チャンネルのチャンネ
ルデバイダ、１５Ｌは左チャンネルのディレイ、１５Ｒ
は右チャンネルのディレイ、１６Ｌは左チャンネルのア
ッテネータ、１６Ｒは右チャンネルのアッテネータ、１
７Ｌは左チャンネルのＤ／Ａ変換器、１７Ｒは右チャン
ネルのＤ／Ａ変換器、１８Ｌは左チャンネルのパワーア
ンプ、１８Ｒは右チャンネルのパワーアンプ、１９Ｌは
左チャンネルのスピーカ、１９Ｒは右チャンネルのスピ
ーカ、２０は集音マイク、２１はＡ／Ｄ変換器、２２は
その係数が適応アルゴリズムにより逐次更新される可変
係数のＦＩＲ型ディジタルフィルタ（適応フィルタ）、
２３は左右チャンネルのディレイの出力を加算する加算
器、２４は２２の適応フィルタにより求めたインパルス
レスポンスから遅延時間を計算する演算部、２５はＡ／
Ｄ変換器２１の出力から適応フィルタ２２の出力を減算
する減算器、２６はスイッチ１１Ｌと１１Ｒとディレイ
１５Ｌと１５Ｒとアッテネータ１６Ｌと１６Ｒとノイズ
発生部１２を制御する制御系、２７は収音マイク２０と
Ａ／Ｄ変換器２１と適応フィルタ２２と加算器２３と演
算部２２と減算器２５で構成される測定系、２７は高速
ディジタル信号処理部である。 【００１５】以下、図１の動作を説明する。 【００１６】初めの状態はスイッチ１１がＯＮ、スイッ
チ１３がＯＦＦで、音楽信号を再生している。次に、制
御系２６がスイッチ１１をＯＦＦにし、入力端子１０Ｌ
と１０Ｒから入力されたステレオオーディオ信号はチャ
ンネルデバイダ１４Ｌと１４Ｒに入力させないように
し、再生音が無音の状態にする。この後、制御系２６は
ディレイ１５Ｌと１５Ｒの遅延時間を０ｍ秒にする。数
ｍ秒間、無音の状態を続けた後、制御系２６は、測定系
２７に測定を開始させ、スイッチ１３をＯＮにする。更
に、アッテネータ１６Ｌの減衰量を零、アッテネータ１
６Ｒの減衰量を無限大にする。 【００１７】次に、ノイズ発生部１２にノイズ信号を出
力させる。このノイズ信号は、チャンネルデバイダ１４
Ｌと１４Ｒを通り、ディレイ１５Ｌと１５Ｒを通りアッ
テネータ１６Ｌと１６Ｒに入力される。ここで、アッテ
ネータ１６Ｌの減衰量が零で、アッテネータ１６Ｒの減
衰量が無限大なので、左チャンネルのみノイズ信号が出
力される。 【００１８】アッテネータ１６Ｌを通ったノイズ信号
は、Ｄ／Ａ変換器１７Ｌでアナログ信号に変換し、スピ
ーカ１９Ｌで再生する。再生した信号は音波となって収
音マイクに到達し、アナログの電気信号に変換される。
この電気信号は、Ａ／Ｄ変換器２１によりディジタル信
号に変換し減算器２５に入力される。 【００１９】また、加算器２３にはアッテネータ１６Ｌ
とアッテネータ１６Ｒを通ったノイズ信号が入力され
る。ここで減衰量が零のアッテネータ１６Ｌの出力のみ
が加算器２３より出力され、適応フィルタ２２に入力さ
れる。 【００２０】適応フィルタ２２の出力は減算器２５に入
力され、Ａ／Ｄ変換器２１の出力より減算される。適応
フィルタ２２のフィルタ係数は、減算器２５の出力信号
を係数更新用の誤差信号として、この誤差信号が最小と
なるよう更新される。ここで誤差信号すなわち減算器２
５の出力信号を漸近的に最小とする係数更新アルゴリズ
ムは周知である。 【００２１】適応フィルタ２２は誤差信号が所定のレベ
ル以下になるまで係数更新をくり返す。誤差信号が所定
のレベル以下になった場合は、係数更新を中止しフィル
タ係数を演算部２４へ送出する。このときの適応フィル
タ２２のフィルタ係数は、Ｄ／Ａ変換器１７Ｌからパワ
ーアンプ１８Ｌを経てスピーカ１９Ｌで音波として放射
されマイクロホン２０で受音され、電気信号に変換され
てＡ／Ｄ変換器２１に至るまでの系のインパルスレスポ
ンスに最も近くなる。 【００２２】演算部２４は適応フィルタ２２より受け取
ったフィルタ係数を１つの時系列としてピーク検出を行
い、ピークを示す時刻Ｔ1を記憶するとともに、フィル
タ係数列のパワーＰ1を計算しこれを記憶する。 【００２３】図５は本発明における適応フィルタの系数
列の一例を示す図であり、サンプリング間隔Ｔs 、フィ
ルタ係数列の長さをＭ、フィルタ係数列をＡ0 ，Ａ1 ・
・・，ＡM-1 として、ピーク検出は以下のように行う。 【００２４】まず、Ａ0 ，Ａ1 ，・・・，ＡM-1 から絶
対値が最大となるＡi を求め、この大きさをＡMAX とす
る。さらに、Ａ0 ，Ａ1 ，・・・，ＡM-1 から絶対値が
ＡMAX ／Ｇをはじめて越えるＡi が現れるｉを求め、こ
れからピークを示す時刻Ｔ1をＴ1 ＝ｉ×Ｔs として求
める。 【００２５】次に、右チャンネルの測定を行う。制御系
２６は、アッテネータ１６Ｌの減衰量を無限大に、アッ
テネータ１６Ｒの減衰量を零にする。更に、前記と同じ
処理を繰り返し、収束時の適応フィルタのフィルタ係数
列のピークを示す時刻Ｔ2 とパワーＰ2 を記憶する。 【００２６】次に、演算部２４はＴ1 ，Ｔ2 の最大値を
求めこれをＴMAX として、ディレイ１５Ｌの設定値Ｄ1
＝ＴMAX −Ｔ1 、ディレイ１５Ｒの設定値Ｄ2 ＝ＴMAX
−Ｔ2 を計算し、これを制御系２６に送出し、制御系２
６は演算部２４より受信したＤ1 をディレイ１５Ｌに、
Ｄ2 をディレイ１５Ｒに設定する。 【００２７】同様に、演算部２４はＰ1 ，Ｐ2 の最大値
を求めこれをＰMAX として、アッテネータ１６Ｌの設定
値Ａ1 ＝Ｐ1 ／ＰMAX 、アッテネータ１５Ｒの設定値Ａ
2 ＝Ｐ2 ／ＰMAX を計算し、これを制御系２６に送出
し、制御系２６は演算部２４より受信したＡ1 をアッテ
ネータ１６Ｌに、Ａ2 をアッテネータ１６Ｒに設定す
る。 【００２８】この後、スイッチ１３をＯＦＦ、スイッチ
１１をＯＮにし、左右の到達時間差及び左右のレベル差
を補正したステレオオーディオ信号を再生する。 【００２９】また、スイッチ１１と１３、チャンネルデ
バイダ１４Ｌと１４Ｒ、ディレイ１５Ｌと１５Ｒ、アッ
テネータ１６Ｌと１６Ｒ、ノイズ発生部１２、適応フィ
ルタ２２、加算器２３、演算部２４、減算器２５は、例
えばＤＳＰを用いた高速ディジタル信号処理装置のプロ
グラムを書くことで実現できる。 【００３０】また、複数のスピーカに対しても同じ手順
で補正できることは明かである。 【００３１】実施例２．図２は本発明の請求項２の音響
再生装置の構成を示すブロック回路図である。図におい
て、１０Ｌは左チャンネルの入力端子、１０Ｒは右チャ
ンネル入力端子、１１はオーディオ信号をＯＮまたはＯ
ＦＦするスイッチ、１２はノイズ発生部、１３はノイズ
信号をＯＮまたはＯＦＦするスイッチ、１４Ｌは左チャ
ンネルのチャンネルデバイダ、１４Ｒは右チャンネルの
チャンネルデバイダ、１５Ｌは左チャンネルのディレ
イ、１５Ｒは右チャンネルのディレイ、１６Ｌは左チャ
ンネルのアッテネータ、１６Ｒは右チャンネルのアッテ
ネータ、１７Ｌは左チャンネルのＤ／Ａ変換器、１７Ｒ
は右チャンネルのＤ／Ａ変換器、１８Ｌは左チャンネル
のパワーアンプ、１８Ｒは右チャンネルのパワーアン
プ、１９Ｌは左チャンネルのスピーカ、１９Ｒは右チャ
ンネルのスピーカ、２０は集音マイク、２１はＡ／Ｄ変
換器、２２は適応フィルタ、２３は左右チャンネルのデ
ィレイの出力を加算する加算器、２４は２２の適応フィ
ルタにより求めたインパルスレスポンスから遅延時間を
計算する演算部、２５はＡ／Ｄ変換器２１の出力から適
応フィルタ２２の出力を減算する減算器、２６はスイッ
チ１１Ｌと１１Ｒとディレイ１５Ｌと１５Ｒとアッテネ
ータ１６Ｌと１６Ｒとノイズ発生部１２を制御する制御
系、２７は収音マイク２０とＡ／Ｄ変換器２１と適応フ
ィルタ２２と加算器２３と演算部２２と減算器２５で構
成される測定系、２７は高速ディジタル信号処理部、２
８はディレイ、２９はデータのサンプリングレートを落
とすデシメーションフィルタである。 【００３２】以下、図２の動作を説明する。 【００３３】初めの状態はスイッチ１１がＯＮ、スイッ
チ１３がＯＦＦで、音楽信号を再生している。次に、制
御系２６がスイッチ１１をＯＦＦにし、入力端子１０Ｌ
と１０Ｒから入力されたステレオオーディオ信号はチャ
ンネルデバイダ１４Ｌと１４Ｒに入力させないように
し、再生音が無音の状態にする。この後、制御系２６は
ディレイ１５Ｌと１５Ｒと２８の遅延時間を０ｍ秒にす
る。数ｍ秒間、無音の状態を続けた後、制御系２６は、
測定系２７に測定を開始させ、スイッチ１３をＯＮにす
る。更に、アッテネータ１６Ｌの減衰量を零、アッテネ
ータ１６Ｒの減衰量を無限大にする。 【００３４】次に、ノイズ発生部１２にノイズ信号を出
力させる。このノイズ信号は、チャンネルデバイダ１４
Ｌと１４Ｒを通り、ディレイ１５Ｌと１５Ｒを通りアッ
テネータ１６Ｌと１６Ｒに入力される。ここで、アッテ
ネータ１６Ｌの減衰量が零で、アッテネータ１６Ｒの減
衰量が無限大なので、左チャンネルのみノイズ信号が出
力される。 【００３５】アッテネータ１６Ｌを通ったノイズ信号
は、Ｄ／Ａ変換器１７Ｌでアナログ信号に変換し、スピ
ーカ１９Ｌで再生する。再生した信号は音波となって収
音マイクに到達し、アナログの電気信号に変換される。
この電気信号は、Ａ／Ｄ変換器２１によりディジタル信
号に変換し減算器２５に入力される。 【００３６】また、加算器２３にはアッテネータ１６Ｌ
とアッテネータ１６Ｒを通ったノイズ信号が入力され
る。ここで減衰量が零のアッテネータ１６Ｌの出力のみ
が加算器２３より出力され、ディレイ２８に入力され
る。 【００３７】ディレイ２８の出力はデシメーションフィ
ルタ２９で１／Ｍのデータレートに間引きされ、適応フ
ィルタ２２でフィルタリングされた後、減算器２５に入
力される。 【００３８】Ａ／Ｄ変換器２１はＤ／Ａ変換器１７Ｌの
１／Ｍのサンプリング周波数でマイクロホン２０の出力
信号をサンプリングし、これを減算器２５へ入力する。 【００３９】また、適応フィルタ２２のフィルタ係数
は、減算器２５の出力信号を係数更新用の誤差信号とし
て、この誤差信号が最小となるよう更新される。 【００４０】適応フィルタ２２は誤差信号が所定のレベ
ル以下になるまで係数更新をくり返す。誤差信号が所定
のレベル以下になった場合は、係数更新を中止しフィル
タ係数を演算部２４へ送出する。 【００４１】演算部２４は適応フィルタ２２より受け取
ったフィルタ係数を１つの時系列として実施例１と同様
にピーク検出を行い、ピークを示す時刻Ｔ1を記憶す
る。 【００４２】次に、ディレイ２８の遅延量を１サンプル
づつ増加しながら前記時刻Ｔ1 が適応フィルタのサンプ
ル時間で１サンプル早くなるまで前記と同様の処理を行
い、前記時刻Ｔ1を更新し、そのときのディレイ２８の
遅延量ＴD1を記憶する。 【００４３】また、演算部２４は前記フィルタ係数列の
パワーＰ1 を計算し、これを記憶する。 【００４４】次に、右チャンネルの測定を行う。制御系
２６は、アッテネータ１６Ｌを０にし、その後に、１６
Ｒを１にする。更に、前記と同じ処理を繰り返し、収束
時の適応フィルタのフィルタ係数列のピークを示す時刻
Ｔ2 と、ディレイ２３の遅延量ＴD2及び前記フィルタ系
数列のパワーＰ2 を記憶する。 【００４５】次に、演算部２４はＴ1 ＋ＴD1，Ｔ2 ＋Ｔ
D2の最大値を求めこれをＴMAX として、ディレイ１５Ｌ
の設定値Ｄ1 ＝ＴMAX −Ｔ1 −ＴD1、ディレイ１５Ｒの
設定値Ｄ2 ＝ＴMAX −Ｔ2 −ＴD2を計算し、これを制御
系２６に送出し、制御系２６は演算部２４より受信した
Ｄ1 をディレイ１５Ｌに、Ｄ2 をディレイ１５Ｒに設定
する。 【００４６】同様に、演算部２４はＰ1 ，Ｐ2 の最大値
を求めこれをＰMAX として、アッテネータ１６Ｌの設定
値Ａ1 ＝Ｐ1 ／ＰMAX 、アッテネータ１５Ｒの設定値Ａ
2 ＝Ｐ2 ／ＰMAX を計算し、これを制御系２６に送出
し、この制御系２６は演算部２４より受信したＡ1 をア
ッテネータ１６Ｌに、Ａ2 をアッテネータ１６Ｒに設定
する。 【００４７】この後、スイッチ１３をＯＦＦ、スイッチ
１１をＯＮにし、左右の到達時間差及び左右のレベル差
を補正したステレオオーディオ信号を再生する。 【００４８】また、スイッチ１１と１３、チャンネルデ
バイダ１４Ｌと１４Ｒ、ディレイ１５Ｌと１５Ｒ、アッ
テネータ１６Ｌと１６Ｒ、ノイズ発生部１２、適応フィ
ルタ２２、加算器２３、演算部２４、減算器２５、ディ
レイ２８、デシメーションフィルタ２９は、例えばＤＳ
Ｐを用いた高速ディジタル信号処理装置のプログラムを
書くことで実現できる。 【００４９】また、ディレイ２８はディレイ１５Ｌと１
５Ｒを利用することも可能である。 【００５０】また、複数のスピーカに対しても同じ手順
で補正できることは明かである。 【００５１】実施例３．図３は本発明の請求項３の音響
再生装置の構成を示すブロック回路図である。図におい
て、、１０Ｌは左チャンネルの入力端子、１０Ｒは右チ
ャンネル入力端子、１１はオーディオ信号をＯＮまたは
ＯＦＦするスイッチ、１２はノイズ発生部、１３はノイ
ズ信号をＯＮまたはＯＦＦするスイッチ、１４Ｌｌは左
チャンネル低域のチャンネルデバイダ、１４Ｌｍは左チ
ャンネル中域のチャンネルデバイダ、１４Ｌｈは左チャ
ンネル高域のチャンネルデバイダ、１４Ｒｌは右チャン
ネル低域のチャンネルデバイダ、１４Ｒｍは右チャンネ
ル中域のチャンネルデバイダ、１４Ｒｈは右チャンネル
高域のチャンネルデバイダ、１５Ｌは左チャンネルのデ
ィレイ、１５Ｒは右チャンネルのディレイ、１６Ｌは左
チャンネルのアッテネータ、１６Ｒは右チャンネルのア
ッテネータ、１７Ｌは左チャンネルのＤ／Ａ変換器、１
７Ｒは右チャンネルのＤ／Ａ変換器、１８Ｌは左チャン
ネルのパワーアンプ、１８Ｒは右チャンネルのパワーア
ンプ、１９Ｌｌは左チャンネル低域のスピーカ、１９Ｌ
ｍは左チャンネル中域のスピーカ、１９Ｌｎは左チャン
ネル高域のスピーカ、１９Ｒｌは右チャンネル低域のス
ピーカ、１９Ｒｍは右チャンネル中域のスピーカ、１９
Ｒｎは右チャンネル高域のスピーカ、２０は集音マイ
ク、２１はＡ／Ｄ変換器、２２は適応フィルタ、２３は
左右チャンネルのディレイの出力を加算する加算器、２
４は２２の適応フィルタにより求めたインパルスレスポ
ンスから遅延時間を計算する演算部、２５はＡ／Ｄ変換
器２１の出力から適応フィルタ２２の出力を減算する減
算器、２６はスイッチ１１Ｌと１１Ｒとディレイ１５Ｌ
と１５Ｒとアッテネータ１６Ｌと１６Ｒとノイズ発生部
１２を制御する制御系、２７は収音マイク２０とＡ／Ｄ
変換器２１と適応フィルタ２２と加算器２３と演算部２
４と減算器２５で構成される測定系、２７は高速ディジ
タル信号処理部である。 【００５２】以下、図３の動作を説明する。 【００５３】初めの状態はスイッチ１１がＯＮ、スイッ
チ１３がＯＦＦで、音楽信号を再生している。次に、制
御系２６がスイッチ１１をＯＦＦにし、入力端子１０Ｌ
と１０Ｒから入力されたステレオオーディオ信号をディ
レイ１４Ｌと１４Ｒに入力させないようにし、再生音が
無音の状態にする。この後、制御系２６はディレイ１５
Ｌ、１５Ｒの遅延時間を０ｍ秒にする。数ｍ秒間、無音
の状態を続けた後、制御系２６は、測定系２７に測定を
開始させて、スイッチ１３をＯＮにする。更に、アッテ
ネータ１６Ｌの減衰量を零、アッテネータ１６Ｒの減衰
量を無限大にする。 【００５４】次に、ノイズ発生部１２にノイズ信号を出
力させる。このノイズ信号は、バンドパスフィルタ３０
で中域のスピーカの再生周波数帯域に帯域制限されてか
ら、ディレイ１５Ｌと１５Ｒを通り、アッテネータ１６
Ｌと１６Ｒに入力される。ここで、アッテネータ１６Ｌ
の減衰量が零でアッテネータ１６Ｒの減衰量は無限大な
ので、左チャンネルのみノイズ信号が出力される。 【００５５】アッテネータ１６Ｌを通ったノイズ信号
は、Ｄ／Ａ変換器１７Ｌでアナログ信号に変換され、パ
ワーアンプ１８Ｌで増幅されチャンネルデバイダ１４Ｌ
ｌ、１４Ｌｍ、１４Ｌｈに入力される。 【００５６】ここで、ノイズ信号はバンドパスフィルタ
で中域のスピーカの再生周波数帯域に帯域制限されてい
るので、チャンネルデバイダ１４Ｌｌ、１４Ｌｍの出力
はチャンネルデバイダ１４Ｌｍの出力と比較すると小さ
くなる。 【００５７】スピーカ１９Ｌｌ、１９Ｌｍ、１９Ｌｈで
再生された信号は音波となって収音マイクに到達し、ア
ナログの電気信号に変換される。この電気信号は、Ａ／
Ｄ変換器２１によりディジタル信号に変換し減算器２５
に入力される。 【００５８】また、加算器２３にはアッテネータ１６Ｌ
とアッテネータ１６Ｒを通ったノイズ信号が入力され
る。ここで減衰量が零のアッテネータ１６Ｌの出力のみ
が加算器２３より出力され、適応フィルタ２２に入力さ
れる。 【００５９】適応フィルタ２２の出力は減算器２５に入
力され、Ａ／Ｄ変換器２１の出力より減算される。適応
フィルタ２２のフィルタ係数は、減算器２５の出力信号
を係数更新用の誤差信号として、この誤差信号が最小と
なるよう更新される。ここで誤差信号すなわち減算器２
５の出力信号を漸近的に最小とする係数更新アルゴリズ
ムは周知である。 【００６０】適応フィルタ２２は誤差信号が所定のレベ
ル以下になるまで係数更新をくり返す。誤差信号が所定
のレベル以下になった場合は、係数更新を中止しフィル
タ係数を演算部２４へ送出する。ここで、低域のスピー
カ１９Ｌｌ及び高域のスピーカ１９Ｌｈからの出力は中
域のスピーカ１９Ｌｍに比べ小さいので、このときの適
応フィルタ２２のフィルタ係数は、Ｄ／Ａ変換器１７Ｌ
からパワーアンプ１８Ｌ、チャンネルデバイダ１８Ｌｍ
を経てスピーカ１９Ｌｍで音波として放射されマイクロ
ホン２０で受音され、電気信号に変換されてＡ／Ｄ変換
器２１に至るまでの系のインパルスレスポンスを近似し
ている。 【００６１】演算部２４は適応フィルタ２２より受け取
ったフィルタ係数を１つの時系列として実施例１と同様
にピーク検出を行い、ピークを示す時刻Ｔ1 を記憶する
とともに、フィルタ係数列のパワーＰ1 を計算しこれを
記憶する。 【００６２】次に、右チャンネルの測定を行う。制御系
２６は、アッテネータ１６Ｌの減衰量を無限大にし、そ
の後に、アッテネータ１６Ｒの減衰量を零にする。更
に、前記と同じ処理を繰り返し、収束時の適応フィルタ
のフィルタ係数列のピークを示す時刻Ｔ2 とパワーＰ2
を記憶する。 【００６３】次に、演算部２４はＴ1 ，Ｔ2 の最大値を
求めこれをＴMAX として、ディレイ１５Ｌの設定値Ｄ1
＝ＴMAX −Ｔ1 、ディレイ１５Ｒの設定値Ｄ2 ＝ＴMAX
−Ｔ2 を計算し、これを制御系２６に送出し、制御系２
６は演算部２４より受信したＤ1 をディレイ１５Ｌに、
Ｄ2 をディレイ１５Ｒに設定する。 【００６４】同様に、演算部２４はＰ1 ，Ｐ2 の最大値
を求めこれをＰMAX として、アッテネータ１６Ｌの設定
値Ａ1 ＝Ｐ1 ／ＰMAX 、アッテネータ１５Ｒの設定値Ａ
2 ＝Ｐ2／ＰMAXを計算し、これを制御系２６に送出し、
制御系２６は演算部２４より受信したＡ1 をアッテネー
タ１６Ｌに、Ａ2 をアッテネータ１６Ｒに設定する。 【００６５】この後、スイッチ１３をＯＦＦ、スイッチ
１１をＯＮにし、左右の到達時間差及び左右のレベル差
を補正したステレオオーディオ信号を再生する。 【００６６】また、スイッチ１１と１３、ディレイ１５
Ｌと１５Ｒ、アッテネータ１６Ｌと１６Ｒ、ノイズ発生
部１２、適応フィルタ２２、加算器２３、演算部２４、
減算器２５は、例えばＤＳＰを用いた高速ディジタル信
号処理装置のプログラムを書くことで実現できる。 【００６７】また、複数のスピーカに対しても同じ手順
で補正できることは明かである。 【００６８】実施例４．図４は本発明の請求項４の音響
再生装置の構成を示すブロック回路図である。図におい
て、１０Ｌは左チャンネルの入力端子、１０Ｒは右チャ
ンネル入力端子、１１はオーディオ信号をＯＮまたはＯ
ＦＦするスイッチ、１２Ｌは左チャンネルのノイズ発生
部、１２Ｒは右チャンネルのノイズ発生部、１３はノイ
ズ信号をＯＮまたはＯＦＦするスイッチ、１４Ｌは左チ
ャンネルのチャンネルデバイダ、１４Ｒは右チャンネル
のチャンネルデバイダ、１５Ｌは左チャンネルのディレ
イ、１５Ｒは右チャンネルのディレイ、１６Ｌは左チャ
ンネルのアッテネータ、１６Ｒは右チャンネルのアッテ
ネータ、１７Ｌは左チャンネルのＤ／Ａ変換器、１７Ｒ
は右チャンネルのＤ／Ａ変換器、１８Ｌは左チャンネル
のパワーアンプ、１８Ｒは右チャンネルのパワーアン
プ、１９Ｌは左チャンネルのスピーカ、１９Ｒは右チャ
ンネルのスピーカ、２０は集音マイク、２１はＡ／Ｄ変
換器、２２Ｌは左チャンネルの適応フィルタ、２２Ｒは
右チャンネルの適応フィルタ、２４は２２Ｌ、２２Ｒの
適応フィルタにより求めたインパルスレスポンスから遅
延時間を計算する演算部、２５はＡ／Ｄ変換器２１の出
力から適応フィルタ２２Ｌ、２２Ｒの出力を減算する減
算器、２６はスイッチ１１Ｌ、１１Ｒとディレイ１５
Ｌ、１５Ｒとアッテネータ１６Ｌと１６Ｒとノイズ発生
部１２を制御する制御系、２７は収音マイク２０とＡ／
Ｄ変換器２１と適応フィルタ２２Ｌ、２２Ｒと加算器２
３と演算部２２と減算器２５で構成される測定系、２７
は高速ディジタル信号処理部である。 【００６９】以下、図４の動作を説明する。 【００７０】初めの状態はスイッチ１１がＯＮ、スイッ
チ１３がＯＦＦで、音楽信号を再生している。次に、制
御系２６がスイッチ１１をＯＦＦにし、入力端子１０Ｌ
と１０Ｒから入力されたステレオオーディオ信号はチャ
ンネルデバイダ１４Ｌと１４Ｒに入力させないように
し、再生音が無音の状態にする。この後、制御系２６は
ディレイ１５Ｌと１５Ｒの遅延時間を０ｍ秒にする。数
ｍ秒間、無音の状態を続けた後、制御系２６は、測定系
２７に測定を開始させ、スイッチ１３をＯＮにする。更
に、アッテネータ１６Ｌ、１６Ｒの減衰量をともに零に
する。 【００７１】次に、ノイズ発生部１２Ｌと１２Ｒにノイ
ズ信号を出力させる。このノイズ信号は、それぞれ無相
関であり、チャンネルデバイダ１４Ｌと１４Ｒを通り、
ディレイ１５Ｌと１５Ｒを通りアッテネータ１６Ｌと１
６Ｒに入力される。 【００７２】アッテネータ１６Ｌ、１６Ｒを通ったノイ
ズ信号は、Ｄ／Ａ変換器１７Ｌ、１７Ｒでアナログ信号
に変換し、スピーカ１９Ｌ、１９Ｒでそれぞれ再生す
る。再生した信号は音波となって収音マイクに到達し、
アナログの電気信号に変換される。この電気信号は、Ａ
／Ｄ変換器２１によりディジタル信号に変換し減算器２
５に入力される。 【００７３】また、適応フィルタ２２Ｌには左チャンネ
ルのノイズ信号が入力され、適応フィルタ２２Ｒには右
チャンネルのノイズ信号が入力される。 【００７４】適応フィルタ２２Ｌ、２２Ｒの出力は減算
器２５に入力され、Ａ／Ｄ変換器２１の出力より減算さ
れる。適応フィルタ２２Ｌ、２２Ｒのフィルタ係数は、
減算器２５の出力信号を係数更新用の誤差信号として、
それぞれこの誤差信号が最小となるよう更新される。こ
こで誤差信号すなわち減算器２５の出力信号を漸近的に
最小とする係数更新アルゴリズムは周知である。 【００７５】適応フィルタ２２Ｌ、２２Ｒは誤差信号が
所定のレベル以下になるまで係数更新をくり返す。誤差
信号が所定のレベル以下になった場合は、係数更新を中
止しそれぞれのフィルタ係数を演算部２４へ送出する。
このときの適応フィルタ２２Ｌのフィルタ係数は、Ｄ／
Ａ変換器１７Ｌからパワーアンプ１８Ｌを経てスピーカ
１９Ｌで音波として放射されマイクロホン２０で受音さ
れ、電気信号に変換されてＡ／Ｄ変換器２１に至るまで
の系のインパルスレスポンスに最も近くなり、適応フィ
ルタ２２Ｒのフィルタ係数は、Ｄ／Ａ変換器１７Ｌから
パワーアンプ１８Ｌを経てスピーカ１９Ｌで音波として
放射されマイクロホン２０で受音され、電気信号に変換
されてＡ／Ｄ変換器２１に至るまでの系のインパルスレ
スポンスに最も近くなる。 【００７６】演算部２４は適応フィルタ２２Ｌより受け
取ったフィルタ係数を１つの時系列として実施例１と同
様にピーク検出を行い、ピークを示す時刻Ｔ1 を記憶す
るとともに、フィルタ係数列のパワーＰ1を計算しこれ
を記憶する。 【００７７】同様に演算部２４は適応フィルタ２２Ｒよ
り受け取ったフィルタ係数列のピークを示す時刻Ｔ2と
パワーＰ2を記憶する。 【００７８】次に、演算部２４はＴ1 ，Ｔ2 の最大値を
求めこれをＴMAX として、ディレイ１５Ｌの設定値Ｄ1
＝ＴMAX −Ｔ1 、ディレイ１５Ｒの設定値Ｄ2 ＝ＴMAX
−Ｔ2 を計算し、これを制御系２６に送出し、制御系２
６は演算部２４より受信したＤ1 をディレイ１５Ｌに、
Ｄ2 をディレイ１５Ｒに設定する。 【００７９】同様に、演算部２４はＰ1 ，Ｐ2 の最大値
を求めこれをＰMAX として、アッテネータ１６Ｌの設定
値Ａ1 ＝Ｐ1 ／ＰMAX 、アッテネータ１５Ｒの設定値Ａ
2 ＝Ｐ2 ／ＰMAX を計算し、これを制御系２６に送出
し、この制御系２６は演算部２４より受信したＡ1 をア
ッテネータ１６Ｌに、Ａ2 をアッテネータ１６Ｒに設定
する。 【００８０】この後、スイッチ１３をＯＦＦ、スイッチ
１１をＯＮにし、左右の到達時間差及び左右のレベル差
を補正したステレオオーディオ信号を再生する。 【００８１】また、スイッチ１１と１３、チャンネルデ
バイダ１４Ｌと１４Ｒ、ディレイ１５Ｌと１５Ｒ、アッ
テネータ１６Ｌと１６Ｒ、ノイズ発生部１２Ｌと１２
Ｒ、適応フィルタ２２Ｌと２２Ｒ、演算部２４、減算器
２５は、例えばＤＳＰを用いた高速ディジタル信号処理
装置のプログラムを書くことで実現できる。 【００８２】また、複数のスピーカに対しても同じ手順
で補正できることは明かである。 【００８３】 【発明の効果】以上のように、本発明によれば、簡単に
再生音の音像の定位が改善できる。
【図面の簡単な説明】
【図１】本発明の実施例１による音響再生装置の構成を
示すブロック回路図である。 【図２】本発明の実施例２による音響再生装置の構成を
示すブロック回路図である。 【図３】本発明の実施例３による音響再生装置の構成を
示すブロック回路図である。 【図４】本発明の実施例４による音響再生装置の構成を
示すブロック回路図である。 【図５】本発明における適応フィルタの係数列の一例を
示す図である。 【図６】従来のステレオ再生装置を示すブロック図であ
る。 【符号の説明】 １０Ｌ、１０Ｒ オーディオ信号入力端子 １１、１３ スイッチ １２、１２Ｌ、１２Ｒ ノイズ発生部 １４Ｌ、１４Ｒ、１４Ｌｌ、１４Ｒｌ チャンネルデバ
イダ １４Ｌｍ、１４Ｒｍ、１４Ｌｈ、１４Ｒｈ チャンネル
デバイダ １５Ｌ、１５Ｒ ディレイ １６Ｌ、１６Ｒ アッテネータ １７Ｌ、１７Ｒ Ｄ／Ａ変換器 １８Ｌ、１８Ｒ パワーアンプ １９Ｌ、１９Ｒ、１９Ｌｌ、１９Ｒｌ スピーカ １９Ｌｍ、１９Ｒｍ、１９Ｌｈ、１９Ｒｈ スピーカ ２０ 収音マイクロホン ２１ Ａ／Ｄ変換器 ２２、２２Ｌ、２２Ｒ 適応フィルタ ２３ 加算器 ２４ 演算部 ２５ 減算器 ２６ 制御系 ２７ 測定系 ２８ ディレイ ２９ デシメーションフィルタ ３０ バンドパスフィルタ
示すブロック回路図である。 【図２】本発明の実施例２による音響再生装置の構成を
示すブロック回路図である。 【図３】本発明の実施例３による音響再生装置の構成を
示すブロック回路図である。 【図４】本発明の実施例４による音響再生装置の構成を
示すブロック回路図である。 【図５】本発明における適応フィルタの係数列の一例を
示す図である。 【図６】従来のステレオ再生装置を示すブロック図であ
る。 【符号の説明】 １０Ｌ、１０Ｒ オーディオ信号入力端子 １１、１３ スイッチ １２、１２Ｌ、１２Ｒ ノイズ発生部 １４Ｌ、１４Ｒ、１４Ｌｌ、１４Ｒｌ チャンネルデバ
イダ １４Ｌｍ、１４Ｒｍ、１４Ｌｈ、１４Ｒｈ チャンネル
デバイダ １５Ｌ、１５Ｒ ディレイ １６Ｌ、１６Ｒ アッテネータ １７Ｌ、１７Ｒ Ｄ／Ａ変換器 １８Ｌ、１８Ｒ パワーアンプ １９Ｌ、１９Ｒ、１９Ｌｌ、１９Ｒｌ スピーカ １９Ｌｍ、１９Ｒｍ、１９Ｌｈ、１９Ｒｈ スピーカ ２０ 収音マイクロホン ２１ Ａ／Ｄ変換器 ２２、２２Ｌ、２２Ｒ 適応フィルタ ２３ 加算器 ２４ 演算部 ２５ 減算器 ２６ 制御系 ２７ 測定系 ２８ ディレイ ２９ デシメーションフィルタ ３０ バンドパスフィルタ
フロントページの続き
(72)発明者 渡辺 雅司
兵庫県川西市久代３丁目13番21号 株式
会社 ケーディーエル内
(56)参考文献 特開 平４−170300（ＪＰ，Ａ)
特開 平６−46499（ＪＰ，Ａ)
(58)調査した分野(Int.Cl.7，ＤＢ名)
H04S 7/00
G10K 15/00
H03H 21/00
H04S 1/00
H03H 17/02 601
Claims (1)
- (57)【特許請求の範囲】 【請求項１】 Ｎ個の各々が無相関な測定信号を発生す
る測定信号発生部と、Ｎ個のスピーカそれぞれに前記測
定信号を接続するスイッチ手段と、リスニングポジショ
ンに設置され各スピーカで同時に再生した測定信号を収
音する収音マイクと、各スピーカへの入力となる測定信
号と収音された測定信号よりそれぞれのスピーカからマ
イクまでのインパルスレスポンスを求めるＮ個の適応フ
ィルタと、前記インパルスレスポンスの立ち上がりの遅
延時間を測定する測定手段と、遅延時間を記憶する記憶
手段と、記憶した遅延時間から各スピーカの収音マイク
への到達時間を同じにする遅延時間を計算する計算手段
と、各スピーカに接続された遅延回路と、前記測定信号
発生部を制御するとともに、各遅延回路の遅延時間を計
算した遅延時間に更新する制御手段を備えたことを特徴
とする音響再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20627293A JP3509135B2 (ja) | 1993-08-20 | 1993-08-20 | 音響再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20627293A JP3509135B2 (ja) | 1993-08-20 | 1993-08-20 | 音響再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0759200A JPH0759200A (ja) | 1995-03-03 |
| JP3509135B2 true JP3509135B2 (ja) | 2004-03-22 |
Family
ID=16520583
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20627293A Expired - Lifetime JP3509135B2 (ja) | 1993-08-20 | 1993-08-20 | 音響再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3509135B2 (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR101086398B1 (ko) | 2003-12-24 | 2011-11-25 | 삼성전자주식회사 | 다수의 마이크로폰을 이용한 지향성 제어 가능 스피커시스템 및 그 방법 |
| KR100650709B1 (ko) * | 2005-11-23 | 2006-11-27 | (주)바코 | 씨-마이크로폰 음향특정 측정 시스템 |
| JP4835151B2 (ja) * | 2005-12-21 | 2011-12-14 | ヤマハ株式会社 | オーディオシステム |
| JP4655098B2 (ja) | 2008-03-05 | 2011-03-23 | ヤマハ株式会社 | 音声信号出力装置、音声信号出力方法およびプログラム |
| AU2014243797B2 (en) * | 2013-03-14 | 2016-05-19 | Apple Inc. | Adaptive room equalization using a speaker and a handheld listening device |
-
1993
- 1993-08-20 JP JP20627293A patent/JP3509135B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0759200A (ja) | 1995-03-03 |
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