JP3362436B2 - 信号処理回路及び信号処理方法 - Google Patents
信号処理回路及び信号処理方法Info
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- JP3362436B2 JP3362436B2 JP09215393A JP9215393A JP3362436B2 JP 3362436 B2 JP3362436 B2 JP 3362436B2 JP 09215393 A JP09215393 A JP 09215393A JP 9215393 A JP9215393 A JP 9215393A JP 3362436 B2 JP3362436 B2 JP 3362436B2
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Description
【０００１】
【産業上の利用分野】本発明は、Ｒ，Ｇ，Ｂ信号から２
つの色差信号（Ｒ−Ｙ），（Ｂ−Ｙ）を生成する信号処
理回路及び信号処理方法に関し、特に、３板ＣＣＤカメ
ラ信号処理に用いて好適な信号処理回路及び信号処理方
法に関する。
つの色差信号（Ｒ−Ｙ），（Ｂ−Ｙ）を生成する信号処
理回路及び信号処理方法に関し、特に、３板ＣＣＤカメ
ラ信号処理に用いて好適な信号処理回路及び信号処理方
法に関する。
【０００２】
【従来の技術】３板ＣＣＤカメラ信号処理において、
Ｒ，Ｇ，Ｂの３原色信号から２つの色差信号、即ち（Ｒ
−Ｙ），（Ｂ−Ｙ）信号を生成する従来のクロママトリ
クス回路では、図４に示すように、Ｒ信号に対して掛け
算器４１，４２で別々の色差マトリクス係数（０．７，
−０．３）を掛け、Ｇ信号に対して掛け算器４３で単一
の色差マトリクス係数（−０．５９）を掛け、Ｂ信号に
対して掛け算器４４，４５で別々の色差マトリクス係数
（−０．１１，０．８９）を掛け、しかる後掛け算器４
１，４３，４４の各出力を加算器４６で加算することに
よって（Ｒ−Ｙ）信号を、また掛け算器４２，４３，４
５の各出力を加算器４７で加算することによって（Ｂ−
Ｙ）信号をそれぞれ得る構成となっていた。
Ｒ，Ｇ，Ｂの３原色信号から２つの色差信号、即ち（Ｒ
−Ｙ），（Ｂ−Ｙ）信号を生成する従来のクロママトリ
クス回路では、図４に示すように、Ｒ信号に対して掛け
算器４１，４２で別々の色差マトリクス係数（０．７，
−０．３）を掛け、Ｇ信号に対して掛け算器４３で単一
の色差マトリクス係数（−０．５９）を掛け、Ｂ信号に
対して掛け算器４４，４５で別々の色差マトリクス係数
（−０．１１，０．８９）を掛け、しかる後掛け算器４
１，４３，４４の各出力を加算器４６で加算することに
よって（Ｒ−Ｙ）信号を、また掛け算器４２，４３，４
５の各出力を加算器４７で加算することによって（Ｂ−
Ｙ）信号をそれぞれ得る構成となっていた。
【０００３】このときの（Ｒ−Ｙ），（Ｂ−Ｙ）信号
は、
は、
【数１】
（Ｒ−Ｙ）＝０．７０Ｒ−０．５９Ｇ−０．１１Ｂ
【数２】
（Ｂ−Ｙ）＝−０．３０Ｒ−０．５９Ｇ＋０．８９Ｂ
の構成比となる。
【０００４】
【発明が解決しようとする課題】このように、従来のク
ロママトリクス回路では、３チャンネルのＲ，Ｇ，Ｂ信
号入力に対して直接色差マトリクス係数を掛けて（Ｒ−
Ｙ），（Ｂ−Ｙ）信号を生成する構成となっていたの
で、Ｒ，Ｇ，Ｂ信号に対して５個の掛け算器が必要であ
ることから、回路構成が複雑となり、かつ回路規模が大
きくなるという問題があった。さらに、従来回路では、
（Ｒ−Ｙ），（Ｂ−Ｙ）信号に対して色差ゲインを別々
に掛け、また色相（ＨＵＥ）ゲインの補正については
Ｒ，Ｇ，Ｂの原色状態で補正するするように別回路で係
数を掛けていたので、さらに回路構成が複雑になってい
た。
ロママトリクス回路では、３チャンネルのＲ，Ｇ，Ｂ信
号入力に対して直接色差マトリクス係数を掛けて（Ｒ−
Ｙ），（Ｂ−Ｙ）信号を生成する構成となっていたの
で、Ｒ，Ｇ，Ｂ信号に対して５個の掛け算器が必要であ
ることから、回路構成が複雑となり、かつ回路規模が大
きくなるという問題があった。さらに、従来回路では、
（Ｒ−Ｙ），（Ｂ−Ｙ）信号に対して色差ゲインを別々
に掛け、また色相（ＨＵＥ）ゲインの補正については
Ｒ，Ｇ，Ｂの原色状態で補正するするように別回路で係
数を掛けていたので、さらに回路構成が複雑になってい
た。
【０００５】本発明は、上記課題に鑑みてなされたもの
であり、その目的とするところは、回路規模の縮小化を
可能とした信号処理回路及び信号処理方法を提供するこ
とにある。
であり、その目的とするところは、回路規模の縮小化を
可能とした信号処理回路及び信号処理方法を提供するこ
とにある。
【０００６】
【課題を解決するための手段】上記目的を達成するため
に、本発明による信号処理回路は、Ｒ，Ｇ，Ｂ信号から
（Ｒ−Ｇ），（Ｂ−Ｇ）信号を生成する第１の演算回路
と、この第１の演算回路から出力される（Ｒ−Ｇ），
（Ｂ−Ｇ）信号を同時化しかつ切り換えて点順次の（Ｒ
−Ｇ）／（Ｂ−Ｇ）信号として出力する回路と、この点
順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号から点順次の（Ｒ−
Ｙ）／（Ｂ−Ｙ）信号を生成する第２の演算回路とを備
え、この第２の演算回路が、点順次の（Ｒ−Ｇ）／（Ｂ
−Ｇ）信号に基づく点順次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信
号に対して第１の係数を掛ける第１の掛け算器と、この
第１の掛け算器の出力信号と前記点順次の（Ｒ−Ｇ）／
（Ｂ−Ｇ）信号とを加算して点順次の（Ｒ−Ｙ）／（Ｂ
−Ｙ）信号として出力する加算器と、この加算器から出
力される点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信号に対して
第２の係数を掛ける第２の掛け算器とを有し、第１の係
数が色相ゲインの補正量に応じて可変であり、第２の係
数が色差ゲインの補正量に応じて可変である構成となっ
ている。
に、本発明による信号処理回路は、Ｒ，Ｇ，Ｂ信号から
（Ｒ−Ｇ），（Ｂ−Ｇ）信号を生成する第１の演算回路
と、この第１の演算回路から出力される（Ｒ−Ｇ），
（Ｂ−Ｇ）信号を同時化しかつ切り換えて点順次の（Ｒ
−Ｇ）／（Ｂ−Ｇ）信号として出力する回路と、この点
順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号から点順次の（Ｒ−
Ｙ）／（Ｂ−Ｙ）信号を生成する第２の演算回路とを備
え、この第２の演算回路が、点順次の（Ｒ−Ｇ）／（Ｂ
−Ｇ）信号に基づく点順次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信
号に対して第１の係数を掛ける第１の掛け算器と、この
第１の掛け算器の出力信号と前記点順次の（Ｒ−Ｇ）／
（Ｂ−Ｇ）信号とを加算して点順次の（Ｒ−Ｙ）／（Ｂ
−Ｙ）信号として出力する加算器と、この加算器から出
力される点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信号に対して
第２の係数を掛ける第２の掛け算器とを有し、第１の係
数が色相ゲインの補正量に応じて可変であり、第２の係
数が色差ゲインの補正量に応じて可変である構成となっ
ている。
【０００７】
【作用】Ｒ，Ｇ，Ｂ信号から（Ｒ−Ｇ），（Ｂ−Ｇ）信
号を生成し、この（Ｒ−Ｇ），（Ｂ−Ｇ）信号を同時化
しかつ切り換えて点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号
とし、この点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号に対し
て色差マトリクス係数を掛けることによって点順次の
（Ｒ−Ｙ）／（Ｂ−Ｙ）信号を生成するに際して、点順
次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号に掛ける第１の係数
と、点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信号に掛ける第２
の係数とを、色相ゲイン及び色差ゲインの各補正量に応
じてコントロールすることで、補正のための回路を別に
設けなくても、色相ゲイン及び色差ゲインを補正するこ
とができる。その結果、色相ゲイン及び色差ゲインを補
正可能な構成を採るに当たって回路規模をより小さくで
きる。
号を生成し、この（Ｒ−Ｇ），（Ｂ−Ｇ）信号を同時化
しかつ切り換えて点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号
とし、この点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号に対し
て色差マトリクス係数を掛けることによって点順次の
（Ｒ−Ｙ）／（Ｂ−Ｙ）信号を生成するに際して、点順
次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号に掛ける第１の係数
と、点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信号に掛ける第２
の係数とを、色相ゲイン及び色差ゲインの各補正量に応
じてコントロールすることで、補正のための回路を別に
設けなくても、色相ゲイン及び色差ゲインを補正するこ
とができる。その結果、色相ゲイン及び色差ゲインを補
正可能な構成を採るに当たって回路規模をより小さくで
きる。
【０００８】
【実施例】以下、本発明の実施例を図面に基づいて詳細
に説明する。図１は、本発明による一実施例のクロママ
トリクス回路が適用されたクロマ信号処理回路を示すブ
ロック図である。図において、Ｒ，Ｇ，Ｂの３原色信号
は、ホワイトバランス回路１Ｒ，１Ｇ，１Ｂで色調整が
行われ、さらにγ補正回路２Ｒ，２Ｇ，２Ｂでγ補正さ
れた後、ホワイトクリップ回路３Ｒ，３Ｇ，３Ｂに供給
される。ホワイトクリップ回路３Ｒ，３Ｂを経たＲ，Ｂ
信号は加算器４，５の各一入力となる。ホワイトクリッ
プ回路３Ｇを経たＧ信号は、インバータ６で反転されて
加算器４，５の各他入力となる。この加算器４，５及び
インバータ６によって、Ｒ，Ｇ，Ｂ信号から（Ｒ−
Ｇ），（Ｂ−Ｇ）信号を生成する演算回路が構成されて
いる。
に説明する。図１は、本発明による一実施例のクロママ
トリクス回路が適用されたクロマ信号処理回路を示すブ
ロック図である。図において、Ｒ，Ｇ，Ｂの３原色信号
は、ホワイトバランス回路１Ｒ，１Ｇ，１Ｂで色調整が
行われ、さらにγ補正回路２Ｒ，２Ｇ，２Ｂでγ補正さ
れた後、ホワイトクリップ回路３Ｒ，３Ｇ，３Ｂに供給
される。ホワイトクリップ回路３Ｒ，３Ｂを経たＲ，Ｂ
信号は加算器４，５の各一入力となる。ホワイトクリッ
プ回路３Ｇを経たＧ信号は、インバータ６で反転されて
加算器４，５の各他入力となる。この加算器４，５及び
インバータ６によって、Ｒ，Ｇ，Ｂ信号から（Ｒ−
Ｇ），（Ｂ−Ｇ）信号を生成する演算回路が構成されて
いる。
【０００９】すなわち、加算器４，５は、Ｒ，Ｂ信号と
インバータ６で反転されたＧ信号とを加算することによ
って（Ｒ−Ｇ），（Ｂ−Ｇ）信号を出力する。これら
（Ｒ−Ｇ），（Ｂ−Ｇ）信号は、例えば４ｆsc（ｆsc：
カラーサブキャリア周波数）のデータレートの信号とし
て帯域制限回路７に供給される。この帯域制限回路７で
は、４ｆscデータレートの（Ｒ−Ｇ），（Ｂ−Ｇ）信号
を同時化しかつ２ｆscデータレートの点順次の（Ｒ−
Ｇ）／（Ｂ−Ｇ）信号にするデシメイション(Decimatio
n)処理が行われると共に、ローパスフィルタ（Ｌ．Ｐ．
Ｆ）７１にて信号帯域を十分に落とすフィルタリング処
理が行われる。ここで、デシメイション処理とは、信号
処理システム内でサンプリング周波数を降下させるため
の操作処理を言う。
インバータ６で反転されたＧ信号とを加算することによ
って（Ｒ−Ｇ），（Ｂ−Ｇ）信号を出力する。これら
（Ｒ−Ｇ），（Ｂ−Ｇ）信号は、例えば４ｆsc（ｆsc：
カラーサブキャリア周波数）のデータレートの信号とし
て帯域制限回路７に供給される。この帯域制限回路７で
は、４ｆscデータレートの（Ｒ−Ｇ），（Ｂ−Ｇ）信号
を同時化しかつ２ｆscデータレートの点順次の（Ｒ−
Ｇ）／（Ｂ−Ｇ）信号にするデシメイション(Decimatio
n)処理が行われると共に、ローパスフィルタ（Ｌ．Ｐ．
Ｆ）７１にて信号帯域を十分に落とすフィルタリング処
理が行われる。ここで、デシメイション処理とは、信号
処理システム内でサンプリング周波数を降下させるため
の操作処理を言う。
【００１０】帯域制限回路７から出力される点順次の
（Ｒ−Ｇ）／（Ｂ−Ｇ）信号は、直接セレクトスイッチ
８の一入力になるとともに、ローパスフィルタ９を経て
セレクトスイッチ８の他入力となる。セレクトスイッチ
８は、２入力のいずれか一方を選択することにより、各
々異なる出力帯域特性を持つ点順次の（Ｒ−Ｇ）／（Ｂ
−Ｇ）信号を出力することができる。セレクトスイッチ
８から出力される点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号
は、演算回路１０に供給される。
（Ｒ−Ｇ）／（Ｂ−Ｇ）信号は、直接セレクトスイッチ
８の一入力になるとともに、ローパスフィルタ９を経て
セレクトスイッチ８の他入力となる。セレクトスイッチ
８は、２入力のいずれか一方を選択することにより、各
々異なる出力帯域特性を持つ点順次の（Ｒ−Ｇ）／（Ｂ
−Ｇ）信号を出力することができる。セレクトスイッチ
８から出力される点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号
は、演算回路１０に供給される。
【００１１】この演算回路１０は、点順次の（Ｒ−Ｇ）
／（Ｂ−Ｇ）信号に対して色差マトリクス係数を掛ける
ことによって点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信号を生
成する回路である。ここでの（Ｒ−Ｙ）／（Ｂ−Ｙ）信
号は、
／（Ｂ−Ｇ）信号に対して色差マトリクス係数を掛ける
ことによって点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信号を生
成する回路である。ここでの（Ｒ−Ｙ）／（Ｂ−Ｙ）信
号は、
【数３】
（Ｒ−Ｙ）＝０．７０（Ｒ−Ｇ）−０．１１（Ｂ−Ｇ）
【数４】
（Ｂ−Ｙ）＝−０．３０（Ｒ−Ｇ）＋０．８９（Ｂ−
Ｇ） の（Ｒ−Ｇ），（Ｂ−Ｇ）構成比で生成される。
Ｇ） の（Ｒ−Ｇ），（Ｂ−Ｇ）構成比で生成される。
【００１２】図２は、演算回路１０の一構成例を示すブ
ロック図である。同図において、点順次の（Ｒ−Ｇ）／
（Ｂ−Ｇ）信号は、信号処理回路２１で（Ｒ−Ｇ）／
（Ｂ−Ｇ）の順番が入れ換えられて（Ｂ−Ｇ）／（Ｒ−
Ｇ）信号として掛け算器２２に供給される。掛け算器２
２は、（Ｂ−Ｇ）信号に対して０．８９の色差マトリク
ス係数を、（Ｒ−Ｇ）信号に対して０．７０の色差マト
リクス係数を交互に掛ける処理を行う。一方、掛け算器
２３には、点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号が直接
入力される。この掛け算器２３は、（Ｒ−Ｇ）信号に対
して−０．３０の色差マトリクス係数を、（Ｂ−Ｇ）信
号に対して−０．１１の色差マトリクス係数を交互に掛
ける処理を行う。掛け算器２２，２３の各出力信号、即
ち点順次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号と点順次の（Ｒ
−Ｇ）／（Ｂ−Ｇ）信号とは加算器２４で加算される。
これにより、加算器２４の出力信号として、点順次の
（Ｂ−Ｙ）／（Ｒ−Ｙ）信号が得られることになる。
ロック図である。同図において、点順次の（Ｒ−Ｇ）／
（Ｂ−Ｇ）信号は、信号処理回路２１で（Ｒ−Ｇ）／
（Ｂ−Ｇ）の順番が入れ換えられて（Ｂ−Ｇ）／（Ｒ−
Ｇ）信号として掛け算器２２に供給される。掛け算器２
２は、（Ｂ−Ｇ）信号に対して０．８９の色差マトリク
ス係数を、（Ｒ−Ｇ）信号に対して０．７０の色差マト
リクス係数を交互に掛ける処理を行う。一方、掛け算器
２３には、点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号が直接
入力される。この掛け算器２３は、（Ｒ−Ｇ）信号に対
して−０．３０の色差マトリクス係数を、（Ｂ−Ｇ）信
号に対して−０．１１の色差マトリクス係数を交互に掛
ける処理を行う。掛け算器２２，２３の各出力信号、即
ち点順次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号と点順次の（Ｒ
−Ｇ）／（Ｂ−Ｇ）信号とは加算器２４で加算される。
これにより、加算器２４の出力信号として、点順次の
（Ｂ−Ｙ）／（Ｒ−Ｙ）信号が得られることになる。
【００１３】このように、Ｒ，Ｇ，Ｂ信号から（Ｒ−
Ｇ），（Ｂ−Ｇ）信号を生成し、この（Ｒ−Ｇ），（Ｂ
−Ｇ）信号を同時化しかつ切り換えて点順次の（Ｒ−
Ｇ）／（Ｂ−Ｇ）信号とし、信号帯域を十分に落とした
後に、点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号に色差マト
リクス係数を掛けて点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信
号を生成することにより、回路構成が複雑で大規模とな
る掛け算器が２個で済むことになる。すなわち、Ｒ，
Ｇ，Ｂ信号に対して直接色差マトリクス係数を掛けるこ
とよって（Ｒ−Ｇ），（Ｂ−Ｇ）信号を生成していた従
来回路では掛け算器が５個必要であったのに対し、本構
成によれば、２個の掛け算器２２，２３で済むため、回
路構成を簡略化でき、回路規模を小さくできることにな
る。
Ｇ），（Ｂ−Ｇ）信号を生成し、この（Ｒ−Ｇ），（Ｂ
−Ｇ）信号を同時化しかつ切り換えて点順次の（Ｒ−
Ｇ）／（Ｂ−Ｇ）信号とし、信号帯域を十分に落とした
後に、点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号に色差マト
リクス係数を掛けて点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信
号を生成することにより、回路構成が複雑で大規模とな
る掛け算器が２個で済むことになる。すなわち、Ｒ，
Ｇ，Ｂ信号に対して直接色差マトリクス係数を掛けるこ
とよって（Ｒ−Ｇ），（Ｂ−Ｇ）信号を生成していた従
来回路では掛け算器が５個必要であったのに対し、本構
成によれば、２個の掛け算器２２，２３で済むため、回
路構成を簡略化でき、回路規模を小さくできることにな
る。
【００１４】図３は、演算回路１０の他の構成例を示す
ブロック図である。本例における演算回路１０は、色差
ゲイン及び色相ゲインの補正をも行い得るように構成さ
れている。すなわち、数３，数４の各式を変形すると、
ブロック図である。本例における演算回路１０は、色差
ゲイン及び色相ゲインの補正をも行い得るように構成さ
れている。すなわち、数３，数４の各式を変形すると、
【数５】
（Ｒ−Ｙ）＝０．７０｛（Ｒ−Ｇ）−０．１６（Ｂ−Ｇ）｝
【数６】
（Ｂ−Ｙ）＝０．８９｛（Ｂ−Ｇ）−０．３４（Ｒ−Ｇ）｝
となり、色差マトリクス係数０．７０及び０．８９が色
差ゲインに、色差マトリクス係数０．１６及び０．３４
が色相ゲインにそれぞれ対応することになる。
差ゲインに、色差マトリクス係数０．１６及び０．３４
が色相ゲインにそれぞれ対応することになる。
【００１５】図３において、点順次の（Ｒ−Ｇ）／（Ｂ
−Ｇ）信号は、加算器３１の一入力になるとともに、デ
ータ入れ換え回路３２で（Ｒ−Ｇ）／（Ｂ−Ｇ）の順番
が入れ換えられて（Ｂ−Ｇ）／（Ｒ−Ｇ）信号として掛
け算器３３に供給される。掛け算器３３は色相ゲインの
補正量に応じて係数が可変な構成となっており、その係
数の初期値として色相ゲインに関する理論上の色差マト
リクス係数０．１６及び０．３４が設定される。この初
期値は、色相ゲインの補正量に対応してコントロールさ
れることになる。そして、この掛け算器３３において
は、（Ｂ−Ｇ）信号に対して色差マトリクス係数（−
０．１６）を、（Ｒ−Ｇ）信号に対して色差マトリクス
係数（−０．３４）を交互に掛ける処理が行われる。掛
け算器３３を経た点順次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号
は加算器３１の他入力となる。
−Ｇ）信号は、加算器３１の一入力になるとともに、デ
ータ入れ換え回路３２で（Ｒ−Ｇ）／（Ｂ−Ｇ）の順番
が入れ換えられて（Ｂ−Ｇ）／（Ｒ−Ｇ）信号として掛
け算器３３に供給される。掛け算器３３は色相ゲインの
補正量に応じて係数が可変な構成となっており、その係
数の初期値として色相ゲインに関する理論上の色差マト
リクス係数０．１６及び０．３４が設定される。この初
期値は、色相ゲインの補正量に対応してコントロールさ
れることになる。そして、この掛け算器３３において
は、（Ｂ−Ｇ）信号に対して色差マトリクス係数（−
０．１６）を、（Ｒ−Ｇ）信号に対して色差マトリクス
係数（−０．３４）を交互に掛ける処理が行われる。掛
け算器３３を経た点順次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号
は加算器３１の他入力となる。
【００１６】加算器３３は、点順次の（Ｒ−Ｇ）／（Ｂ
−Ｇ）信号と点順次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号とを
加算することにより、点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）
信号を出力する。この点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）
信号は掛け算器３４に供給される。掛け算器３４は色差
ゲインの補正量に応じて係数が可変な構成となってお
り、その係数の初期値として色差ゲインに関する理論上
の色差マトリクス係数０．７０及び０．８９が設定され
る。この初期値は、色差ゲインの補正量に対応してコン
トロールされることになる。そして、この掛け算器３４
においては、（Ｒ−Ｙ）信号に対して色差マトリクス係
数０．７０を、（Ｂ−Ｙ）信号に対して色差マトリクス
係数０．８９を交互に掛ける処理が行われる。これによ
り、掛け算器３４の出力信号として、色差ゲイン及び色
相ゲインの補正された点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）
信号が得られることになる。
−Ｇ）信号と点順次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号とを
加算することにより、点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）
信号を出力する。この点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）
信号は掛け算器３４に供給される。掛け算器３４は色差
ゲインの補正量に応じて係数が可変な構成となってお
り、その係数の初期値として色差ゲインに関する理論上
の色差マトリクス係数０．７０及び０．８９が設定され
る。この初期値は、色差ゲインの補正量に対応してコン
トロールされることになる。そして、この掛け算器３４
においては、（Ｒ−Ｙ）信号に対して色差マトリクス係
数０．７０を、（Ｂ−Ｙ）信号に対して色差マトリクス
係数０．８９を交互に掛ける処理が行われる。これによ
り、掛け算器３４の出力信号として、色差ゲイン及び色
相ゲインの補正された点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）
信号が得られることになる。
【００１７】このように、演算回路１０を構成する２つ
の掛け算器３３，３４に十分なゲイン範囲を持たせ、こ
れら掛け算器３３，３４で色差マトリクス係数を掛ける
と同時にこれらの係数を色差ゲイン及び色相ゲインの各
補正量に応じてコントロールすることにより、色差ゲイ
ン及び色相ゲインの補正のための回路を別に設ける必要
がないので、回路規模を小さくできる。例えば、色差ゲ
イン及び色相ゲインの補正のための回路を（Ｒ−Ｇ），
（Ｂ−Ｇ）別々に２チャンネル持つ場合には、回路構成
が複雑で大規模となる掛け算器が４個必要となるのに対
し、本構成によれば２個で済むことになる。
の掛け算器３３，３４に十分なゲイン範囲を持たせ、こ
れら掛け算器３３，３４で色差マトリクス係数を掛ける
と同時にこれらの係数を色差ゲイン及び色相ゲインの各
補正量に応じてコントロールすることにより、色差ゲイ
ン及び色相ゲインの補正のための回路を別に設ける必要
がないので、回路規模を小さくできる。例えば、色差ゲ
イン及び色相ゲインの補正のための回路を（Ｒ−Ｇ），
（Ｂ−Ｇ）別々に２チャンネル持つ場合には、回路構成
が複雑で大規模となる掛け算器が４個必要となるのに対
し、本構成によれば２個で済むことになる。
【００１８】
【発明の効果】以上説明したように、本発明によれば、
Ｒ，Ｇ，Ｂ信号から（Ｒ−Ｇ），（Ｂ−Ｇ）信号を生成
し、この（Ｒ−Ｇ），（Ｂ−Ｇ）信号を同時化しかつ切
り換えて点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号とし、こ
の点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号に色差マトリク
ス係数を掛けることによって点順次の（Ｒ−Ｙ）／（Ｂ
−Ｙ）信号を生成する構成としたことにより、Ｒ，Ｇ，
Ｂ信号に対して直接色差マトリクス係数を掛けることに
よって（Ｒ−Ｙ），（Ｂ−Ｙ）信号を生成していた従来
回路に比べて、少ない数の掛け算器で回路を構成できる
ので、回路構成の簡略化及び回路規模の縮小化が可能と
なる効果がある。
Ｒ，Ｇ，Ｂ信号から（Ｒ−Ｇ），（Ｂ−Ｇ）信号を生成
し、この（Ｒ−Ｇ），（Ｂ−Ｇ）信号を同時化しかつ切
り換えて点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号とし、こ
の点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号に色差マトリク
ス係数を掛けることによって点順次の（Ｒ−Ｙ）／（Ｂ
−Ｙ）信号を生成する構成としたことにより、Ｒ，Ｇ，
Ｂ信号に対して直接色差マトリクス係数を掛けることに
よって（Ｒ−Ｙ），（Ｂ−Ｙ）信号を生成していた従来
回路に比べて、少ない数の掛け算器で回路を構成できる
ので、回路構成の簡略化及び回路規模の縮小化が可能と
なる効果がある。
【００１９】また、点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信
号に色差マトリクス係数を掛けて点順次の（Ｒ−Ｙ）／
（Ｂ−Ｙ）信号を生成する掛け算器に十分なゲイン範囲
を持たせて色差マトリクス係数を掛けると同時に、これ
らの係数を色差ゲイン及び色相ゲインの各補正量に応じ
てコントロールするようにしたことにより、色差ゲイン
及び色相ゲインの補正のための回路を別に設ける必要が
ないので、回路規模をより小さくできることになる。
号に色差マトリクス係数を掛けて点順次の（Ｒ−Ｙ）／
（Ｂ−Ｙ）信号を生成する掛け算器に十分なゲイン範囲
を持たせて色差マトリクス係数を掛けると同時に、これ
らの係数を色差ゲイン及び色相ゲインの各補正量に応じ
てコントロールするようにしたことにより、色差ゲイン
及び色相ゲインの補正のための回路を別に設ける必要が
ないので、回路規模をより小さくできることになる。
【図１】本発明による一実施例のクロママトリクス回路
が適用されたクロマ信号処理回路を示すブロック図であ
る。
が適用されたクロマ信号処理回路を示すブロック図であ
る。
【図２】図１における演算回路の一構成例を示すブロッ
ク図である。
ク図である。
【図３】図１における演算回路の他の構成例を示すブロ
ック図である。
ック図である。
【図４】従来例を示すブロック図である。
４，５，２４，３１ 加算器
７ 帯域制限回路
９ ローパスフィルタ（Ｌ．Ｐ．Ｆ）
１０ 演算回路
２１，３２ データ入れ換え回路
２２，２３，３３，３４ 掛け算器
Claims (2)
- 【請求項１】 Ｒ，Ｇ，Ｂ信号から２つの色差信号（Ｒ
−Ｙ），（Ｂ−Ｙ）信号を生成する信号処理回路であっ
て、 前記Ｒ，Ｇ，Ｂ信号から（Ｒ−Ｇ），（Ｂ−Ｇ）信号を
生成する第１の演算回路と、 前記第１の演算回路から出力される（Ｒ−Ｇ），（Ｂ−
Ｇ）信号を同時化しかつ切り換えて点順次の（Ｒ−Ｇ）
／（Ｂ−Ｇ）信号として出力する回路と、 前記点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号から点順次の
（Ｒ−Ｙ）／（Ｂ−Ｙ）信号を生成する第２の演算回路
とを備え、 前記第２の演算回路は、 前記点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号に基づく点順
次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号に対して第１の係数を
掛ける第１の掛け算器と、 前記第１の掛け算器の出力信号と前記点順次の（Ｒ−
Ｇ）／（Ｂ−Ｇ）信号とを加算して点順次の（Ｒ−Ｙ）
／（Ｂ−Ｙ）信号として出力する加算器と、 前記加算器から出力される点順次の（Ｒ−Ｙ）／（Ｂ−
Ｙ）信号に対して第２の係数を掛ける第２の掛け算器と
を有し、 前記第１の係数が色相ゲインの補正量に応じて可変であ
り、前記第２の係数が色差ゲインの補正量に応じて可変
である ことを特徴とする信号処理回路。 - 【請求項２】 Ｒ，Ｇ，Ｂ信号から（Ｒ−Ｇ），（Ｂ−
Ｇ）信号を生成し、この生成したＲ−Ｇ），（Ｂ−Ｇ）
信号を同時化しかつ切り換えて点順次の（Ｒ−Ｇ）／
（Ｂ−Ｇ）信号とし、前記点順次の（Ｒ−Ｇ）／（Ｂ−
Ｇ）信号から点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信号を生
成する信号処理方法であって、 前記点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号に基づく点順
次の（Ｂ−Ｇ）／（Ｒ−Ｇ）信号に対して色相ゲインの
補正量に応じて可変な第１の係数を掛け算し、 この第１の係数が掛けられた点順次の（Ｂ−Ｇ）／（Ｒ
−Ｇ）信号と前記点順次の（Ｒ−Ｇ）／（Ｂ−Ｇ）信号
とを加算して点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信号を生
成し、 前記点順次の（Ｒ−Ｙ）／（Ｂ−Ｙ）信号に対して色差
ゲインの補正量に応じ て可変な第２の係数を掛ける こと
を特徴とする信号処理方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP09215393A JP3362436B2 (ja) | 1993-03-26 | 1993-03-26 | 信号処理回路及び信号処理方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP09215393A JP3362436B2 (ja) | 1993-03-26 | 1993-03-26 | 信号処理回路及び信号処理方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06284438A JPH06284438A (ja) | 1994-10-07 |
| JP3362436B2 true JP3362436B2 (ja) | 2003-01-07 |
Family
ID=14046482
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP09215393A Expired - Fee Related JP3362436B2 (ja) | 1993-03-26 | 1993-03-26 | 信号処理回路及び信号処理方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3362436B2 (ja) |
-
1993
- 1993-03-26 JP JP09215393A patent/JP3362436B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH06284438A (ja) | 1994-10-07 |
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