JP3291330B2 - 文字表示装置及びそれを備えたマイクロコンピュータ - Google Patents
文字表示装置及びそれを備えたマイクロコンピュータInfo
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- JP3291330B2 JP3291330B2 JP29996092A JP29996092A JP3291330B2 JP 3291330 B2 JP3291330 B2 JP 3291330B2 JP 29996092 A JP29996092 A JP 29996092A JP 29996092 A JP29996092 A JP 29996092A JP 3291330 B2 JP3291330 B2 JP 3291330B2
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Description
【０００１】
【産業上の利用分野】本発明は、表示文字をテレビ画面
上で垂直移動させるのに好適な文字表示装置及びそれを
備えたマイクロコンピュータに関する。
上で垂直移動させるのに好適な文字表示装置及びそれを
備えたマイクロコンピュータに関する。
【０００２】
【従来の技術】最近のテレビ受像機はどの様な視聴状態
であるのかをテレビ画面上に集中表示する様になってい
る。例えば、視聴中の放送チャンネルを表示したり、テ
レビ入力又はビデオ入力を切換表示したり、或はビデオ
のタイマー予約状況を表示したり等、様々なオンスクリ
ーン表示を行える様になっている。ところで、こうした
文字表示はオンスクリーン回路を用いることによって実
現される。このオンスクリーン回路は、表示文字の水平
位置を検出する水平位置検出回路、表示文字の垂直位置
を検出する垂直位置検出回路、両検出回路の出力から文
字表示の為のアドレスデータを発生するアドレス回路、
前記アドレスデータでアクセスされ文字コード及び文字
修飾コードが読み出されるビデオＲＡＭ、文字コードで
アクセスされドットパターンの文字データが読み出され
るキャラクタＲＯＭ、更に文字修飾コード及び文字デー
タを画面表示できる状態に処理を施す出力回路等を内蔵
して成っている。
であるのかをテレビ画面上に集中表示する様になってい
る。例えば、視聴中の放送チャンネルを表示したり、テ
レビ入力又はビデオ入力を切換表示したり、或はビデオ
のタイマー予約状況を表示したり等、様々なオンスクリ
ーン表示を行える様になっている。ところで、こうした
文字表示はオンスクリーン回路を用いることによって実
現される。このオンスクリーン回路は、表示文字の水平
位置を検出する水平位置検出回路、表示文字の垂直位置
を検出する垂直位置検出回路、両検出回路の出力から文
字表示の為のアドレスデータを発生するアドレス回路、
前記アドレスデータでアクセスされ文字コード及び文字
修飾コードが読み出されるビデオＲＡＭ、文字コードで
アクセスされドットパターンの文字データが読み出され
るキャラクタＲＯＭ、更に文字修飾コード及び文字デー
タを画面表示できる状態に処理を施す出力回路等を内蔵
して成っている。
【０００３】さて、上記したオンスクリーン回路を用い
て表示文字をテレビ画面の上下方向へ垂直移動させる場
合、垂直位置制御回路の具体的構成が重要となる。これ
を示したのが図４である。図４において、（１）は８ビ
ットのカウンタであり、バッファ（２）を介した垂直同
期パルスＶsyncの立上りでリセットされ、インバータ
（３）を介した水平同期パルスＨsyncの立上りをカウン
トするものである。尚、テレビ映像の各フィールド画面
を形成する走査線は２６２．５本である為、カウンタ
（１）は少なくとも８ビットの桁数を必要とする。
（４）は８ビットのレジスタであり、表示文字の垂直位
置を示す８ビットデータが予めセットされる。（５）は
一致検出回路であり、カウンタ（１）の値がレジスタ
（４）の値に達した時に一致検出出力を発生するもので
ある。そして各垂直操作毎にレジスタ（４）の内容を順
次インクリメントし、この時の一致検出出力でビデオＲ
ＡＭをアクセスする様にしていた。
て表示文字をテレビ画面の上下方向へ垂直移動させる場
合、垂直位置制御回路の具体的構成が重要となる。これ
を示したのが図４である。図４において、（１）は８ビ
ットのカウンタであり、バッファ（２）を介した垂直同
期パルスＶsyncの立上りでリセットされ、インバータ
（３）を介した水平同期パルスＨsyncの立上りをカウン
トするものである。尚、テレビ映像の各フィールド画面
を形成する走査線は２６２．５本である為、カウンタ
（１）は少なくとも８ビットの桁数を必要とする。
（４）は８ビットのレジスタであり、表示文字の垂直位
置を示す８ビットデータが予めセットされる。（５）は
一致検出回路であり、カウンタ（１）の値がレジスタ
（４）の値に達した時に一致検出出力を発生するもので
ある。そして各垂直操作毎にレジスタ（４）の内容を順
次インクリメントし、この時の一致検出出力でビデオＲ
ＡＭをアクセスする様にしていた。
【０００４】
【発明が解決しようとする課題】しかしながら図５のタ
イムチャートから明らかな様に、カウンタ（１）は垂直
同期パルスＶsyncの後縁でリセット解除されて計数動作
を開始する。即ち、目視不可能な垂直同期パルスＶsync
の発生期間に存在する２１〜２７本程度の水平同期パル
スＨsyncは無視されることになる。その為、レジスタ
（４）の値を最小の００Ｈ（Ｈ：ヘキサデシマル）にセ
ットしてカウンタ（１）及びレジスタ（４）の値の一致
検出を行っても、目視可能なテレビ画面最上部の垂直ア
ドレスしか得られないことになる。従って、表示文字を
テレビ画面の上から下へ垂直移動させる場合、表示文字
がテレビ画面上部にいきなり現れてテレビ画面下部へ徐
々に消えていき、反対に表示文字をテレビ画面の下から
上へ垂直移動させる場合、表示文字がテレビ画面下部か
ら徐々に現れてテレビ画面上部でいきなり消えてしまう
等、不自然な垂直移動が行われてしまう問題があった。
イムチャートから明らかな様に、カウンタ（１）は垂直
同期パルスＶsyncの後縁でリセット解除されて計数動作
を開始する。即ち、目視不可能な垂直同期パルスＶsync
の発生期間に存在する２１〜２７本程度の水平同期パル
スＨsyncは無視されることになる。その為、レジスタ
（４）の値を最小の００Ｈ（Ｈ：ヘキサデシマル）にセ
ットしてカウンタ（１）及びレジスタ（４）の値の一致
検出を行っても、目視可能なテレビ画面最上部の垂直ア
ドレスしか得られないことになる。従って、表示文字を
テレビ画面の上から下へ垂直移動させる場合、表示文字
がテレビ画面上部にいきなり現れてテレビ画面下部へ徐
々に消えていき、反対に表示文字をテレビ画面の下から
上へ垂直移動させる場合、表示文字がテレビ画面下部か
ら徐々に現れてテレビ画面上部でいきなり消えてしまう
等、不自然な垂直移動が行われてしまう問題があった。
【０００５】そこで本発明は、表示文字をテレビ画面上
の目視可能な範囲で常に滑らかに垂直移動させることの
できる文字表示装置及びそれを備えたマイクロコンピュ
ータを提供することを目的とする。
の目視可能な範囲で常に滑らかに垂直移動させることの
できる文字表示装置及びそれを備えたマイクロコンピュ
ータを提供することを目的とする。
【０００６】
【課題を解決するための手段】本発明は前記問題点を解
決する為に成されたものであり、その特徴とするところ
は、水平同期パルスでリセットされ所定周波数のクロッ
クを計数する第１カウンタ、表示文字の水平開始位置を
示す値を保持する第１レジスタ、及び前記第１カウンタ
及び前記第１レジスタの内容の一致検出を行う第１検出
器を有する水平位置制御回路と、垂直同期パルスの発生
から直後の水平同期パルスの発生までの間にリセットパ
ルスを発生するパルス発生器、前記リセットパルスでリ
セットされ前記水平同期パルスを計数する第２カウン
タ、前記表示文字の垂直開始位置を示す値を保持する第
２レジスタ、及び前記第２カウンタ及び前記第２レジス
タの内容の一致検出を行う第２検出器を有する垂直位置
制御回路と、前記水平位置制御回路及び前記垂直位置制
御回路の一致検出出力を取り込んで前記表示文字の表示
位置を示すアドレスデータを順次発生するアドレス回路
と、個々の表示文字の表示位置に対応したアドレスに個
々の表示文字の為の文字コード及び文字修飾コードが記
憶され、前記アドレスデータでアクセスされるビデオＲ
ＡＭと、表示可能な全表示文字の為の文字データが記憶
され、前記文字コードでアクセスされるキャラクタＲＯ
Ｍと、前記文字修飾コード及び前記文字データを表示文
字として表示できる状態に処理する出力回路と、を備
え、前記表示文字をテレビ画面上で垂直移動させる時、
前記垂直同期パルスの発生期間中にも文字表示を行う点
である。
決する為に成されたものであり、その特徴とするところ
は、水平同期パルスでリセットされ所定周波数のクロッ
クを計数する第１カウンタ、表示文字の水平開始位置を
示す値を保持する第１レジスタ、及び前記第１カウンタ
及び前記第１レジスタの内容の一致検出を行う第１検出
器を有する水平位置制御回路と、垂直同期パルスの発生
から直後の水平同期パルスの発生までの間にリセットパ
ルスを発生するパルス発生器、前記リセットパルスでリ
セットされ前記水平同期パルスを計数する第２カウン
タ、前記表示文字の垂直開始位置を示す値を保持する第
２レジスタ、及び前記第２カウンタ及び前記第２レジス
タの内容の一致検出を行う第２検出器を有する垂直位置
制御回路と、前記水平位置制御回路及び前記垂直位置制
御回路の一致検出出力を取り込んで前記表示文字の表示
位置を示すアドレスデータを順次発生するアドレス回路
と、個々の表示文字の表示位置に対応したアドレスに個
々の表示文字の為の文字コード及び文字修飾コードが記
憶され、前記アドレスデータでアクセスされるビデオＲ
ＡＭと、表示可能な全表示文字の為の文字データが記憶
され、前記文字コードでアクセスされるキャラクタＲＯ
Ｍと、前記文字修飾コード及び前記文字データを表示文
字として表示できる状態に処理する出力回路と、を備
え、前記表示文字をテレビ画面上で垂直移動させる時、
前記垂直同期パルスの発生期間中にも文字表示を行う点
である。
【０００７】
【作用】本発明によれば、垂直同期パルスの発生から直
後の水平同期パルスの発生までの間に第２カウンタの為
のリセットパルスを発生できるので、第２カウンタは垂
直同期パルスの発生期間に存在する目視不可能な水平同
期パルスを計数できることになる。従って、表示文字を
テレビ画面の上下方向に垂直移動させる時、表示文字が
テレビ画面の最上部でいきなり現れたり消えたりする不
都合を解消できる。
後の水平同期パルスの発生までの間に第２カウンタの為
のリセットパルスを発生できるので、第２カウンタは垂
直同期パルスの発生期間に存在する目視不可能な水平同
期パルスを計数できることになる。従って、表示文字を
テレビ画面の上下方向に垂直移動させる時、表示文字が
テレビ画面の最上部でいきなり現れたり消えたりする不
都合を解消できる。
【０００８】
【実施例】本発明の詳細を図面に従って具体的に説明す
る。図１は本発明の文字表示装置をマイクロコンピュー
タに用いた一実施例を示す図である。図１において、端
子（１１）（１２）には各々テレビ信号に含まれる水平
同期パルスＨsync及び垂直同期パルスＶsyncが取り込ま
れる。（１３）は水平方向での表示文字の開始位置を検
出する水平位置制御回路であり、第１レジスタ（１
４）、第１カウンタ（１５）、及び第１レジスタ（１
４）及び第１カウンタ（１５）の内容の一致検出を行う
第１検出器（１６）から成る。ここで各表示文字の文字
フォントを横１８ドット×縦２１ドット、水平方向に表
示可能な最大文字数を１４に設定すると、第１レジスタ
（１４）及び第１カウンタ（１５）は共に８ビットで構
成されることになる。（１７）は発振器であり、水平方
向の各ドット表示毎に１周期を繰り返す発振クロックを
発生するものである。従って、第１カウンタ（１５）
は、インバータ（３７）出力の立上り毎に即ち水平同期
パルスＨsyncの立下り毎にリセットされ、発振クロック
の立上り毎にインクリメントを行う。また第１レジスタ
（１４）にはデータバス（１８）から水平方向での表示
文字の開始位置を示す８ビットデータがプリセットされ
る。そして第１カウンタ（１５）の値が第１レジスタ
（１４）の値に到来した時、第１検出器（１６）からそ
の旨を示す一致検出出力が発生する。
る。図１は本発明の文字表示装置をマイクロコンピュー
タに用いた一実施例を示す図である。図１において、端
子（１１）（１２）には各々テレビ信号に含まれる水平
同期パルスＨsync及び垂直同期パルスＶsyncが取り込ま
れる。（１３）は水平方向での表示文字の開始位置を検
出する水平位置制御回路であり、第１レジスタ（１
４）、第１カウンタ（１５）、及び第１レジスタ（１
４）及び第１カウンタ（１５）の内容の一致検出を行う
第１検出器（１６）から成る。ここで各表示文字の文字
フォントを横１８ドット×縦２１ドット、水平方向に表
示可能な最大文字数を１４に設定すると、第１レジスタ
（１４）及び第１カウンタ（１５）は共に８ビットで構
成されることになる。（１７）は発振器であり、水平方
向の各ドット表示毎に１周期を繰り返す発振クロックを
発生するものである。従って、第１カウンタ（１５）
は、インバータ（３７）出力の立上り毎に即ち水平同期
パルスＨsyncの立下り毎にリセットされ、発振クロック
の立上り毎にインクリメントを行う。また第１レジスタ
（１４）にはデータバス（１８）から水平方向での表示
文字の開始位置を示す８ビットデータがプリセットされ
る。そして第１カウンタ（１５）の値が第１レジスタ
（１４）の値に到来した時、第１検出器（１６）からそ
の旨を示す一致検出出力が発生する。
【０００９】（１９）は垂直方向での表示文字の開始位
置を検出する垂直位置制御回路であり、第２レジスタ
（２０）、第２カウンタ（２１）、及び第２レジスタ
（２０）及び第２カウンタ（２１）の内容の一致検出を
行う第２検出器（２２）を含み、更に第２カウンタ（２
１）のリセットを行うパルス発生器（２３）を含んで成
る。パルス発生器（２３）は、垂直同期パルスＶsyncを
反転する３段のインバータ（２４）（２５）（２６）、
インバータ（２４）の反転出力を遅延するコンデンサ
（２７）、及び垂直同期パルスＶsync及びインバータ
（２６）の反転出力の論理和演算を行うＯＲゲート（２
８）から成る。即ち、ＯＲゲート（２８）からは垂直同
期パルスＶsyncの立下りから直後の水平同期パルスＨsy
ncの立下りまでの間にリセットパルスａが発生すること
になる。従って、第２カウンタ（２１）はリセットパル
スａ毎に即ち垂直同期パルスＶsyncの立下り毎にリセッ
トされ、その後垂直同期パルスＶsyncの発生期間内に存
在する２１〜２７個の水平同期パルスＨsyncに同期して
計数を開始することになる。また第２レジスタ（２０）
にはデータバス（１８）から垂直方向での表示文字の開
始位置を示す８ビットデータがプリセットされる。そし
て第２カウンタ（２１）の値が第２レジスタ（２０）の
値まで到来した時、第２検出器（２２）からその旨を示
す一致検出出力が発生する。例えば第２レジスタ（２
０）に「０００００００１」がプリセットされると、第
２カウンタ（２１）が垂直同期パルスＶsyncの発生期間
内に存在する１個目の水平同期パルスＨsyncに同期して
インクリメントを行った時点で、第２検出器（２２）か
ら一致検出出力が発生する。即ち、テレビ画面上の可視
領域を外れた垂直同期パルスＶsyncの発生期間であるに
も関わらず、文字表示を行うことができる。尚、前記パ
ルス発生器（２３）は図１の構成要素に限定されるもの
ではなく、垂直同期パルスＶsyncの立下りから直後の水
平同期パルスＨsyncの立下りまでの間にリセットパルス
ａを発生できれば如何なる構成であってもよい。
置を検出する垂直位置制御回路であり、第２レジスタ
（２０）、第２カウンタ（２１）、及び第２レジスタ
（２０）及び第２カウンタ（２１）の内容の一致検出を
行う第２検出器（２２）を含み、更に第２カウンタ（２
１）のリセットを行うパルス発生器（２３）を含んで成
る。パルス発生器（２３）は、垂直同期パルスＶsyncを
反転する３段のインバータ（２４）（２５）（２６）、
インバータ（２４）の反転出力を遅延するコンデンサ
（２７）、及び垂直同期パルスＶsync及びインバータ
（２６）の反転出力の論理和演算を行うＯＲゲート（２
８）から成る。即ち、ＯＲゲート（２８）からは垂直同
期パルスＶsyncの立下りから直後の水平同期パルスＨsy
ncの立下りまでの間にリセットパルスａが発生すること
になる。従って、第２カウンタ（２１）はリセットパル
スａ毎に即ち垂直同期パルスＶsyncの立下り毎にリセッ
トされ、その後垂直同期パルスＶsyncの発生期間内に存
在する２１〜２７個の水平同期パルスＨsyncに同期して
計数を開始することになる。また第２レジスタ（２０）
にはデータバス（１８）から垂直方向での表示文字の開
始位置を示す８ビットデータがプリセットされる。そし
て第２カウンタ（２１）の値が第２レジスタ（２０）の
値まで到来した時、第２検出器（２２）からその旨を示
す一致検出出力が発生する。例えば第２レジスタ（２
０）に「０００００００１」がプリセットされると、第
２カウンタ（２１）が垂直同期パルスＶsyncの発生期間
内に存在する１個目の水平同期パルスＨsyncに同期して
インクリメントを行った時点で、第２検出器（２２）か
ら一致検出出力が発生する。即ち、テレビ画面上の可視
領域を外れた垂直同期パルスＶsyncの発生期間であるに
も関わらず、文字表示を行うことができる。尚、前記パ
ルス発生器（２３）は図１の構成要素に限定されるもの
ではなく、垂直同期パルスＶsyncの立下りから直後の水
平同期パルスＨsyncの立下りまでの間にリセットパルス
ａを発生できれば如何なる構成であってもよい。
【００１０】（２９）はテレビ画面上での表示文字の各
表示領域に対応したアドレスを持つビデオＲＡＭであ
り、各アドレスには表示文字に対応した文字コード及び
文字修飾コード等が各垂直操作毎に書き換えられて記憶
される。尚、ビデオＲＡＭ（２９）の書き込み情報をデ
ータバス（１８）を介してモニタすることも可能であ
る。（３０）は第１検出器（１６）及び第２検出器（２
２）の一致検出出力を取り込み、表示文字の表示位置を
示すアドレスデータ即ちビデオＲＡＭ（２９）の為のア
ドレスデータを発生するアドレス回路である。
表示領域に対応したアドレスを持つビデオＲＡＭであ
り、各アドレスには表示文字に対応した文字コード及び
文字修飾コード等が各垂直操作毎に書き換えられて記憶
される。尚、ビデオＲＡＭ（２９）の書き込み情報をデ
ータバス（１８）を介してモニタすることも可能であ
る。（３０）は第１検出器（１６）及び第２検出器（２
２）の一致検出出力を取り込み、表示文字の表示位置を
示すアドレスデータ即ちビデオＲＡＭ（２９）の為のア
ドレスデータを発生するアドレス回路である。
【００１１】（３１）は垂直同期パルスＶsync又はアド
レス回路（３０）からの割込信号ＩＮＴをＣＰＵ（図示
せず）に導出するＯＲゲートである。ＣＰＵが垂直同期
パルスＶsyncを取り込んだ場合、該ＣＰＵは直前のフィ
ールド画面の文字表示が終了したものと判断し、直後の
フィールド画面に文字表示を行う為の文字コード及び文
字修飾コードをデータバス（１８）を介してビデオＲＡ
Ｍ（２９）に書き込む。一方、ビデオＲＡＭ（２９）の
記憶容量を越える行数の文字表示を行う場合、例えばビ
デオＲＡＭ（２９）が１０行分の記憶容量しか持たない
のにも関わらず２０行分の文字を１行目から２０行目に
向けて且つ文字フォントの縦１ドット目から２１ドット
目に向けて徐々に見える様に表示する場合、１〜１０行
目の文字表示が終了した後に１１〜２０行目の文字表示
を行える様にビデオＲＡＭ（２９）の内容を書き換えな
ければならない。その為に前記割込信号ＩＮＴが発生す
る。例えば第１及び第２レジスタ（１４）（２０）に各
々１０行目の文字の水平及び垂直終了位置を示す８ビッ
トデータがプリセットされた状態で、第１及び第２検出
器（１６）（２２）から一致検出出力が発生すると、ア
ドレス回路（３０）から割込信号ＩＮＴが発生してＣＰ
Ｕに取り込まれる。該ＣＰＵは１０行分の文字表示が終
了したものと判断し、１行目を１１行目に代えて文字表
示を行う為の文字コード及び文字修飾コードをデータバ
ス（１８）を介してビデオＲＡＭ（２９）に書き込む。
その後、第１及び第２レジスタ（１４）（２０）に各々
１１行目の文字の水平及び垂直終了位置を示す８ビット
データがプリセットされた状態で、第１及び第２検出器
（１６）（２２）から一致検出出力が発生すると、アド
レス回路（３０）から割込信号ＩＮＴが発生してＣＰＵ
に取り込まれる。該ＣＰＵは１１行分の文字表示が終了
したものと判断し、１行目及び２行目を１１行目及び１
２行目に代えて文字表示を行う為の文字コード及び文字
修飾コードをデータバス（１８）を介してビデオＲＡＭ
（２９）に書き込む。この動作を２０行目まで繰り返す
ことによって２０行分の文字表示を行う。
レス回路（３０）からの割込信号ＩＮＴをＣＰＵ（図示
せず）に導出するＯＲゲートである。ＣＰＵが垂直同期
パルスＶsyncを取り込んだ場合、該ＣＰＵは直前のフィ
ールド画面の文字表示が終了したものと判断し、直後の
フィールド画面に文字表示を行う為の文字コード及び文
字修飾コードをデータバス（１８）を介してビデオＲＡ
Ｍ（２９）に書き込む。一方、ビデオＲＡＭ（２９）の
記憶容量を越える行数の文字表示を行う場合、例えばビ
デオＲＡＭ（２９）が１０行分の記憶容量しか持たない
のにも関わらず２０行分の文字を１行目から２０行目に
向けて且つ文字フォントの縦１ドット目から２１ドット
目に向けて徐々に見える様に表示する場合、１〜１０行
目の文字表示が終了した後に１１〜２０行目の文字表示
を行える様にビデオＲＡＭ（２９）の内容を書き換えな
ければならない。その為に前記割込信号ＩＮＴが発生す
る。例えば第１及び第２レジスタ（１４）（２０）に各
々１０行目の文字の水平及び垂直終了位置を示す８ビッ
トデータがプリセットされた状態で、第１及び第２検出
器（１６）（２２）から一致検出出力が発生すると、ア
ドレス回路（３０）から割込信号ＩＮＴが発生してＣＰ
Ｕに取り込まれる。該ＣＰＵは１０行分の文字表示が終
了したものと判断し、１行目を１１行目に代えて文字表
示を行う為の文字コード及び文字修飾コードをデータバ
ス（１８）を介してビデオＲＡＭ（２９）に書き込む。
その後、第１及び第２レジスタ（１４）（２０）に各々
１１行目の文字の水平及び垂直終了位置を示す８ビット
データがプリセットされた状態で、第１及び第２検出器
（１６）（２２）から一致検出出力が発生すると、アド
レス回路（３０）から割込信号ＩＮＴが発生してＣＰＵ
に取り込まれる。該ＣＰＵは１１行分の文字表示が終了
したものと判断し、１行目及び２行目を１１行目及び１
２行目に代えて文字表示を行う為の文字コード及び文字
修飾コードをデータバス（１８）を介してビデオＲＡＭ
（２９）に書き込む。この動作を２０行目まで繰り返す
ことによって２０行分の文字表示を行う。
【００１２】（３２）は縦２１ドット×横１８ドットの
ドットパターンを持つ文字データを各アドレスに記憶し
たキャラクタＲＯＭであり、ビデオＲＡＭ（２９）から
読み出された文字コードでアクセスされる。例えば水平
及び垂直走査に基づきビデオＲＡＭ（２９）から「Ａ」
の文字コードが読み出された場合、キャラクタＲＯＭ
（３２）の全記憶領域の中から「Ａ」の文字データを記
憶したアドレスがアクセスされる。尚、キャラクタＲＯ
Ｍ（３２）はテレビ画面に表示できる文字だけを記憶し
ている。
ドットパターンを持つ文字データを各アドレスに記憶し
たキャラクタＲＯＭであり、ビデオＲＡＭ（２９）から
読み出された文字コードでアクセスされる。例えば水平
及び垂直走査に基づきビデオＲＡＭ（２９）から「Ａ」
の文字コードが読み出された場合、キャラクタＲＯＭ
（３２）の全記憶領域の中から「Ａ」の文字データを記
憶したアドレスがアクセスされる。尚、キャラクタＲＯ
Ｍ（３２）はテレビ画面に表示できる文字だけを記憶し
ている。
【００１３】（３３）は文字修飾を行う為の文字修飾レ
ジスタであり、色、縁取り等を指定する為の文字修飾デ
ータがデータバス（１８）を介してプリセットされる４
個の８ビットレジスタ（図示せず）から成る。該８ビッ
トレジスタはビデオＲＡＭ（２９）から読み出された２
ビットの文字修飾コードで選択される。（３４）はキャ
ラクタＲＯＭ（３２）及び文字修飾レジスタ（３３）か
ら各々出力された文字データ及び文字修飾データに基づ
く文字情報をテレビ画面に表示できる様に信号処理を施
す出力回路であり、文字表示の為のＢＬ端子、文字修飾
の為のＲ，Ｇ，Ｂ端子を持っている。尚、ＢＬ端子の状
態は水平及び垂直走査に基づき文字ドットが存在する時
に「１」となり、Ｒ，Ｇ，Ｂ端子は各々赤，緑，青の文
字修飾を行う時に「１」となる。そしてＢＬ，Ｒ，Ｇ，
Ｂ端子の状態を次段の信号処理回路（図示せず）に取り
込むことによってテレビ画面表示を可能としている。
ジスタであり、色、縁取り等を指定する為の文字修飾デ
ータがデータバス（１８）を介してプリセットされる４
個の８ビットレジスタ（図示せず）から成る。該８ビッ
トレジスタはビデオＲＡＭ（２９）から読み出された２
ビットの文字修飾コードで選択される。（３４）はキャ
ラクタＲＯＭ（３２）及び文字修飾レジスタ（３３）か
ら各々出力された文字データ及び文字修飾データに基づ
く文字情報をテレビ画面に表示できる様に信号処理を施
す出力回路であり、文字表示の為のＢＬ端子、文字修飾
の為のＲ，Ｇ，Ｂ端子を持っている。尚、ＢＬ端子の状
態は水平及び垂直走査に基づき文字ドットが存在する時
に「１」となり、Ｒ，Ｇ，Ｂ端子は各々赤，緑，青の文
字修飾を行う時に「１」となる。そしてＢＬ，Ｒ，Ｇ，
Ｂ端子の状態を次段の信号処理回路（図示せず）に取り
込むことによってテレビ画面表示を可能としている。
【００１４】（３５）はモード制御回路であり、テレビ
受像機に応じて出力回路（３４）のＢＬ，Ｒ，Ｇ，Ｂ端
子の出力形式を切り換える為のデータがデータバス（１
８）を介してプリセットされるものである。即ち出力回
路（３５）の出力形式の切り換えが指示されると、Ｂ
Ｌ，Ｒ，Ｇ，Ｂ端子の状態が反転することになる。以上
説明した様に、垂直同期パルスＶsyncの立下りと直後の
水平同期パルスＨsyncの立下りの間にリセットパルスａ
を発生できる為、垂直同期パルスＶsyncの発生期間に文
字表示を行うことができる。即ち、図３に示す様に、従
来は矢印ｃの範囲でしか表示文字を垂直移動できなかっ
たが、本実施例では矢印ｄの範囲で表示文字を垂直移動
できることになる。従って、表示文字を上下方向に垂直
移動させる場合、表示文字をテレビ画面（３６）上の目
視可能な範囲で常に滑らかに垂直移動させることが可能
となる。
受像機に応じて出力回路（３４）のＢＬ，Ｒ，Ｇ，Ｂ端
子の出力形式を切り換える為のデータがデータバス（１
８）を介してプリセットされるものである。即ち出力回
路（３５）の出力形式の切り換えが指示されると、Ｂ
Ｌ，Ｒ，Ｇ，Ｂ端子の状態が反転することになる。以上
説明した様に、垂直同期パルスＶsyncの立下りと直後の
水平同期パルスＨsyncの立下りの間にリセットパルスａ
を発生できる為、垂直同期パルスＶsyncの発生期間に文
字表示を行うことができる。即ち、図３に示す様に、従
来は矢印ｃの範囲でしか表示文字を垂直移動できなかっ
たが、本実施例では矢印ｄの範囲で表示文字を垂直移動
できることになる。従って、表示文字を上下方向に垂直
移動させる場合、表示文字をテレビ画面（３６）上の目
視可能な範囲で常に滑らかに垂直移動させることが可能
となる。
【００１５】
【発明の効果】本発明によれば、垂直同期パルスの発生
期間にも文字表示を行うことができる為、表示文字を上
下方向に垂直移動させる場合、表示文字をテレビ画面上
の目視可能な範囲で常に滑らかに垂直移動させることが
可能となり、視聴者に不快感を与えることのない利点が
得られる。
期間にも文字表示を行うことができる為、表示文字を上
下方向に垂直移動させる場合、表示文字をテレビ画面上
の目視可能な範囲で常に滑らかに垂直移動させることが
可能となり、視聴者に不快感を与えることのない利点が
得られる。
【図１】本発明の文字表示装置を示す図である。
【図２】図１の要部波形を示す波形図である。
【図３】表示文字の垂直移動を説明する為の図である。
【図４】従来の垂直位置制御回路を示す図である。
【図５】図４の動作波形を示す波形図である。
（１３） 水平位置制御回路 （１９） 垂直位置制御回路 （２３） パルス発生器 （２９） ビデオＲＡＭ （３０） アドレス回路 （３２） キャラクタＲＯＭ （３４） 出力回路
Claims (2)
- 【請求項１】 水平同期パルスでリセットされ所定周
波数のクロックを計数する第1カウンタ、表示文字の水
平開始位置を示す値を保持する第1レジスタ、及び前記
第1カウンタ及び前記第1レジスタの内容の一致検出を行
う第1検出器を有する水平位置制御回路と、 垂直同期パルスの発生から直後の水平同期パルスの発生
までの間にリセットパルスを発生するパルス発生器、前
記リセットパルスでリセットされ前記水平同期パルスを
計数する第２カウンタ、前記表示文字の垂直開始位置を
示す値を保持する第２レジスタ、及び前記第２カウンタ
及び前記第２レジスタの内容の一致検出を行う第２検出
器を有する垂直位置制御回路と、 前記水平位置制御回路及び前記垂直位置制御回路の一致
検出出力を取り込んで前記表示文字の表示位置を示すア
ドレスデータを順次発生するアドレス回路と、個々の表
示文字の表示位置に対応したアドレスに個々の表示文字
の為の文字コード及び文字修飾コードが記憶され、前記
アドレスデータでアクセスされるビデオＲＡＭと、表示
可能な全表示文字の為の文字データが記憶され、前記文
字コードでアクセスされるキャラクタＲＯＭと、 前記文字修飾コード及び前記文字データを表示文字とし
て表示できる状態に処理する出力回路と、を備え、 前記表示文字をテレビ画面上で垂直移動させる時、前記
垂直同期パルスの発生期間中文字表示を行うことを特徴
とする文字表示装置。 - 【請求項２】 水平同期パルスでリセットされ所
定周波数のクロックを計数する第1カウンタ、表示文字
の水平開始位置を示す値を保持する第1レジスタ、及び
前記第1カウンタ及び前記第1レジスタの内容の一致検出
を行う第1検出器を有する水平位置制御回路と、 垂直同期パルスの発生から直後の水平同期パルスの発生
までの間にリセットパルスを発生するパルス発生器、前
記リセットパルスでリセットされ前記水平同期パルスを
計数する第２カウンタ、前記表示文字の垂直開始位置を
示す値を保持する第２レジスタ、及び前記第２カウンタ
及び前記第２レジスタの内容の一致検出を行う第２検出
器を有する垂直位置制御回路と、 前記水平位置制御回路及び前記垂直位置制御回路の一致
検出出力を取り込んで前記表示文字の表示位置を示すア
ドレスデータを順次発生するアドレス回路と、 個々の表示文字の表示位置に対応したアドレスに個々の
表示文字の為の文字コード及び文字修飾コードが記憶さ
れ、前記アドレスデータでアクセスされるビデオＲＡＭ
と、 表示可能な全表示文字の為の文字データが記憶され、前
記文字コードでアクセスされるキャラクタＲＯＭと、前
記文字修飾コード及び前記文字データを表示文字として
表示できる状態に処理する出力回路と、 前記垂直同期パルス又は、ビデオRAMからの表示データ
の表示が終了した後に前記アドレス回路から、発生する
割り込み信号を取り込み、前記ビデオRAMに文字データ
を書き込ませるCPU、を備え、 前記表示文字をテレビ画面上で垂直移動させる時、前記
垂直同期パルスの発生期間中に、文字表示を行うことを
特徴とする文字表示装置を備えたことを特徴とするマイ
クロコンピュータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29996092A JP3291330B2 (ja) | 1992-11-10 | 1992-11-10 | 文字表示装置及びそれを備えたマイクロコンピュータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29996092A JP3291330B2 (ja) | 1992-11-10 | 1992-11-10 | 文字表示装置及びそれを備えたマイクロコンピュータ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06149220A JPH06149220A (ja) | 1994-05-27 |
| JP3291330B2 true JP3291330B2 (ja) | 2002-06-10 |
Family
ID=17879051
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29996092A Expired - Fee Related JP3291330B2 (ja) | 1992-11-10 | 1992-11-10 | 文字表示装置及びそれを備えたマイクロコンピュータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3291330B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11122530A (ja) * | 1997-10-16 | 1999-04-30 | Elmo Co Ltd | 資料提示装置 |
-
1992
- 1992-11-10 JP JP29996092A patent/JP3291330B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH06149220A (ja) | 1994-05-27 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |