JP3258460B2 - 測定器におけるデータ出力方法 - Google Patents
測定器におけるデータ出力方法Info
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- JP3258460B2 JP3258460B2 JP20838293A JP20838293A JP3258460B2 JP 3258460 B2 JP3258460 B2 JP 3258460B2 JP 20838293 A JP20838293 A JP 20838293A JP 20838293 A JP20838293 A JP 20838293A JP 3258460 B2 JP3258460 B2 JP 3258460B2
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Description
【０００１】
【産業上の利用分野】この発明は測定器におけるデータ
出力方法に関し、さらに詳しく言えば、複数の測定デー
タを１つの出力チャンネルから時分割的に出力するよう
にしたデータ出力方法に関するものである。
出力方法に関し、さらに詳しく言えば、複数の測定デー
タを１つの出力チャンネルから時分割的に出力するよう
にしたデータ出力方法に関するものである。
【０００２】
【従来の技術】図４には従来例に係る出力部の構成が示
されている。これを例えば電力計に適用される場合につ
いて説明すると、測定部１にはＡ／Ｄ変換された電圧信
号と電流信号とが取り込まれ、これにより同測定部１に
おいて複数の測定データとして例えば有効電力、皮相電
力、無効電力、力率などが求められる。
されている。これを例えば電力計に適用される場合につ
いて説明すると、測定部１にはＡ／Ｄ変換された電圧信
号と電流信号とが取り込まれ、これにより同測定部１に
おいて複数の測定データとして例えば有効電力、皮相電
力、無効電力、力率などが求められる。
【０００３】制御部２はそれぞれがラッチ回路４とその
後段に接続されたＤ／Ａ変換回路５とからなるｎ個の出
力チャンネル３ａ〜３ｎを備え、予め指定された出力チ
ャンネルからそれに対応する測定データを出力させる。
後段に接続されたＤ／Ａ変換回路５とからなるｎ個の出
力チャンネル３ａ〜３ｎを備え、予め指定された出力チ
ャンネルからそれに対応する測定データを出力させる。
【０００４】すなわち、制御部２はまず初めに、例えば
有効電力データをデータバスにのせ、第１の出力チャン
ネル３ａのラッチ回路４にラッチ信号を出力する。これ
により、同出力チャンネル３ａのＤ／Ａ変換回路５より
アナログ出力Ｖ０１が出力される。
有効電力データをデータバスにのせ、第１の出力チャン
ネル３ａのラッチ回路４にラッチ信号を出力する。これ
により、同出力チャンネル３ａのＤ／Ａ変換回路５より
アナログ出力Ｖ０１が出力される。
【０００５】続いて、制御部２は皮相電力、無効電力、
力率などの各測定データを順次データバスにのせるとと
もに、各出力チャンネル３ｂ〜３ｎのラッチ回路４にラ
ッチ信号を出力する。このようにして、各出力チャンネ
ル３ｂ〜３ｎからアナログ出力Ｖ０２〜Ｖ０ｎが出力さ
れ、レコーダなどにおいて記録紙上に記録される。
力率などの各測定データを順次データバスにのせるとと
もに、各出力チャンネル３ｂ〜３ｎのラッチ回路４にラ
ッチ信号を出力する。このようにして、各出力チャンネ
ル３ｂ〜３ｎからアナログ出力Ｖ０２〜Ｖ０ｎが出力さ
れ、レコーダなどにおいて記録紙上に記録される。
【０００６】この動作が繰り返し行なわれ、図５にはそ
の繰り返し時間をΔｔとしたときの出力チャンネル３ａ
および３ｎから出力されたアナログ出力Ｖ０１，Ｖ０ｎ
の波形図が例示されている。
の繰り返し時間をΔｔとしたときの出力チャンネル３ａ
および３ｎから出力されたアナログ出力Ｖ０１，Ｖ０ｎ
の波形図が例示されている。
【０００７】
【発明が解決しようとする課題】こによれば、得ようと
する測定データと出力チャンネルとが１：１で対応して
いるため、時間軸上でとぎれのない波形が得られること
になるが、得ようとする測定データ数分の出力チャンネ
ルを必要とするため、コストアップは免れない。
する測定データと出力チャンネルとが１：１で対応して
いるため、時間軸上でとぎれのない波形が得られること
になるが、得ようとする測定データ数分の出力チャンネ
ルを必要とするため、コストアップは免れない。
【０００８】また、複数の測定データを同時に観測しよ
うとする場合には、別途に多チャンネルのシンクロスコ
ープ記録計などが必要となる。
うとする場合には、別途に多チャンネルのシンクロスコ
ープ記録計などが必要となる。
【０００９】
【課題を解決するための手段】この発明は上記従来の事
情にかんがみなされたもので、その構成上の特徴は、Ａ
／Ｄ変換された被測定入力信号から複数の測定データを
得る測定部と、その測定データをレコーダなどの記録手
段に出力する出力部と、上記測定部の測定動作や上記出
力部の出力動作などを制御する制御部とを含む測定器に
おいて、上記出力部には上記測定データを一時的に保持
する１つのラッチ回路およびそのラッチデータを上記記
録手段に適合するアナログ信号に変換するＤ／Ａ変換回
路とが設けられ、上記制御部は上記測定部にて得られた
複数の測定データを所定の切り替えタイミングでラッチ
信号とともに順次上記出力部のラッチ回路に与え、同出
力部のＤ／Ａ変換回路からアナログに変換された複数の
測定データが時分割的に出力されるようにしたことにあ
る。
情にかんがみなされたもので、その構成上の特徴は、Ａ
／Ｄ変換された被測定入力信号から複数の測定データを
得る測定部と、その測定データをレコーダなどの記録手
段に出力する出力部と、上記測定部の測定動作や上記出
力部の出力動作などを制御する制御部とを含む測定器に
おいて、上記出力部には上記測定データを一時的に保持
する１つのラッチ回路およびそのラッチデータを上記記
録手段に適合するアナログ信号に変換するＤ／Ａ変換回
路とが設けられ、上記制御部は上記測定部にて得られた
複数の測定データを所定の切り替えタイミングでラッチ
信号とともに順次上記出力部のラッチ回路に与え、同出
力部のＤ／Ａ変換回路からアナログに変換された複数の
測定データが時分割的に出力されるようにしたことにあ
る。
【００１０】なお、上記出力部から出力される複数の測
定データを同一の記録紙上に記録する場合、それらの各
測定データに所定のオフセット電圧を加算することが好
ましい。
定データを同一の記録紙上に記録する場合、それらの各
測定データに所定のオフセット電圧を加算することが好
ましい。
【００１１】
【作用】上記の構成によると、制御部からの出力切替信
号にしたがって１つの出力チャンネルが複数の測定デー
タが時分割的に出力される。
号にしたがって１つの出力チャンネルが複数の測定デー
タが時分割的に出力される。
【００１２】そして、その各測定データを同一の記録紙
上に書かせる場合には、その各測定データに所定のオフ
セット電圧を加算することにより、全体として波形観測
が容易となる。
上に書かせる場合には、その各測定データに所定のオフ
セット電圧を加算することにより、全体として波形観測
が容易となる。
【００１３】
【実施例】以下、このこの発明の実施例を図１のブロッ
ク線図、図２の出力波形図および図３のタイミングチャ
ートを参照しながら説明する。
ク線図、図２の出力波形図および図３のタイミングチャ
ートを参照しながら説明する。
【００１４】図１のブロック線図において、この測定器
１０は測定部１１、制御部１２およびＣＲＴなどからな
る表示部１３により実質的に構成されるが、同測定器１
０には操作部１４のほかに出力部１５が接続されてい
る。
１０は測定部１１、制御部１２およびＣＲＴなどからな
る表示部１３により実質的に構成されるが、同測定器１
０には操作部１４のほかに出力部１５が接続されてい
る。
【００１５】この場合、出力部１５は１つのラッチ回路
１５ａとその後段に接続されたＤ／Ａ変換回路１５ｂと
からなり、そのアナログ出力がレコーダなどの記録部１
６に与えられるようになっている。
１５ａとその後段に接続されたＤ／Ａ変換回路１５ｂと
からなり、そのアナログ出力がレコーダなどの記録部１
６に与えられるようになっている。
【００１６】上記の構成において、測定部１１にはＡ／
Ｄ変換回路１７を介して例えば被測定電路の電圧データ
と電流データとが入力され、同測定部１１はこのデータ
に基づいて有効電力、皮相電力、無効電力、力率などの
各測定データを演算する。
Ｄ変換回路１７を介して例えば被測定電路の電圧データ
と電流データとが入力され、同測定部１１はこのデータ
に基づいて有効電力、皮相電力、無効電力、力率などの
各測定データを演算する。
【００１７】制御部１２はまず１番目に出力すべき測定
データａをデータバスにのせ、出力部１５のラッチ回路
１５ａにラッチ信号を出力する。これにより、ラッチ回
路１５ａにて測定データａが保持され、Ｄ／Ａ変換回路
１５ｂからそのアナログデータが出力される。
データａをデータバスにのせ、出力部１５のラッチ回路
１５ａにラッチ信号を出力する。これにより、ラッチ回
路１５ａにて測定データａが保持され、Ｄ／Ａ変換回路
１５ｂからそのアナログデータが出力される。
【００１８】例えば操作部１４にて予め設定された一定
時間Δｔが経過すると、制御部１２は次に２番目に出力
すべき測定データｂをデータバスにのせ、出力部１５の
ラッチ回路１５ａにラッチ信号を出力する。これによ
り、上記と同様にしてＤ／Ａ変換回路１５ｂから測定デ
ータｂのアナログデータが出力される。
時間Δｔが経過すると、制御部１２は次に２番目に出力
すべき測定データｂをデータバスにのせ、出力部１５の
ラッチ回路１５ａにラッチ信号を出力する。これによ
り、上記と同様にしてＤ／Ａ変換回路１５ｂから測定デ
ータｂのアナログデータが出力される。
【００１９】これが繰り返されることにより、一定の時
間間隔Δｔをもって各測定データａ〜ｎが順次切り替え
られて出力され、１つの出力チャンネルであっても複数
の測定データを同一の記録紙上に記録することが可能と
なる。
間間隔Δｔをもって各測定データａ〜ｎが順次切り替え
られて出力され、１つの出力チャンネルであっても複数
の測定データを同一の記録紙上に記録することが可能と
なる。
【００２０】図２には測定データａ〜ｄの記録例が示さ
れているが、同図のように各測定データａ〜ｄに任意の
記録上オフセット電圧Ｖｏｆｆａ〜Ｖｏｆｆｄを加算し
て階段状とすることにより、各測定データａ〜ｄの区別
を容易にすることができる。
れているが、同図のように各測定データａ〜ｄに任意の
記録上オフセット電圧Ｖｏｆｆａ〜Ｖｏｆｆｄを加算し
て階段状とすることにより、各測定データａ〜ｄの区別
を容易にすることができる。
【００２１】上記の例では一定周期Δｔで出力を自動的
に切り替えるようにしているが、外部トリガによって測
定データの出力を切り替えるようにすることも可能であ
る。この場合には、制御部１２から図３の（ｃ）に示さ
れているような周期Δｔの出力変換タイミングパルスが
Ｉ／Ｏポート１８を介して外部のＣＰＵ（中央演算処理
ユニット）２０に出力される。
に切り替えるようにしているが、外部トリガによって測
定データの出力を切り替えるようにすることも可能であ
る。この場合には、制御部１２から図３の（ｃ）に示さ
れているような周期Δｔの出力変換タイミングパルスが
Ｉ／Ｏポート１８を介して外部のＣＰＵ（中央演算処理
ユニット）２０に出力される。
【００２２】なお、この例では同ＣＰＵ２０は記録部１
６やＡ／Ｄ変換回路１７などを制御する目的で設けられ
ているが、制御部１２自体にそのＣＰＵの機能と同等の
機能が備えられている場合には、ことさら外部のＣＰＵ
を用いる必要はない。
６やＡ／Ｄ変換回路１７などを制御する目的で設けられ
ているが、制御部１２自体にそのＣＰＵの機能と同等の
機能が備えられている場合には、ことさら外部のＣＰＵ
を用いる必要はない。
【００２３】図３の（ｂ）が制御部１２に入力される外
部トリガ波形であり、同図（ａ）には同トリガに応じて
切り替えられたＤ／Ａ変換回路１５ｂの出力波形が示さ
れている。
部トリガ波形であり、同図（ａ）には同トリガに応じて
切り替えられたＤ／Ａ変換回路１５ｂの出力波形が示さ
れている。
【００２４】これによると、外部トリガの立ち下がりの
タイミングが出力データの切り替え要求時点とされてい
るが、この場合、外部トリガが立ち下がってもその時点
では即座にデータの切り替えは行なわず、その後の出力
変換タイミングパルスを検出した時点で、ＣＰＵ２０よ
りＡ／Ｄ変換回路１７を介してのデータの取り込みを行
ない、急激な出力の切り替わり時点でデータの取り込み
を行なわないようにしている。
タイミングが出力データの切り替え要求時点とされてい
るが、この場合、外部トリガが立ち下がってもその時点
では即座にデータの切り替えは行なわず、その後の出力
変換タイミングパルスを検出した時点で、ＣＰＵ２０よ
りＡ／Ｄ変換回路１７を介してのデータの取り込みを行
ない、急激な出力の切り替わり時点でデータの取り込み
を行なわないようにしている。
【００２５】
【発明の効果】以上説明したように、この発明によれ
ば、出力チャンネルを１つにして大幅なコストダウンが
図れるとともに、その１つの出力チャンネルにて複数の
測定データを時分割的に出力するようにしたことによ
り、同一の記録紙上に複数の測定データを書かせること
が可能となり、書く測定データを同時に観測するうえで
好都合である。
ば、出力チャンネルを１つにして大幅なコストダウンが
図れるとともに、その１つの出力チャンネルにて複数の
測定データを時分割的に出力するようにしたことによ
り、同一の記録紙上に複数の測定データを書かせること
が可能となり、書く測定データを同時に観測するうえで
好都合である。
【図１】この発明の実施例に係る測定器およびその出力
部を示したブロック線図。
部を示したブロック線図。
【図２】この発明により複数の測定データ波形を同一の
記録紙上に書かせた状態を示した波形図。
記録紙上に書かせた状態を示した波形図。
【図３】外部トリガにより出力が切り替えられる例を説
明するためのタイミングチャート。
明するためのタイミングチャート。
【図４】従来例を示したブロック線図。
【図５】従来の出力波形を示した波形図。
１１ 測定部 １２ 制御部 １３ 表示部 １４ 操作部 １５ 出力部 １５ａ ラッチ回路 １５ｂ Ｄ／Ａ変換回路 １７ Ａ／Ｄ変換回路 ２０ ＣＰＵ
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) G01R 21/133 - 22/00 130 G01R 11/00 - 11/66 G01R 13/02 G08C 15/06
Claims (2)
- 【請求項１】 Ａ／Ｄ変換された被測定入力信号から複
数の測定データを得る測定部と、その測定データをレコ
ーダなどの記録手段に出力する出力部と、上記測定部の
測定動作や上記出力部の出力動作などを制御する制御部
とを含む測定器において、 上記出力部には上記測定データを一時的に保持する１つ
のラッチ回路およびそのラッチデータを上記記録手段に
適合するアナログ信号に変換するＤ／Ａ変換回路とが設
けられ、上記制御部は上記測定部にて得られた複数の測
定データを所定の切り替えタイミングでラッチ信号とと
もに順次上記出力部のラッチ回路に与え、同出力部のＤ
／Ａ変換回路からアナログに変換された複数の測定デー
タが時分割的に出力されるようにしたことを特徴とする
測定器におけるデータ出力方法。 - 【請求項２】 上記出力部から出力される複数の測定デ
ータは所定のオフセット電圧を加算された上で、上記記
録手段において同一の記録紙上に記録されることを特徴
とする請求項１に記載の測定器におけるデータ出力方
法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20838293A JP3258460B2 (ja) | 1993-07-30 | 1993-07-30 | 測定器におけるデータ出力方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20838293A JP3258460B2 (ja) | 1993-07-30 | 1993-07-30 | 測定器におけるデータ出力方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0743400A JPH0743400A (ja) | 1995-02-14 |
| JP3258460B2 true JP3258460B2 (ja) | 2002-02-18 |
Family
ID=16555349
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20838293A Expired - Fee Related JP3258460B2 (ja) | 1993-07-30 | 1993-07-30 | 測定器におけるデータ出力方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3258460B2 (ja) |
-
1993
- 1993-07-30 JP JP20838293A patent/JP3258460B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0743400A (ja) | 1995-02-14 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
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| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
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