JP3109128B2 - シャープネス回路 - Google Patents
シャープネス回路Info
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- JP3109128B2 JP3109128B2 JP03116726A JP11672691A JP3109128B2 JP 3109128 B2 JP3109128 B2 JP 3109128B2 JP 03116726 A JP03116726 A JP 03116726A JP 11672691 A JP11672691 A JP 11672691A JP 3109128 B2 JP3109128 B2 JP 3109128B2
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- circuit
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Description
【０００１】
【産業上の利用分野】本発明はシャープネス回路に係わ
り、特に、ｇｍアンプを用いてシャープネス回路を構成
する場合に用いて好適なものである。
り、特に、ｇｍアンプを用いてシャープネス回路を構成
する場合に用いて好適なものである。
【０００２】
【従来の技術】周知の通り、テレビジョン信号を処理す
るための回路の１つとしてシャープネス回路が用いられ
ており、従来より種々のシャープネス回路が提案されて
いる（例えば、特開昭６２−１８９８８０号公報）。上
記シャープネス回路は、輪郭が強調されている映像信号
を生成するために設けられているものであり、一般に、
輪郭を強調する程度を調整することができるようになさ
れている。
るための回路の１つとしてシャープネス回路が用いられ
ており、従来より種々のシャープネス回路が提案されて
いる（例えば、特開昭６２−１８９８８０号公報）。上
記シャープネス回路は、輪郭が強調されている映像信号
を生成するために設けられているものであり、一般に、
輪郭を強調する程度を調整することができるようになさ
れている。
【０００３】図２は、従来のシャープネス回路の一例を
示す構成図である。図２から明らかなように、このシャ
ープネス回路は、第１のｇｍアンプ１および第２のｇｍ
アンプ２を直列に接続するとともに、この直列回路と並
列に第３のｇｍアンプ３を設けている。そして、入力端
子ＩＮに供給された入力信号Ｖｉｎを第１のｇｍアンプ
１および第３のｇｍアンプ３の一方の入力端子（＋端
子）に与えている。また、第２のｇｍアンプおよび第３
のｇｍアンプ３の出力信号を出力端子ＯＵＴに導出する
とともに、第１〜第３のｇｍアンプ１，２，３の他方の
入力端子（−端子）に戻している。また、コンデンサＣ
１を介して入力端子Ｖｉｎ側と出力端子Ｖｏｕｔ側とを
接続するとともに、第１のｇｍアンプ１から第２のｇｍ
アンプ２に出力信号を供給する線路をコンデンサＣ２を
介して接地している。
示す構成図である。図２から明らかなように、このシャ
ープネス回路は、第１のｇｍアンプ１および第２のｇｍ
アンプ２を直列に接続するとともに、この直列回路と並
列に第３のｇｍアンプ３を設けている。そして、入力端
子ＩＮに供給された入力信号Ｖｉｎを第１のｇｍアンプ
１および第３のｇｍアンプ３の一方の入力端子（＋端
子）に与えている。また、第２のｇｍアンプおよび第３
のｇｍアンプ３の出力信号を出力端子ＯＵＴに導出する
とともに、第１〜第３のｇｍアンプ１，２，３の他方の
入力端子（−端子）に戻している。また、コンデンサＣ
１を介して入力端子Ｖｉｎ側と出力端子Ｖｏｕｔ側とを
接続するとともに、第１のｇｍアンプ１から第２のｇｍ
アンプ２に出力信号を供給する線路をコンデンサＣ２を
介して接地している。
【０００４】図２のシャープネス回路の伝達関数出力信
号Ｖｏｕｔ／Ｖｉｎは、
号Ｖｏｕｔ／Ｖｉｎは、
【数１】 に示すようになる。なお、（１）式において、Ｓ：Ｊ
ω、Ｃ1 ：コンデンサＣ１の静電容量、Ｃ2 ：コンデン
サＣ２の静電容量をそれぞれ示している。ここで、第３
のｇｍアンプ３に設けられている図示しない外部ピン
（ユーザコントロールと称されている）を操作すること
により、上記（１）式の分母における最後の項のｇｍ３
の大きさを可変して伝達関数が所定の大きさになるよう
に制御している。
ω、Ｃ1 ：コンデンサＣ１の静電容量、Ｃ2 ：コンデン
サＣ２の静電容量をそれぞれ示している。ここで、第３
のｇｍアンプ３に設けられている図示しない外部ピン
（ユーザコントロールと称されている）を操作すること
により、上記（１）式の分母における最後の項のｇｍ３
の大きさを可変して伝達関数が所定の大きさになるよう
に制御している。
【０００５】
【発明が解決しようとする課題】ところで、バイポーラ
ＩＣの場合には、上記ｇｍアンプはトランジスタによっ
て構成される。トランジスタの場合はその構造上コレク
タと接地との間に寄生容量がつくので、図３の回路図に
示すようにシャープネス回路には出力端子Ｖｏｕｔと接
地との間に寄生容量Ｃｘが繋がっていることになる。し
たがって、図２に示した従来のシャープネス回路の場合
には、（Ａ）に示した出力側の部分にはｇｍアンプの出
力部が２個接続されていることになり、この部分におい
てはｇｍアンプの２倍の寄生容量（２Ｃｘ）が付いてし
まう。
ＩＣの場合には、上記ｇｍアンプはトランジスタによっ
て構成される。トランジスタの場合はその構造上コレク
タと接地との間に寄生容量がつくので、図３の回路図に
示すようにシャープネス回路には出力端子Ｖｏｕｔと接
地との間に寄生容量Ｃｘが繋がっていることになる。し
たがって、図２に示した従来のシャープネス回路の場合
には、（Ａ）に示した出力側の部分にはｇｍアンプの出
力部が２個接続されていることになり、この部分におい
てはｇｍアンプの２倍の寄生容量（２Ｃｘ）が付いてし
まう。
【０００６】このように出力端に２倍の寄生容量が付く
と、実際のシャープネス回路の伝達関数を以下のように
してしまう。
と、実際のシャープネス回路の伝達関数を以下のように
してしまう。
【数２】
【０００７】（１）式および（２）より明らかなよう
に、実際のシャープネス回路においては寄生容量Ｃｘ
は、高域におけるｆ特の悪化を招く不都合がある。ま
た、高域でのｆ特の悪化を改善するために、例えばコン
デンサＣ１を通して入力される信号のみをアンプを通し
て入力するようにした場合には、Ｓ／Ｎの悪化を招いて
しまう不都合があった。本発明は上述の問題点に鑑み、
ｆ特およびＳ／Ｎを悪化させることが少ないシャープネ
ス回路を提供できるようにすることを目的とする。
に、実際のシャープネス回路においては寄生容量Ｃｘ
は、高域におけるｆ特の悪化を招く不都合がある。ま
た、高域でのｆ特の悪化を改善するために、例えばコン
デンサＣ１を通して入力される信号のみをアンプを通し
て入力するようにした場合には、Ｓ／Ｎの悪化を招いて
しまう不都合があった。本発明は上述の問題点に鑑み、
ｆ特およびＳ／Ｎを悪化させることが少ないシャープネ
ス回路を提供できるようにすることを目的とする。
【０００８】
【課題を解決するための手段】本発明のシャープネス回
路は、外部から供給される入力信号が一方の入力端子に
与えられる第１のｇｍアンプと、上記第１のｇｍアンプ
の出力信号が一方の入力端子に与えられるとともにその
出力から導出される信号がシャープネス回路の出力信号
として外部に導出される第２のｇｍアンプと、上記入力
信号と上記第２のｇｍアンプの出力信号とを混合するた
めのミックス回路とを具備し、上記第２のｇｍアンプの
出力信号を上記第１のｇｍアンプの他方の入力端子に供
給するとともに、上記ミックス回路の出力信号を上記第
２のｇｍアンプの他方の入力端子に供給するようにして
いる。
路は、外部から供給される入力信号が一方の入力端子に
与えられる第１のｇｍアンプと、上記第１のｇｍアンプ
の出力信号が一方の入力端子に与えられるとともにその
出力から導出される信号がシャープネス回路の出力信号
として外部に導出される第２のｇｍアンプと、上記入力
信号と上記第２のｇｍアンプの出力信号とを混合するた
めのミックス回路とを具備し、上記第２のｇｍアンプの
出力信号を上記第１のｇｍアンプの他方の入力端子に供
給するとともに、上記ミックス回路の出力信号を上記第
２のｇｍアンプの他方の入力端子に供給するようにして
いる。
【０００９】
【作用】入力側の信号と出力側の信号とを所定の割合で
加算してその加算出力を第２のｇｍアンプに供給するミ
ックス回路を設け、上記２つの信号を上記ミックス回路
でミックスする割合を変えることにより伝達関数を可変
するようにして、２個のｇｍアンプを用いるだけでゲイ
ン調整可能なシャープネス回路を構成する。
加算してその加算出力を第２のｇｍアンプに供給するミ
ックス回路を設け、上記２つの信号を上記ミックス回路
でミックスする割合を変えることにより伝達関数を可変
するようにして、２個のｇｍアンプを用いるだけでゲイ
ン調整可能なシャープネス回路を構成する。
【００１０】
【実施例】図１は、本発明のシャープネス回路の一実施
例を示す構成図である。図１に示したように本実施例の
シャープネス回路は、２つのｇｍアンプ１および２と、
ミックス回路３とにより構成されている。２つのｇｍア
ンプ１，２、すなわち、第１のｇｍアンプ１および第２
のｇｍアンプ２は、図２に示した従来のシャープネス回
路における第１のｇｍアンプ１および第２のｇｍアンプ
２と同じような回路構成を有している。
例を示す構成図である。図１に示したように本実施例の
シャープネス回路は、２つのｇｍアンプ１および２と、
ミックス回路３とにより構成されている。２つのｇｍア
ンプ１，２、すなわち、第１のｇｍアンプ１および第２
のｇｍアンプ２は、図２に示した従来のシャープネス回
路における第１のｇｍアンプ１および第２のｇｍアンプ
２と同じような回路構成を有している。
【００１１】このように構成された本実施例のシャープ
ネス回路においては、入力端子ＩＮに与えられた入力信
号Ｖｉｎが第１のｇｍアンプ１の一方の入力端子に与え
られるとともに、ミックス回路３に与えられる。また、
第１のｇｍアンプ１の出力信号が第２のｇｍアンプ２の
一方の入力端子に与えられるとともに、第２のｇｍアン
プ２の出力信号が出力端子ＯＵＴ、第１のｇｍアンプ１
の他方の入力端子、およびミックス回路３にそれぞれ与
えられる。更に、ミックス回路３の出力信号ＳO が第２
のｇｍアンプ２の他方の入力端子に与えられる。
ネス回路においては、入力端子ＩＮに与えられた入力信
号Ｖｉｎが第１のｇｍアンプ１の一方の入力端子に与え
られるとともに、ミックス回路３に与えられる。また、
第１のｇｍアンプ１の出力信号が第２のｇｍアンプ２の
一方の入力端子に与えられるとともに、第２のｇｍアン
プ２の出力信号が出力端子ＯＵＴ、第１のｇｍアンプ１
の他方の入力端子、およびミックス回路３にそれぞれ与
えられる。更に、ミックス回路３の出力信号ＳO が第２
のｇｍアンプ２の他方の入力端子に与えられる。
【００１２】また、第２のｇｍアンプ２の出力の一部を
第１のｇｍアンプ１の一方の入力端子側に戻していると
ともに、第１のｇｍアンプ１から第２のｇｍアンプ２に
出力信号を供給する線路をコンデンサＣ２を介して接地
している。更に、ミックス回路３の比例定数ｋの値を可
変するために、出力電圧の大きさが可変の直流電源４が
設けられていて、この直流電源４からミックス回路３に
導出する電圧値を制御することにより、上述したミック
ス回路３の出力信号ＳO の内容を可変するようになって
いる。すなわち、出力信号ＳO は、出力信号ＳO ＝｛ｋ
・Ｖｉｎ＋（１−ｋ）・Ｖｏｕｔ｝となっており、直流
電源４の出力電圧の大きさを可変することにより、ミッ
クス回路３から第２のｇｍアンプ２の他方の入力端子に
供給される出力信号ＳO が可変される。
第１のｇｍアンプ１の一方の入力端子側に戻していると
ともに、第１のｇｍアンプ１から第２のｇｍアンプ２に
出力信号を供給する線路をコンデンサＣ２を介して接地
している。更に、ミックス回路３の比例定数ｋの値を可
変するために、出力電圧の大きさが可変の直流電源４が
設けられていて、この直流電源４からミックス回路３に
導出する電圧値を制御することにより、上述したミック
ス回路３の出力信号ＳO の内容を可変するようになって
いる。すなわち、出力信号ＳO は、出力信号ＳO ＝｛ｋ
・Ｖｉｎ＋（１−ｋ）・Ｖｏｕｔ｝となっており、直流
電源４の出力電圧の大きさを可変することにより、ミッ
クス回路３から第２のｇｍアンプ２の他方の入力端子に
供給される出力信号ＳO が可変される。
【００１３】このように構成された本実施例のシャープ
ネス回路の伝達関数は、
ネス回路の伝達関数は、
【数３】 のようになる。
【００１４】（２）式および（３）式より明らかなよう
に、図２に示した従来の回路と図１の本実施例の回路と
では伝達関数の式が同じであるので、回路動作としては
同等の動作を行うことが判る。このような動作を得るた
めに、従来は３個のｇｍアンプを用いてシャープネス回
路を構成していたが、本実施例の場合はミックス回路３
を用い、入力端子ＩＮ側から与えられる信号と出力端子
ＯＵＴ側から与えられる信号とを加算する比率を変える
ことにより、ゲインを上げたり下げたりするようにして
いる。
に、図２に示した従来の回路と図１の本実施例の回路と
では伝達関数の式が同じであるので、回路動作としては
同等の動作を行うことが判る。このような動作を得るた
めに、従来は３個のｇｍアンプを用いてシャープネス回
路を構成していたが、本実施例の場合はミックス回路３
を用い、入力端子ＩＮ側から与えられる信号と出力端子
ＯＵＴ側から与えられる信号とを加算する比率を変える
ことにより、ゲインを上げたり下げたりするようにして
いる。
【００１５】本実施例のシャープネス回路は、上記した
ように従来はｇｍアンプを３個用いて構成していたシャ
ープネス回路を２個のｇｍアンプ１，２だけを用いて構
成するようにしたので、本実施例のシャープネス回路の
場合は、図２の従来回路と比較してｇｍアンプを１個削
減することができる。なお、ｇｍアンプを１個削減する
代わりに、本実施例ではミックス回路３を１個使用して
いるので、これが従来よりも余分に必要になる。しか
し、ｇｍアンプとミックス回路３とを比較した場合、回
路構成部品はミックス回路３の方が遙かに少ない。した
がって、本実施例のシャープネス回路の場合には、素子
数を大幅に削減することができる。
ように従来はｇｍアンプを３個用いて構成していたシャ
ープネス回路を２個のｇｍアンプ１，２だけを用いて構
成するようにしたので、本実施例のシャープネス回路の
場合は、図２の従来回路と比較してｇｍアンプを１個削
減することができる。なお、ｇｍアンプを１個削減する
代わりに、本実施例ではミックス回路３を１個使用して
いるので、これが従来よりも余分に必要になる。しか
し、ｇｍアンプとミックス回路３とを比較した場合、回
路構成部品はミックス回路３の方が遙かに少ない。した
がって、本実施例のシャープネス回路の場合には、素子
数を大幅に削減することができる。
【００１６】また、本実施例のシャープネス回路の場
合、素子数を削減するのみならず、出力端子ＯＵＴに連
なるｇｍアンプが１個なので、出力端子ＯＵＴに連なる
（Ａ）の部分に付く寄生容量を従来の約半分程度に押さ
えることができる。したがって、寄生容量によるｆ特の
悪化を少なくすることができるとともに、ｆ特の悪化を
防止するためにＳ／Ｎの悪化を招く不都合がないもので
ある。
合、素子数を削減するのみならず、出力端子ＯＵＴに連
なるｇｍアンプが１個なので、出力端子ＯＵＴに連なる
（Ａ）の部分に付く寄生容量を従来の約半分程度に押さ
えることができる。したがって、寄生容量によるｆ特の
悪化を少なくすることができるとともに、ｆ特の悪化を
防止するためにＳ／Ｎの悪化を招く不都合がないもので
ある。
【００１７】
【発明の効果】本発明は上述したように、入力側の信号
と出力側の信号とを所定の割合で加算するミックス回路
を設け、上記２つの信号をミックスする割合を可変する
ことによりシャープネス回路における伝達関数のゲイン
を変えるようにして、２個のｇｍアンプを用いるだけで
ゲイン調整可能なシャープネス回路を構成するようにし
たので、出力端に付くｇｍアンプの寄生容量を少なくす
ることができ、ｆ特およびＳ／Ｎを悪化させることが少
ないシャープネス回路を実現できる。また、ミックス回
路はｇｍアンプと比較して格段と少ない素子数で構成す
ることができるので、ミックス回路全体の素子数を大幅
に削減できる。
と出力側の信号とを所定の割合で加算するミックス回路
を設け、上記２つの信号をミックスする割合を可変する
ことによりシャープネス回路における伝達関数のゲイン
を変えるようにして、２個のｇｍアンプを用いるだけで
ゲイン調整可能なシャープネス回路を構成するようにし
たので、出力端に付くｇｍアンプの寄生容量を少なくす
ることができ、ｆ特およびＳ／Ｎを悪化させることが少
ないシャープネス回路を実現できる。また、ミックス回
路はｇｍアンプと比較して格段と少ない素子数で構成す
ることができるので、ミックス回路全体の素子数を大幅
に削減できる。
【図１】本発明の一実施例を示すシャープネス回路の構
成図である。
成図である。
【図２】従来のシャープネス回路の一例を示す構成図で
ある。
ある。
【図３】ｇｍアンプの出力部に寄生している容量を示す
回路図である。
回路図である。
１ 第１のｇｍアンプ ２ 第２のｇｍアンプ ３ ミックス回路 ４ 直流電源 Ｖｉｎ 入力信号 Ｖｏｕｔ 出力信号
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) H04N 5/14 - 5/217
Claims (1)
- 【請求項１】 外部から供給される入力信号が一方の入
力端子に与えられる第１のｇｍアンプと、上記第１のｇ
ｍアンプの出力信号が一方の入力端子に与えられるとと
もにその出力から導出される信号がシャープネス回路の
出力信号として外部に導出される第２のｇｍアンプと、
上記入力信号と上記第２のｇｍアンプの出力信号とを混
合するためのミックス回路とを具備し、上記第２のｇｍ
アンプの出力信号を上記第１のｇｍアンプの他方の入力
端子に供給するとともに、上記ミックス回路の出力信号
を上記第２のｇｍアンプの他方の入力端子に供給するよ
うにしたことを特徴とするシャープネス回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03116726A JP3109128B2 (ja) | 1991-04-19 | 1991-04-19 | シャープネス回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03116726A JP3109128B2 (ja) | 1991-04-19 | 1991-04-19 | シャープネス回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04321380A JPH04321380A (ja) | 1992-11-11 |
| JP3109128B2 true JP3109128B2 (ja) | 2000-11-13 |
Family
ID=14694282
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03116726A Expired - Fee Related JP3109128B2 (ja) | 1991-04-19 | 1991-04-19 | シャープネス回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3109128B2 (ja) |
-
1991
- 1991-04-19 JP JP03116726A patent/JP3109128B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04321380A (ja) | 1992-11-11 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |