JP3039223B2 - 磁気エンコーダ - Google Patents

磁気エンコーダ

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JP3039223B2
JP3039223B2 JP5235271A JP23527193A JP3039223B2 JP 3039223 B2 JP3039223 B2 JP 3039223B2 JP 5235271 A JP5235271 A JP 5235271A JP 23527193 A JP23527193 A JP 23527193A JP 3039223 B2 JP3039223 B2 JP 3039223B2
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JP
Japan
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voltage comparator
magnetoresistive element
magnetic encoder
duty ratio
rotating
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JP5235271A
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鉄男 工藤
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NEC Corp
Original Assignee
NEC Corp
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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は磁気エンコーダに関し、
特にスダレ型磁気抵抗素子を利用した磁気エンコーダに
関する。
【0002】
【従来の技術】従来のこの種の磁気エンコーダは、図3
に示すように、磁化パターン2を有する回転着磁体1
と、回転着磁体1による磁界の変化を検知し電位変化の
信号を出力するスダレ型磁気抵抗素子を利用する磁気抵
抗素子3と、電圧比較器4とを有する。
【0003】回転着磁体1の有する磁化パターン2は、
図4に示すように、回転着磁体1の円周側面にN極とS
極とを交互に着磁したものとして構成される。
【0004】次に、従来の磁気エンコーダの動作につい
て説明する。
【0005】図4(a)に示すように、4つのスダレ型
磁気抵抗素子MRE1〜MRE4はλ/4(λ:波長)
ピッチで配列され、それぞれ図4(b)に示すようにM
RE1とMRE2およびMRE3とMRE4の2つの磁
気抵抗素子の中点の電位VaおよびVbは図5(b)お
よび(c)のような電位変化を示す。
【0006】図5において、(a)はスダレ型磁気抵抗
素子MRE1に対する回転着磁体1の磁界を示し、
(b)は中点電位Va、(c)は中点電位Vb、また
(d)は電圧比較器4の出力電圧Voutを示す。電圧
比較器4は、電位VaとVbとを比較し、Va〉Vbの
ときは+Vcc,Va〈VbのときはOVの電位の矩形
波パルスとして出力する。
【0007】
【発明が解決しようとする課題】この従来の磁気エンコ
ーダでは、磁化パターンを回転着磁体の円周側面に着磁
しており、磁化パターンによる磁界を検出する磁気抵抗
素子との距離を一定に保つ必要がある。これは、磁気抵
抗素子との距離が変化すると中点電位信号も変化し、電
圧比較器の出力するパルス電圧のデューティ比を変化さ
せる要因となることを回避するためである。
【0008】したがって、デューティ比の変化を減少さ
せるためには、回転着磁体を真円に近づけ、偏心を減少
させ、また側面を平滑にする必要がある。すなわち、回
転着磁体の機械的精度を上げなければならないが、それ
にも限度があり従ってデューティ比の変化の減少にも限
度があるという問題点があった。
【0009】本発明の目的は上述した問題点を解決し、
回転着磁体の機械的精度に関する条件を著しく緩和しう
る磁気エンコーダを提供することにある。
【0010】
【課題を解決するための手段】本発明の磁気エンコーダ
は、磁化パターンを有する回転着磁体と、この回転着磁
体と対向配置し前記回転着磁体の形成する磁界による電
位変化信号を出力する磁気抵抗素子と、この磁気抵抗素
子による前記電位変化信号を入力して矩形波パルス列の
出力パルスを送出する電圧比較器と、前記出力パルスを
入力としてそのデューティ比を補正し前記回転着磁体の
機械的精度にもとづく前記デューティ比の変化を補正す
るデューティ補正回路とを備える。
【0011】また本発明の磁気エンコーダは、前記電圧
比較器と前記回転着磁体との間に前記電圧比較器の入力
レベルを増大する差動増幅器を介在させた構成を有す
る。
【0012】さらに本発明の磁気エンコーダは、前記磁
気抵抗素子と前記電圧比較器と前記デューティ補正回路
または前記磁気抵抗素子と前記電圧比較器と前記デュー
ティ補正回路と前記差動増幅器とをそれぞれ1チップか
1モジュールとした構成を有する。
【0013】
【実施例】次に、本発明について図面を参照して説明す
る。
【0014】図1は、本発明の第一の実施例の磁気エン
コーダの構成図である。
【0015】本第一の実施例は、回転着磁体1と、回転
着磁体1の円周側面に複数着磁して配設した磁化パター
ン2と、スダレ型磁気抵抗素子を利用する磁気抵抗素子
3と、電圧比較器4と、デューティ比補正回路5とを備
え、点線で示す部分は1チップまたは1モジュールの一
体化構成とされる。
【0016】磁化パターン2の着磁数は、回転着磁体1
を1回転するときに発生させる出力パルス数との関係に
より決定され、例えば100乃至200程度のものが利
用される。
【0017】回転着磁体1の機械的精度には限度がある
ので、電圧比較器4の出力パルスのデューティ比は厳密
にはそれぞれ異って変化している。これら電圧比較器4
の出力パルスはデューティ比補正回路5に入力される。
【0018】デューティ比補正回路5は、希望するデュ
ーティ比の出力パルスを出力するように、あらかじめ回
路常数が設定されている。デューティ比補正回路5の具
体的構成例としては、例えば単安定マルチバイブレータ
回路があり、回路構成素子のコンデンサ、抵抗器による
時定数を適宜選定することにより、入力信号があれば一
定のパルス幅すなわち一定デューティ比のパルスを出力
させることができる。時定数を適宜選定することによ
り、デューティ比を略5%〜95%の可変範囲にわたっ
て設定可能である。
【0019】尚本第一の実施例は、電圧比較器4に入力
する信号電圧が十分に確保できる場合であるが、電圧比
較器4に入力する信号電圧が小さい場合には図2の第二
の実施例に示すように差動増幅器6を磁気抵抗素子3と
電圧比較器4との間に介在させて十分なレベルの信号電
圧とし、電圧比較器4に入力させることによって安定し
た動作を確保することができる。
【0020】
【発明の効果】以上説明したように本発明は、磁気エン
コーダの出力パルスに対するデューティ補正を施すこと
により、従来必要とされていた回転着磁体に対する機械
的精度の条件を大幅に緩和して量産化を容易とするとと
もに出力パルスのデューティ比を希望値に自由に設定す
ることができる効果を有する。
【図面の簡単な説明】
【図1】本発明の第一の実施例の磁気エンコーダの構成
図である。
【図2】本発明の第二の実施例の磁気エンコーダの構成
図である。
【図3】従来の磁気エンコーダの構成図である。
【図4】磁気抵抗素子の配置例(a)および接続例
(b)を示す図である。
【図5】図4の各部の電位変化と電圧比較出力とを示す
波形図である。
【符号の説明】
1 回転着磁体 2 磁化パターン 3 磁気抵抗素子 4 電圧比較器 5 デューティ比補正回路 6 差動増幅器
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7,DB名) G01D 5/00 - 5/252 G01D 5/39 - 5/62

Claims (3)

    (57)【特許請求の範囲】
  1. 【請求項1】 磁化パターンを有する回転着磁体と、こ
    の回転着磁体と対向配置し前記回転着磁体の形成する磁
    界による電位変化信号を出力する磁気抵抗素子と、この
    磁気抵抗素子による前記電位変化信号を入力して矩形波
    パルス列の出力パルスを送出する電圧比較器と、前記出
    力パルスを入力としてそのデューティ比を補正し前記回
    転着磁体の機械的精度にもとづく前記デューティ比の変
    化を補正するデューティ補正回路とを備えることを特徴
    とする磁気エンコーダ。
  2. 【請求項2】 前記電圧比較器と前記回転着磁体との間
    に前記電圧比較器の入力レベルを増大する差動増幅器を
    介在させたことを特徴とする請求項1記載の磁気エンコ
    ーダ。
  3. 【請求項3】 前記磁気抵抗素子と前記電圧比較器と前
    記デューティ補正回路または前記磁気抵抗素子と前記電
    圧比較器と前記デューティ補正回路と前記差動増幅器と
    をそれぞれ1チップか1モジュールとして構成したこと
    を特徴とする請求項1または2記載の磁気エンコーダ。
JP5235271A 1993-09-22 1993-09-22 磁気エンコーダ Expired - Lifetime JP3039223B2 (ja)

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JPH0791980A JPH0791980A (ja) 1995-04-07
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