JP3030790B2 - 電源アラーム回路 - Google Patents
電源アラーム回路Info
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Description
【０００１】
【産業上の利用分野】本発明は、複数の独立した電源回
路を備えた電源に於ける電源アラーム回路に関する。
路を備えた電源に於ける電源アラーム回路に関する。
【０００２】
【従来の技術】図４に示すように、複数の電源回路４１
−１〜４１−ｎにより複数の負荷にそれぞれ独立的に安
定化電力を供給する電源が知られている。同図に於い
て、４２はスイッチングトランジスタ等を含む直流出力
部、４３は制御部、４４はアラーム回路、４５はリセッ
トスイッチ、４６は入力部である。
−１〜４１−ｎにより複数の負荷にそれぞれ独立的に安
定化電力を供給する電源が知られている。同図に於い
て、４２はスイッチングトランジスタ等を含む直流出力
部、４３は制御部、４４はアラーム回路、４５はリセッ
トスイッチ、４６は入力部である。
【０００３】入力部４６は、交流入力電圧或いは直流入
力電圧を、電源回路４１−１〜４１−ｎ対応の直流電圧
として出力する構成を有し、各電源回路４１−１〜４１
−ｎは、制御部４３からのオン，オフ制御信号に従って
直流出力部４２は、入力された直流電圧のスイッチング
を行い、それを整流平滑化して負荷に供給し、その出力
電圧を制御部４３に於いて検出し、設定値と比較してス
イッチングのオン時間等を制御して、出力電圧を安定化
させるものである。又アラーム回路４４は、正常時は制
御部４３を動作状態とするオン信号ｓ１（“１”）を出
力し、過電圧や過電流等の異常時の検出信号ｓ２によ
り、オン信号ｓ１をオフ信号（“０”）として制御部４
３の動作を停止させるものである。
力電圧を、電源回路４１−１〜４１−ｎ対応の直流電圧
として出力する構成を有し、各電源回路４１−１〜４１
−ｎは、制御部４３からのオン，オフ制御信号に従って
直流出力部４２は、入力された直流電圧のスイッチング
を行い、それを整流平滑化して負荷に供給し、その出力
電圧を制御部４３に於いて検出し、設定値と比較してス
イッチングのオン時間等を制御して、出力電圧を安定化
させるものである。又アラーム回路４４は、正常時は制
御部４３を動作状態とするオン信号ｓ１（“１”）を出
力し、過電圧や過電流等の異常時の検出信号ｓ２によ
り、オン信号ｓ１をオフ信号（“０”）として制御部４
３の動作を停止させるものである。
【０００４】異常検出によりアラーム回路４４からオフ
信号を出力した後、異常状態が回復し、リセットスイッ
チ４５をオンとしてアラーム回路４４にリセット信号を
加えると、アラーム回路４４はリセット動作により初期
状態に戻り、それによって、オン信号ｓ１（“１”）を
送出するから、制御部４３は動作を再開して、負荷に安
定化電力を供給することができる。
信号を出力した後、異常状態が回復し、リセットスイッ
チ４５をオンとしてアラーム回路４４にリセット信号を
加えると、アラーム回路４４はリセット動作により初期
状態に戻り、それによって、オン信号ｓ１（“１”）を
送出するから、制御部４３は動作を再開して、負荷に安
定化電力を供給することができる。
【０００５】
【発明が解決しようとする問題点】電源回路４１−１〜
４１−ｎ対応にリセットスイッチ４５を設けて、異常検
出によるアラーム回路４４をリセットする従来例の構成
に於いて、電源回路４１−１〜４１−ｎが多数の場合に
は、異常検出により動作を停止した電源回路４１−１〜
４１−ｎを見つけるのが容易でない欠点がある。そこ
で、各電源回路４１−１〜４１−ｎのアラーム回路４４
に共通のリセット信号を加える構成が提案された。即
ち、リセットスイッチ４５を複数の電源回路４１−１〜
４１−ｎのアラーム回路４４に対して１個設けて、共通
のリセット信号を加えるものである。
４１−ｎ対応にリセットスイッチ４５を設けて、異常検
出によるアラーム回路４４をリセットする従来例の構成
に於いて、電源回路４１−１〜４１−ｎが多数の場合に
は、異常検出により動作を停止した電源回路４１−１〜
４１−ｎを見つけるのが容易でない欠点がある。そこ
で、各電源回路４１−１〜４１−ｎのアラーム回路４４
に共通のリセット信号を加える構成が提案された。即
ち、リセットスイッチ４５を複数の電源回路４１−１〜
４１−ｎのアラーム回路４４に対して１個設けて、共通
のリセット信号を加えるものである。
【０００６】その場合に、正常動作の電源回路のアラー
ム回路４４にもリセット信号が加えられ、一旦初期状態
に戻る過程において正常時のオン信号が一瞬停止するこ
とになる。即ち、制御部４３の動作が一瞬停止し、直流
出力部４２から負荷に供給する電力の瞬断が生じる欠点
がある。本発明は、このような共通のリセット信号を加
えても、正常動作の電源回路の動作の瞬断が生じないよ
うにすることを目的とする。
ム回路４４にもリセット信号が加えられ、一旦初期状態
に戻る過程において正常時のオン信号が一瞬停止するこ
とになる。即ち、制御部４３の動作が一瞬停止し、直流
出力部４２から負荷に供給する電力の瞬断が生じる欠点
がある。本発明は、このような共通のリセット信号を加
えても、正常動作の電源回路の動作の瞬断が生じないよ
うにすることを目的とする。
【０００７】
【発明が解決しようとする問題点】本発明の電源アラー
ム回路は、図１を参照して説明すると、負荷に安定化電
力を供給する為の直流出力部２と制御部３と、この制御
部３に正常時はオン信号を加えて動作状態とし、異常検
出時にオフ信号を加えて動作を停止させるアラーム回路
４とをそれぞれ含む複数の電源回路１−１〜１−ｎを備
えた電源に於いて、複数の電源回路１−１〜１−ｎのア
ラーム回路４に、リセットスイッチ５等により共通のリ
セット信号を加えた時に、オフ信号を送出したアラーム
回路のみリセットされ、正常時のオン信号を送出したア
ラーム回路は、このオン信号によりアラーム信号をマス
クする構成を設けたものである。
ム回路は、図１を参照して説明すると、負荷に安定化電
力を供給する為の直流出力部２と制御部３と、この制御
部３に正常時はオン信号を加えて動作状態とし、異常検
出時にオフ信号を加えて動作を停止させるアラーム回路
４とをそれぞれ含む複数の電源回路１−１〜１−ｎを備
えた電源に於いて、複数の電源回路１−１〜１−ｎのア
ラーム回路４に、リセットスイッチ５等により共通のリ
セット信号を加えた時に、オフ信号を送出したアラーム
回路のみリセットされ、正常時のオン信号を送出したア
ラーム回路は、このオン信号によりアラーム信号をマス
クする構成を設けたものである。
【０００８】
【作用】複数の電源回路１−１〜１−ｎの各アラーム回
路４は、制御部３に、正常時はオン信号（“１”）、異
常検出時はオフ信号（“０”）を加えるものであり、又
マスク機能として図１に於いてはインヒビット回路６を
設けた場合を示し、リセットスイッチ５等による共通の
リセット信号が加えられた時、正常動作の電源回路に於
けるアラーム回路４は、このリセット信号をオン信号
（“１”）によってインヒビット回路６等によりマスク
するから、リセットが行われることはない。従って、一
瞬の動作停止も生じないことになる。又異常検出のアラ
ーム回路は、オン信号（“１”）を送出していないか
ら、共通のリセット信号によりリセットされ、それによ
って、アラーム回路４からオン信号が送出されるから、
制御部３は直流出力部２の制御動作を再開することにな
る。
路４は、制御部３に、正常時はオン信号（“１”）、異
常検出時はオフ信号（“０”）を加えるものであり、又
マスク機能として図１に於いてはインヒビット回路６を
設けた場合を示し、リセットスイッチ５等による共通の
リセット信号が加えられた時、正常動作の電源回路に於
けるアラーム回路４は、このリセット信号をオン信号
（“１”）によってインヒビット回路６等によりマスク
するから、リセットが行われることはない。従って、一
瞬の動作停止も生じないことになる。又異常検出のアラ
ーム回路は、オン信号（“１”）を送出していないか
ら、共通のリセット信号によりリセットされ、それによ
って、アラーム回路４からオン信号が送出されるから、
制御部３は直流出力部２の制御動作を再開することにな
る。
【０００９】
【実施例】図２は本発明の一実施例の要部回路図であ
り、図１の複数の電源回路１−１〜１−ｎのアラーム回
路４の要部を示す。同図に於いて、１１−１，１１−４
は４個の電源回路対応のアラーム回路の中の２個のアラ
ーム回路を示し、１２はアラーム検出用の比較器、１３
はサイリスタ、１４はトランジスタ、１５はリセット用
の比較器、１６はマスク用のインバータ、１７はリセッ
トスイッチ、Ｒ１〜Ｒ１０は抵抗、Ｃ１はコンデンサ、
ＰＤ１〜ＰＤ４は発光ダイオード、ＰＴ１，ＰＴ４はホ
トトランジスタであり、発光ダイオードＰＤ１とホトト
ランジスタＰＴ１とによりホトカプラが構成され、同様
に、発光ダイオードＰＤ４とホトトランジスタＰＴ４と
によりホトカプラが構成されている。
り、図１の複数の電源回路１−１〜１−ｎのアラーム回
路４の要部を示す。同図に於いて、１１−１，１１−４
は４個の電源回路対応のアラーム回路の中の２個のアラ
ーム回路を示し、１２はアラーム検出用の比較器、１３
はサイリスタ、１４はトランジスタ、１５はリセット用
の比較器、１６はマスク用のインバータ、１７はリセッ
トスイッチ、Ｒ１〜Ｒ１０は抵抗、Ｃ１はコンデンサ、
ＰＤ１〜ＰＤ４は発光ダイオード、ＰＴ１，ＰＴ４はホ
トトランジスタであり、発光ダイオードＰＤ１とホトト
ランジスタＰＴ１とによりホトカプラが構成され、同様
に、発光ダイオードＰＤ４とホトトランジスタＰＴ４と
によりホトカプラが構成されている。
【００１０】正常時は、アラーム信号ＡＬＭ１，ＡＬＭ
４はローレベルであるから、比較器１２の出力はローレ
ベルとなり、サイリスタ１３はオフとなる。又リセット
スイッチ１７をオフとすると、ホトダイオードＰＤ１〜
ＰＤ４は発光しないから、ホトトランジスタＰＴ１，Ｐ
Ｔ４はオフであり、比較器１５の−端子には、抵抗Ｒ
６，Ｒ７により電圧＋Ｖが分圧されて加えられ、又＋端
子は抵抗Ｒ９を介して接地されるから、比較器１５の出
力はローレベルとなり、トランジスタ１４はオフとな
る。従って、オン信号Ｓ１，Ｓ４は“１”となる。この
“１”のオン信号Ｓ１，Ｓ４は、電源回路の制御部３に
加えられて動作状態となり、直流出力部２が制御される
（図１参照）。
４はローレベルであるから、比較器１２の出力はローレ
ベルとなり、サイリスタ１３はオフとなる。又リセット
スイッチ１７をオフとすると、ホトダイオードＰＤ１〜
ＰＤ４は発光しないから、ホトトランジスタＰＴ１，Ｐ
Ｔ４はオフであり、比較器１５の−端子には、抵抗Ｒ
６，Ｒ７により電圧＋Ｖが分圧されて加えられ、又＋端
子は抵抗Ｒ９を介して接地されるから、比較器１５の出
力はローレベルとなり、トランジスタ１４はオフとな
る。従って、オン信号Ｓ１，Ｓ４は“１”となる。この
“１”のオン信号Ｓ１，Ｓ４は、電源回路の制御部３に
加えられて動作状態となり、直流出力部２が制御される
（図１参照）。
【００１１】前述のような正常時に於いて、リセットス
イッチ１７をオンとすると、＋Ｖの電圧が抵抗Ｒ１０を
介して直列接続のホトダイオードＰＤ１〜ＰＤ４に印加
されて発光するから、ホトトランジスタＰＴ１，ＰＴ４
はオンとなり、比較器１５の＋端子に、抵抗Ｒ８，Ｒ９
により電圧＋Ｖを分圧した電圧が加えられ、この分圧電
圧を、抵抗Ｒ６，Ｒ７による分圧電圧より高く設定して
おくと、比較器１５の出力はハイレベルとなるが、イン
バータ１６の出力が比較器１５の＋端子に加えられ、こ
の正常時には、インバータ１６の出力は、“１”のオン
信号Ｓ１を反転した“０”となるから、比較器１５の出
力はローレベルを維持することになる。従って、トラン
ジスタ１４はオフのままとなり、リセットスイッチ１７
による共通のリセット信号はオン信号Ｓ１，Ｓ４により
マスクされることになる。
イッチ１７をオンとすると、＋Ｖの電圧が抵抗Ｒ１０を
介して直列接続のホトダイオードＰＤ１〜ＰＤ４に印加
されて発光するから、ホトトランジスタＰＴ１，ＰＴ４
はオンとなり、比較器１５の＋端子に、抵抗Ｒ８，Ｒ９
により電圧＋Ｖを分圧した電圧が加えられ、この分圧電
圧を、抵抗Ｒ６，Ｒ７による分圧電圧より高く設定して
おくと、比較器１５の出力はハイレベルとなるが、イン
バータ１６の出力が比較器１５の＋端子に加えられ、こ
の正常時には、インバータ１６の出力は、“１”のオン
信号Ｓ１を反転した“０”となるから、比較器１５の出
力はローレベルを維持することになる。従って、トラン
ジスタ１４はオフのままとなり、リセットスイッチ１７
による共通のリセット信号はオン信号Ｓ１，Ｓ４により
マスクされることになる。
【００１２】又異常時にはアラーム信号ＡＬＭ１，ＡＬ
Ｍ４はハイレベルとなるもので、例えば、アラーム信号
ＡＬＭ１がハイレベルになったとすると、アラーム回路
１１−１の比較器１２の出力はハイレベルとなり、サイ
リスタ１３はオンとなる。従って、オン信号Ｓ１は
“０”となる。即ち、オフ信号となり、電源回路の制御
部３は動作を停止することになる。
Ｍ４はハイレベルとなるもので、例えば、アラーム信号
ＡＬＭ１がハイレベルになったとすると、アラーム回路
１１−１の比較器１２の出力はハイレベルとなり、サイ
リスタ１３はオンとなる。従って、オン信号Ｓ１は
“０”となる。即ち、オフ信号となり、電源回路の制御
部３は動作を停止することになる。
【００１３】この状態に於いて、異常状態が回復してア
ラーム信号ＡＬＭ１がローレベルとなっても、サイリス
タ１３はオン状態を継続するから、オン信号Ｓ１は
“０”のままとなる。そこで、リセットスイッチ１７を
オンとして共通のリセット信号を各アラーム回路１１−
１，１１−４に加えると、ホトトランジスタＰＴ１，Ｐ
Ｔ４はオンとなり、比較器１５の＋端子に、抵抗Ｒ８，
Ｒ９による分圧電圧が加えられる。その時、アラーム回
路１１−１ではオン信号Ｓ１が“０”であるから、イン
バータ１６の出力はハイレベルとなり、又アラーム回路
１１−４ではオン信号Ｓ４が“１”であるから、インバ
ータ１６の出力はローレベルとなっている。従って、ア
ラーム回路１１−１の比較器１５の出力はハイレベルと
なり、トランジスタ１４がオンとなり、オン状態のサイ
リスタ１３をバイパスするから、サイリスタ１３はオフ
状態に復帰する。
ラーム信号ＡＬＭ１がローレベルとなっても、サイリス
タ１３はオン状態を継続するから、オン信号Ｓ１は
“０”のままとなる。そこで、リセットスイッチ１７を
オンとして共通のリセット信号を各アラーム回路１１−
１，１１−４に加えると、ホトトランジスタＰＴ１，Ｐ
Ｔ４はオンとなり、比較器１５の＋端子に、抵抗Ｒ８，
Ｒ９による分圧電圧が加えられる。その時、アラーム回
路１１−１ではオン信号Ｓ１が“０”であるから、イン
バータ１６の出力はハイレベルとなり、又アラーム回路
１１−４ではオン信号Ｓ４が“１”であるから、インバ
ータ１６の出力はローレベルとなっている。従って、ア
ラーム回路１１−１の比較器１５の出力はハイレベルと
なり、トランジスタ１４がオンとなり、オン状態のサイ
リスタ１３をバイパスするから、サイリスタ１３はオフ
状態に復帰する。
【００１４】又アラーム回路１１−４は、比較器１５の
出力がローレベルを維持するから、トランジスタ１４は
オフのままであり、オン信号Ｓ４は“１”を継続し、一
瞬も“０”となることがない。即ち、オン信号Ｓ４によ
り共通のリセット信号がマスクされたことになる。
出力がローレベルを維持するから、トランジスタ１４は
オフのままであり、オン信号Ｓ４は“１”を継続し、一
瞬も“０”となることがない。即ち、オン信号Ｓ４によ
り共通のリセット信号がマスクされたことになる。
【００１５】図３は本発明の他の実施例の要部回路図で
あり、１個のアラーム回路或いは複数のアラーム回路を
共通化した構成に相当し、２１はリセットスイッチ、２
２は比較器、２３はインバータ、２４はトランジスタ、
２５はリセット端子ＲＳ付きのラッチ回路、２６はラッ
チ回路、２７〜３０はダイオード、Ｒ１１〜Ｒ１８は抵
抗、Ａ１〜Ａ４はアラーム信号、ＳＡ１〜ＳＡ４はオン
信号或いは外部へのアラーム信号である。
あり、１個のアラーム回路或いは複数のアラーム回路を
共通化した構成に相当し、２１はリセットスイッチ、２
２は比較器、２３はインバータ、２４はトランジスタ、
２５はリセット端子ＲＳ付きのラッチ回路、２６はラッ
チ回路、２７〜３０はダイオード、Ｒ１１〜Ｒ１８は抵
抗、Ａ１〜Ａ４はアラーム信号、ＳＡ１〜ＳＡ４はオン
信号或いは外部へのアラーム信号である。
【００１６】ラッチ回路２５に加えられるアラーム信号
Ａ１〜Ａ４は、正常時に“０”、異常時に“１”とする
と、ラッチ回路２６は反転出力のラッチ回路の構成と
し、反対に正常時に“１”、異常時に“０”とすると、
ラッチ回路２６は通常のラッチ回路の構成とすることに
なる。又ラッチ回路２５のリセット端子ＲＳがトランジ
スタ２４のコレクタに接続され、トランジスタ２４がオ
ンとなって、コレクタが“０”となると、ラッチ回路２
５のリセットが行われる。
Ａ１〜Ａ４は、正常時に“０”、異常時に“１”とする
と、ラッチ回路２６は反転出力のラッチ回路の構成と
し、反対に正常時に“１”、異常時に“０”とすると、
ラッチ回路２６は通常のラッチ回路の構成とすることに
なる。又ラッチ回路２５のリセット端子ＲＳがトランジ
スタ２４のコレクタに接続され、トランジスタ２４がオ
ンとなって、コレクタが“０”となると、ラッチ回路２
５のリセットが行われる。
【００１７】４個の電源回路のアラーム回路を共通化し
た場合、各電源回路の制御部からのアラーム信号Ａ１〜
Ａ４がラッチ回路２５に加えられ、又オン信号ＳＡ１〜
ＳＡ４がそれぞれの制御部に加えられ、オン信号ＳＡ１
〜ＳＡ４が“１”の時に動作状態となる。その場合、ダ
イオード２７〜３０は逆バイアス状態となるから、イン
バータ２３の入力は抵抗Ｒ１４を介して電圧＋Ｖが加え
られ、その出力はローレベルとなる。又比較器２２の−
端子に抵抗Ｒ１８，Ｒ１３により＋Ｖの電圧が分圧され
て加えられ、リセットスイッチ２１がオフの時は、比較
器２２の＋端子は抵抗Ｒ１２を介して接地されるから、
比較器２２の出力はローレベルとなり、トランジスタ２
４はオフとなる。
た場合、各電源回路の制御部からのアラーム信号Ａ１〜
Ａ４がラッチ回路２５に加えられ、又オン信号ＳＡ１〜
ＳＡ４がそれぞれの制御部に加えられ、オン信号ＳＡ１
〜ＳＡ４が“１”の時に動作状態となる。その場合、ダ
イオード２７〜３０は逆バイアス状態となるから、イン
バータ２３の入力は抵抗Ｒ１４を介して電圧＋Ｖが加え
られ、その出力はローレベルとなる。又比較器２２の−
端子に抵抗Ｒ１８，Ｒ１３により＋Ｖの電圧が分圧され
て加えられ、リセットスイッチ２１がオフの時は、比較
器２２の＋端子は抵抗Ｒ１２を介して接地されるから、
比較器２２の出力はローレベルとなり、トランジスタ２
４はオフとなる。
【００１８】ラッチ回路２６を反転出力のラッチ回路と
した場合に、電源回路の一つ或いは複数に異常が発生し
てアラーム信号の一つ或いは複数が“１”となると、ラ
ッチ回路２５にこの“１”のアラーム信号がラッチされ
る。例えば、アラーム信号Ａ１が“１”となったとする
と、ラッチ回路２５にラッチされ、そのラッチ出力がラ
ッチ回路２６にラッチされ、反転されて“０”のオン信
号ＳＡ１となり、他のオン信号ＳＡ２〜ＳＡ４は“１”
のままとなる。
した場合に、電源回路の一つ或いは複数に異常が発生し
てアラーム信号の一つ或いは複数が“１”となると、ラ
ッチ回路２５にこの“１”のアラーム信号がラッチされ
る。例えば、アラーム信号Ａ１が“１”となったとする
と、ラッチ回路２５にラッチされ、そのラッチ出力がラ
ッチ回路２６にラッチされ、反転されて“０”のオン信
号ＳＡ１となり、他のオン信号ＳＡ２〜ＳＡ４は“１”
のままとなる。
【００１９】次に異常状態が回復してアラーム信号Ａ１
が“０”となり、リセットスイッチ２１をオンとする
と、抵抗Ｒ１１，Ｒ１２により＋Ｖの電圧が分圧されて
比較器２２の＋端子に加えられ、その時、ラッチ回路２
６からのオン信号ＳＡ１は前の“０”の状態を維持して
いるから、ダイオード２７を介してインバータ２３の入
力はローレベルとなる。従って、インバータ２３の出力
はハイレベルとなり、比較器２２の出力はハイレベルと
なる。それによって、トランジスタ２４はオンとなるか
ら、ラッチ回路２５のリセット端子ＲＳにローレベルの
リセット信号が加えられ、ラッチ回路２５はリセットさ
れる。即ち、リセットスイッチ２１をオンとすることに
より、共通のリセット信号を加えることができる。
が“０”となり、リセットスイッチ２１をオンとする
と、抵抗Ｒ１１，Ｒ１２により＋Ｖの電圧が分圧されて
比較器２２の＋端子に加えられ、その時、ラッチ回路２
６からのオン信号ＳＡ１は前の“０”の状態を維持して
いるから、ダイオード２７を介してインバータ２３の入
力はローレベルとなる。従って、インバータ２３の出力
はハイレベルとなり、比較器２２の出力はハイレベルと
なる。それによって、トランジスタ２４はオンとなるか
ら、ラッチ回路２５のリセット端子ＲＳにローレベルの
リセット信号が加えられ、ラッチ回路２５はリセットさ
れる。即ち、リセットスイッチ２１をオンとすることに
より、共通のリセット信号を加えることができる。
【００２０】それにより、ラッチ出力は総て“０”とな
り、ラッチ回路２６はこれを反転して出力するから、オ
ン信号ＳＡ１は再び“１”となり、他のオン信号ＳＡ２
〜ＳＡ４は“１”を継続することになる。従って、オン
信号ＳＡ１が加えられる電源回路の制御部の動作が再開
されて負荷に安定化電力が供給される。又他のオン信号
ＳＡ２〜ＳＡ４が加えられる電源回路の制御部は、オン
信号ＳＡ２〜ＳＡ４が変化しないから、瞬断を生じるこ
とはない。
り、ラッチ回路２６はこれを反転して出力するから、オ
ン信号ＳＡ１は再び“１”となり、他のオン信号ＳＡ２
〜ＳＡ４は“１”を継続することになる。従って、オン
信号ＳＡ１が加えられる電源回路の制御部の動作が再開
されて負荷に安定化電力が供給される。又他のオン信号
ＳＡ２〜ＳＡ４が加えられる電源回路の制御部は、オン
信号ＳＡ２〜ＳＡ４が変化しないから、瞬断を生じるこ
とはない。
【００２１】又図３に示す構成を複数個設けて、リセッ
トスイッチ２１を共通的に設けることにより、全アラー
ム回路に対して共通のリセット信号を加えることができ
る。その場合、オン信号ＳＡ１〜ＳＡ４が“１”である
と、インバータ２３の出力がローレベルであるから、比
較器２２の＋端子に抵抗Ｒ１１，Ｒ１２による分圧電圧
が加えられても、−端子に加えられる抵抗Ｒ１８，Ｒ１
３による分圧電圧より低い値に維持され、比較器２２の
出力はローレベルを維持することになる。従って、ラッ
チ回路２５のリセットは行われないことになる。
トスイッチ２１を共通的に設けることにより、全アラー
ム回路に対して共通のリセット信号を加えることができ
る。その場合、オン信号ＳＡ１〜ＳＡ４が“１”である
と、インバータ２３の出力がローレベルであるから、比
較器２２の＋端子に抵抗Ｒ１１，Ｒ１２による分圧電圧
が加えられても、−端子に加えられる抵抗Ｒ１８，Ｒ１
３による分圧電圧より低い値に維持され、比較器２２の
出力はローレベルを維持することになる。従って、ラッ
チ回路２５のリセットは行われないことになる。
【００２２】本発明は前述の各実施例にのみ限定される
ものではなく、種々付加変更することができるものであ
り、又複数の電源回路の直流出力部は、既に知られてい
る各種の構成を用いることができるものである。
ものではなく、種々付加変更することができるものであ
り、又複数の電源回路の直流出力部は、既に知られてい
る各種の構成を用いることができるものである。
【００２３】
【発明の効果】以上説明したように、本発明は、制御部
３に、正常時はオン信号を加えて動作状態とし、異常検
出時にオフ信号を加えて動作を停止させるアラーム回路
４に、共通のリセット信号を加えた時、オン信号により
リセット信号をマスクする構成を設けたもので、複数の
電源回路１−１〜１−ｎのアラーム回路４に１個のリセ
ットスイッチ等による共通のリセット信号を加えた時、
異常検出のアラーム回路４のみリセット動作を行わせる
ことができ、リセットの操作が簡単となる利点がある。
３に、正常時はオン信号を加えて動作状態とし、異常検
出時にオフ信号を加えて動作を停止させるアラーム回路
４に、共通のリセット信号を加えた時、オン信号により
リセット信号をマスクする構成を設けたもので、複数の
電源回路１−１〜１−ｎのアラーム回路４に１個のリセ
ットスイッチ等による共通のリセット信号を加えた時、
異常検出のアラーム回路４のみリセット動作を行わせる
ことができ、リセットの操作が簡単となる利点がある。
【００２４】更に、正常動作のアラーム回路４は、リセ
ット信号がオン信号によりマスクされるから、リセット
動作が行われないことになり、従って、瞬断を生じるよ
うなことはなくなり、負荷に安定な電力を継続して供給
することができ、複数の電源回路１−１〜１−ｎからな
る電源の信頼性を向上することができる。
ット信号がオン信号によりマスクされるから、リセット
動作が行われないことになり、従って、瞬断を生じるよ
うなことはなくなり、負荷に安定な電力を継続して供給
することができ、複数の電源回路１−１〜１−ｎからな
る電源の信頼性を向上することができる。
【図１】本発明の原理説明図である。
【図２】本発明の一実施例の要部回路図である。
【図３】本発明の他の実施例の要部回路図である。
【図４】電源の説明図である。
１−１〜１−ｎ 電源回路 ２ 直流出力部 ３ 制御部 ４ アラーム回路 ５ リセットスイッチ
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) H02M 3/00 G06F 1/26 H02J 1/00 309 H02J 1/10
Claims (1)
- 【請求項１】 負荷に安定化電力を供給する為の直流出
力部（２）と制御部（３）と、該制御部（３）に正常時
はオン信号を加えて動作状態とし、異常検出時にオフ信
号を加えて動作を停止させるアラーム回路（４）とをそ
れぞれ含む複数の電源回路（１−１〜１−ｎ）を備えた
電源に於いて、 前記複数の電源回路（１−１〜１−ｎ）の前記アラーム
回路（４）に共通のリセット信号を加えた時に、前記オ
フ信号を送出したアラーム回路のみリセットされ、正常
時の前記オン信号を送出したアラーム回路は、該オン信
号により前記リセット信号をマスクする構成を設けたこ
とを特徴とする電源アラーム回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3225595A JP3030790B2 (ja) | 1991-09-05 | 1991-09-05 | 電源アラーム回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3225595A JP3030790B2 (ja) | 1991-09-05 | 1991-09-05 | 電源アラーム回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05184137A JPH05184137A (ja) | 1993-07-23 |
| JP3030790B2 true JP3030790B2 (ja) | 2000-04-10 |
Family
ID=16831788
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3225595A Expired - Fee Related JP3030790B2 (ja) | 1991-09-05 | 1991-09-05 | 電源アラーム回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3030790B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3373991B2 (ja) * | 1995-12-14 | 2003-02-04 | 三菱電機株式会社 | インバータ装置 |
-
1991
- 1991-09-05 JP JP3225595A patent/JP3030790B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05184137A (ja) | 1993-07-23 |
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