JP2988384B2 - レチクルアセンブリ - Google Patents

レチクルアセンブリ

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    • G03F7/70483Information management; Active and passive control; Testing; Wafer monitoring, e.g. pattern monitoring
    • G03F7/70605Workpiece metrology
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  • Preparing Plates And Mask In Photomechanical Process (AREA)
  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明はレチクル(あるいはマス
ク)アセンブリ、特にその位置精度測定用パターンの改
良に関する。
【0002】
【従来の技術】図9は従来のレチクルを示す。すなわ
ち、チップ領域1外の適当な場所にはチップアライメン
トマーク2−1、2−2が設けられている。他方、チッ
プ領域1内の適当な場所たとえば4隅には位置精度測定
用パターン3−1、3−2、3−3、3−4が設けられ
ている。チップアライメントマーク2−1、2−2及び
位置精度測定用パターン3−1、3−2、3−3、3−
4はレーザビームもしくは荷電粒子によってスキャンさ
れ、この結果得られる反射光あるいは反射荷電粒子を検
出することにより検出される。
【0003】始めに、チップアライメントマーク2−
1、2−2を検出することによりチップ原点(0,0)
を計算する。次いで、チップ原点(0,0)を基準とし
て位置精度測定用パターン3−1、3−2、3−3、3
−4の位置を検出する。たとえば、図9の位置精度測定
パターン3−3の拡大図である図10を参照すると、位
置精度測定用パターン−3はI型パターン3−3x、
3−3yにより構成されている。I型パターン3−3x
にはレーザビーム(もしくは荷電粒子ビーム)4xをX
方向にスキャンして反射特性5xを得る。このときのパ
ターンエッジ位置をx1 、x2 とすれば、I型パターン
3−3xの中心線の位置xは、 x=(x1+x2)/2 となる。同様に、I型パターン3−3yにはレーザビー
ム(もしくは荷電粒子ビーム)4yをY方向にスキャン
して反射特性5yを得る。このときのパターンエッジ位
置をy1 、y2 とすれば、I型パターン3−3yの中心
線の位置yは、 y=(y1+y2)/2 となる。
【0004】上述のごとくして得られた位置座標(x,
y)は設計上の位置座標と比較することによりレチクル
の合否判定を行ったり、あるいは位置精度情報に変換し
て製造プロセスにフィードバックする。なお、設計上の
位置座標は事前にドキュメントもしくはデータベースと
して設計者からレチクル製造者へ通知されている。
【0005】
【発明が解決しようとする課題】しかしながら、上述の
従来のレチクルでは、各レイヤで位置精度測定用パター
ンを同一にしても半導体装置(ウエハ)上に成膜した場
合には各レイヤで位置精度測定用パターンを同一にする
ことは実質的に不可能であった。つまり、図11の
(A)に示すように、レチクル3レイヤでI型パターン
3−3x−1、3−3x−2、3−3x−3、3−3y
−1、3−3y−2、3−3y−3を同一座標(x,
y)としても、図11の(B)に示すごとく、ウエハプ
ロセスでは位置精度測定用パターンによる各種膜が堆積
するので、剥れ易く、この結果、同一座標(x,y)に
ならないからである。上述のウエハプロセスでの各種膜
の堆積を防ぐために、図12の(A)に示すごとく、3
レイヤで位置精度測定用パターンを異なる座標(x1
1)、(x2,y2)、(x3 ,y3)とすると、図12の
(B)に示すごとく、各種膜は堆積しないが、半導体チ
ップ設計、レチクル設計、マスク設計が頻雑となる。た
とえば、位置精度測定用パターンを各チップ領域に4つ
配置し、20レイヤが必要である半導体装置において
は、80(=20×4)の設計上の位置座標が必要とな
る。この結果、歩留りの低下を招くという課題がある。
【0006】上述のレチクルでの課題はマスクにおいて
も発生する。従って、本発明の目的は、各レイヤで位置
精度測定用パターンの位置座標をウエハプロセスにおい
ても同一としたレチクルアセンブリを提供することにあ
る。他の目的は、各レイヤで位置精度測定用パターンの
位置座標をウエハプロセスにおいても同一としたマスク
アセンブリを提供することにある。
【0007】
【課題を解決するための手段】上述の課題を解決するた
めに本発明は、1つの半導体装置を製造するための複数
のレチクル(あるいはマスク)よりなるレチクルアセン
ブリ(あるいはマスクアセンブリ)において、各レチク
ル(あるいはマスク)は位置精度測定用の複数のI型パ
ターン(もしくはL型パターン)の対を有し、これらの
I型パターン(あるいはL型パターン)の対は半導体装
置上で互いに重ならないにし、複数のI型パターン(あ
るいはL型パターン)の対の中心線の交点は半導体装置
上で同一となるようにしたものである。
【0008】
【発明の実施の形態】図1は本発明に係るレチクルの第
1の実施の形態を示す平面図である。図9の位置精度測
定用パターン3−1〜3−4の代りに位置精度測定用パ
ターン3’−1〜3’−4を設けてある。位置精度測定
用パターンたとえば3’−3は、図2に示すように、X
方向スキャン用としての1対のI型パターン3’−3x
及びY方向スキャン用としての1対のI型パターン3’
−3yにより構成されている。
【0009】I型パターン3’−3xにはレーザビーム
(もしくは荷電粒子ビーム)4xをX方向にスキャンし
て反射特性5’xを得る。このときのパターンエッジ位
置をx1 、x2 、x3 、x4 とすれば、I型パターン
3’−3xの中心線の位置xは、 x=(x1+x2+x3+x4)/4 となる。同様に、I型パターン3' −3yにはレーザビ
ーム(もしくは荷電粒子ビーム)4yをY方向にスキャ
ンして反射特性5’yを得る。このときのパターンエッ
ジ位置をy1 、y2 、y3 、y4 とすれば、I型パター
ン3’−3yの中心線の位置yは、 y=(y1+y2+y3+y4)/4 となる。
【0010】図3は1つの半導体装置を製造するために
図1、図2のレチクルの3レイヤの位置精度測定用パタ
ーンを示し、(A)は平面図、(B)は(A)のB−B
線断面図である。すなわち、第2のレチクルのI型パタ
ーン3’−3x−2、3’−3y−2のピッチは、第1
のレチクルのI型パターン3’−3x−1、3’−3y
−1のピッチより大きく、また、第3のレチクルのI型
パターン3’−3x−3、3’−3y−3のピッチは、
第2のレチクルのI型パターン3’−3x−2、3’−
3y−2のピッチより大きい。しかも、第1のレチクル
のI型パターン3’−3x−1、3’−3y−1の中心
線の交点は(x,y)であり、第2のレチクルのI型パ
ターン3’−3x−2、3’−3y−2の中心線の交点
は(x,y)であり、第のレチクルのI型パターン
3’−3x−3、3’−3y−3の中心線の交点は
(x,y)であり、同一である。従って、図3の(A)
に示す3レイヤレチクルを用いてウエハプロセスを実行
しても、図3の(B)に示すごとく、位置精度測定用パ
ターンによる各種膜は単独であり、堆積しない。
【0011】なお、図において、各I型パターンは幅
1〜10μm、長さ5〜20μmであり、各レチクルの
I型パターンのピッチは2〜5μmである。
【0012】図4は図1、図2のレチクルをウエハに対
応するマスクに適用した場合を示す。なお、図4におけ
る41はマスクにおけるウエハ形状、42はチップパタ
ーンを示す。各チップパターン42には図1、図2の場
合と同様に、位置精度測定用パターン3’−1〜3’−
4が設けられており、1つの半導体装置を製造する場合
の各マスクの位置精度測定用パターン3’−1〜3’−
4のI型パターンのピッチは異なり、半導体装置上に成
膜された場合には、各種膜は単独であり、堆積しない。
また、各マスクの位置精度測定用パターンの中心線の交
点は同一である。
【0013】図5は本発明に係るレチクルの第2の実施
の形態を示す平面図である。図1の位置精度測定用パタ
ーン3’−1〜3’−4の代りに位置精度測定用パター
ン3”−1〜3”−4を設けてある。位置精度測定用パ
ターンたとえば3”−3は、図に示すように、X方向
スキャン用及びYスキャン用としての1対のL型パター
ン3”−3により構成されている。
【0014】L型パターン3”−3−1のY方向部分に
はレーザビーム(もしくは荷電粒子ビーム)4xをX方
向にスキャンして反射特性5’xを得る。このときのパ
ターンエッジ位置をx1 、x2 、x3 、x4 とすれば、
L型パターン3”−3−1のY方向部分の中心線の位置
xは、 x=(x1+x2+x3+x4)/4 となる。同様に、L型パターン3”−3−1のX方向部
分にはレーザビーム(もしくは荷電粒子ビーム)4yを
Y方向にスキャンして反射特性5’yを得る。このとき
のパターンエッジ位置をy1 、y2 、y3 、y4 とすれ
ば、L型パターン3”−3−1のX方向部分の中心線の
位置yは、 y=(y1+y2+y3+y4)/4 となる。
【0015】図7は1つの半導体装置を製造するために
図5、図6のレチクルの3レイヤの位置精度測定用パタ
ーンを示し、(A)は平面図、(B)は(A)のB−B
線断面図である。すなわち、第2のレチクルのL型パタ
ーン3’−3−2のピッチは、第1のレチクルのL型パ
ターン3’−3−1のピッチより大きく、また、第3の
レチクルのL型パターン3’−3−3のピッチは、第2
のレチクルのL型パターン3’−3−2のピッチより大
きい。しかも、第1のレチクルのL型パターン3’−3
−1の中心線の交点は(x,y)であり、第2のレチク
ルのL型パターン3’−3−2の中心線の交点は(x,
y)であり、第のレチクルのL型パターン3’−3−
3の中心線の交点は(x,y)であり、同一である。従
って、図7の(A)に示す3レイヤレチクルを用いてウ
エハプロセスを実行しても、図7の(B)に示すごと
く、位置精度測定用パターンによる各種膜は単独であ
り、堆積しない。
【0016】なお、図7において、各L型パターンは幅
1〜10μm、長さ15〜50μmであり、各レチクル
のL型パターンのピッチは2〜5μmである。
【0017】図8は図5、図6のレチクルをウエハに対
応するマスクに適用した場合を示す。なお、図8におけ
る81はマスクにおけるウエハ形状、82はチップパタ
ーンを示す。各チップパターン82には図5、図6の場
合と同様に、位置精度測定用パターン3”−1〜3”−
4が設けられており、1つの半導体装置を製造する場合
の各マスクの位置精度測定用パターン3”−1〜3”−
4のL型パターンのピッチは異なり、半導体装置上に成
膜された場合には、各種膜は単独であり、堆積しない。
また、各マスクの位置精度測定用パターンの中心線の交
点は同一である。
【0018】
【発明の効果】以上説明したように本発明によれば、レ
チクルアセンブリ及びマスクアセンブリの各レイヤで位
置精度測定用パターンの位置座標をウエハプロセスにお
いて同一にできる。
【図面の簡単な説明】
【図1】本発明に係るレチクルの第1の実施の形態を示
す平面図である。
【図2】図1の部分拡大図である。
【図3】図1のレチクルの3レイヤを重ねた場合の位置
精度測定用パターンを示し、(A)は平面図、(B)は
(A)のB−B線断面図である。
【図4】図1、図2のレチクルをマスクに適用した場合
を示し、(A)は全体平面図、(B)は部分拡大図であ
る。
【図5】本発明に係るレチクルの第2の実施の形態を示
す平面図である。
【図6】図5の部分拡大図である。
【図7】図5のレチクルの3レイヤを重ねた場合の位置
精度測定用パターンを示し、(A)は平面図、(B)は
(A)のB−B線断面図である。
【図8】図5、図6のレチクルをマスクに適用した場合
を示し、(A)は全体平面図、(B)は部分拡大図であ
る。
【図9】従来のレチクルを示す平面図である。
【図10】図9の部分拡大図である。
【図11】図9のレチクルの3レイヤを重ねた場合の位
置精度測定用パターンを示し、(A)は平面図、(B)
は(A)のB−B線断面図である。
【図12】図9のレチクルの3レイヤを重ねた場合の位
置精度測定用パターンを示し、(A)は平面図、(B)
は(A)のB−B線断面図である。
【符号の説明】
1…チップ領域 2−1、2−2…チップアライメントマーク 3−1〜3−4、3’−1〜3’−4、3”−1〜3”
−4…位置精度測定用パターン 41、81…ウエハ形状 42、82…チップパターン
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平3−137646(JP,A) 特開 平6−202311(JP,A) 特開 平5−47621(JP,A) 特開 平7−226365(JP,A) 特開 昭61−46021(JP,A) 実願 昭63−103832号(実開 平2− 26225号)の願書に添付した明細書及び 図面の内容を撮影したマイクロフィルム (JP,U) (58)調査した分野(Int.Cl.6,DB名) G03F 1/08 - 1/16 H01L 21/027

Claims (8)

    (57)【特許請求の範囲】
  1. 【請求項1】 1つの半導体装置を製造するための複数
    のレチクルよりなるレチクルアセンブリにおいて、 前記各レチクルは位置精度測定用の複数のI型パターン
    の対を有し、前記各レチクルの各I型パターンは前記半
    導体装置上で互いに重ならないにし、前記各レチクル
    複数のI型パターンの対の中心線の交点は前記半導体装
    置上で同一となるようにしたことを特徴とするレチクル
    アセンブリ。
  2. 【請求項2】 前記複数のI型パターンの対のピッチを
    前記各レチクル毎に異ならせた請求項1に記載のレチク
    ルアセンブリ。
  3. 【請求項3】 1つの半導体装置を製造するための複数
    のレチクルよりなるレチクルアセンブリにおいて、 前記各レチクルは位置精度測定用の複数のL型パターン
    の対を有し、前記各レチクルの各L型パターンは前記半
    導体装置上で互いに重ならないにし、前記各レチクル
    数のL型パターンの対の中心線の交点は前記半導体装置
    上で同一となるようにしたことを特徴とするレチクルア
    センブリ。
  4. 【請求項4】 前記複数のL型パターンの対のピッチを
    前記各レチクル毎に異ならせた請求項3に記載のレチク
    ルアセンブリ。
  5. 【請求項5】 1つの半導体装置を製造するための複数
    のマスクよりなるマスクアセンブリにおいて、 前記各マスクは位置精度測定用の複数のI型パターン
    を有し、各マスクの各I型パターンは前記半導体装置
    上で互いに重ならないにし、前記各マスクの複数のI型
    パターンの対の中心線の交点は前記半導体装置上で同一
    となるようにしたことを特徴とするマスクアセンブリ。
  6. 【請求項6】 前記複数のI型パターンの対のピッチを
    前記各マスク毎に異ならせた請求項5に記載のマスクア
    センブリ。
  7. 【請求項7】 1つの半導体装置を製造するための複数
    のマスクよりなるマスクアセンブリにおいて、 前記各マスクは位置精度測定用の複数のL型パターン
    を有し、各マスクの各L型パターンは前記半導体装置
    上で互いに重ならないにし、前記各マスクの複数のL型
    パターンの対の中心線の交点は前記半導体装置上で同一
    となるようにしたことを特徴とするマスクアセンブリ。
  8. 【請求項8】 前記複数のL型パターンの対のピッチを
    前記各マスク毎に異ならせた請求項7に記載のマスクア
    センブリ。
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