JP2919850B2 - 液晶表示装置の駆動回路 - Google Patents
液晶表示装置の駆動回路Info
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- JP2919850B2 JP2919850B2 JP6840989A JP6840989A JP2919850B2 JP 2919850 B2 JP2919850 B2 JP 2919850B2 JP 6840989 A JP6840989 A JP 6840989A JP 6840989 A JP6840989 A JP 6840989A JP 2919850 B2 JP2919850 B2 JP 2919850B2
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- JP
- Japan
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- liquid crystal
- display
- dots
- display pattern
- circuit
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- Liquid Crystal Display Device Control (AREA)
Description
【発明の詳細な説明】 〔概要〕 液晶表示装置の表示を行なうための駆動回路に関し、 いかなる表示パターンにおいても最良の表示品質で見
易くすることを目的とし、 隣接する２ラインの表示データを比較することを繰り
返して、１画面分の表示パターンにおけるオンからオフ
に変化するドット数、及び、オフからオンに変化するド
ット数の割合を数量化する表示パターン数量化回路と、
表示パターン数量化回路にて数量化された値に応じて液
晶交流化信号の周波数を変化させる周波数可変回路とを
設けた構成とする。
易くすることを目的とし、 隣接する２ラインの表示データを比較することを繰り
返して、１画面分の表示パターンにおけるオンからオフ
に変化するドット数、及び、オフからオンに変化するド
ット数の割合を数量化する表示パターン数量化回路と、
表示パターン数量化回路にて数量化された値に応じて液
晶交流化信号の周波数を変化させる周波数可変回路とを
設けた構成とする。
本発明は、液晶表示装置の表示を行なうための駆動回
路に関する。
路に関する。
近年、液晶表示装置は表示容量の増大化の傾向にあ
り、後述するようなクロストークが原因による表示品質
の悪化が表示容量の増大化に伴なって更に目立つように
なり、これを改善する必要がある。
り、後述するようなクロストークが原因による表示品質
の悪化が表示容量の増大化に伴なって更に目立つように
なり、これを改善する必要がある。
第６図は一般の液晶表示装置の駆動回路の概略図を示
す。同図において、表示パネル１にマトリクス状に設け
られた液晶セル211,212,…は走査側駆動回路３からの各
ラインY1,Y2,…毎に時分割出力される走査パルルとデー
タ側駆動回路４からのデータパルスとを重畳印加される
ことにより、データパルスに対応したオン、オフ情報に
従って表示される。例えば第６図に示すような表示パタ
ーン（黒丸がオンドット、白丸がオフドット）を得る場
合、液晶セル211に印加される電圧は第７図（Ａ）、液
晶セル212に印加される電圧は第７図（Ｂ），液晶セル2
21に印加される電圧は第７図（Ｃ）に示す如くである。
す。同図において、表示パネル１にマトリクス状に設け
られた液晶セル211,212,…は走査側駆動回路３からの各
ラインY1,Y2,…毎に時分割出力される走査パルルとデー
タ側駆動回路４からのデータパルスとを重畳印加される
ことにより、データパルスに対応したオン、オフ情報に
従って表示される。例えば第６図に示すような表示パタ
ーン（黒丸がオンドット、白丸がオフドット）を得る場
合、液晶セル211に印加される電圧は第７図（Ａ）、液
晶セル212に印加される電圧は第７図（Ｂ），液晶セル2
21に印加される電圧は第７図（Ｃ）に示す如くである。
この場合、一般に液晶セルには交流信号を印加する必
要があるので、第７図（Ｄ）に示すような１フレーム単
位で極性が反転する液晶交流化信号を重畳されたデータ
パルスを作っている。このため、液晶セルには第７図
（Ａ）〜（Ｃ）に示すような交流電圧が印加される。な
お、第７図（Ａ）〜（Ｃ）にON,OFFで示す電圧（走査パ
ルスのタイミング）以外のタイミングは他の液晶セルを
走査している非選択期間である。
要があるので、第７図（Ｄ）に示すような１フレーム単
位で極性が反転する液晶交流化信号を重畳されたデータ
パルスを作っている。このため、液晶セルには第７図
（Ａ）〜（Ｃ）に示すような交流電圧が印加される。な
お、第７図（Ａ）〜（Ｃ）にON,OFFで示す電圧（走査パ
ルスのタイミング）以外のタイミングは他の液晶セルを
走査している非選択期間である。
ところで、第６図に示す如く、例えばX1ラインが１ド
ットずつオン、オフを繰返す表示パターン、X2ラインが
全ドットオフの表示パターンを得る場合、非選択期間に
おけるオンのデータパルスの数によって同じオフのドッ
トでもX1ラインのオフドットとX2ラインのオフドットで
も輝度が異なる。これは、液晶セルは等価的に抵抗及び
コンデンサで構成された回路とみなし得るので、隣接す
る液晶セルのオン情報がクロストークされるからであ
る。このクロストークによる表示品質の悪化は、表示容
量の増大化に伴って駆動パルス周波数が高くなると更に
目立つようになる。
ットずつオン、オフを繰返す表示パターン、X2ラインが
全ドットオフの表示パターンを得る場合、非選択期間に
おけるオンのデータパルスの数によって同じオフのドッ
トでもX1ラインのオフドットとX2ラインのオフドットで
も輝度が異なる。これは、液晶セルは等価的に抵抗及び
コンデンサで構成された回路とみなし得るので、隣接す
る液晶セルのオン情報がクロストークされるからであ
る。このクロストークによる表示品質の悪化は、表示容
量の増大化に伴って駆動パルス周波数が高くなると更に
目立つようになる。
そこで、従来、液晶交流化信号の周波数を第７図
（Ｅ）に示すように少し高くとり、非選択期間における
各ライン間のオフドットの液晶印加電圧の差を少なくし
て輝度差を少なくするようにしていた。このようにすれ
ば、クロストークによる表示品質の悪化は多少改善され
る。
（Ｅ）に示すように少し高くとり、非選択期間における
各ライン間のオフドットの液晶印加電圧の差を少なくし
て輝度差を少なくするようにしていた。このようにすれ
ば、クロストークによる表示品質の悪化は多少改善され
る。
然るに、前記クロストークの程度は表示パターンによ
り（即ち、非選択期間におけるオンドット、オフドット
の割合）変る。このため、いかなる表示パターンにおい
ても第７図（Ｅ）に示す液晶交流化信号に限ってしまう
と、表示パターンによってはかえって各ライン間のオフ
ドットの輝度差が大きくなってしまうことがあり、完全
な表示品質の向上にはなっていない問題点があった。
り（即ち、非選択期間におけるオンドット、オフドット
の割合）変る。このため、いかなる表示パターンにおい
ても第７図（Ｅ）に示す液晶交流化信号に限ってしまう
と、表示パターンによってはかえって各ライン間のオフ
ドットの輝度差が大きくなってしまうことがあり、完全
な表示品質の向上にはなっていない問題点があった。
本発明は、いかなる表示パターンにおいても最良の表
示品質で見易くできる液晶表示装置の駆動回路を提供す
ることを目的とする。
示品質で見易くできる液晶表示装置の駆動回路を提供す
ることを目的とする。
第１図は本発明の原理ブロック図を示す。同図中、20
は表示パターン数量化回路で、隣接する２ラインの表示
データを比較することを繰り返して、１画面分の表示パ
ターンにおけるオンからオフに変化するドット数、及
び、オフからオンに変化するドット数の割合を数量化す
る。
は表示パターン数量化回路で、隣接する２ラインの表示
データを比較することを繰り返して、１画面分の表示パ
ターンにおけるオンからオフに変化するドット数、及
び、オフからオンに変化するドット数の割合を数量化す
る。
21は周波数可変回路で、表示パターン数量化回路20に
て数量化された値に応じて液晶交流信号の周波数を可変
して取出す。
て数量化された値に応じて液晶交流信号の周波数を可変
して取出す。
隣接する２ラインの表示データにおいて、オンドット
とオフドットとの組合せはオンドットどうし又はオフド
ットどうしの組合せに比して負荷が大きい。即ち、オン
ドットからオフドットへのクロストークにより、オフド
ットにも輝度を生じてしまう。そこで、１画面分の表示
パターンにおけるオンからオフに変化するドット数、及
び、オフからオンに変化するドット数の割合（以下、負
荷割合と称す）を数量化し、この値に応じて液晶交流化
信号の周波数を可変し、負荷割合が大きければ高周波
数、負荷割合が小さければ低周波数となるようにする。
これにより、いかなる表示パターンにおいても非選択期
間における各ライン間のオフドットの輝度差が少なくな
る。
とオフドットとの組合せはオンドットどうし又はオフド
ットどうしの組合せに比して負荷が大きい。即ち、オン
ドットからオフドットへのクロストークにより、オフド
ットにも輝度を生じてしまう。そこで、１画面分の表示
パターンにおけるオンからオフに変化するドット数、及
び、オフからオンに変化するドット数の割合（以下、負
荷割合と称す）を数量化し、この値に応じて液晶交流化
信号の周波数を可変し、負荷割合が大きければ高周波
数、負荷割合が小さければ低周波数となるようにする。
これにより、いかなる表示パターンにおいても非選択期
間における各ライン間のオフドットの輝度差が少なくな
る。
第２図は本発明の一実施例のブロック図を示す。同図
において、表示データ（D1〜D4の４ビット構成とする）
（第３図（Ｂ））はデータ変換回路10に供給され、取込
み信号（CPX）（第３図（Ａ））にてここに取込まれ、
周波数逓倍回路11で得られた取込み信号の４倍の周波数
の変換信号（CPX×４）（第４図（Ａ））で１ビットの
シリアルデータとして取出され、ラインメモリ12及びエ
クスクルシブオアゲート13に供給される。例えば、Ynラ
インのデータは周波数逓倍回路11からの書込み信号（CP
X×４）及びロード信号（１ライン毎に出力される）
（第４図（Ｅ））に同期してラインメモリ12に蓄えら
れ、読出し信号（CPX×４）にて第４図（Ｂ）に示す如
く取出されてエクスクルシブオアゲート13に供給され、
Ynラインのデータがラインメモリ12から取出されるとき
Yn+1ラインのデータはデータ変換回路10から第４図
（Ｃ）に示す如く取出されてエクスクルシブオアゲート
13に供給される。ラインメモリ12には、640×400ドット
の表示パネルの場合、640個のデータ（１ライン分）が
格納される。
において、表示データ（D1〜D4の４ビット構成とする）
（第３図（Ｂ））はデータ変換回路10に供給され、取込
み信号（CPX）（第３図（Ａ））にてここに取込まれ、
周波数逓倍回路11で得られた取込み信号の４倍の周波数
の変換信号（CPX×４）（第４図（Ａ））で１ビットの
シリアルデータとして取出され、ラインメモリ12及びエ
クスクルシブオアゲート13に供給される。例えば、Ynラ
インのデータは周波数逓倍回路11からの書込み信号（CP
X×４）及びロード信号（１ライン毎に出力される）
（第４図（Ｅ））に同期してラインメモリ12に蓄えら
れ、読出し信号（CPX×４）にて第４図（Ｂ）に示す如
く取出されてエクスクルシブオアゲート13に供給され、
Ynラインのデータがラインメモリ12から取出されるとき
Yn+1ラインのデータはデータ変換回路10から第４図
（Ｃ）に示す如く取出されてエクスクルシブオアゲート
13に供給される。ラインメモリ12には、640×400ドット
の表示パネルの場合、640個のデータ（１ライン分）が
格納される。
エクスクルシブオアゲート13にてYnラインのデータ
（第４図（Ｂ））とYn+1ラインのデータ（第４図
（Ｃ））とのエクスクルシブオアがとられ、第４図
（Ｄ）に示す出力信号が得られる。この場合、表示パタ
ーンは第５図に示す如くであり、隣接ラインにおけるオ
ンドット、オフドットの組合せは３個所であるので、エ
クスクルシブオアゲート13の出力信号（第４図（Ｄ））
はＨレベル３個に相当する信号となる。エクスクルシブ
オアゲート13の出力信号（第４図（Ｄ））は１フレーム
カウンタ14にて周波数逓倍回路11のカウント信号（CPX
×４）でカウントされ、この場合のカウント値は３であ
る。このようにして、隣接する２ラインどうしのドット
のエクスクルシブオアをとられた信号が１フレームカウ
ンタ14に次々にカウントされ、ここに蓄えられる。１フ
レームカウンタ14はフレーム信号にて１フレーム毎にそ
のカウント値をカウント値変換器15に出力すると共に、
そのカウント値をクリアする。
（第４図（Ｂ））とYn+1ラインのデータ（第４図
（Ｃ））とのエクスクルシブオアがとられ、第４図
（Ｄ）に示す出力信号が得られる。この場合、表示パタ
ーンは第５図に示す如くであり、隣接ラインにおけるオ
ンドット、オフドットの組合せは３個所であるので、エ
クスクルシブオアゲート13の出力信号（第４図（Ｄ））
はＨレベル３個に相当する信号となる。エクスクルシブ
オアゲート13の出力信号（第４図（Ｄ））は１フレーム
カウンタ14にて周波数逓倍回路11のカウント信号（CPX
×４）でカウントされ、この場合のカウント値は３であ
る。このようにして、隣接する２ラインどうしのドット
のエクスクルシブオアをとられた信号が１フレームカウ
ンタ14に次々にカウントされ、ここに蓄えられる。１フ
レームカウンタ14はフレーム信号にて１フレーム毎にそ
のカウント値をカウント値変換器15に出力すると共に、
そのカウント値をクリアする。
カウント値変換器15は１フレームカウンタ14の出力を
この値に応じて次段の16進のプリセットカウンタ16のフ
ルカウント値16以下の値に変換する回路で、その変換出
力は、１フレームカウンタ14の値が大きい程プリセット
カウンタ16のフルカウント値16に近くなるように構成さ
れている。１フレームカウンタ14における１フレーム分
のカウンタ値に応じた変換出力が例えば「12」であると
すると、カウント値変換器15の出力は16進プリセットカ
ウンタ16に供給されてここに「12」がプリセットされ
る。プリセットカウンタ16はロード信号（１ライン毎に
出力される）（第４図（Ｅ））にてロードされ、この場
合は「12」がプリセットされているので「４」をカウン
トした時点で切換信号（第４図（Ｆ））が出力される。
この値に応じて次段の16進のプリセットカウンタ16のフ
ルカウント値16以下の値に変換する回路で、その変換出
力は、１フレームカウンタ14の値が大きい程プリセット
カウンタ16のフルカウント値16に近くなるように構成さ
れている。１フレームカウンタ14における１フレーム分
のカウンタ値に応じた変換出力が例えば「12」であると
すると、カウント値変換器15の出力は16進プリセットカ
ウンタ16に供給されてここに「12」がプリセットされ
る。プリセットカウンタ16はロード信号（１ライン毎に
出力される）（第４図（Ｅ））にてロードされ、この場
合は「12」がプリセットされているので「４」をカウン
トした時点で切換信号（第４図（Ｆ））が出力される。
切換信号（第４図（Ｆ））はデューティ50％信号発生
回路17に供給され、ここで第４図（Ｇ）に示すような周
波数の液晶交流化信号とされ、データパルスはこの液晶
交流化信号に重畳されて出力される。これと同様に、隣
接する２ラインのオンドット、オフドットの組合せ個所
が前記の場合よりも少ないフレームでは、カウント値変
換器15の出力が例えば「10」であるとすると、プリセッ
トカウンタ16は「６」をカウントした時点で切換信号
（第４図（Ｈ））を出力する。これにより、液晶交流化
信号（第４図（Ｉ））は前記の場合（第４図（Ｇ））よ
りも低い周波数とされる。このように、表示パターンに
応じて液晶交流化信号の周波数を異ならせているので、
その表示パターンに最適な輝度を得ることができ、表示
品質を向上できる。
回路17に供給され、ここで第４図（Ｇ）に示すような周
波数の液晶交流化信号とされ、データパルスはこの液晶
交流化信号に重畳されて出力される。これと同様に、隣
接する２ラインのオンドット、オフドットの組合せ個所
が前記の場合よりも少ないフレームでは、カウント値変
換器15の出力が例えば「10」であるとすると、プリセッ
トカウンタ16は「６」をカウントした時点で切換信号
（第４図（Ｈ））を出力する。これにより、液晶交流化
信号（第４図（Ｉ））は前記の場合（第４図（Ｇ））よ
りも低い周波数とされる。このように、表示パターンに
応じて液晶交流化信号の周波数を異ならせているので、
その表示パターンに最適な輝度を得ることができ、表示
品質を向上できる。
以上説明した如く、本発明によれば、表示パターンの
負荷割合に対応して液晶交流化信号の周波数が可変され
るので、いかなる表示パターンにおいてもオフドットど
うしの輝度差が少なくなり、表示品質を向上することが
できる。
負荷割合に対応して液晶交流化信号の周波数が可変され
るので、いかなる表示パターンにおいてもオフドットど
うしの輝度差が少なくなり、表示品質を向上することが
できる。
第１図は本発明の原理ブロック図、 第２図は本発明の一実施例のブロック図、 第３図はパラレル表示データの取込みの様子を説明する
図、 第４図は本発明の動作タイミングチャート、 第５図は表示パターンの一例の図、 第６図は一般の液晶表示装置の駆動回路の概略図、 第７図は第６図に示す表示パターンの液晶セル印加電圧
波形図である。 図において、 １は表示パネル、 211,212,…は液晶セル、 ３は走査側駆動回路、 ４はデータ側駆動回路、 10はデータ変換回路、 12はラインメモリ、 13はエクスクルシブオアゲート、 14は１フレームカウンタ、 15はカウント値変換器、 16は16進プリセットカウンタ、 17はデューティ50％信号発生回路、 20は表示パターン数量化回路、 21は周波数可変回路 を示す。
図、 第４図は本発明の動作タイミングチャート、 第５図は表示パターンの一例の図、 第６図は一般の液晶表示装置の駆動回路の概略図、 第７図は第６図に示す表示パターンの液晶セル印加電圧
波形図である。 図において、 １は表示パネル、 211,212,…は液晶セル、 ３は走査側駆動回路、 ４はデータ側駆動回路、 10はデータ変換回路、 12はラインメモリ、 13はエクスクルシブオアゲート、 14は１フレームカウンタ、 15はカウント値変換器、 16は16進プリセットカウンタ、 17はデューティ50％信号発生回路、 20は表示パターン数量化回路、 21は周波数可変回路 を示す。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭62−157010（ＪＰ，Ａ) (58)調査した分野(Int.Cl.6，ＤＢ名) G09G 3/36 G02F 1/133
Claims (1)
- 【請求項１】隣接する２ラインの表示データを比較する
ことを繰り返して、１画面分の表示パターンにおけるオ
ンからオフに変化するドット数、及び、オフからオンに
変化するドット数の割合を数量化する表示パターン数量
化回路と、 前記表示パターン数量化回路にて数量化された値に応じ
て液晶交流化信号の周波数を変化させる周波数可変回路
とを設けたことを特徴とする液晶表示装置の駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6840989A JP2919850B2 (ja) | 1989-03-20 | 1989-03-20 | 液晶表示装置の駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6840989A JP2919850B2 (ja) | 1989-03-20 | 1989-03-20 | 液晶表示装置の駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02247689A JPH02247689A (ja) | 1990-10-03 |
| JP2919850B2 true JP2919850B2 (ja) | 1999-07-19 |
Family
ID=13372849
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6840989A Expired - Lifetime JP2919850B2 (ja) | 1989-03-20 | 1989-03-20 | 液晶表示装置の駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2919850B2 (ja) |
-
1989
- 1989-03-20 JP JP6840989A patent/JP2919850B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02247689A (ja) | 1990-10-03 |
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