JP2837970B2 - Ｉｃカード - Google Patents

Ｉｃカード

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JP2837970B2 JP7939191A JP7939191A JP2837970B2 JP 2837970 B2 JP2837970 B2 JP 2837970B2 JP 7939191 A JP7939191 A JP 7939191A JP 7939191 A JP7939191 A JP 7939191A JP 2837970 B2 JP2837970 B2 JP 2837970B2
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    • G07F7/08—Mechanisms actuated by objects other than coins to free or to actuate vending, hiring, coin or paper currency dispensing or refunding apparatus by coded identity card or credit card or other personal identification means
    • G07F7/10—Mechanisms actuated by objects other than coins to free or to actuate vending, hiring, coin or paper currency dispensing or refunding apparatus by coded identity card or credit card or other personal identification means together with a coded signal, e.g. in the form of personal identification information, like personal identification number [PIN] or biometric data
    • G07F7/1008—Active credit-cards provided with means to personalise their use, e.g. with PIN-introduction/comparison system
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06Q—INFORMATION AND COMMUNICATION TECHNOLOGY [ICT] SPECIALLY ADAPTED FOR ADMINISTRATIVE, COMMERCIAL, FINANCIAL, MANAGERIAL OR SUPERVISORY PURPOSES; SYSTEMS OR METHODS SPECIALLY ADAPTED FOR ADMINISTRATIVE, COMMERCIAL, FINANCIAL, MANAGERIAL OR SUPERVISORY PURPOSES, NOT OTHERWISE PROVIDED FOR
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    • G06Q20/30—Payment architectures, schemes or protocols characterised by the use of specific devices or networks
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Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】この発明は、ＩＣカードに係り、
特にコマンド入力タイプの電気的書き込み及び一括消去
可能なメモリ半導体素子を複数個内蔵するＩＣカードに
関する。
【０００２】
【従来の技術】図２は従来のこの種のＩＣカードの回路
構成を示すブロック図である。アドレスデコーダ１に、
互いに同様の構成を有する二つのメモリ半導体素子２及
び３が接続されている。これらのメモリ半導体素子２及
び３は、それぞれ外部からコマンドを入力してそのコマ
ンドにより動作モードが決定されるコマンド入力タイプ
の素子であると共に電気的書き込み及び一括消去をする
ことができる。アドレスデコーダ１にはアドレスバス７
のうちの一部の信号線７ａとカードイネーブル信号線６
とが接続されている。各メモリ半導体素子２及び３に
は、それぞれアドレスバス７、読み出し制御信号線８、
書き込み制御信号線９、データバス１０及びプログラム
電源線１１が接続されている。また、アドレスデコーダ
１とメモリ半導体素子２及び３とがそれぞれチップイネ
ーブル信号線１２及び１３により接続されている。カー
ドイネーブル信号線６、読み出し制御信号線８及び書き
込み制御信号線９はそれぞれ抵抗１６、１７及び１８に
より電源にプルアップされている。
【０００３】ここで、メモリ半導体素子２の内部構成を
図３に示す。メモリセルアレイ２０にＸアドレスデコー
ダ２１及びＹアドレスデコーダ２２を介してアドレスバ
ス７が接続されると共にデータ入出力回路２４を介して
データバス１０が接続されている。データバス１０には
コマンドラッチ回路２５も接続されており、さらにＸア
ドレスデコーダ２１、Ｙアドレスデコーダ２２、データ
入出力回路２４及びコマンドラッチ回路２５に制御論理
回路２３が接続されている。この制御論理回路２３にチ
ップイネーブル信号線１２、読み出し制御信号線８、書
き込み制御信号線９及びプログラム電源線１１が接続さ
れている。
【０００４】このメモリ半導体素子２の読み出し時に
は、チップイネーブル信号線１２を“Ｌ"レベル、読み
出し制御信号線８を“Ｌ"レベル、書き込み制御信号線
９を“Ｈ"レベルにすると共にプログラム電源線１１に
通常の電源電圧を印加する。そして、アドレスバス７上
に所望のアドレスを指定すると、そのアドレスに対応す
るメモリセルがＸアドレスデコーダ２１及びＹアドレス
デコーダ２２によりメモリセルアレイ２０の中から選択
され、そのメモリセルに記憶されていたデータがデータ
入出力回路２４を介してデータバス１０に出力される。
【０００５】一方、書き込み及び一括消去の場合は、プ
ログラム電源線１１のプログラム電圧を印加し、チップ
イネーブル信号線１２を“Ｌ"レベル、読み出し制御信
号線８を“Ｈ"レベル、書き込み制御信号線９を“Ｌ"レ
ベルにする。この状態で、データバス１０からコマンド
を入力すると、コマンドはコマンドラッチ回路２５に保
持され、このコマンドの内容により書き込みとなるか一
括消去となるかが決定される。
【０００６】そして、書き込みの場合は、チップイネー
ブル信号線１２を“Ｌ"レベル、読み出し制御信号線８
を“Ｈ"レベル、書き込み制御信号線９を“Ｌ"レベルと
してデータバス１０にデータを入力することによりこれ
を所望のアドレスのメモリセルに書き込み、さらにチッ
プイネーブル信号線１２を“Ｌ"レベル、読み出し制御
信号線８を“Ｌ"レベル、書き込み制御信号線９を“Ｈ"
レベルとして書き込んだデータをデータバス１０上に読
み出し、所定のアルゴリズムによりベリファイを行う。
【０００７】また、一括消去の場合は、書き込みの場合
と同様にチップイネーブル信号線１２を“Ｌ"レベル、
読み出し制御信号線８を“Ｈ"レベル、書き込み制御信
号線９を“Ｌ"レベルとしてメモリセルアレイ２０内の
全てのメモリセルの内容を消去した後、チップイネーブ
ル信号線１２を“Ｌ"レベル、読み出し制御信号線８を
“Ｌ"レベル、書き込み制御信号線９を“Ｈ"レベルとし
て書き込み動作のときとは異なるアルゴリズムにより一
括消去のベリファイを行う。
【０００８】なお、チップイネーブル信号線１２が
“Ｈ"レベルの場合には、他の信号線のレベルに拘わら
ずにメモリ半導体素子２は非活性な状態となり、いずれ
の動作をも行わない。
【０００９】このようなメモリ半導体素子２及び３を内
蔵した図２のＩＣカードを作動させるときには、プログ
ラム電源線１１に所定の電圧を印加すると共にカードイ
ネーブル信号線６を“Ｌ"レベルとするが、このカード
イネーブル信号は信号線７ａを介してアドレスデコーダ
１に入力されるアドレス信号の一部に基づいてデコード
される。その結果、アドレス信号により指定されるアド
レスに応じてメモリ半導体素子２及び３のうちいずれか
一方にアドレスデコーダ１から“Ｌ"レベルのチップイ
ネーブル信号が出力され、そのメモリ半導体素子が活性
状態となる。これにより、上述した各動作を行うことが
可能となる。
【００１０】
【発明が解決しようとする課題】しかしながら、アドレ
スデコーダ１はメモリ半導体素子２及び３に接続されて
いるチップイネーブル信号線１２及び１３の内いずれか
一方を“Ｌ"レベル、他方を“Ｈ"レベルとするので、Ｉ
Ｃカード内の全てのメモリ半導体素子２及び３の記憶内
容を消去しようとする場合には、メモリ半導体素子２及
び３を一つずつ動作させて消去しなければならず、ＩＣ
カード全体としての一括消去ができないという問題点が
あった。このため、多数のメモリ半導体素子を内蔵する
ＩＣカードでは、カード全体の記憶内容の消去に多大の
時間と手間を要していた。この発明はこのような問題点
を解消するためになされたもので、内蔵する全てのメモ
リ半導体素子の記憶内容を一括消去することができるＩ
Ｃカードを提供することを目的とする。
【００１１】
【課題を解決するための手段】この発明に係るＩＣカー
ドは、外部から入力されたコマンドに基づいて動作モー
ドが決定され且つ電気的書き込み及び一括消去可能な複
数のメモリ半導体素子と、アドレス信号に基づいてカー
ドイネーブル信号をデコードし、前記複数のメモリ半導
体素子のうちの一つに選択的にチップイネーブル信号を
出力するアドレスデコーダと、外部から入力されたコマ
ンドが所定のコマンドであるときに前記アドレスデコー
ダのデコード動作を禁止することによりカードイネーブ
ル信号をチップイネーブル信号として全てのメモリ半導
体素子に供給させるデコード禁止手段とを備えたもので
ある。
【００１２】
【作用】この発明においては、外部から入力されたコマ
ンドが所定のコマンドであるときに、デコード禁止手段
がアドレスデコーダのデコード動作を禁止し、これによ
りカードイネーブル信号をチップイネーブル信号として
全てのメモリ半導体素子に供給させる。
【００１３】
【実施例】以下、この発明の実施例を添付図面に基づい
て説明する。図１はこの発明の一実施例に係るＩＣカー
ドの回路構成を示すブロック図である。アドレスデコー
ダ３１に、互いに同様の構成を有する二つのメモリ半導
体素子２及び３が接続されている。これらのメモリ半導
体素子２及び３は、それぞれ外部からコマンドを入力し
てそのコマンドにより動作モードが決定されるコマンド
入力タイプの素子であると共に電気的書き込み及び一括
消去をすることができる。アドレスデコーダ３１にはア
ドレスバス７のうちの一部の信号線７ａとカードイネー
ブル信号線６と読み出し制御信号線８が接続されてい
る。各メモリ半導体素子２及び３には、それぞれアドレ
スバス７、読み出し制御信号線８、書き込み制御信号線
９、データバス１０及びプログラム電源線１１が接続さ
れている。また、アドレスデコーダ３１とメモリ半導体
素子２及び３とがそれぞれチップイネーブル信号線１２
及び１３により接続されている。また、カードイネーブ
ル信号線６、読み出し制御信号線８及び書き込み制御信
号線９はそれぞれ抵抗１６、１７及び１８により電源に
プルアップされている。
【００１４】また、このＩＣカードはコマンドデコーダ
４を有しており、コマンドデコーダ４にカードイネーブ
ル信号線６、書き込み制御信号線９、データバス１０及
びプログラム電源線１１が接続されている。コマンドデ
コーダ４の出力１４がラッチ回路５に接続され、ラッチ
回路５の出力１５がアドレスデコーダ３１に接続されて
いる。さらに、ラッチ回路５には書き込み制御信号線９
が接続されている。これらコマンドデコーダ４及びラッ
チ回路５によりデコード禁止手段が形成されている。な
お、メモリ半導体素子２及び３はそれぞれ図３に示した
ものと同様の内部構成を有している。
【００１５】コマンドデコーダ４は、カードイネーブル
信号線６及び書き込み制御信号線９が共に“Ｌ"レベル
で且つプログラム電源線１１にプログラム電圧が印加さ
れたときに、データバス１０に入力されたデータをデコ
ードし、その内容が一括消去を示す特定のコードである
場合に出力１４を“Ｈ"レベルとする。ラッチ回路５
は、コマンドデコーダ４の出力を書き込み制御信号線９
の立ち上がりでラッチし、これを出力する。アドレスデ
コーダ３１は、ラッチ回路５の出力１５が“Ｌ"レベル
のとき、及びラッチ回路５の出力１５が“Ｈ"レベルで
且つ読み出し制御信号線８が“Ｌ"レベルであるとき
は、通常の動作モードとなり、信号線７ａを介して入力
される一部のアドレス信号に基づいてメモリ半導体素子
２及び３のいずれか一方を選択し、カードイネーブル信
号線６に入力されたカードイネーブル信号をチップイネ
ーブル信号としてチップイネーブル信号線１２あるいは
１３に出力する。一方、ラッチ回路５の出力１５及び読
み出し制御信号線８が共に“Ｈ"レベルのときには、信
号線７ａを介して入力される一部のアドレス信号に拘わ
らず、カードイネーブル信号をそのままチップイネーブ
ル信号として双方のチップイネーブル信号線１２及び１
３に出力する。すなわち、このときアドレスデコーダ３
１のデコード動作が禁止される。
【００１６】次に、このＩＣカードの動作について説明
する。まず、読み出し動作及び書き込み動作を行うとき
には、データバス１０を介して読み出しコマンドあるい
は書き込みコマンドが入力される。これらのコマンドに
対しては、コマンドデコーダ４はその出力１４を“Ｈ"
レベルとすることはない。すなわち、ラッチ回路５の出
力１５は“Ｌ"レベルのままであるので、アドレスデコ
ーダ３１は通常の動作モードとなり、アドレス信号に基
づいてメモリ半導体素子２及び３のいずれか一方を選択
する。従って、図２に示した従来のＩＣカードと同様に
して読み出し動作及び書き込み動作を行うことができ
る。
【００１７】次に、一括消去動作を行うときには、プロ
グラム電源線１１にプログラム電圧を印加すると共にカ
ードイネーブル信号線６及び書き込み制御信号線９を
“Ｌ"レベル、読み出し制御信号線８を“Ｈ"レベルに
し、この状態でデータバス１０を介して一括消去を示す
特定のコードのデータを入力する。その結果、コマンド
デコーダ４は出力１４を“Ｈ"レベルとし、ラッチ回路
５を介してアドレスデコーダ３１に“Ｈ"レベルの信号
が入力される。このとき、読み出し制御信号線８も
“Ｈ"レベルであるので、アドレスデコーダ３１はデコ
ード禁止のモードとなり、アドレスデコーダ３１からチ
ップイネーブル信号線１２及び１３の双方に“Ｌ"レベ
ルのチップイネーブル信号が出力され、双方のメモリ半
導体素子２及び３は共に活性状態となる。従って、デー
タバス１０を介して一括消去のコマンドを入力すること
により、メモリ半導体素子２及び３の記憶内容は同時に
一括消去されることとなる。
【００１８】その後、カードイネーブル信号線６を
“Ｌ"レベル、読み出し制御信号線８を“Ｌ"レベル、書
き込み制御信号線９を“Ｈ"レベルとして一括消去のベ
リファイを行う。このとき、ラッチ回路５の出力１５は
“Ｈ"レベルのままであるので、アドレスデコーダ３１
は通常の動作モードとなり、アドレス信号に基づいてメ
モリ半導体素子２及び３のいずれか一方を選択する。従
って、正常なベリファイ動作を行うことができる。
【００１９】なお、上記の実施例では、二つのメモリ半
導体素子２及び３を内蔵したＩＣカードについて述べた
が、ＩＣカードが三つ以上のメモリ半導体素子を内蔵し
ていても同様の効果が得られる。また、メモリ半導体素
子２及び３は通常の電源電圧とプログラム電圧との二種
類の電源電圧を使用しているが、コマンド入力によって
その動作モードが決定されるタイプのメモリ半導体素子
であれば、単一電源動作のメモリ半導体素子であっても
よい。さらに、メモリ半導体素子の動作モードとして
は、読み出し、書き込み及び一括消去の三つに限定され
るものではなく、例えば部分消去等の他のモードが含ま
れていてもよい。
【００２０】
【発明の効果】以上説明したように、この発明に係るＩ
Ｃカードは、外部から入力されたコマンドに基づいて動
作モードが決定され且つ電気的書き込み及び一括消去可
能な複数のメモリ半導体素子と、アドレス信号に基づい
てカードイネーブル信号をデコードし、前記複数のメモ
リ半導体素子のうちの一つに選択的にチップイネーブル
信号を出力するアドレスデコーダと、外部から入力され
たコマンドが所定のコマンドであるときに前記アドレス
デコーダのデコード動作を禁止することによりカードイ
ネーブル信号をチップイネーブル信号として全てのメモ
リ半導体素子に供給させるデコード禁止手段とを備えて
いるので、内蔵する全てのメモリ半導体素子の記憶内容
を一括消去することができる。
【図面の簡単な説明】
【図１】この発明の一実施例に係るＩＣカードの回路構
成を示すブロック図である。
【図２】従来のＩＣカードの回路構成を示すブロック図
である。
【図３】この発明で用いられるメモリ半導体素子の内部
構成を示す回路図である。
【符号の説明】
２ メモリ半導体素子 ３ メモリ半導体素子 ４ コマンドデコーダ ５ ラッチ回路 ３１ アドレスデコーダ

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項１】 外部から入力されたコマンドに基づいて
    動作モードが決定され且つ電気的書き込み及び一括消去
    可能な複数のメモリ半導体素子と、アドレス信号に基づ
    いてカードイネーブル信号をデコードし、前記複数のメ
    モリ半導体素子のうちの一つに選択的にチップイネーブ
    ル信号を出力するアドレスデコーダと、外部から入力さ
    れたコマンドが所定のコマンドであるときに前記アドレ
    スデコーダのデコード動作を禁止することによりカード
    イネーブル信号をチップイネーブル信号として全てのメ
    モリ半導体素子に供給させるデコード禁止手段とを備え
    たことを特徴とするＩＣカード。
JP7939191A 1991-04-12 1991-04-12 Ｉｃカード Expired - Lifetime JP2837970B2 (ja)

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US07/866,488 US5343030A (en) 1991-04-12 1992-04-10 IC card having flash erase means
EP92303260A EP0508829B1 (en) 1991-04-12 1992-04-10 IC card
DE69215417T DE69215417T2 (de) 1991-04-12 1992-04-10 IC-Karte

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US5343030A (en) 1994-08-30
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