JP2778421B2 - チャージポンプ型位相同期ループ - Google Patents
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- 239000003990 capacitor Substances 0.000 claims description 19
- 230000010355 oscillation Effects 0.000 claims description 16
- 238000007599 discharging Methods 0.000 claims description 3
- 241001122767 Theaceae Species 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
- 238000009499 grossing Methods 0.000 description 2
- 238000013459 approach Methods 0.000 description 1
- 150000001768 cations Chemical class 0.000 description 1
- 238000013016 damping Methods 0.000 description 1
- 230000014509 gene expression Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
- H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
- H03L7/089—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses
- H03L7/0891—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses the up-down pulses controlling source and sink current generators, e.g. a charge pump
- H03L7/0893—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses the up-down pulses controlling source and sink current generators, e.g. a charge pump the up-down pulses controlling at least two source current generators or at least two sink current generators connected to different points in the loop
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- H03L7/093—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal using special filtering or amplification characteristics in the loop
-
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- H03L2207/00—Indexing scheme relating to automatic control of frequency or phase and to synchronisation
- H03L2207/04—Modifications for maintaining constant the phase-locked loop damping factor when other loop parameters change
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- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
【0001】
【産業上の利用分野】本発明は位相同期ループに関し、
特にチャージポンプ型位相同期ループに関する。
特にチャージポンプ型位相同期ループに関する。
【0002】
【従来の技術】MOS集積化回路に適した位相同期ルー
プの構成として、チャージポンプ型位相同期ループがよ
く用いられる。チャージポンプ型位相同期ループの構成
例は、たとえば文献「Charge−Pump Pha
se−Lock Loops,IEEE TRANSA
CTION ON COMMUNICATIONS,V
OL.COM−28,No.11,NOVEMBER
1980」に記載されている。従来のチャージポンプ型
位相同期ループ全体の構成を示す図3を参照すると、こ
のチャージポンプ型位相同期ループは、電圧制御発振回
路31と、ループフィルタ32と、チャージポンプ33
と位相比較器34とを有している。
プの構成として、チャージポンプ型位相同期ループがよ
く用いられる。チャージポンプ型位相同期ループの構成
例は、たとえば文献「Charge−Pump Pha
se−Lock Loops,IEEE TRANSA
CTION ON COMMUNICATIONS,V
OL.COM−28,No.11,NOVEMBER
1980」に記載されている。従来のチャージポンプ型
位相同期ループ全体の構成を示す図3を参照すると、こ
のチャージポンプ型位相同期ループは、電圧制御発振回
路31と、ループフィルタ32と、チャージポンプ33
と位相比較器34とを有している。
【0003】入力INと出力OUTは位相比較器34で
その位相を比較される。入力INの位相が出力OUTの
位相より進んでいればUP信号、遅れていればDOWN
信号が出力される。UPまたはDOWNの信号が出力さ
れる時間は入力INと出力OUTの位相差に相当する時
間である。このUPまたはDOWNの信号がループフィ
ルタ32で平滑され電圧制御発振回路31に入力される
ので、負帰還の作用により出力信号OUTの位相は入力
信号INの位相に近づき、やがて一致する。
その位相を比較される。入力INの位相が出力OUTの
位相より進んでいればUP信号、遅れていればDOWN
信号が出力される。UPまたはDOWNの信号が出力さ
れる時間は入力INと出力OUTの位相差に相当する時
間である。このUPまたはDOWNの信号がループフィ
ルタ32で平滑され電圧制御発振回路31に入力される
ので、負帰還の作用により出力信号OUTの位相は入力
信号INの位相に近づき、やがて一致する。
【0004】さらに、この従来のチャージポンプ型位相
同期ループのループフィルタ32およびチャージポンプ
33の具体的構成を示す図4を参照すると、このループ
フィルタ32は、抵抗値Rの抵抗42と、容量値Cの容
量43とから構成され、チャージポンプ33は、電流値
IPの定電流源44および45と、信号UPにて開閉が
制御されるスイッチ46と、信号DOWNにて開閉が制
御されるスイッチ47とから構成される。
同期ループのループフィルタ32およびチャージポンプ
33の具体的構成を示す図4を参照すると、このループ
フィルタ32は、抵抗値Rの抵抗42と、容量値Cの容
量43とから構成され、チャージポンプ33は、電流値
IPの定電流源44および45と、信号UPにて開閉が
制御されるスイッチ46と、信号DOWNにて開閉が制
御されるスイッチ47とから構成される。
【0005】次に、チャージポンプ型位相同期ループの
ループフィルタ32およびチャージポンプ33のそれぞ
れの動作について説明する。
ループフィルタ32およびチャージポンプ33のそれぞ
れの動作について説明する。
【0006】図4に示すチャージポンプ33は、位相比
較器34からの入力信号UPが入力されるとスイッチ4
6が閉じ、定電流源44より電流IPがループフィルタ
32の抵抗42と容量43に流入する。電流IPが流入
している期間中、抵抗42の両端には電圧値(IP*
R)の矩形状の電圧が、容量43の端子には傾き(IP
/C)の積分電圧が生じる。
較器34からの入力信号UPが入力されるとスイッチ4
6が閉じ、定電流源44より電流IPがループフィルタ
32の抵抗42と容量43に流入する。電流IPが流入
している期間中、抵抗42の両端には電圧値(IP*
R)の矩形状の電圧が、容量43の端子には傾き(IP
/C)の積分電圧が生じる。
【0007】また、入力信号DOWNが入力されるとス
イッチ47が閉じ、定電流源45より電流IPが抵抗4
2と容量43から流出する。電流IPが流出している期
間中、抵抗42の両端には電圧値(−IP*R)の矩形
状の電圧が、容量43の端子には傾き(−IP/C)の
積分電圧が生じる。
イッチ47が閉じ、定電流源45より電流IPが抵抗4
2と容量43から流出する。電流IPが流出している期
間中、抵抗42の両端には電圧値(−IP*R)の矩形
状の電圧が、容量43の端子には傾き(−IP/C)の
積分電圧が生じる。
【0008】チャージポンプ型の位相同期ループは、こ
の電流源44および45と容量43による積分作用によ
りループフィルタの役割を果たしている。抵抗42が容
量43に直列に挿入されていることによりループの次数
は2次となる。位相同期ループの特性を決めるファクタ
である自然周波数ωn と減衰率εはそれぞれ次のように
表される。
の電流源44および45と容量43による積分作用によ
りループフィルタの役割を果たしている。抵抗42が容
量43に直列に挿入されていることによりループの次数
は2次となる。位相同期ループの特性を決めるファクタ
である自然周波数ωn と減衰率εはそれぞれ次のように
表される。
【0009】
【0010】ここで、K0は電圧制御発振回路の利得で
ある。
ある。
【0011】
【発明が解決しようとする課題】しかしながら、従来の
チャージポンプ型位相同期ループには次に示すような問
題点がある。
チャージポンプ型位相同期ループには次に示すような問
題点がある。
【0012】すなわち、2次の位相同期ループにおいて
は、減衰率εをε<1とすると不足制動となって出力に
リンギングが発生する。そのために、通常はε=1.4
程度の値を用いる。
は、減衰率εをε<1とすると不足制動となって出力に
リンギングが発生する。そのために、通常はε=1.4
程度の値を用いる。
【0013】一方、ループの帯域を決定するのは自然周
波数ωn であるので、所望のεとωn を得るために必要
となる(R*C)の積は式(2)から決定される。とこ
ろが、ループの帯域を狭くしたい場合、言い換えるとω
n を小さくしたい場合には、(R*C)の積を大きくし
なくてはならなくなる。集積化回路においては、大容量
のCや高抵抗のRを用いることは、そのチップ面積のう
ち大きな部分を占有する問題点がある。
波数ωn であるので、所望のεとωn を得るために必要
となる(R*C)の積は式(2)から決定される。とこ
ろが、ループの帯域を狭くしたい場合、言い換えるとω
n を小さくしたい場合には、(R*C)の積を大きくし
なくてはならなくなる。集積化回路においては、大容量
のCや高抵抗のRを用いることは、そのチップ面積のう
ち大きな部分を占有する問題点がある。
【0014】
【課題を解決するための手段】本発明のチャージポンプ
型位相同期ループは、外部入力信号と電圧制御発振回路
の出力信号との位相差を検出する位相比較器と、前記位
相比較器の出力信号に従って電流のチャージおよびディ
スチャージを行うチャージポンプと、前記チャージポン
プの出力電流を平滑化して前記電圧制御発振回路の制御
電圧を生成するループフィルタと、前記ループフィルタ
の出力する制御電圧により出力信号の周波数を変化させ
る前記電圧制御発振回路よりなる位相同期ループにおい
て、前記チャージポンプは並列に接続される第1および
第2のチャージポンプを備え、前記ループフィルタは、
一端は前記第1のチャージポンプの出力端に接続され、
他端が固定電位に接続される抵抗と、一端が前記第2の
チャージポンプの出力端に接続され、他端が接地される
容量と、前記抵抗の一端と前記容量の一端が入力され、
前記抵抗の両端に発生する電圧と前記容量の両端に発生
する電圧とを加算して、前記電圧制御発振回路の制御電
圧を生成する加算回路とを備える構成である。
型位相同期ループは、外部入力信号と電圧制御発振回路
の出力信号との位相差を検出する位相比較器と、前記位
相比較器の出力信号に従って電流のチャージおよびディ
スチャージを行うチャージポンプと、前記チャージポン
プの出力電流を平滑化して前記電圧制御発振回路の制御
電圧を生成するループフィルタと、前記ループフィルタ
の出力する制御電圧により出力信号の周波数を変化させ
る前記電圧制御発振回路よりなる位相同期ループにおい
て、前記チャージポンプは並列に接続される第1および
第2のチャージポンプを備え、前記ループフィルタは、
一端は前記第1のチャージポンプの出力端に接続され、
他端が固定電位に接続される抵抗と、一端が前記第2の
チャージポンプの出力端に接続され、他端が接地される
容量と、前記抵抗の一端と前記容量の一端が入力され、
前記抵抗の両端に発生する電圧と前記容量の両端に発生
する電圧とを加算して、前記電圧制御発振回路の制御電
圧を生成する加算回路とを備える構成である。
【0015】また、本発明の他のチャージポンプ型位相
同期ループは、外部入力信号と電圧制御発振回路の出力
信号との位相差を検出する位相比較器と、前記位相比較
器の出力信号に従って電流のチャージおよびディスチャ
ージを行うチャージポンプと、前記チャージポンプの出
力電流を平滑化して前記電圧制御発振回路の制御電圧を
生成するループフィルタと、前記ループフィルタの出力
する制御電圧により出力信号の周波数を変化させる前記
電圧制御発振回路よりなる位相同期ループにおいて、前
記チャージポンプは並列に接続される第1および第2の
チャージポンプを備え、前記ループフィルタは、非反転
入力端子が前記第1のチャージポンプの出力端子に接続
され反転入力端子が前記第2のチャージポンプの出力端
子に接続され出力端子が前記電圧制御発振回路に接続さ
れた演算増幅回路と、一端が前記第1のチャージポンプ
の出力端子及び前記演算増幅回路の非反転入力端子に接
続され他端が固定電位に接続された抵抗と、一端が前記
第2のチャージポンプの出力端子及び前記演算増幅回路
の反転入力端子に接続され他端が前記演算増幅回路の出
力端子に接続された容量とを備えた構成である。
同期ループは、外部入力信号と電圧制御発振回路の出力
信号との位相差を検出する位相比較器と、前記位相比較
器の出力信号に従って電流のチャージおよびディスチャ
ージを行うチャージポンプと、前記チャージポンプの出
力電流を平滑化して前記電圧制御発振回路の制御電圧を
生成するループフィルタと、前記ループフィルタの出力
する制御電圧により出力信号の周波数を変化させる前記
電圧制御発振回路よりなる位相同期ループにおいて、前
記チャージポンプは並列に接続される第1および第2の
チャージポンプを備え、前記ループフィルタは、非反転
入力端子が前記第1のチャージポンプの出力端子に接続
され反転入力端子が前記第2のチャージポンプの出力端
子に接続され出力端子が前記電圧制御発振回路に接続さ
れた演算増幅回路と、一端が前記第1のチャージポンプ
の出力端子及び前記演算増幅回路の非反転入力端子に接
続され他端が固定電位に接続された抵抗と、一端が前記
第2のチャージポンプの出力端子及び前記演算増幅回路
の反転入力端子に接続され他端が前記演算増幅回路の出
力端子に接続された容量とを備えた構成である。
【0016】
【0017】
【実施例】次に、本発明のチャージポンプ型位相同期ル
ープを図面を参照して説明する。本発明の第1の実施例
のチャージポンプ型位相同期ループを示す図1を参照す
ると、この実施例のチャージポンプ型位相同期ループ
は、電圧制御発振回路1と、ループフィルタ12と、チ
ャージポンプ13と、位相比較器14とを有している。
この実施例の電圧制御発振回路1および位相比較器14
は従来のチャージポンプ型位相同期ループの電圧制御回
路31および位相比較器34と同じ機能を有している。
ープを図面を参照して説明する。本発明の第1の実施例
のチャージポンプ型位相同期ループを示す図1を参照す
ると、この実施例のチャージポンプ型位相同期ループ
は、電圧制御発振回路1と、ループフィルタ12と、チ
ャージポンプ13と、位相比較器14とを有している。
この実施例の電圧制御発振回路1および位相比較器14
は従来のチャージポンプ型位相同期ループの電圧制御回
路31および位相比較器34と同じ機能を有している。
【0018】さらに、この実施例のチャージポンプ型位
相同期ループのループフィルタ12は、抵抗値Rの抵抗
2と、容量値Cの容量3と、抵抗2と容量3の端子電圧
を加算する加算回路15とを有し、チャージポンプ13
は、電流値IPRの定電流源4および5と、電流値IP
Cの定電流源6および7と、信号UPにて開閉が制御さ
れるスイッチ8および10と、信号DOWNにて開閉が
制御されるスイッチ9および11とを有している。
相同期ループのループフィルタ12は、抵抗値Rの抵抗
2と、容量値Cの容量3と、抵抗2と容量3の端子電圧
を加算する加算回路15とを有し、チャージポンプ13
は、電流値IPRの定電流源4および5と、電流値IP
Cの定電流源6および7と、信号UPにて開閉が制御さ
れるスイッチ8および10と、信号DOWNにて開閉が
制御されるスイッチ9および11とを有している。
【0019】この実施例のチャージポンプ型位相同期ル
ープの構成要素と従来型のチャージポンプ型の位相同期
ループの構成要素の相違は、抵抗2と容量3とが直列に
は接続されておらず、それぞれ定電流源4および5なら
びにスイッチ8および9で構成される第1のチャージポ
ンプと、定電流源6および7ならびにスイッチ10およ
び11で構成される第2のチャージポンプとに接続され
ている点と、抵抗端に容量端の電圧を加算する加算回路
15を有する点である。
ープの構成要素と従来型のチャージポンプ型の位相同期
ループの構成要素の相違は、抵抗2と容量3とが直列に
は接続されておらず、それぞれ定電流源4および5なら
びにスイッチ8および9で構成される第1のチャージポ
ンプと、定電流源6および7ならびにスイッチ10およ
び11で構成される第2のチャージポンプとに接続され
ている点と、抵抗端に容量端の電圧を加算する加算回路
15を有する点である。
【0020】したがって、この実施例と従来例との動作
上の相違点は次の通りである。すなわち、入力信号UP
またはDOWN信号が入力されると、抵抗2の両端には
電圧値(IPR*R)の矩形状の電圧が、容量3の両端
には傾き(IPC/C)の積分電圧が生じ、この二つの
電圧が加算回路15にて加算されて電圧制御発振回路1
に加えられる。
上の相違点は次の通りである。すなわち、入力信号UP
またはDOWN信号が入力されると、抵抗2の両端には
電圧値(IPR*R)の矩形状の電圧が、容量3の両端
には傾き(IPC/C)の積分電圧が生じ、この二つの
電圧が加算回路15にて加算されて電圧制御発振回路1
に加えられる。
【0021】この場合、位相同期ループの特性を決める
ファクタである自然周波数ωn と減衰率εはそれぞれ次
のように表される。
ファクタである自然周波数ωn と減衰率εはそれぞれ次
のように表される。
【0022】
【0023】この結果、本発明によるチャージポンプ型
位相同期ループにおいては、(1)式および(4)式を
比較すると、電流値IPが電流値IPRと電流値IPC
に分離されたことによって、パラメータの自由度が1つ
増えている。したがって、電流値IPRおよびIPCの
比(IPR/IPC)の値を適切に選択することによっ
て比較的小さな(R*C)の積の値に対しても所望の自
然周波数ωn と減衰率εの値を得られるようになる。
位相同期ループにおいては、(1)式および(4)式を
比較すると、電流値IPが電流値IPRと電流値IPC
に分離されたことによって、パラメータの自由度が1つ
増えている。したがって、電流値IPRおよびIPCの
比(IPR/IPC)の値を適切に選択することによっ
て比較的小さな(R*C)の積の値に対しても所望の自
然周波数ωn と減衰率εの値を得られるようになる。
【0024】このことによって、集積化回路上に実現す
る上で問題とならないレベルの容量の容量値Cと抵抗の
抵抗値Rのそれぞれの値を選択できるようになり、従来
の回路で見られたような、大容量の容量値Cや高抵抗の
抵抗値Rを用いることにより非常に大きな面積を占有す
るという欠点は克服できる。
る上で問題とならないレベルの容量の容量値Cと抵抗の
抵抗値Rのそれぞれの値を選択できるようになり、従来
の回路で見られたような、大容量の容量値Cや高抵抗の
抵抗値Rを用いることにより非常に大きな面積を占有す
るという欠点は克服できる。
【0025】次に、本発明の第2の実施例のチャージポ
ンプ型位相同期ループを説明する。
ンプ型位相同期ループを説明する。
【0026】図2を参照すると、この実施例のチャージ
ポンプ型位相同期ループは、抵抗値Rの抵抗24と、容
量値Cの容量23と、演算増幅回路25以外は第1の実
施例のチャージポンプ型位相同期ループと同一構成要素
を有しているので、その構成要素には同じ参照符号を付
し図示するだけに留め、詳細な説明は省略する。
ポンプ型位相同期ループは、抵抗値Rの抵抗24と、容
量値Cの容量23と、演算増幅回路25以外は第1の実
施例のチャージポンプ型位相同期ループと同一構成要素
を有しているので、その構成要素には同じ参照符号を付
し図示するだけに留め、詳細な説明は省略する。
【0027】また、演算増幅回路25が加算回路と積分
回路の役割を果たしており、この演算増幅回路25の出
力には第1の実施例のチャージポンプ型位相同期ループ
と同様の出力が得られるので、第1の実施例の場合とま
ったく同様の効果が得られる。
回路の役割を果たしており、この演算増幅回路25の出
力には第1の実施例のチャージポンプ型位相同期ループ
と同様の出力が得られるので、第1の実施例の場合とま
ったく同様の効果が得られる。
【0028】
【発明の効果】以上説明したように、本発明のチャージ
ポンプ型位相同期ループによれば、チャージポンプを並
列に接続される第1および第2のチャージポンプより構
成し、ループフィルタを第1のチャージポンプの出力電
流を流出入させる抵抗と、第2のチャージポンプの出力
電流を積分する容量と、抵抗に発生する電圧と容量に発
生する電圧とを加算する加算回路から構成したことによ
り、従来と比較して小さな抵抗や容量を用いて位相同期
ループを構成することができるという効果を有する。
ポンプ型位相同期ループによれば、チャージポンプを並
列に接続される第1および第2のチャージポンプより構
成し、ループフィルタを第1のチャージポンプの出力電
流を流出入させる抵抗と、第2のチャージポンプの出力
電流を積分する容量と、抵抗に発生する電圧と容量に発
生する電圧とを加算する加算回路から構成したことによ
り、従来と比較して小さな抵抗や容量を用いて位相同期
ループを構成することができるという効果を有する。
【図1】本発明の第1の実施例のチャージポンプ型位相
同期ループの構成を示す図である。
同期ループの構成を示す図である。
【図2】本発明の第2の実施例のチャージポンプ型位相
同期ループの構成を示す図である。
同期ループの構成を示す図である。
【図3】従来のチャージポンプ型位相同期ループの構成
を示す図である。
を示す図である。
【図4】図3に示すチャージポンプ型位相同期ループの
ループフィルタおよびチャージポンプの構成を示すブロ
ック図である。
ループフィルタおよびチャージポンプの構成を示すブロ
ック図である。
1,31 電圧制御発振回路 2,24,42 抵抗 3,23,43 容量 4,5,6,7,44,45 定電流源 8,9,10,11,46,47 スイッチ 12,22,32 ループフィルタ 13,33 チャージポンプ 14,34 位相比較器 15 加算器 25 演算増幅回路 IN 入力信号 OUT 出力信号
Claims (2)
- 【請求項1】 外部入力信号と電圧制御発振回路の出力
信号との位相差を検出する位相比較器と、前記位相比較
器の出力信号に従って電流のチャージおよびディスチャ
ージを行うチャージポンプと、前記チャージポンプの出
力電流を平滑化して前記電圧制御発振回路の制御電圧を
生成するループフィルタと、前記ループフィルタの出力
する制御電圧により出力信号の周波数を変化させる前記
電圧制御発振回路よりなる位相同期ループにおいて、前記チャージポンプは並列に接続される第1および第2
のチャージポンプを備え、 前記ループフィルタは、一端
は前記第1のチャージポンプの出力端に接続され、他端
が固定電位に接続される抵抗と、一端が前記第2のチャ
ージポンプの出力端に接続され、他端が接地される容量
と、前記抵抗の一端と前記容量の一端が入力され、前記
抵抗の両端に発生する電圧と前記容量の両端に発生する
電圧とを加算して、前記電圧制御発振回路の制御電圧を
生成する加算回路とを備えることを特徴とするチャージ
ポンプ型位相同期ループ。 - 【請求項2】 外部入力信号と電圧制御発振回路の出力
信号との位相差を検出する位相比較器と、前記位相比較
器の出力信号に従って電流のチャージおよびディスチャ
ージを行うチャージポンプと、前記チャージポンプの出
力電流を平滑化して前記電圧制御発振回路の制御電圧を
生成するループフィルタと、前記ループフィルタの出力
する制御電圧により出力信号の周波数を変化させる前記
電圧制御発振回路よりなる位相同期ループにおいて、前記チャージポンプは並列に接続される第1および第2
のチャージポンプを備え、 前記ループフィルタは、非反
転入力端子が前記第1のチャージポンプの出力端子に接
続され反転入力端子が前記第2のチャージポンプの出力
端子に接続され出力端子が前記電圧制御発振回路に接続
された演算増幅回路と、一端が前記第1のチャージポン
プの出力端子及び前記演算増幅回路の非反転入力端子に
接続され他端が固定電位に接続された抵抗と、一端が前
記第2のチャージポンプの出力端子及び前記演算増幅回
路の反転入力端子に接続され他端が前記演算増幅回路の
出力端子に接続された容量とを備えたことを特徴とする
チャージポンプ型位相同期ループ。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5221572A JP2778421B2 (ja) | 1993-09-07 | 1993-09-07 | チャージポンプ型位相同期ループ |
EP94113962A EP0642227A1 (en) | 1993-09-07 | 1994-09-06 | Charge-pump phase-lock loop circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5221572A JP2778421B2 (ja) | 1993-09-07 | 1993-09-07 | チャージポンプ型位相同期ループ |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0779159A JPH0779159A (ja) | 1995-03-20 |
JP2778421B2 true JP2778421B2 (ja) | 1998-07-23 |
Family
ID=16768841
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5221572A Expired - Lifetime JP2778421B2 (ja) | 1993-09-07 | 1993-09-07 | チャージポンプ型位相同期ループ |
Country Status (2)
Country | Link |
---|---|
EP (1) | EP0642227A1 (ja) |
JP (1) | JP2778421B2 (ja) |
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US7319732B2 (en) | 2003-06-11 | 2008-01-15 | Matsuhita Electric Industrial Co., Ltd. | Low-pass filter and phase locked loop |
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Publication number | Priority date | Publication date | Assignee | Title |
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FI107092B (fi) | 1998-12-22 | 2001-05-31 | Nokia Mobile Phones Ltd | Varauspumppuun perustuva vaihelukittu silmukka |
DE10050294B4 (de) | 2000-10-10 | 2006-08-24 | Atmel Germany Gmbh | PLL-Schaltung |
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US11962311B2 (en) | 2021-10-20 | 2024-04-16 | Samsung Electronics Co., Ltd. | Sub-sampling phase locked loop with compensated loop bandwidth and integrated circuit including the same |
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Publication number | Priority date | Publication date | Assignee | Title |
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1993
- 1993-09-07 JP JP5221572A patent/JP2778421B2/ja not_active Expired - Lifetime
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1994
- 1994-09-06 EP EP94113962A patent/EP0642227A1/en not_active Withdrawn
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Publication number | Publication date |
---|---|
JPH0779159A (ja) | 1995-03-20 |
EP0642227A1 (en) | 1995-03-08 |
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