JP2679185B2 - 無線選択呼び出し信号受信機 - Google Patents
無線選択呼び出し信号受信機Info
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- 230000001360 synchronised effect Effects 0.000 claims description 3
- 239000000284 extract Substances 0.000 claims 1
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- 238000010586 diagram Methods 0.000 description 4
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- 241000905510 Scena Species 0.000 description 3
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- 238000005070 sampling Methods 0.000 description 3
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- WFWKZHZTDPTPOV-UHFFFAOYSA-N 4-amino-n-[2-(ethylamino)ethyl]benzamide Chemical compound CCNCCNC(=O)C1=CC=C(N)C=C1 WFWKZHZTDPTPOV-UHFFFAOYSA-N 0.000 description 1
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- 238000000034 method Methods 0.000 description 1
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04W—WIRELESS COMMUNICATION NETWORKS
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- G08B—SIGNALLING OR CALLING SYSTEMS; ORDER TELEGRAPHS; ALARM SYSTEMS
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- H04L7/00—Arrangements for synchronising receiver with transmitter
- H04L7/04—Speed or phase control by synchronisation signals
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- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
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Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は、無線選択呼び出し信号受信機におけるデコ
ーダに関し、特に、無線選択呼び出し信号中のプリアン
ブルを短時間で検出できるプリアンブル検出回路に関す
る。
ーダに関し、特に、無線選択呼び出し信号中のプリアン
ブルを短時間で検出できるプリアンブル検出回路に関す
る。
［従来の技術］ 従来の無線選択呼び出し信号受信機は、第２図に示す
ように、受信部201、デコーダ部202、報知部203より構
成されている。受信部201はバッテリセービング制御信
号CONTにより間欠的に動作し、消費電力の低減を図って
いる。デコーダ部202は受信部201において復調により得
られた受信データDATAを処理し、受信データDATAから自
受信機宛のアドレスを検出するとアドレス検出パルスAD
ETを出力する。報知部203はアドレス検出パルスADETが
入力されるとスピーカ、LED等により報知動作を行う。
ように、受信部201、デコーダ部202、報知部203より構
成されている。受信部201はバッテリセービング制御信
号CONTにより間欠的に動作し、消費電力の低減を図って
いる。デコーダ部202は受信部201において復調により得
られた受信データDATAを処理し、受信データDATAから自
受信機宛のアドレスを検出するとアドレス検出パルスAD
ETを出力する。報知部203はアドレス検出パルスADETが
入力されるとスピーカ、LED等により報知動作を行う。
選択呼び出し信号のフォーマットは、例えばCCIRで勧
告されているように（CCIR RPC No.1,POCSAGコードとも
呼ばれる）、第６図のように“1",“0"信号の繰り返さ
れるプリアンブル（PA）に続く任意個数のバッチで構成
されている。１バッチは１つの同期信号（SC）と８つの
フレームとを含んでいる。アドレス信号は予め定められ
たフレーム中のコードワードとして送られる。
告されているように（CCIR RPC No.1,POCSAGコードとも
呼ばれる）、第６図のように“1",“0"信号の繰り返さ
れるプリアンブル（PA）に続く任意個数のバッチで構成
されている。１バッチは１つの同期信号（SC）と８つの
フレームとを含んでいる。アドレス信号は予め定められ
たフレーム中のコードワードとして送られる。
以上説明した選択呼び出し信号は受信するため、デコ
ーダ部202（第２図）は、第３図に示すように、ビット
同期回路301、プリアンブル検出回路302、同期信号検出
回路303、アドレス検出回路304、受信制御回路305によ
り構成されている。
ーダ部202（第２図）は、第３図に示すように、ビット
同期回路301、プリアンブル検出回路302、同期信号検出
回路303、アドレス検出回路304、受信制御回路305によ
り構成されている。
従来のプリアンブル検出回路は、例えば第４図に示す
ように、Ｄフリップフロップ401〜404によるシフトレジ
スタとANDゲート406で構成されていた。すなわち、ビッ
ト同期回路301（第３図）で抽出したクロックCLKの１位
相でのみ受信データDATAをサンプリングし、プリアンブ
ル検出動作を行なっていた。
ように、Ｄフリップフロップ401〜404によるシフトレジ
スタとANDゲート406で構成されていた。すなわち、ビッ
ト同期回路301（第３図）で抽出したクロックCLKの１位
相でのみ受信データDATAをサンプリングし、プリアンブ
ル検出動作を行なっていた。
次に、従来の選択呼び出し信号受信機のデコーダ部20
2（第２図）の動作について説明する。デコーダの動作
は、プリアンブルサーチモード、同期信号サーチモー
ド、アドレスサーチモードの３つの状態に分けられる。
2（第２図）の動作について説明する。デコーダの動作
は、プリアンブルサーチモード、同期信号サーチモー
ド、アドレスサーチモードの３つの状態に分けられる。
第５図（ａ）を参照すると、プリアンブルPAサーチモ
ードでは、一定周期で受信部をONとする（CONT＝
“1"）。この時、第３図に示したビット同期回路301、
プリアンブル検出回路302が起動される（起動信号BENA
＝起動信号PAENA＝“1"）。ビット同期回路301は受信信
号に同期するようにクロックの位相修正を行う。プリア
ンブル検出回路302は受信データDATAをビット同期回路3
01の出力するクロックCLKでサンプリングし、プリアン
ブルPAの有無をチェックする。
ードでは、一定周期で受信部をONとする（CONT＝
“1"）。この時、第３図に示したビット同期回路301、
プリアンブル検出回路302が起動される（起動信号BENA
＝起動信号PAENA＝“1"）。ビット同期回路301は受信信
号に同期するようにクロックの位相修正を行う。プリア
ンブル検出回路302は受信データDATAをビット同期回路3
01の出力するクロックCLKでサンプリングし、プリアン
ブルPAの有無をチェックする。
プリアンブルが検出されると（プリアンブル検出パル
スPADET＝“1"）、デコーダ部202（第２図）は同期信号
SCサーチモードに移る。この時、受信制御回路305は受
信部201（第２図）を連続動作させるとともに、同期信
号検出回路303を起動する（起動信号SCENA＝“1"）。同
期信号検出回路303が同期信号を検出すると（同期信号
検出パルスSCDET＝“1"）フレーム同期が確立し、デコ
ーダ部202はアドレスサーチモードに移る。
スPADET＝“1"）、デコーダ部202（第２図）は同期信号
SCサーチモードに移る。この時、受信制御回路305は受
信部201（第２図）を連続動作させるとともに、同期信
号検出回路303を起動する（起動信号SCENA＝“1"）。同
期信号検出回路303が同期信号を検出すると（同期信号
検出パルスSCDET＝“1"）フレーム同期が確立し、デコ
ーダ部202はアドレスサーチモードに移る。
アドレスサーチモードでは受信制御回路305は自受信
機に割り当てられたフレームのタイミングで間欠的に受
信部201を動作させると共に、アドレス検出回路304を起
動する（起動信号AENA＝“1"）。ビット同期回路301は
長いデータの途中でビート同期が外れないように、アド
レスサーチモードでも受信部201がONの時起動される
が、雑音によりクロック位相が乱されないように、通
常、クロック位相修正の時定数は短く設定される（BMOD
E＝“0"）。アドレス検出回路304は予め定められた自己
のアドレスを検出するとアドレス検出パルスを出力する
（ADET＝“1"）。アドレス検出パルスにより報知部203
（第２図）が起動され、スピーカ、LED等により呼び出
しがあったことを報知する。
機に割り当てられたフレームのタイミングで間欠的に受
信部201を動作させると共に、アドレス検出回路304を起
動する（起動信号AENA＝“1"）。ビット同期回路301は
長いデータの途中でビート同期が外れないように、アド
レスサーチモードでも受信部201がONの時起動される
が、雑音によりクロック位相が乱されないように、通
常、クロック位相修正の時定数は短く設定される（BMOD
E＝“0"）。アドレス検出回路304は予め定められた自己
のアドレスを検出するとアドレス検出パルスを出力する
（ADET＝“1"）。アドレス検出パルスにより報知部203
（第２図）が起動され、スピーカ、LED等により呼び出
しがあったことを報知する。
一定回数（例えば２回）連続して同期信号を検出でき
なかった場合、あるいは一定回数連続してアドレスの符
号誤りを検出したときフレーム同期外れと判断し、プリ
アンブルPAサーチモードに復帰する。また、プリアンブ
ルを検出したときもフレーム同期外れと判断し、同期信
号SCサーチモードに復帰する（特願昭61−1974号参
照）。
なかった場合、あるいは一定回数連続してアドレスの符
号誤りを検出したときフレーム同期外れと判断し、プリ
アンブルPAサーチモードに復帰する。また、プリアンブ
ルを検出したときもフレーム同期外れと判断し、同期信
号SCサーチモードに復帰する（特願昭61−1974号参
照）。
［発明が解決しようとする課題］ 従来の無線選択呼び出し信号受信機のデコーダでは、
上述したようにプリアンブル検出回路302はビット同期
回路301の出力するクロックの１位相でのみプリアンブ
ルのチェックを行なっていた。したがって、プリアンブ
ルサーチモードではまずビット同期引き込みを行い、ビ
ット同期確立後にプリアンブルを検出するためプリアン
ブル検出までに時間がかかる。言い換えれば、受信部を
間欠動作させるとき、受信機ONの時間（第５図（ａ）の
TBS）をビット同期に必要な時間分長くとらなければな
らず、バッテリセービング効率が良くないという欠点が
あった。
上述したようにプリアンブル検出回路302はビット同期
回路301の出力するクロックの１位相でのみプリアンブ
ルのチェックを行なっていた。したがって、プリアンブ
ルサーチモードではまずビット同期引き込みを行い、ビ
ット同期確立後にプリアンブルを検出するためプリアン
ブル検出までに時間がかかる。言い換えれば、受信部を
間欠動作させるとき、受信機ONの時間（第５図（ａ）の
TBS）をビット同期に必要な時間分長くとらなければな
らず、バッテリセービング効率が良くないという欠点が
あった。
また、第５図（ａ）で示すように、データバーストが
短い間隔で連続して送られるとき（第５図（ａ）のT
1〈〈バッチ長）、通常２つのバースト間ではビット位
相が異なっている。このため、第７図（ａ）に示すよう
に、受信部の特性の偏りによりプリアンブルのデューテ
ィが50％でないとき、第４図に示した従来のプリアンブ
ル検出回路では第２のデータバーストのプリアンブルを
受信できない場合がある。この場合、第５図（ａ）に示
す第２のデータバーストに含まれるアドレス（A3）を受
信できないことがある。
短い間隔で連続して送られるとき（第５図（ａ）のT
1〈〈バッチ長）、通常２つのバースト間ではビット位
相が異なっている。このため、第７図（ａ）に示すよう
に、受信部の特性の偏りによりプリアンブルのデューテ
ィが50％でないとき、第４図に示した従来のプリアンブ
ル検出回路では第２のデータバーストのプリアンブルを
受信できない場合がある。この場合、第５図（ａ）に示
す第２のデータバーストに含まれるアドレス（A3）を受
信できないことがある。
［課題を解決するための手段］ 本発明の無線選択呼び出し信号受信機のデコーダ部
は、受信信号に同期したクロックを抽出するビット同期
回路と、プリアンブル信号を検出し、プリアンブル検出
パルスを出力するプリアンブル検出回路と、同期信号を
検出し、同期信号検出パルスを出力する同期信号検出回
路と、予め定められた自己のアドレス信号を検出し、ア
ドレス検出パルスを出力するアドレス検出回路と、前記
プリアンブル検出パルス、同期信号検出パルス、アドレ
ス検出パルスを入力とし、前記受信部の間欠受信動作を
制御するためのバッテリセービング制御信号と前記ビッ
ト同期回路、プリアンブル検出回路、同期信号検出回
路、アドレス検出回路を制御するための制御信号とを出
力する受信制御回路とを含み、前記プリアンブル検出回
路は、前記ビット同期回路で抽出されたクロックの複数
の位相でプリアンブルをチェックし、少なくとも１つの
位相でプリアンブルが検出された時、前記プリアンブル
検出パルスを出力する回路を有している。
は、受信信号に同期したクロックを抽出するビット同期
回路と、プリアンブル信号を検出し、プリアンブル検出
パルスを出力するプリアンブル検出回路と、同期信号を
検出し、同期信号検出パルスを出力する同期信号検出回
路と、予め定められた自己のアドレス信号を検出し、ア
ドレス検出パルスを出力するアドレス検出回路と、前記
プリアンブル検出パルス、同期信号検出パルス、アドレ
ス検出パルスを入力とし、前記受信部の間欠受信動作を
制御するためのバッテリセービング制御信号と前記ビッ
ト同期回路、プリアンブル検出回路、同期信号検出回
路、アドレス検出回路を制御するための制御信号とを出
力する受信制御回路とを含み、前記プリアンブル検出回
路は、前記ビット同期回路で抽出されたクロックの複数
の位相でプリアンブルをチェックし、少なくとも１つの
位相でプリアンブルが検出された時、前記プリアンブル
検出パルスを出力する回路を有している。
［実施例］ 以下に本発明の一実施例を図面を参照して説明する。
本発明による無線選択呼び出し信号受信機は、第２図
に示したものと同様の構成のものに適用され、本発明の
要部であるデコーダ部も概略的に言えば第３図に示した
ものと同じ構成をとる。
に示したものと同様の構成のものに適用され、本発明の
要部であるデコーダ部も概略的に言えば第３図に示した
ものと同じ構成をとる。
しかし、第３図に示したプリアンブル検出回路につい
て言えば、後述するように、本発明によるものは第４図
に示したものとまったく異なる。
て言えば、後述するように、本発明によるものは第４図
に示したものとまったく異なる。
以上の理由で実施例の説明は第２図、第３図をも参照
して行う。
して行う。
本発明によるプリアンブル検出回路は、例えば第１図
に示すように、Ｄフリップフロップ101〜104による第一
のシフトレジスタとＤフリップフロップ105〜108で構成
される第二のシフトレジスタと、ANDゲート110,111、OR
ゲート112で構成されている。すなわち、本発明による
プリアンブル検出回路はビット同期回路301（第３図）
で抽出されたクロックCLKの１位相で受信データをサン
プリングする従来のプリアンブル検出回路に加えて、ビ
ット同期回路301で抽出されたクロックCLKと108゜異な
った位相で受信データをサンプリングしてプリアンブル
検出動作を行なう回路を有し、いずれかの位相でプリア
ンブルを検出したとき、プリアンブル検出パルス（PADE
T）を出力するようにしている。
に示すように、Ｄフリップフロップ101〜104による第一
のシフトレジスタとＤフリップフロップ105〜108で構成
される第二のシフトレジスタと、ANDゲート110,111、OR
ゲート112で構成されている。すなわち、本発明による
プリアンブル検出回路はビット同期回路301（第３図）
で抽出されたクロックCLKの１位相で受信データをサン
プリングする従来のプリアンブル検出回路に加えて、ビ
ット同期回路301で抽出されたクロックCLKと108゜異な
った位相で受信データをサンプリングしてプリアンブル
検出動作を行なう回路を有し、いずれかの位相でプリア
ンブルを検出したとき、プリアンブル検出パルス（PADE
T）を出力するようにしている。
次に、本発明の一実施例の選択呼び出し信号受信機の
デコーダ部の動作について説明する。デコーダの動作
は、プリアンブルサーチモード、同期信号サーチモー
ド、アドレスサーチモードの３つの状態に分けられる。
デコーダ部の動作について説明する。デコーダの動作
は、プリアンブルサーチモード、同期信号サーチモー
ド、アドレスサーチモードの３つの状態に分けられる。
第５図（ｂ）を参照すると、プリアンブルサーチモー
ドでは、一定周期で受信部201をONとする（バッテリセ
ービング制御信号CONT＝“1"）。この時、ビット同期回
路301、プリアンブル検出回路302が起動される（起動信
号BENA＝起動信号PAENA＝“1"）。
ドでは、一定周期で受信部201をONとする（バッテリセ
ービング制御信号CONT＝“1"）。この時、ビット同期回
路301、プリアンブル検出回路302が起動される（起動信
号BENA＝起動信号PAENA＝“1"）。
受信部201をONとする時間（TBS）は、従来の受信機に
おける受信部ONの時間（TBS′）より短くすることがで
きる（TBS＜TBS′）。ビット同期回路301は受信データD
ATAに同期するようクロックCLKの位相修正を行う。プリ
アンブル検出回路302は受信データをビット同期回路301
の出力するクロックCLKの２つの位相（クロックCLKの立
ち上がりエッジおよび立ち下がりエッジ）でサンプリン
グし、プリアンブルの有無をチェックする。
おける受信部ONの時間（TBS′）より短くすることがで
きる（TBS＜TBS′）。ビット同期回路301は受信データD
ATAに同期するようクロックCLKの位相修正を行う。プリ
アンブル検出回路302は受信データをビット同期回路301
の出力するクロックCLKの２つの位相（クロックCLKの立
ち上がりエッジおよび立ち下がりエッジ）でサンプリン
グし、プリアンブルの有無をチェックする。
プリアンブルが検出されると（プリアンブル検出パル
スPADET＝“1"）、デコーダ部202は同期信号サーチモー
ドに移る。この時、受信制御回路305は受信部201を連続
動作させるとともに、同期信号検出回路303を起動する
（起動信号SCENA＝“1"）。同期信号検出回路303が同期
信号を検出すると（同期信号検出パルスSCDET＝“1"）
フレーム同期が確立し、デコーダ部202はアドレスサー
チモードに移る。
スPADET＝“1"）、デコーダ部202は同期信号サーチモー
ドに移る。この時、受信制御回路305は受信部201を連続
動作させるとともに、同期信号検出回路303を起動する
（起動信号SCENA＝“1"）。同期信号検出回路303が同期
信号を検出すると（同期信号検出パルスSCDET＝“1"）
フレーム同期が確立し、デコーダ部202はアドレスサー
チモードに移る。
アドレスサーチモードでは、受信制御回路305は自受
信機に割り当てられたフレームのタイミングで間欠的に
受信部201を動作させると共に、アドレス受信回路304を
起動する（起動信号AENA＝“1"）。ビット同期回路301
は長いデータの途中でビット同期が外れないように、ア
ドレスサーチモードでも受信部201がONの時起動される
が、雑音により位相が乱されないように、通常クロック
位相修正の時定数は短く設定される（BMODE＝“0"）。
アドレス受信回路304は予め定められた自己のアドレス
を検出するとアドレス検出パルスを出力する（ADET＝
“1"）。アドレス検出パルス（ADET）により報知203が
起動され、スピーカ、LED等により呼び出しがあったこ
とを報知する。
信機に割り当てられたフレームのタイミングで間欠的に
受信部201を動作させると共に、アドレス受信回路304を
起動する（起動信号AENA＝“1"）。ビット同期回路301
は長いデータの途中でビット同期が外れないように、ア
ドレスサーチモードでも受信部201がONの時起動される
が、雑音により位相が乱されないように、通常クロック
位相修正の時定数は短く設定される（BMODE＝“0"）。
アドレス受信回路304は予め定められた自己のアドレス
を検出するとアドレス検出パルスを出力する（ADET＝
“1"）。アドレス検出パルス（ADET）により報知203が
起動され、スピーカ、LED等により呼び出しがあったこ
とを報知する。
一定回数（例えば２回）連続して同期信号を検出でき
なかった場合、あるいは一定回数連続してアドレスの符
号誤りを検出したときフレーム同期外れと判断し、プリ
アンブルPAサーチモードに復帰する。また、プリアンブ
ルを検出したときもフレーム同期外れと判断し、同期信
号SCサーチモードに復帰する。
なかった場合、あるいは一定回数連続してアドレスの符
号誤りを検出したときフレーム同期外れと判断し、プリ
アンブルPAサーチモードに復帰する。また、プリアンブ
ルを検出したときもフレーム同期外れと判断し、同期信
号SCサーチモードに復帰する。
第７図（ｂ）を参照すると、第１のデータバーストと
第２のデータバーストが連続して送られ、２つのデータ
バースト間でビート同期がずれている。また受信部の特
性の偏りのためプリアンブルのデューティがずれている
場合、本発明のプリアンブル検出回路ではクロックの立
ち上がりでサンプルするとシフトレジスタには従来と同
じく全て“0"がとりこまれプリアンブルを検出できな
い。しかし，クロックの立ち下がりでサンプリングする
シフトレジスタには正しく“1",“0",…データが取込ま
れるためプリアンブルの検出が行われる（PADET＝
１）。上述のように、アドレスサーチモードでプリアン
ブルを検出すると同期信号サーチモードに移るため、第
５図（ｂ）に示すように、第２のデータバーストにも正
しく同期することができる。したがって、従来のデコー
ダと異なり、第２のデータバーストに含まれるアドレス
（A3）をも確実に検出することができる。
第２のデータバーストが連続して送られ、２つのデータ
バースト間でビート同期がずれている。また受信部の特
性の偏りのためプリアンブルのデューティがずれている
場合、本発明のプリアンブル検出回路ではクロックの立
ち上がりでサンプルするとシフトレジスタには従来と同
じく全て“0"がとりこまれプリアンブルを検出できな
い。しかし，クロックの立ち下がりでサンプリングする
シフトレジスタには正しく“1",“0",…データが取込ま
れるためプリアンブルの検出が行われる（PADET＝
１）。上述のように、アドレスサーチモードでプリアン
ブルを検出すると同期信号サーチモードに移るため、第
５図（ｂ）に示すように、第２のデータバーストにも正
しく同期することができる。したがって、従来のデコー
ダと異なり、第２のデータバーストに含まれるアドレス
（A3）をも確実に検出することができる。
［発明の効果］ 以上説明したように、本発明は、無線選択呼び出し信
号受信機のデコーダにおいて、プリアンブル検出回路は
ビット同期回路が抽出したクロックの複数の位相でプリ
アンブルをチェックし、少なくとも１つの位相でプリア
ンブルが検出された時、プリアンブル検出パルスを出力
することにより、ビット同期がとれていなくてもプリア
ンブルを検出できる。このことにより、バッテリセービ
ング効率を高めることができ、また、データバーストを
連続して送られた場合も確実に受信できるという効果が
ある。
号受信機のデコーダにおいて、プリアンブル検出回路は
ビット同期回路が抽出したクロックの複数の位相でプリ
アンブルをチェックし、少なくとも１つの位相でプリア
ンブルが検出された時、プリアンブル検出パルスを出力
することにより、ビット同期がとれていなくてもプリア
ンブルを検出できる。このことにより、バッテリセービ
ング効率を高めることができ、また、データバーストを
連続して送られた場合も確実に受信できるという効果が
ある。
第１図は本発明の一実施例によるプリアンブル検出回路
のブロック図、第２図は本発明が適用される一般的な選
択呼び出し信号受信機のブロック図、第３図は本発明が
適用される選択呼び出し信号受信機のデコーダのブロッ
ク図、第４図は従来のプリアンブル検出回路のブロック
図、第５図は従来の選択呼び出し信号受信機のデコーダ
の動作を説明するタイムチャート（図（ａ））と本発明
の一実施例における選択呼び出し信号受信機のデコーダ
の動作を説明するタイムチャート（図（ｂ））とを示し
た図、第６図は選択呼び出し信号のフォーマット例（CC
IR No.1コード）を示した図、第７図は従来（図
（ａ））及び本発明（図（ｂ））のプリアンブル検出回
路の動作を示すタイムチャート。 DATA:受信データ、CLK:クロック、CONT:バッテリセービ
ング制御信号、BENA:ビット同期回路起動信号、BMODE:
ビット同期回路位相修正モード制御信号、PAENA:プリア
ンブル検出回路起動信号、PADET:フプリアンブル検出パ
ルス、SCENA:同期信号検出回路起動信号、SCDET:同期信
号検出パルス、AENA:アドレス検出回路起動信号、ADET:
アドレス検出パルス。
のブロック図、第２図は本発明が適用される一般的な選
択呼び出し信号受信機のブロック図、第３図は本発明が
適用される選択呼び出し信号受信機のデコーダのブロッ
ク図、第４図は従来のプリアンブル検出回路のブロック
図、第５図は従来の選択呼び出し信号受信機のデコーダ
の動作を説明するタイムチャート（図（ａ））と本発明
の一実施例における選択呼び出し信号受信機のデコーダ
の動作を説明するタイムチャート（図（ｂ））とを示し
た図、第６図は選択呼び出し信号のフォーマット例（CC
IR No.1コード）を示した図、第７図は従来（図
（ａ））及び本発明（図（ｂ））のプリアンブル検出回
路の動作を示すタイムチャート。 DATA:受信データ、CLK:クロック、CONT:バッテリセービ
ング制御信号、BENA:ビット同期回路起動信号、BMODE:
ビット同期回路位相修正モード制御信号、PAENA:プリア
ンブル検出回路起動信号、PADET:フプリアンブル検出パ
ルス、SCENA:同期信号検出回路起動信号、SCDET:同期信
号検出パルス、AENA:アドレス検出回路起動信号、ADET:
アドレス検出パルス。
Claims (1)
- 【請求項１】プリアンブル信号、同期信号、アドレス信
号とを含む選択呼び出し信号を間欠的に受信する受信部
と、該受信部により復調された信号を処理するデコーダ
部と、該デコーダ部において自受信機宛のアドレスを検
出したとき報知する報知部とを備えた無線選択呼び出し
信号受信機において、前記デコーダ部は、受信信号に同
期したクロックを抽出するビット同期回路と、プリアン
ブル信号を検出し、プリアンブル検出パルスを出力する
プリアンブル検出回路と、同期信号を検出し、同期信号
検出パルスを出力する同期信号検出回路と、予め定られ
た自己のアドレス信号を検出し、アドレス検出パルスを
出力するアドレス検出回路と、前記プリアンブル検出パ
ルス、同期信号検出パルス、アドレス検出パルスを入力
とし、前記受信部の間欠受信動作を制御するためのバッ
テリセービング制御信号と前記ビット同期回路、プリア
ンブル検出回路、同期信号検出回路、アドレス検出回路
を制御するための制御信号とを出力する受信制御回路と
を含み、前記プリアンブル検出回路は、前記ビット同期
回路で抽出されたクロックの複数の位相でプリアンブル
をチェックし、少なくとも１つの位相でプリアンブルが
検出された時、前記プリアンブル検出パルスを出力する
ことを特徴とする無線選択呼び出し信号受信機。
Priority Applications (8)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63306837A JP2679185B2 (ja) | 1988-12-06 | 1988-12-06 | 無線選択呼び出し信号受信機 |
| CA002004590A CA2004590C (en) | 1988-12-06 | 1989-12-05 | Radio paging receiver |
| AU45942/89A AU623710B2 (en) | 1988-12-06 | 1989-12-05 | Radio paging receiver |
| EP89122380A EP0372473B1 (en) | 1988-12-06 | 1989-12-05 | Radio paging receiver |
| DE68928163T DE68928163T2 (de) | 1988-12-06 | 1989-12-05 | Funkrufempfänger |
| KR1019890018018A KR920007092B1 (ko) | 1988-12-06 | 1989-12-06 | 무선 호출 수신기 |
| US07/807,648 US5227777A (en) | 1988-12-06 | 1991-12-16 | Radio paging receiver for intermittently receiving a paging signal transmitted on different phases of a clock |
| HK97102588A HK1001017A1 (en) | 1988-12-06 | 1997-12-23 | Radio paging receiver |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63306837A JP2679185B2 (ja) | 1988-12-06 | 1988-12-06 | 無線選択呼び出し信号受信機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02153633A JPH02153633A (ja) | 1990-06-13 |
| JP2679185B2 true JP2679185B2 (ja) | 1997-11-19 |
Family
ID=17961854
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63306837A Expired - Fee Related JP2679185B2 (ja) | 1988-12-06 | 1988-12-06 | 無線選択呼び出し信号受信機 |
Country Status (7)
| Country | Link |
|---|---|
| EP (1) | EP0372473B1 (ja) |
| JP (1) | JP2679185B2 (ja) |
| KR (1) | KR920007092B1 (ja) |
| AU (1) | AU623710B2 (ja) |
| CA (1) | CA2004590C (ja) |
| DE (1) | DE68928163T2 (ja) |
| HK (1) | HK1001017A1 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6138001A (en) * | 1996-03-12 | 2000-10-24 | Ntt Mobile Communications Network, Inc. | Scheme for intermittent reception of paging signals in mobile communication system |
| JPH11341538A (ja) | 1998-05-29 | 1999-12-10 | Nec Shizuoka Ltd | 無線通信装置 |
| JP4195009B2 (ja) * | 2002-11-26 | 2008-12-10 | クゥアルコム・インコーポレイテッド | Ｕｍｔｓシステムにおけるプリアンブル検出及びデータレート制御 |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6013588B2 (ja) * | 1977-09-16 | 1985-04-08 | 日本電気株式会社 | 無線個別呼出受信機 |
| DE3069899D1 (en) * | 1979-09-12 | 1985-02-14 | Gen Electric | Binary coincidence detector |
| JPS56136050A (en) * | 1980-03-28 | 1981-10-23 | Nec Corp | Individual selective call reception system |
| GB2136178A (en) * | 1983-02-25 | 1984-09-12 | Philips Electronic Associated | Pager decoding system |
| GB8320979D0 (en) * | 1983-08-03 | 1983-09-07 | Multitone Electronics Plc | Decoding arrangements |
| JPS62160830A (ja) * | 1986-01-10 | 1987-07-16 | Nec Corp | 選択呼出信号受信機 |
-
1988
- 1988-12-06 JP JP63306837A patent/JP2679185B2/ja not_active Expired - Fee Related
-
1989
- 1989-12-05 AU AU45942/89A patent/AU623710B2/en not_active Ceased
- 1989-12-05 CA CA002004590A patent/CA2004590C/en not_active Expired - Fee Related
- 1989-12-05 DE DE68928163T patent/DE68928163T2/de not_active Expired - Fee Related
- 1989-12-05 EP EP89122380A patent/EP0372473B1/en not_active Expired - Lifetime
- 1989-12-06 KR KR1019890018018A patent/KR920007092B1/ko not_active IP Right Cessation
-
1997
- 1997-12-23 HK HK97102588A patent/HK1001017A1/xx not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR920007092B1 (ko) | 1992-08-24 |
| DE68928163D1 (de) | 1997-08-14 |
| EP0372473A3 (en) | 1991-12-18 |
| AU4594289A (en) | 1990-06-14 |
| AU623710B2 (en) | 1992-05-21 |
| EP0372473A2 (en) | 1990-06-13 |
| JPH02153633A (ja) | 1990-06-13 |
| HK1001017A1 (en) | 1998-05-15 |
| CA2004590A1 (en) | 1990-06-06 |
| EP0372473B1 (en) | 1997-07-09 |
| KR900011171A (ko) | 1990-07-11 |
| CA2004590C (en) | 1993-10-05 |
| DE68928163T2 (de) | 1997-12-04 |
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