JP2605603Y2 - 半導体集積回路 - Google Patents
半導体集積回路Info
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- JP2605603Y2 JP2605603Y2 JP1997011245U JP1124597U JP2605603Y2 JP 2605603 Y2 JP2605603 Y2 JP 2605603Y2 JP 1997011245 U JP1997011245 U JP 1997011245U JP 1124597 U JP1124597 U JP 1124597U JP 2605603 Y2 JP2605603 Y2 JP 2605603Y2
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Description
【０００１】
【産業上の利用分野】この考案は半導体集積回路に関
し、特に小さな消費電流で高速動作させるに好適なサン
プルホールド回路を含む半導体集積回路に関する。
し、特に小さな消費電流で高速動作させるに好適なサン
プルホールド回路を含む半導体集積回路に関する。
【０００２】
【従来の技術】従来のサンプルホールド回路は、図２に
示すように、オペアンプＡＭＰがその逆相入力端子−と
出力間でボルテージホロワ接続され、その正相入力端子
＋には、接地ラインとの間に入力電圧をサンプルホール
ドするコンデンサＣ1 が接続され、入力端子ＩＮとの間
にコントロール端子ＴＳに与えられた信号により駆動す
るスイッチＳＷが接続されている。またその出力には出
力端子ＯＵＴが接続されている。出力端子ＯＵＴには容
量性負荷Ｃが接続される。
示すように、オペアンプＡＭＰがその逆相入力端子−と
出力間でボルテージホロワ接続され、その正相入力端子
＋には、接地ラインとの間に入力電圧をサンプルホール
ドするコンデンサＣ1 が接続され、入力端子ＩＮとの間
にコントロール端子ＴＳに与えられた信号により駆動す
るスイッチＳＷが接続されている。またその出力には出
力端子ＯＵＴが接続されている。出力端子ＯＵＴには容
量性負荷Ｃが接続される。
【０００３】このサンプルホールド回路の動作では、時
間と共に変動する電圧が入力端子ＩＮに入力されると、
コントロール端子ＴＳに入力される制御信号によりスイ
ッチＳＷが瞬時導通されてコンデンサＣ1 がその時の瞬
時値電圧に充電され、その電圧を保持する。オペアンプ
ＡＭＰはその保持された電圧と同じ電圧を出力し、所定
の周期でこの動作を繰り返す。ところで、負荷容量Ｃが
例えば１００ＰＦ程度と比較的大きい場合はその充放
電、すなわち出力電圧ＶOUT の波形的な傾きの立ち上が
り及び立ち下がりに時間を要し、その周期を速くしにく
くする。
間と共に変動する電圧が入力端子ＩＮに入力されると、
コントロール端子ＴＳに入力される制御信号によりスイ
ッチＳＷが瞬時導通されてコンデンサＣ1 がその時の瞬
時値電圧に充電され、その電圧を保持する。オペアンプ
ＡＭＰはその保持された電圧と同じ電圧を出力し、所定
の周期でこの動作を繰り返す。ところで、負荷容量Ｃが
例えば１００ＰＦ程度と比較的大きい場合はその充放
電、すなわち出力電圧ＶOUT の波形的な傾きの立ち上が
り及び立ち下がりに時間を要し、その周期を速くしにく
くする。
【０００４】ところで上記のオペアンプＡＭＰは例えば
図３に示す回路のオペアンプＡＭＰ1 で構成する。この
回路はＰチャンネルＭＯＳトランジスタＱ1 ，Ｑ2 ，Ｎ
チャンネルＭＯＳトランジスタＱ3 ，Ｑ4 ，Ｑ5 により
差動アンプを構成し、トランジスタＱ3 ，Ｑ4 のそれぞ
れのゲートを逆相入力端子−，正相入力端子＋とする。
電源ラインＶｃｃと接地ラインＧｎｄの間にＰチャンネ
ルＭＯＳトランジスタＱ6 とＮチャンネルＭＯＳトラン
ジスタＱ7 をドレインどうしで直列接続して配置し、そ
のドレインをオペアンプＡＭＰ1 の出力端子ＯＵＴとす
る。ＮチャンネルＭＯＳトランジスタＱ5 ，Ｑ7 のゲー
トは共通接続され、一定の電圧Ｖr1が与えられ、トラン
ジスタＱ5 ，Ｑ7 にはそれぞれのドレインに所定値以上
の電圧が印加されるとき一定の電流Ｉ1，Ｉ2が流れ、差
動アンプの正相出力でＰチャンネルＭＯＳトランジスタ
Ｑ6 を駆動して両入力端子＋，−の電圧に応じた電圧を
出力端子ＯＵＴに出力する。
図３に示す回路のオペアンプＡＭＰ1 で構成する。この
回路はＰチャンネルＭＯＳトランジスタＱ1 ，Ｑ2 ，Ｎ
チャンネルＭＯＳトランジスタＱ3 ，Ｑ4 ，Ｑ5 により
差動アンプを構成し、トランジスタＱ3 ，Ｑ4 のそれぞ
れのゲートを逆相入力端子−，正相入力端子＋とする。
電源ラインＶｃｃと接地ラインＧｎｄの間にＰチャンネ
ルＭＯＳトランジスタＱ6 とＮチャンネルＭＯＳトラン
ジスタＱ7 をドレインどうしで直列接続して配置し、そ
のドレインをオペアンプＡＭＰ1 の出力端子ＯＵＴとす
る。ＮチャンネルＭＯＳトランジスタＱ5 ，Ｑ7 のゲー
トは共通接続され、一定の電圧Ｖr1が与えられ、トラン
ジスタＱ5 ，Ｑ7 にはそれぞれのドレインに所定値以上
の電圧が印加されるとき一定の電流Ｉ1，Ｉ2が流れ、差
動アンプの正相出力でＰチャンネルＭＯＳトランジスタ
Ｑ6 を駆動して両入力端子＋，−の電圧に応じた電圧を
出力端子ＯＵＴに出力する。
【０００５】図３の回路の動作において、まずオペアン
プＡＭＰ1 の入力端子＋の電圧ＶC1が低い時、トランジ
スタＱ4 の抵抗は大きく、そのドレイン電圧は高く、し
たがってトランジスタＱ6 の抵抗が大きくなっている。
一方トランジスタＱ7 のゲートには一定の電圧が与えら
れて、一定の抵抗に保持されて、トランジスタＱ6 −Ｑ
7 の接続点、すなわち出力端子ＯＵＴの出力電圧ＶOUT
は低くなっている。この状態でオペアンプＡＭＰ１の入
力端子＋の電圧、すなわちコンデンサＣ1 の電圧ＶC1が
高く変わった際には、トランジスタＱ4 の抵抗は小さく
なり、そのドレイン電圧が低くなり、トランジスタＱ6
の抵抗が低くなり、トランジスタＱ7 に流れる電流Ｉ2
に加え負荷容量Ｃ（図２参照）を充電する電流が流れ出
力電圧ＶOUTを比較的急速に高める。この状態でオペア
ンプＡＭＰ1 の入力端子＋の電圧ＶC1が低くなると、前
記の通りトランジスタＱ6 の抵抗が高くなり電流は少な
くなり、負荷容量Ｃに貯えられた電荷はトランジスタＱ
7 の電流Ｉ2により放電し、出力電圧ＶOUTは低くなる。
しかしながらトランジスタＱ7 はゲート電圧が一定に保
たれているので抵抗が低く成り得ず、出力電圧ＶOUTの
波形的な傾きの立ち下がりは時間がかかる。そこで出力
電圧ＶOUTの波形的な傾きの立ち下がりを速くしようと
するとトランジスタＱ7 の電流Ｉ2、すなわちゲート電
圧Ｖr1を大きくする必要がある。しかしながらこの電流
Ｉ2は常時流れているので回路の消費電流が大きくな
る。
プＡＭＰ1 の入力端子＋の電圧ＶC1が低い時、トランジ
スタＱ4 の抵抗は大きく、そのドレイン電圧は高く、し
たがってトランジスタＱ6 の抵抗が大きくなっている。
一方トランジスタＱ7 のゲートには一定の電圧が与えら
れて、一定の抵抗に保持されて、トランジスタＱ6 −Ｑ
7 の接続点、すなわち出力端子ＯＵＴの出力電圧ＶOUT
は低くなっている。この状態でオペアンプＡＭＰ１の入
力端子＋の電圧、すなわちコンデンサＣ1 の電圧ＶC1が
高く変わった際には、トランジスタＱ4 の抵抗は小さく
なり、そのドレイン電圧が低くなり、トランジスタＱ6
の抵抗が低くなり、トランジスタＱ7 に流れる電流Ｉ2
に加え負荷容量Ｃ（図２参照）を充電する電流が流れ出
力電圧ＶOUTを比較的急速に高める。この状態でオペア
ンプＡＭＰ1 の入力端子＋の電圧ＶC1が低くなると、前
記の通りトランジスタＱ6 の抵抗が高くなり電流は少な
くなり、負荷容量Ｃに貯えられた電荷はトランジスタＱ
7 の電流Ｉ2により放電し、出力電圧ＶOUTは低くなる。
しかしながらトランジスタＱ7 はゲート電圧が一定に保
たれているので抵抗が低く成り得ず、出力電圧ＶOUTの
波形的な傾きの立ち下がりは時間がかかる。そこで出力
電圧ＶOUTの波形的な傾きの立ち下がりを速くしようと
するとトランジスタＱ7 の電流Ｉ2、すなわちゲート電
圧Ｖr1を大きくする必要がある。しかしながらこの電流
Ｉ2は常時流れているので回路の消費電流が大きくな
る。
【０００６】一方、出力電圧ＶOUTの波形的な傾きの立
ち下がりを速くするオペアンプは、図４に示す回路のオ
ペアンプＡＭＰ2 がある。この回路は前述の図３に示す
オペアンプＡＭＰ1 のＰチャンネルＭＯＳトランジスタ
Ｑ1 ，Ｑ2 ，Ｑ6 にかえてＮチャンネルＭＯＳトランジ
スタＱ11，Ｑ12，Ｑ16とし、ＮチャンネルＭＯＳトラン
ジスタＱ3 ，Ｑ4 ，Ｑ5 ，Ｑ7 にかえてＰチャンネルＭ
ＯＳトランジスタＱ13，Ｑ14，Ｑ15，Ｑ17で構成する。
この回路によればオペアンプＡＭＰ1 において説明した
と同様な理由により出力電圧ＶOUTの波形的な傾きの立
ち下がりは速くなるが立ち上がりは遅くなる。かくして
オペアンプＡＭＰ1 のように出力電圧の波形的な傾きの
立ち上がりが速い動作特性を有するオペアンプと、オペ
アンプＡＭＰ2 のように出力電圧の波形的な傾きの立ち
下がりの速い動作特性を有するオペアンプとが具体的に
構成される。
ち下がりを速くするオペアンプは、図４に示す回路のオ
ペアンプＡＭＰ2 がある。この回路は前述の図３に示す
オペアンプＡＭＰ1 のＰチャンネルＭＯＳトランジスタ
Ｑ1 ，Ｑ2 ，Ｑ6 にかえてＮチャンネルＭＯＳトランジ
スタＱ11，Ｑ12，Ｑ16とし、ＮチャンネルＭＯＳトラン
ジスタＱ3 ，Ｑ4 ，Ｑ5 ，Ｑ7 にかえてＰチャンネルＭ
ＯＳトランジスタＱ13，Ｑ14，Ｑ15，Ｑ17で構成する。
この回路によればオペアンプＡＭＰ1 において説明した
と同様な理由により出力電圧ＶOUTの波形的な傾きの立
ち下がりは速くなるが立ち上がりは遅くなる。かくして
オペアンプＡＭＰ1 のように出力電圧の波形的な傾きの
立ち上がりが速い動作特性を有するオペアンプと、オペ
アンプＡＭＰ2 のように出力電圧の波形的な傾きの立ち
下がりの速い動作特性を有するオペアンプとが具体的に
構成される。
【０００７】
【考案が解決しようとする課題】上述のように従来のサ
ンプルホールド回路はオペアンプを１つで構成している
ので出力電圧の波形的な傾きの立ち上がりと立ち下がり
の速いものを得るのは消費電流を大きくするので容易で
なかった。そこで、この考案は、小さな消費電流で出力
電圧の波形的な傾きの立ち上がり及び立ち下がりとも速
い動作を行うサンプルホールド回路を含む半導体集積回
路を提供することを目的とする。
ンプルホールド回路はオペアンプを１つで構成している
ので出力電圧の波形的な傾きの立ち上がりと立ち下がり
の速いものを得るのは消費電流を大きくするので容易で
なかった。そこで、この考案は、小さな消費電流で出力
電圧の波形的な傾きの立ち上がり及び立ち下がりとも速
い動作を行うサンプルホールド回路を含む半導体集積回
路を提供することを目的とする。
【０００８】
【課題を解決するための手段】この考案の半導体集積回
路は、ボルテージホロワ接続され、入出力端子間で並列
接続された相異なる動作特性を有する一組のオペアンプ
と、各オペアンプの正相入力と接地間にそれぞれ挿入し
たコンデンサと、入力端子と各オペアンプの正相入力間
に挿入した第１セレクタと、各オペアンプの出力と出力
端子間に挿入した第２セレクタとを具備し、オペアンプ
の一方を出力電圧の波形的な傾きの立ち上がりが速い動
作特性に、他方をその立ち下がりが速い動作特性にし、
第２セレクタにより、出力端子からの出力電圧を正に変
化させるときはオペアンプの一方を選択し、出力端子か
らの出力電圧を負に変化させるときはオペアンプの他方
を選択するようにしたことを特徴とするサンプルホール
ド回路を含む。
路は、ボルテージホロワ接続され、入出力端子間で並列
接続された相異なる動作特性を有する一組のオペアンプ
と、各オペアンプの正相入力と接地間にそれぞれ挿入し
たコンデンサと、入力端子と各オペアンプの正相入力間
に挿入した第１セレクタと、各オペアンプの出力と出力
端子間に挿入した第２セレクタとを具備し、オペアンプ
の一方を出力電圧の波形的な傾きの立ち上がりが速い動
作特性に、他方をその立ち下がりが速い動作特性にし、
第２セレクタにより、出力端子からの出力電圧を正に変
化させるときはオペアンプの一方を選択し、出力端子か
らの出力電圧を負に変化させるときはオペアンプの他方
を選択するようにしたことを特徴とするサンプルホール
ド回路を含む。
【０００９】
【考案の実施の形態】以下、この考案の一実施例の半導
体集積回路に含まれるサンプルホールド回路について、
図面を参照して説明する。このサンプルホールド回路は
図１に示すように、入出力端子ＩＮ，ＯＵＴ間で並列接
続され相異なる動作特性を有する第１及び第２オペアン
プＡＭＰ１，ＡＭＰ２と、各オペアンプＡＭＰ1 ，ＡＭ
Ｐ2 の正相入力と接地間にそれぞれ挿入した第１及び第
２コンデンサＣ1 ，Ｃ2 と、入力端子ＩＮと各オペアン
プＡＭＰ1，ＡＭＰ2 の正相入力間に挿入した第１セレ
クタＳ1 と、各オペアンプＡＭＰ1，ＡＭＰ2 の出力と
出力端子ＯＵＴ間に挿入した第２セレクタＳ2 とで構成
される。オペアンプＡＭＰ1 ，ＡＭＰ2 はそれぞれ、そ
の逆相入力端子−と出力とでボルテージホロワ接続され
ている。オペアンプＡＭＰ1 は具体的には図３に示す回
路で構成され出力電圧の波形的な傾きの立ち上がりが速
い動作特性を有し、オペアンプＡＭＰ2 は具体的には図
４に示す回路で構成され出力電圧の波形的な傾きの立ち
下がりが速い動作特性を有する。このサンプルホールド
回路の動作では入力端子ＩＮに入力された正に変化する
電圧が第１セレクタＳ1 を介して第１コンデンサＣ1 に
サンプルホールドされ第１オペアンプＡＭＰ1 から第２
セレクタＳ2 を介して出力端子ＯＵＴに出力され、入力
端子ＩＮに入力された負に変化する電圧が第１セレクタ
Ｓ1 を介して第２コンデンサＣ2 にサンプルホールドさ
れ第２オペアンプＡＭＰ2 から第２セレクタＳ2 を介し
て出力端子に出力される。
体集積回路に含まれるサンプルホールド回路について、
図面を参照して説明する。このサンプルホールド回路は
図１に示すように、入出力端子ＩＮ，ＯＵＴ間で並列接
続され相異なる動作特性を有する第１及び第２オペアン
プＡＭＰ１，ＡＭＰ２と、各オペアンプＡＭＰ1 ，ＡＭ
Ｐ2 の正相入力と接地間にそれぞれ挿入した第１及び第
２コンデンサＣ1 ，Ｃ2 と、入力端子ＩＮと各オペアン
プＡＭＰ1，ＡＭＰ2 の正相入力間に挿入した第１セレ
クタＳ1 と、各オペアンプＡＭＰ1，ＡＭＰ2 の出力と
出力端子ＯＵＴ間に挿入した第２セレクタＳ2 とで構成
される。オペアンプＡＭＰ1 ，ＡＭＰ2 はそれぞれ、そ
の逆相入力端子−と出力とでボルテージホロワ接続され
ている。オペアンプＡＭＰ1 は具体的には図３に示す回
路で構成され出力電圧の波形的な傾きの立ち上がりが速
い動作特性を有し、オペアンプＡＭＰ2 は具体的には図
４に示す回路で構成され出力電圧の波形的な傾きの立ち
下がりが速い動作特性を有する。このサンプルホールド
回路の動作では入力端子ＩＮに入力された正に変化する
電圧が第１セレクタＳ1 を介して第１コンデンサＣ1 に
サンプルホールドされ第１オペアンプＡＭＰ1 から第２
セレクタＳ2 を介して出力端子ＯＵＴに出力され、入力
端子ＩＮに入力された負に変化する電圧が第１セレクタ
Ｓ1 を介して第２コンデンサＣ2 にサンプルホールドさ
れ第２オペアンプＡＭＰ2 から第２セレクタＳ2 を介し
て出力端子に出力される。
【００１０】次に図１の具体的な回路例を図５を参照し
て説明する。図５は図１のセレクタＳ1 、Ｓ2 を具体的
なスイッチ回路で示したもので、セレクタＳ1 は制御端
子ＴＳ1 に与えられる信号により駆動するスイッチＳＷ
1 と制御端子ＴＳ2 に与えられる信号により駆動するス
イッチＳＷ2 とで構成され、セレクタＳ2 は制御端子Ｔ
Ｓ3 に与えられる信号により駆動するスイッチＳＷ3と
制御端子ＴＳ4 に与えられる信号により駆動するスイッ
チＳＷ4 とで構成されている。スイッチＳＷ1 は入力端
子ＩＮとオペアンプＡＭＰ1 間に接続され、スイッチＳ
Ｗ2 は入力端子ＩＮとオペアンプＡＭＰ2 間に接続され
ている。また、スイッチＳＷ3 はオペアンプＡＭＰ1 と
出力端子ＯＵＴ間に接続され、スイッチＳＷ4 はオペア
ンプＡＭＰ2 と出力端子ＯＵＴ間に接続されている。
て説明する。図５は図１のセレクタＳ1 、Ｓ2 を具体的
なスイッチ回路で示したもので、セレクタＳ1 は制御端
子ＴＳ1 に与えられる信号により駆動するスイッチＳＷ
1 と制御端子ＴＳ2 に与えられる信号により駆動するス
イッチＳＷ2 とで構成され、セレクタＳ2 は制御端子Ｔ
Ｓ3 に与えられる信号により駆動するスイッチＳＷ3と
制御端子ＴＳ4 に与えられる信号により駆動するスイッ
チＳＷ4 とで構成されている。スイッチＳＷ1 は入力端
子ＩＮとオペアンプＡＭＰ1 間に接続され、スイッチＳ
Ｗ2 は入力端子ＩＮとオペアンプＡＭＰ2 間に接続され
ている。また、スイッチＳＷ3 はオペアンプＡＭＰ1 と
出力端子ＯＵＴ間に接続され、スイッチＳＷ4 はオペア
ンプＡＭＰ2 と出力端子ＯＵＴ間に接続されている。
【００１１】次に図６に示すタイミングチャートも併用
して動作を説明する。入力端子ＩＮには入力電圧ＶINが
時間により変化する電圧として与えられる。制御端子Ｔ
Ｓ1，ＴＳ2 にはスイッチＳＷ1 ，ＳＷ2 をコントロー
ルする電圧ＶVS1，ＶVS2が入力電圧に同期してそれぞれ
所定のタイミング信号として与えられ、ハイの時スイッ
チＳＷ1 ，ＳＷ2 をそれぞれＯＮさせる。また、制御端
子ＴＳ3 ，ＴＳ4 にはスイッチＳＷ3 ，ＳＷ4 をコント
ロールする電圧ＶTS3，ＶTS4が入力電圧に同期してそれ
ぞれハイ・ロウ相反対のタイミング信号として与えら
れ、ハイの時スイッチＳＷ3 ，ＳＷ4 をＯＮさせる。時
刻Ｔ１ 前においてスイッチＳＷ1 ，ＳＷ2はＯＦＦ状態
で、コンデンサＣ1 はその電圧ＶC1 として入力電圧Ｖ
IN（＝Ｖ1）を保持している。この時スイッチＳ3 はＯ
Ｎ状態で，コンデンサＣ1 の電圧ＶC1（＝Ｖ1）をオペ
アンプＡＭＰ1 から出力電圧ＶOUTとして出力してい
る。
して動作を説明する。入力端子ＩＮには入力電圧ＶINが
時間により変化する電圧として与えられる。制御端子Ｔ
Ｓ1，ＴＳ2 にはスイッチＳＷ1 ，ＳＷ2 をコントロー
ルする電圧ＶVS1，ＶVS2が入力電圧に同期してそれぞれ
所定のタイミング信号として与えられ、ハイの時スイッ
チＳＷ1 ，ＳＷ2 をそれぞれＯＮさせる。また、制御端
子ＴＳ3 ，ＴＳ4 にはスイッチＳＷ3 ，ＳＷ4 をコント
ロールする電圧ＶTS3，ＶTS4が入力電圧に同期してそれ
ぞれハイ・ロウ相反対のタイミング信号として与えら
れ、ハイの時スイッチＳＷ3 ，ＳＷ4 をＯＮさせる。時
刻Ｔ１ 前においてスイッチＳＷ1 ，ＳＷ2はＯＦＦ状態
で、コンデンサＣ1 はその電圧ＶC1 として入力電圧Ｖ
IN（＝Ｖ1）を保持している。この時スイッチＳ3 はＯ
Ｎ状態で，コンデンサＣ1 の電圧ＶC1（＝Ｖ1）をオペ
アンプＡＭＰ1 から出力電圧ＶOUTとして出力してい
る。
【００１２】時刻Ｔ１ においてスイッチＳＷ1 はＯＦ
Ｆ状態のまま，スイッチＳＷ2 はＯＮ状態になり，コン
デンサＣ2 はその電圧ＶC2してＶ1より低い入力電圧Ｖ
IN（＝Ｖ2）を保持する。このときスイッチＳＷ4 はＯ
ＦＦ状態である。次に時刻Ｔ2においてスイッチＳＷ1
，ＳＷ2 はＯＦＦ状態のまま，スイッチＳＷ3 はＯＦ
Ｆ状態，スイッチＳＷ4 はＯＮ状態になり、コンデンサ
Ｃ2 の電圧ＶC2（＝Ｖ2)をオペアンプＡＭＰ2 から出力
電圧ＶOUTとして出力する。
Ｆ状態のまま，スイッチＳＷ2 はＯＮ状態になり，コン
デンサＣ2 はその電圧ＶC2してＶ1より低い入力電圧Ｖ
IN（＝Ｖ2）を保持する。このときスイッチＳＷ4 はＯ
ＦＦ状態である。次に時刻Ｔ2においてスイッチＳＷ1
，ＳＷ2 はＯＦＦ状態のまま，スイッチＳＷ3 はＯＦ
Ｆ状態，スイッチＳＷ4 はＯＮ状態になり、コンデンサ
Ｃ2 の電圧ＶC2（＝Ｖ2)をオペアンプＡＭＰ2 から出力
電圧ＶOUTとして出力する。
【００１３】同様に時刻Ｔ３ においてＳＷ1 はＯＮ状
態になりコンデンサＣ1 はその電圧ＶC1としてＶ2より
高い入力電圧ＶIN（＝Ｖ3）を保持し、時刻Ｔ4 におい
てＳＷ3 はＯＮ状態、スイッチＳＷ4 はＯＦＦ状態にな
り、コンデンサＣ1 の電圧ＶC1（＝Ｖ2）をオペアンプ
ＡＭＰ1 から出力電圧として出力し、時刻Ｔ5において
ＳＷ2 はＯＮ状態になり、コンデンサＣ2 はその電圧Ｖ
C2としてＶ3より低い入力電圧ＶIN（＝Ｖ4）を保持し、
時刻Ｔ6 においてＳＷ3 はＯＦＦ状態、ＳＷ4 はＯＮ状
態になり、コンデンサＣ2 の電圧ＶC2（＝Ｖ4）をオペ
アンプＡＭＰ2 から出力電圧として出力する。
態になりコンデンサＣ1 はその電圧ＶC1としてＶ2より
高い入力電圧ＶIN（＝Ｖ3）を保持し、時刻Ｔ4 におい
てＳＷ3 はＯＮ状態、スイッチＳＷ4 はＯＦＦ状態にな
り、コンデンサＣ1 の電圧ＶC1（＝Ｖ2）をオペアンプ
ＡＭＰ1 から出力電圧として出力し、時刻Ｔ5において
ＳＷ2 はＯＮ状態になり、コンデンサＣ2 はその電圧Ｖ
C2としてＶ3より低い入力電圧ＶIN（＝Ｖ4）を保持し、
時刻Ｔ6 においてＳＷ3 はＯＦＦ状態、ＳＷ4 はＯＮ状
態になり、コンデンサＣ2 の電圧ＶC2（＝Ｖ4）をオペ
アンプＡＭＰ2 から出力電圧として出力する。
【００１４】このようにＶ1↓Ｖ2↑Ｖ3↓Ｖ4と交互に上
昇，降下を繰り返す出力電圧ＶOUTを出力端子ＯＵＴか
ら出力するとき、上昇、すなわちＶ2からＶ3ように出力
電圧の波形の立ち上がりの際には出力電圧の波形的な傾
きの立ち上がりの速い動作特性を有するオペアンプＡＭ
Ｐ1 が担当し、降下、すなわちＶ1からＶ2、、Ｖ3から
Ｖ4ように出力電圧の波形の立ち下がりの際には出力電
圧の波形的な傾きの立ち下がりの速いオペアンプＡＭＰ
2 が担当して立ち上がりと立ち下がり波形の急峻な出力
電圧を出力する。
昇，降下を繰り返す出力電圧ＶOUTを出力端子ＯＵＴか
ら出力するとき、上昇、すなわちＶ2からＶ3ように出力
電圧の波形の立ち上がりの際には出力電圧の波形的な傾
きの立ち上がりの速い動作特性を有するオペアンプＡＭ
Ｐ1 が担当し、降下、すなわちＶ1からＶ2、、Ｖ3から
Ｖ4ように出力電圧の波形の立ち下がりの際には出力電
圧の波形的な傾きの立ち下がりの速いオペアンプＡＭＰ
2 が担当して立ち上がりと立ち下がり波形の急峻な出力
電圧を出力する。
【００１５】
【考案の効果】以上説明したように、この考案は、立ち
上がりが速くて立ち下がりの遅い動作特性を有する第１
オペアンプと立ち上がりが遅くて立ち下がりの速い動作
特性を有する第２オペアンプとを並列的に接続し、選択
して使うことにより、消費電流を大きくすることなく立
ち上がりと立ち下がり波形の急峻な出力をするサンプル
ホールド回路とすることができる。また、簡単な回路で
構成できるので安価な回路を提供できる。
上がりが速くて立ち下がりの遅い動作特性を有する第１
オペアンプと立ち上がりが遅くて立ち下がりの速い動作
特性を有する第２オペアンプとを並列的に接続し、選択
して使うことにより、消費電流を大きくすることなく立
ち上がりと立ち下がり波形の急峻な出力をするサンプル
ホールド回路とすることができる。また、簡単な回路で
構成できるので安価な回路を提供できる。
【図１】 本考案の一実施例を示すサンプルホールド回
路のブロック図
路のブロック図
【図２】 従来のサンプルホールド回路の回路図
【図３】 第１オペアンプの回路図
【図４】 第２オペアンプの回路図
【図５】 図１のサンプルホールド回路の具体的な回路
図
図
【図６】 図５の回路のタイミングチャート
ＡＭＰ1 第１オペアンプ ＡＭＰ2 第２オペアンプ Ｃ1 第１コンデンサ Ｃ2 第２コンデンサ Ｓ1 第１セレクタ Ｓ2 第２セレクタ ＩＮ 入力端子 ＯＵＴ 出力端子
Claims (1)
- 【請求項１】ボルテージホロワ接続され、入出力端子間
で並列接続された相異なる動作特性を有する一組のオペ
アンプと、前記各オペアンプの正相入力と接地間にそれ
ぞれ挿入したコンデンサと、前記入力端子と前記各オペ
アンプの正相入力間に挿入した第１セレクタと、前記各
オペアンプの出力と前記出力端子間に挿入した第２セレ
クタとを具備し、前記オペアンプの一方を出力電圧の波
形的な傾きの立ち上がりが速い動作特性に、他方をその
立ち下がりが速い動作特性にし、前記第２セレクタによ
り、前記出力端子からの出力電圧を正に変化させるとき
は前記オペアンプの一方を選択し、前記出力端子からの
出力電圧を負に変化させるときは前記オペアンプの他方
を選択するようにしたことを特徴とするサンプルホール
ド回路を含む半導体集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1997011245U JP2605603Y2 (ja) | 1997-12-24 | 1997-12-24 | 半導体集積回路 |
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| JP1997011245U JP2605603Y2 (ja) | 1997-12-24 | 1997-12-24 | 半導体集積回路 |
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