JP2574775B2 - 液晶表示素子 - Google Patents
液晶表示素子Info
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- JP2574775B2 JP2574775B2 JP61245209A JP24520986A JP2574775B2 JP 2574775 B2 JP2574775 B2 JP 2574775B2 JP 61245209 A JP61245209 A JP 61245209A JP 24520986 A JP24520986 A JP 24520986A JP 2574775 B2 JP2574775 B2 JP 2574775B2
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- Japan
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- liquid crystal
- crystal display
- transparent conductive
- display device
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は液晶表示素子に係り、特に液晶配向膜に悪影
響を与える静電気スパークの防止に好適な電極パターン
に関する。
響を与える静電気スパークの防止に好適な電極パターン
に関する。
静電気障害を防止する為には、特公昭52−27654号に
記載のように全端子を短絡することが望ましい。しか
し、この場合、セル切断後共通アースを切り捨てる必要
があり１枚当りのガラスからの取り個数が減少する。ま
た、面付けによっては共通アースが各端子の上にオーバ
ーラップして通電時、電触，異物による電極間タッチ等
の恐れが大きく、これらの点については配慮されていな
かった。
記載のように全端子を短絡することが望ましい。しか
し、この場合、セル切断後共通アースを切り捨てる必要
があり１枚当りのガラスからの取り個数が減少する。ま
た、面付けによっては共通アースが各端子の上にオーバ
ーラップして通電時、電触，異物による電極間タッチ等
の恐れが大きく、これらの点については配慮されていな
かった。
又、対向電極間に突起を設けた例が特開昭60−218625
号公報に記載されている。
号公報に記載されている。
〔発明が解決しようとする問題点〕 上記従来技術は、セル切断後共通アースを切り捨てる
必要がありガラス基板１枚当り取れる個数が減少する。
又、面付けによっては共通アースが各端子の上にオーバ
ーラップして、通電時電触，異物による電極間タッチが
ある。この点について配慮がされておらず設計上問題が
あった。
必要がありガラス基板１枚当り取れる個数が減少する。
又、面付けによっては共通アースが各端子の上にオーバ
ーラップして、通電時電触，異物による電極間タッチが
ある。この点について配慮がされておらず設計上問題が
あった。
更に上記別の従来技術では、有効表示領域内に突起が
ある為、上下基板の合せずれ等により、この突起部分が
パターンとして見えてしまう欠点があった。
ある為、上下基板の合せずれ等により、この突起部分が
パターンとして見えてしまう欠点があった。
本発明は、共通アースによる電触，電極間タッチ不良
のため、共通アースを使用できない場合、又はガラス基
板１枚当りの取り個数を多くするため、共通アースの切
り捨てしろが設計上設けられないなどの設計上の問題を
無くし、共通アースを用いずに静電気障害を無くするこ
とを目的とする。
のため、共通アースを使用できない場合、又はガラス基
板１枚当りの取り個数を多くするため、共通アースの切
り捨てしろが設計上設けられないなどの設計上の問題を
無くし、共通アースを用いずに静電気障害を無くするこ
とを目的とする。
更に、本発明は表示品質を損なうことが少ない液晶表
示素子を提供することを目的とする。
示素子を提供することを目的とする。
上記目的は、ガラス基板上の透明導電膜を加工する際
に用いる電極パターン形状を下記の様にすることにより
達成される。
に用いる電極パターン形状を下記の様にすることにより
達成される。
セル内及びシール部の有効表示領域外で端子のリード
線よりそれぞれ対向させたリード線（以後、避雷針パタ
ーンと称す）を出し、そのリード線のギャップは隣あう
セグメントギャップより狭くする（通常５〜30μｍ）。
線よりそれぞれ対向させたリード線（以後、避雷針パタ
ーンと称す）を出し、そのリード線のギャップは隣あう
セグメントギャップより狭くする（通常５〜30μｍ）。
各セグメントより引出されている端子は全てこの避雷
針パターンにて連結する。また、点灯端子以外のパター
ン（上下板のアライメントマーク等）も全て連結する。
針パターンにて連結する。また、点灯端子以外のパター
ン（上下板のアライメントマーク等）も全て連結する。
避雷針パターンは、前述の共通アースとは異なり端子
の内側のセル内部で連結するため、切り捨てしろが必要
ない。このため、ガラス基板１枚当りの取り個数も最大
限に増える。又、避雷針パターンによりそれぞれのセグ
メントに蓄電した電荷が徐々に放電して、全セグメント
が同電位となり静電気スパークの発生を防止出来る。
の内側のセル内部で連結するため、切り捨てしろが必要
ない。このため、ガラス基板１枚当りの取り個数も最大
限に増える。又、避雷針パターンによりそれぞれのセグ
メントに蓄電した電荷が徐々に放電して、全セグメント
が同電位となり静電気スパークの発生を防止出来る。
更に避雷針パターンは有効表示領域外に設けられてい
るので、上下基板の合せずれが多少あったとしても、こ
れが点灯パターンとして見て、表示品質を損なうことが
少ない。
るので、上下基板の合せずれが多少あったとしても、こ
れが点灯パターンとして見て、表示品質を損なうことが
少ない。
以下、本発明の一実施例を第１図により説明する。
第１図は、液晶セルを構成する一対のガラス基板のう
ちのセグメント電極が形成されるガラス基板の平面図で
ある。ガラス基板10の上に複数のセグメント電極４が形
成され、基板10の端辺には外部回路接続用電極端子11が
形成され、セグメント電極４と電極端子11との間は引き
回しリード12で接続されている。通常セグメント電極4,
電極端子11および引き回しリード12は一体に酸化インジ
ュウム，酸化スズ等で形成される。
ちのセグメント電極が形成されるガラス基板の平面図で
ある。ガラス基板10の上に複数のセグメント電極４が形
成され、基板10の端辺には外部回路接続用電極端子11が
形成され、セグメント電極４と電極端子11との間は引き
回しリード12で接続されている。通常セグメント電極4,
電極端子11および引き回しリード12は一体に酸化インジ
ュウム，酸化スズ等で形成される。
このようにガラス基板10上に所望の形状の透明導電膜
４を形成後、液晶分子配向手段として、ポリイミド膜を
塗布後、ビロード等でラビングすることが行われてい
る。このラビング処理時静電気スパーク障害が発生する
のを防止するために、引き回しリード12の１部に、セグ
メント電極４同志の最小間隙ｄより狭い間隙ｇで避雷針
パターン１を形成する。この避雷針パターン１は有効表
示領域20の外又は液晶セルのシール部３内に形成するこ
とが望ましい。避雷針対向ギャップｇは、ギャップｄに
比して大幅に狭くすることが好ましい（通常５〜30μ
ｍ）。
４を形成後、液晶分子配向手段として、ポリイミド膜を
塗布後、ビロード等でラビングすることが行われてい
る。このラビング処理時静電気スパーク障害が発生する
のを防止するために、引き回しリード12の１部に、セグ
メント電極４同志の最小間隙ｄより狭い間隙ｇで避雷針
パターン１を形成する。この避雷針パターン１は有効表
示領域20の外又は液晶セルのシール部３内に形成するこ
とが望ましい。避雷針対向ギャップｇは、ギャップｄに
比して大幅に狭くすることが好ましい（通常５〜30μ
ｍ）。
本実施例によれば、それぞれのセグメント電極に蓄電
した電荷は避雷針パターン11により徐々に放電し、全セ
グメントが同電位となりセグメント間の静電気スパーク
を防止する。
した電荷は避雷針パターン11により徐々に放電し、全セ
グメントが同電位となりセグメント間の静電気スパーク
を防止する。
本発明によれば、共通アースなどのセル外部での短絡
パターンを用いずに、セグメント間の静電気スパークの
発生を防止できる。これに伴い、１基板当りの取り個数
を減ずることがなく設計上の制限を取り払う効果があ
る。
パターンを用いずに、セグメント間の静電気スパークの
発生を防止できる。これに伴い、１基板当りの取り個数
を減ずることがなく設計上の制限を取り払う効果があ
る。
第１図は本発明の一実施例の液晶表示素子の正面パター
ン図である。 １……避雷針パターン、２……シール、４……セグメン
ト電極、10……ガラス基板、11……電極端子、12……引
き回しリード。
ン図である。 １……避雷針パターン、２……シール、４……セグメン
ト電極、10……ガラス基板、11……電極端子、12……引
き回しリード。
Claims (2)
- 【請求項１】複数の透明導電膜を内面に形成し、上記透
明導電膜を外部回路と接続する電極端子とを有する基板
を少なくとも一枚備える液晶表示素子において、上記透
明導電膜は有効表示領域内に並置し形成され、上記透明
導電膜には、隣り合う透明導電膜間の最小の間隙よりも
小さな間隙となるように突起が並置し形成され、かつ上
記突起は、上記有効表示領域内の透明導電膜と上記電極
端子とを接続する引き回しリードの有効表示領域外の部
分に設けられたことを特徴とする液晶表示素子。 - 【請求項２】上記突起は、上記液晶表示素子のシール部
内に存在することを特徴とする特許請求の範囲第１項記
載の液晶表示素子。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61245209A JP2574775B2 (ja) | 1986-10-17 | 1986-10-17 | 液晶表示素子 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61245209A JP2574775B2 (ja) | 1986-10-17 | 1986-10-17 | 液晶表示素子 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63100427A JPS63100427A (ja) | 1988-05-02 |
| JP2574775B2 true JP2574775B2 (ja) | 1997-01-22 |
Family
ID=17130248
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61245209A Expired - Fee Related JP2574775B2 (ja) | 1986-10-17 | 1986-10-17 | 液晶表示素子 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2574775B2 (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH10509533A (ja) * | 1995-09-11 | 1998-09-14 | フラット パネル ディスプレイ カンパニー ベスローテン フェンノートシャップ エフペーデー | 液晶表示装置 |
| JP3737176B2 (ja) | 1995-12-21 | 2006-01-18 | 株式会社半導体エネルギー研究所 | 液晶表示装置 |
| JP4347581B2 (ja) * | 2003-01-31 | 2009-10-21 | オプトレックス株式会社 | 液晶表示パネル |
| JP5570710B2 (ja) * | 2008-06-24 | 2014-08-13 | スタンレー電気株式会社 | 液晶表示素子及びその製造方法 |
| JP5679532B2 (ja) * | 2013-06-05 | 2015-03-04 | 株式会社半導体エネルギー研究所 | アクティブマトリックス型表示装置 |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60182413A (ja) * | 1984-02-29 | 1985-09-18 | Sharp Corp | 液晶表示素子の製造方法 |
| JPS60218625A (ja) * | 1984-04-16 | 1985-11-01 | Hitachi Ltd | 液晶表示素子 |
| JPS6235328U (ja) * | 1985-08-19 | 1987-03-02 |
-
1986
- 1986-10-17 JP JP61245209A patent/JP2574775B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS63100427A (ja) | 1988-05-02 |
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