JP2551162B2 - 絶縁ゲート型半導体装置 - Google Patents
絶縁ゲート型半導体装置Info
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Description
接触されるソース層と、ソース層に隣接する領域の表面
上にゲート絶縁膜を介してゲート電極を有するような絶
縁ゲート型半導体装置に関する。
MOSFET(以下MOSFETと記す)あるいは絶縁ゲート型バイ
ポーラトランジスタ(以下IGBTと記す)等においては、
それらの絶縁ゲート電極下にあるゲート酸化膜を、ゲー
ト電極にかかる静電気あるいはゲート電源からのノイズ
のような瞬時過電圧から保護するために次のような方策
がとられていた。すなわち、ゲート電極とソース電極の
間に、組立ての段階でツエナダイオードなどを含む保護
回路を接続したり、あるいは半導体装置の製造段階でMO
SFETやIGBT素子と同一基板に保護回路を集積したり、さ
らには、基板上に堆積される多結晶シリコン層などにツ
エナダイオードや抵抗体等を含む保護回路を形成したり
する方法である。
回路を接続する場合は、ツエナダイオード製作の工数お
よびそれを接続する工数が必要であり、また絶縁ゲート
型素子とツエナダイオードなどを含む装置全体を大きく
しなければならず、結果的にはコストがかかる問題があ
る。
ダイオードなどを基板内に作成するためにマスクが新た
に必要となり、製作工数もふえ、また保護回路集積のた
めに歩留まりが低下し、実際にはコストがかかってしま
う。さらに、基板に新しい領域を追加することにより寄
生効果が生じ、絶縁ゲート型素子の特性が影響される場
合もあり、これを阻止するために新たに分離技術を確立
しなければならない問題もある。
の部品を形成する場合は、そのためのマスクの形成、ド
ーピング等の工数が必要であり、やはりコストがかかる
問題がある。
基板の間に介在するゲート絶縁膜を瞬時過電圧による破
壊から保護することのできるゲート絶縁型半導体装置を
できるだけ低いコストで提供することにある。
半導体基板の一表面に選択的に形成される第二導電形の
領域と、該第二導電形の領域に選択的に形成される第一
導電形の領域と、第一導電形の半導体基板と第一導電形
の領域とに挟まれチャネル形成領域となる第二導電形の
領域上にゲート絶縁膜を介して形成されるゲートと、該
ゲートに接続されるゲート電極と、第一導電形の領域と
第二導電形の領域とに接続されるソース電極と、半導体
基板縁部の耐圧構造のための縁部電極とを備えるものに
おいて、前記ゲート電極、ソース電極及び縁部電極のい
ずれかの電極が隣接する間の間隔が所定の抵抗率を有す
る高抵抗の窒化シリコンからなる被覆膜により埋められ
たものとする。更に窒化シリコンからなる被覆膜がSiXN
10-Xからなり、SiXN10-XのXが3ないし7であるとよ
い。
極から高抵抗の窒化シリコンからなる被覆膜を通じて半
導体基板内の他の領域に落ちるので、ゲート絶縁膜の破
壊を阻止することができる。
およびn-層12からなるシリコン基板1のn-層12の表面部
にp層13がn-層12の露出部をはさんで設けられ、p層13
の表面部にそれぞれ一対のn+ソース層14が形成されてい
る。p層13のn+ソース層14とn-層12にはさまれた領域が
チャネル形成領域15であり、上にゲート酸化膜(SiO2)
2を介してゲート3が備えられる。各ゲート3は互いに
接続され、かつゲート電極4を介してゲート端子Gに接
続されている。このゲート電極4と絶縁層5で絶縁され
るソース電極6はAl蒸着膜よりなり、絶縁膜5の開口部
でp層13の中央に形成されたp+層16およびソース層14に
接触し、かつソース端子Sに接続されている。n++ドレ
イン層11には図示しないドレイン電極を介してドレイン
端子Dが接続されている。基板1の縁部に近接してn-層
12上に縁部電極7が設けられるが、この電極7は欠陥の
多い基板縁部を介してドレイン電極、すなわちドレイン
端子Dに接続され、それと同電位にある。この縁部電極
7とソース電極6の縁部は相互に近接する方向に延び、
縁部耐圧構造を形成している。さらに、上面を本発明に
より窒化シリコン膜9が被覆している。この窒化シリコ
ン膜はSiXN10-Xの組成を有し、xの値を変えることによ
り適当な抵抗率を制御される。これにより、ゲート電極
4とソース電極6の間に高抵抗体91が、あるいはソース
電極6と縁部電極7の間に高抵抗体92が接続されること
になる。
瞬時過電圧が加わったとすると、高抵抗体91により過電
圧をゲート電極4からソース電極6あるいはソース端子
Sへ、また高抵抗体91および高抵抗体92により縁部電極
7あるいはドレイン端子Dへ逃がすことができ、ゲート
酸化膜2の破壊を阻止することができる。
えることによって制御できる。その結果静電破壊電圧お
よびゲート・ソース間あるいはソース・ドレイン間のリ
ーク電流は第2図に示すようにSiXN10-Xのxの値により
変化する。従ってxの値を3ないし7とすることによ
り、静電破壊電圧としてA以上、リーク電流としてB以
下の値が保証され、ゲート保護抵抗として役立つ。しか
し、高抵抗体91,92の抵抗の調整には、窒化シリコン膜
9の厚さ,長さを変えてもよい。
電極4とソース電極6の間隙のみを高抵抗膜で埋めれば
よい。またゲート電極4と縁部電極7を近接して配線
し、その間を高抵抗膜で埋めることにより、ドレイン電
極へのみ過電圧を逃がすことができる。
図と共通の部分には同一の符号が付されている。この場
合は、シリコン基板1がp++ドレイン層17,n+バッファ層
18およびn-層12からなるが、n-層12の表面構造はMOSFET
の場合と同じで、ゲート電極4とソース電極6の間をSi
XN10-X膜からなる高抵抗体91、ソース電極6と縁部電極
の間を高抵抗体92が埋めている。
基板内の領域と同電位にある他の電極へ逃がすことがで
きるように、その間の間隙を所定の抵抗値の高抵抗の窒
化シリコンからなる被覆膜で埋めることにより、ゲート
電極と半導体基板の間のゲート絶縁膜を過電圧による破
壊から防ぐことができる。しかも、この構造は従来の表
面保護絶縁膜の材料を変えることのみによって得られる
ので低コストである。さらに、従来の表面保護絶縁膜は
外部からの汚染や外力による損傷からの保護には役立つ
が、容器に収容後、注型樹脂あるいは接合被覆樹脂など
の電荷がその表面を充電することにより信頼性を著しく
低下させる問題があったのに対し、本発明による高抵抗
被覆膜によって表面を覆うことにより、注型樹脂あるい
は接合被覆樹脂からの電荷がその被覆膜を通り電極に抜
けるため、信頼性が向上するという効果がある。
図はSiXN10-X膜のxの値と静電破壊電圧およびリーク電
流との関係線図、第3図は本発明の別の実施例のIGBTの
要部断面図である。 1:シリコン基板、2:ゲート酸化膜、3:ゲート、4:ゲート
電極、6:ソース電極、7:縁部電極、9:窒化シリコン膜、
91,92:高抵抗体。
Claims (2)
- 【請求項1】第一導電形の半導体基板の一表面に選択的
に形成される第二導電形の領域と、該第二導電形の領域
に選択的に形成される第一導電形の領域と、第一導電形
の半導体基板と第一導電形の領域とに挟まれチャネル形
成領域となる第二導電形の領域上にゲート絶縁膜を介し
て形成されるゲートと、該ゲートに接続されるゲート電
極と、第一導電形の領域と第二導電形の領域とに接続さ
れるソース電極と、半導体基板縁部の耐圧構造のための
縁部電極とを備えるものにおいて、前記ゲート電極、ソ
ース電極及び縁部電極のいずれかの電極が隣接する間の
間隔が所定の抵抗率を有する高抵抗の窒化シリコンから
なる被覆膜により埋められたことを特徴とする絶縁ゲー
ト型半導体装置。 - 【請求項2】特許請求の範囲第1項記載の絶縁ゲート形
半導体装置において、窒化シリコンからなる被覆膜がSi
XN10-Xからなり、SiXN10-XのXが3ないし7であること
を特徴とする絶縁ゲート型半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1215646A JP2551162B2 (ja) | 1989-08-22 | 1989-08-22 | 絶縁ゲート型半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1215646A JP2551162B2 (ja) | 1989-08-22 | 1989-08-22 | 絶縁ゲート型半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0379082A JPH0379082A (ja) | 1991-04-04 |
JP2551162B2 true JP2551162B2 (ja) | 1996-11-06 |
Family
ID=16675853
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1215646A Expired - Lifetime JP2551162B2 (ja) | 1989-08-22 | 1989-08-22 | 絶縁ゲート型半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2551162B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE60138964D1 (de) | 2000-12-25 | 2009-07-23 | Honda Motor Co Ltd | Wärmetauscher |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS55141748A (en) * | 1979-04-20 | 1980-11-05 | Sony Corp | Thin film resistor for mos field effect transistor |
JPS59178632A (ja) * | 1983-03-29 | 1984-10-09 | Toshiba Corp | 光デイスクピツクアツプ用対物レンズ支持装置 |
-
1989
- 1989-08-22 JP JP1215646A patent/JP2551162B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH0379082A (ja) | 1991-04-04 |
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