JP2021504952A - Tft基板、esd保護回路およびtft基板の製造方法 - Google Patents
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Abstract
本発明は、TFT基板、ESD保護回路およびTFT基板の製造方法に係り、本実施例におけるTFT基板は、ベース基板と、ベース基板に設けられる第1のゲートと、第1のゲートの上に設けられる第1の絶縁層と、第1の絶縁層に設けられるドレインと、ソースと、アクティブ層と、ドレイン、ソース、およびアクティブ層の上に設けられる第2の絶縁層と、第2の絶縁層の上に設けられる第2のゲートとを備える。これにより、液晶パネル画面の異常表示を防ぐことができる。【選択図】図4
Description
本発明は、液晶ディスプレイの分野に関し、特に、TFT基板、ESD保護回路およびTFT基板の製造方法に関する。
TFT−LCD(Thin Film Transistor Liquid Crystal Display、薄膜トランジスタ液晶ディスプレイ)は、軽量、薄型、低消費電力などの利点があるため、テレビ、ノートパソコン、携帯電話などの機器に広く使用されている。
フラットパネルディスプレイデバイスとして、液晶ディスプレイの液晶パネルは、通常、2枚のガラス基板と、ガラス基板間の液晶層とからなる。下部ガラス基板に多数のデータ線と多数の走査線が集積されており、それらは垂直方向に交互に配置されて多数の単位領域を形成しており、これらの単位領域はピクセルユニットとして定義されている。各ピクセルユニットは、主にピクセル電極、ストレージコンデンサ、TFTトランジスタなどのデバイスを備える。走査線上の駆動信号は、TFTトランジスタの動作状態を制御することができ、それにより、データ線の駆動信号を適時にピクセル電極に書き込むことができる。上記ドライブアレイを構成するガラス基板は、一般的にTFT基板と呼ばれている。上部ガラス基板にブラックマトリクス、カラーフィルター層、共通電極層を一体化で集積している。上部ガラス基板にはカラーフィルター層が設けられているため、一般的にカラーフィルター基板とも呼ばれている。TFT基板とカラーフィルム基板とを合わせて液晶表示基板と呼んでも良い。
しかしながら、液晶表示基板の製造工程においては、現像、エッチング、セル内への液晶配向、および搬送などの複数の工程により静電放電(Electro−Static Discharge、略称ESD)が発生する場合がある。静電気により発生した電荷により、TFTトランジスタデバイスや絶縁層が損傷され、液晶パネルの劣化や歩留まりに影響を与える。そのため、液晶パネルの設計においては、パネルに静電気を放電するための専用な経路や部品も設計されており、このような設計はESD保護回路と呼んでも良い。
図1は、従来技術におけるESD保護回路の概略構成図であり、このESD保護回路では、TFTトランジスタM1のソースがTFTトランジスタM2のドレインに接続され、TFTトランジスタM1のドレインがプラスの電圧(VGH)に接続され、TFTトランジスタM2のソースはマイナスの電圧(VGL)に接続され、また、TFTトランジスタM1のゲートはそのソースに並列に接続され、TFTトランジスタM2のゲートもそのソースに並列に接続されている。データ信号(Data)は、ドライバICにて生成されて対応するピクセル電極に出力され、また、外部から静電気が流入するのを防ぐため、途中にそのESD保護回路を通している。静電気が発生すると、外部から静電気(−KVの高電圧)が流れ込み、それぞれのVGH側とVGL側に放電する。ただし、このESD保護回路では、TFTトランジスタ工程の初期ターンオン電圧の均一性が低いため、実際の製品のTFTトランジスタの初期ターンオン電圧はマイナスの電圧に移動し、すなわち、TFTトランジスタの初期ターンオン電圧は0より小さい。図2を参照すると、2つのTFTトランジスタM1およびM2は、初期ターンオン電圧がマイナスの電圧であるためにターンオンされ、それによって大きなリーク電流を生成する。データ信号が入ると、リーク電流により、データ信号(Data)にはプラスの電圧(VGH)が混在し、図3を示すように、ここで、実線はドライバICから出力されるデータ信号を表し、破線はESD保護回路を通じたデータ信号を表する。データ信号を用いて画素電極を駆動すると、データ信号に不要な電圧が混在するため、ピクセル電極の輝度が異常となり、液晶パネルの表示画面に異常が発生する。
本発明が解決しようとする技術的問題は、上記従来技術におけるTFTトランジスタは、ターンオン電圧がゼロ以下であるため、静電気発生時に液晶パネルを異常表示させることである。
本発明がその技術的問題を解決するために採用する技術的解決策は、以下を含むTFT基板を構築することであり、それは:
ベース基板と、
前記ベース基板に設けられる第1のゲートと、
前記第1のゲートの上に設けられる第1の絶縁層と、
前記第1の絶縁層の上に設けられる、ドレインと、ソースと、アクティブ層と、
前記ドレイン、前記ソース、および前記アクティブ層の上に設けられる第2の絶縁層と、
前記第2の絶縁層の上に設けられ、マイナスの電圧に接続されている第2のゲートとを備え、前記ドレインの少なくとも一部と前記ソースの少なくとも一部とが、前記アクティブ層の外端に離間して設けられ、かつ前記アクティブ層を介して接続されることを特徴とする、TFT基板。
好ましくは、前記第1のゲートおよび前記第2のゲートが前記アクティブ層までそれぞれの距離は同じである。
好ましくは、前記第2のゲートの形状は、U字状である。
好ましくは、前記アクティブ層の前記ベース基板への正射影は、前記第1のゲートの前記ベース基板への正射影を少なくとも部分的に覆っている。
好ましくは、前記ドレインと前記ソースは階段状であり、前記アクティブ層の両端と上端に対称に設けられている。
好ましくは、前記第1のゲートと、前記第2のゲートとの形状およびサイズは同じである。
ベース基板と、
前記ベース基板に設けられる第1のゲートと、
前記第1のゲートの上に設けられる第1の絶縁層と、
前記第1の絶縁層の上に設けられる、ドレインと、ソースと、アクティブ層と、
前記ドレイン、前記ソース、および前記アクティブ層の上に設けられる第2の絶縁層と、
前記第2の絶縁層の上に設けられ、マイナスの電圧に接続されている第2のゲートとを備え、前記ドレインの少なくとも一部と前記ソースの少なくとも一部とが、前記アクティブ層の外端に離間して設けられ、かつ前記アクティブ層を介して接続されることを特徴とする、TFT基板。
好ましくは、前記第1のゲートおよび前記第2のゲートが前記アクティブ層までそれぞれの距離は同じである。
好ましくは、前記第2のゲートの形状は、U字状である。
好ましくは、前記アクティブ層の前記ベース基板への正射影は、前記第1のゲートの前記ベース基板への正射影を少なくとも部分的に覆っている。
好ましくは、前記ドレインと前記ソースは階段状であり、前記アクティブ層の両端と上端に対称に設けられている。
好ましくは、前記第1のゲートと、前記第2のゲートとの形状およびサイズは同じである。
本発明はまた、上記のTFT基板を備えるESD保護回路を構築し、前記TFT基板は、第1のTFTトランジスタと第2のTFTトランジスタとを備え、第1のTFTトランジスタM1のドレインはプラスの電圧信号に接続され、第2のTFTトランジスタのソースはマイナスの電圧信号に接続され、第1のTFTトランジスタのソースと、第1のTFTトランジスタの第1のゲートと、第2のTFTトランジスタのドレインと共にデータ信号に接続され、第2のTFTトランジスタの第1のゲートは、ソースに接続される。
好ましくは、前記第1のTFTトランジスタの第2のゲートおよび前記第2のTFTトランジスタの第2のゲートは、第2のTFTトランジスタのソースにそれぞれ接続される。
好ましくは、前記第1のTFTトランジスタの第2のゲートおよび前記第2のTFTトランジスタの第2のゲートは、第2のTFTトランジスタのソースにそれぞれ接続される。
本発明はまた、以下のステップを含む、TFT基板を製造する方法を構築する。
S11.ベース基板を準備し、前記ベース基板上に第1のゲートを形成することと、
S12.前記第1のゲートおよび前記基板に第1の絶縁層を形成し、前記第1の絶縁層は前記第1のゲートを完全に覆うことと、
S13.前記第1の絶縁層にドレイン、ソースおよびアクティブ層を形成し、ドレインの少なくとも一部およびソースの少なくとも一部は、離間して前記アクティブ層の外端に設けられ、前記アクティブ層を介して接続されていることと、
S14.前記ドレイン、前記ソースおよび前記アクティブ層の上に第2の絶縁層を形成し、前記第2の絶縁層は前記ドレイン、前記ソースおよび前記アクティブ層を完全に覆うことと、
S15.前記第2の絶縁層の上にマイナスの電圧に接続される第2のゲートを形成することとのステップを含むことを特徴とする、TFT基板の製造方法。
好ましくは、前記ステップS11の内に、前記ベース基板に第1のゲートを形成し、それは、
前記ベース基板上に第1の金属層を堆積し、フォトリソグラフィプロセスによって前記第1の金属層をパターニングして第1のゲートを得ること、
または、
前記ベース基板上に第1のポリシリコン層を形成し、前記第1のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記N型のドープされたポリシリコン層をパターニングして、第1のゲートを得ることを含むことを特徴とする、TFT基板の製造方法。
好ましくは、ステップS13はさらに以下を含む。
化学的または物理的気相成長法によって前記第1の絶縁層上に半導体層を堆積し、フォトリソグラフィプロセスによって前記半導体層をパターニングして、アクティブ層を得ることと、
前記アクティブ層および前記第1の絶縁層に第2の金属層を堆積し、フォトリソグラフィプロセスによって前記第2の金属層をパターニングして、ソースおよびドレインを得ることと、または、前記アクティブ層および前記第1の絶縁層に第2のポリシリコン層を形成し、前記第2のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記第2のポリシリコン層をパターニングして、ソースおよびドレインを得ることを含むことを特徴とする、TFT基板の製造方法。
好ましくは、前記ステップS15は以下を含む。
前記第2の絶縁層に第3の金属層を堆積し、フォトリソグラフィプロセスによって前記第3の金属層をパターニングして第2のゲートを得ること、
または、
前記第2の絶縁層に第3のポリシリコン層を形成し、前記第3のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記N型のドープされたポリシリコン層をパターニングして、第2のゲートを得ることを含むことを特徴とする、TFT基板の製造方法。
好ましくは、前記フォトリソグラフィプロセスは、フォトレジスト、露光、現像およびエッチングプロセスを含む。
S11.ベース基板を準備し、前記ベース基板上に第1のゲートを形成することと、
S12.前記第1のゲートおよび前記基板に第1の絶縁層を形成し、前記第1の絶縁層は前記第1のゲートを完全に覆うことと、
S13.前記第1の絶縁層にドレイン、ソースおよびアクティブ層を形成し、ドレインの少なくとも一部およびソースの少なくとも一部は、離間して前記アクティブ層の外端に設けられ、前記アクティブ層を介して接続されていることと、
S14.前記ドレイン、前記ソースおよび前記アクティブ層の上に第2の絶縁層を形成し、前記第2の絶縁層は前記ドレイン、前記ソースおよび前記アクティブ層を完全に覆うことと、
S15.前記第2の絶縁層の上にマイナスの電圧に接続される第2のゲートを形成することとのステップを含むことを特徴とする、TFT基板の製造方法。
好ましくは、前記ステップS11の内に、前記ベース基板に第1のゲートを形成し、それは、
前記ベース基板上に第1の金属層を堆積し、フォトリソグラフィプロセスによって前記第1の金属層をパターニングして第1のゲートを得ること、
または、
前記ベース基板上に第1のポリシリコン層を形成し、前記第1のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記N型のドープされたポリシリコン層をパターニングして、第1のゲートを得ることを含むことを特徴とする、TFT基板の製造方法。
好ましくは、ステップS13はさらに以下を含む。
化学的または物理的気相成長法によって前記第1の絶縁層上に半導体層を堆積し、フォトリソグラフィプロセスによって前記半導体層をパターニングして、アクティブ層を得ることと、
前記アクティブ層および前記第1の絶縁層に第2の金属層を堆積し、フォトリソグラフィプロセスによって前記第2の金属層をパターニングして、ソースおよびドレインを得ることと、または、前記アクティブ層および前記第1の絶縁層に第2のポリシリコン層を形成し、前記第2のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記第2のポリシリコン層をパターニングして、ソースおよびドレインを得ることを含むことを特徴とする、TFT基板の製造方法。
好ましくは、前記ステップS15は以下を含む。
前記第2の絶縁層に第3の金属層を堆積し、フォトリソグラフィプロセスによって前記第3の金属層をパターニングして第2のゲートを得ること、
または、
前記第2の絶縁層に第3のポリシリコン層を形成し、前記第3のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記N型のドープされたポリシリコン層をパターニングして、第2のゲートを得ることを含むことを特徴とする、TFT基板の製造方法。
好ましくは、前記フォトリソグラフィプロセスは、フォトレジスト、露光、現像およびエッチングプロセスを含む。
本発明の技術的解決策の実施において、TFT基板はダブルゲート構造を採用し、第2のゲートはマイナスの電圧に接続されるため、TFTトランジスタのターンオン電圧は正の方向に移動することができる。また、TFTトランジスタによってESD保護回路を構築すると、静電気が発生しても、両方のTFTトランジスタのターンオン電圧が0より大きいため、リーク電流は非常小さいため、無視してもよく、結果として、ドライバICからピクセル電極に出力されるデータ信号は不要な電圧信号が混入せず、ピクセル電極の輝度異常が発生せず、液晶画面の異常を防ぐ。
本発明の発明例をより明確に例示するために、実施例の説明に使用される図面を以下に簡単に説明する。以下の説明における図面は、本発明のいくつかの実施例であることが過ぎないと明らかであり、当業者にとっては、これらの図面に基づいて他の図面を創造的な仕事をすることなく得ることもできる。図面では:
図1は、従来技術におけるESD保護回路の回路構成図である。
図2は、静電気が発生したときの図1のESD保護回路の概略図である。
図3は、静電気が発生したときの入力データ信号と出力データ信号の波形図である。
図4は、本発明におけるTFT基板の概略構成図である。
図5は、従来技術におけるTFTトランジスタと本発明におけるTFTトランジスタのターンオン電圧のシミュレーションの概略図である。
図6は、本発明におけるESD保護回路の回路構成図である。
図7は、本発明におけるTFT基板の製造方法の実施例1のフローチャートである。
以下、添付図面を参照しながら、本発明の実施例について明確に説明する。尚、以下の実施例は、明らかに本発明を具体化した一例のみであって、本発明の技術的範囲を限定する性格を有さない。本発明の範囲から逸脱することなく本発明の実施例に基づいて当業者によって得られる他のすべての実施例も、本発明の範囲である。
図4は、本発明における基板の実施例1の概略構成図であり、本実施例のTFT基板は、積層に設けられているベース基板11、第1のゲート12、第1の絶縁層13、ドレイン14、ソース15、アクティブ層16、第2の絶縁層17、および第2のゲート18を備える。ここで、第1のゲート12は、ベース基板11に設けられており、その面積は、ベース基板11よりも小さく、ベース基板11の中央部に設けられていることが好ましい。第1の絶縁層13は、第1のゲート12の上に設けられ、ドレイン14、ソース15およびアクティブ層16は第1の絶縁層13の上に設けられ、また、ドレイン14の少なくとも一部およびソース15の少なくとも一部は、離間してアクティブ層16の外端にアクティブ層16を介して接続される。また、第2の絶縁層17は、ドレイン14、ソース15およびアクティブ層16の上に配置され、ドレイン14、ソース15およびアクティブ層16を覆い、第2のゲート18は、第2の絶縁層17の上に設けられており、また、第2のゲート18はマイナスの電圧に接続される。
また、本実施例では、アクティブ層16のベース基板11への正射影は、第1のゲート12のベース基板11への正射影を部分的に覆っている。もちろん、他の実施例では、第1のゲート12のベース基板11への正射影を完全に覆ってもよい。
また、ドレイン14とソース15は階段状であり、アクティブ層16の両端と上端に対称に設けられている。もちろん、他の実施例では、ドレイン14およびソース15は他の形状を有してもよく、また、アクティブ層の左端および右端、下端または上端に設けられてもよい。
また、第2のゲート18の形状は、U字状である。もちろん、他の実施例では、第1のゲート12と第2のゲート18との形状およびサイズは同じであってもよく、両者がアクティブ層16までそれぞれの距離は同じであり、もちろん、両者の形状、サイズ、およびアクティブ層16までそれぞれの距離は異なっても良い。
本実施例におけるTFT基板はダブルゲート構造を採用しており、第1のゲート12と第2のゲート18がアクティブ層の両側に分布している。第1のゲートに電圧が印加されると、導電性チャネルのオン電流が発生しつつ、第2のゲート18がマイナスの電圧を印加するため、導電性チャネルの電流量が抑制され、さらに導電性チャネルの断面積の増加が防止され、すなわちTFTトランジスタのターンオン電圧の増加に相当する。図5を参照しながら、第2のゲート18を追加しない場合、TFTトランジスタのターンオン電圧は−5Vであり、第2のゲート18を追加した場合、TFTトランジスタのターンオン電圧は正方向に移動して0Vとなる。
図6は、本発明におけるESD保護回路の回路構成図であり、本実施例におけるESD保護回路は、上記実施例で示したTFT基板を備え、また、このTFT基板は、第1のTFTトランジスタM1と第2のTFTトランジスタM2とを備え、ここで、第1のTFTトランジスタM1のドレインはプラスの電圧信号(VGH)に接続され、第2のTFTトランジスタM2のソースはマイナスの電圧信号(VGL)に接続され、第1のTFTトランジスタM1のソースと、第1のTFTトランジスタM1の第1のゲートと、第2のTFTトランジスタM2のドレインと共にデータ信号(Data)に接続され、第2のTFTトランジスタM2の第1のゲートは、ソースに接続される。
好ましくは、第1のTFTトランジスタM1の第2のゲートおよび第2のTFTトランジスタM2の第2のゲートは、第2のTFTトランジスタM2のソースにそれぞれ接続され、その結果、電圧源を追加せずに、既存のマイナスの電圧信号(VGL)を利用して第1のTFTトランジスタM1の第2のゲートと第2のTFTトランジスタM2の第2のゲートとを接続する。
本実施例では、ドライバICがデータ信号(Data)を出力した後、ESD保護回路を介してピクセル電極に出力されるが、静電気が発生すると、両方のTFTトランジスタM1、M2のターンオン電圧が0より大きいため、リーク電流は非常小さいため、無視してもよく、結果として、データ信号(Data)に不要なプラスの電圧信号(VGH)が混入されないため、ピクセル電極に出力されるデータ信号(Data)がより正確になり、ピクセル電極の輝度の異常な状態が発生しない。
図7は、本発明におけるTFT基板の製造方法の実施例1のフローチャートであり、本実施例のTFT基板の製造方法は、以下の工程を含む。
S11.ベース基板を準備し、ベース基板上に第1のゲートを形成する。
具体的には、一例では、第1のゲートを製造する方法は、ベース基板上に第1の金属層を堆積し、フォトリソグラフィプロセスによって第1の金属層をパターニングして第1のゲートを得る。第1の金属層の材料は、アルミニウム、モリブデン、銅、または銀であってよい。もちろん、別の例では、第1のゲートの製造方法は、ベース基板上に第1のポリシリコン層を形成し、第1のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによってN型のドープされたポリシリコン層をパターニングして、第1のゲートを得る。
具体的には、一例では、第1のゲートを製造する方法は、ベース基板上に第1の金属層を堆積し、フォトリソグラフィプロセスによって第1の金属層をパターニングして第1のゲートを得る。第1の金属層の材料は、アルミニウム、モリブデン、銅、または銀であってよい。もちろん、別の例では、第1のゲートの製造方法は、ベース基板上に第1のポリシリコン層を形成し、第1のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによってN型のドープされたポリシリコン層をパターニングして、第1のゲートを得る。
S12.第1の絶縁層を第1のゲートおよび基板上に形成し、第1の絶縁層は第1のゲートを完全に覆う。
S13.第1の絶縁層にドレイン、ソースおよびアクティブ層を形成し、ドレインの少なくとも一部およびソースの少なくとも一部は、離間してアクティブ層の外端に設けられ、アクティブ層を介して接続されている。
具体的には、アクティブ層の製造方法は、化学的または物理的気相成長法によって第1の絶縁層上に半導体層を堆積し、フォトリソグラフィプロセスによって半導体層をパターニングして、アクティブ層を得る。
具体的には、ドレインおよびソースの製造方法は、アクティブ層および第1の絶縁層に第2の金属層を堆積し、フォトリソグラフィプロセスによって第2の金属層をパターニングして、ソースおよびドレインを得る;または、アクティブ層および第1の絶縁層に第2のポリシリコン層を形成し、第2のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって第2のポリシリコン層をパターニングして、ソースおよびドレインを得る。
S14.ドレイン、ソースおよびアクティブ層に第2の絶縁層を形成し、第2の絶縁層はドレイン、ソースおよびアクティブ層を完全に覆う。
S15. 第2の絶縁層の上にマイナスの電圧に接続される第2のゲートを形成する。
具体的には、第2のゲートの製造方法は、第2の絶縁層に第3の金属層を堆積し、フォトリソグラフィプロセスによって第3の金属層をパターニングして、第2のゲートを得る;または、第2の絶縁層に第3のポリシリコン層を形成し、第3のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによってN型のドープされたポリシリコン層をパターニングして、第2のゲートを得る。
さらに、上記の実施例におけるフォトリソグラフィプロセスは、フォトレジスト、露光、現像およびエッチングプロセスを含む。
上記は本発明の好ましい実施例に過ぎず、本発明を限定することを意図するものではなく、当業者にとって、本発明は様々な改変および変更を有し得る。本発明の精神および原理の範囲内のあらゆる修正、同等の置換、改良などは、本発明の特許請求の範囲に含まれるものとする。
Claims (13)
- ベース基板と、
前記ベース基板に設けられる第1のゲートと、
前記第1のゲートの上に設けられる第1の絶縁層と、
前記第1の絶縁層の上に設けられるドレインと、ソースと、アクティブ層と、
前記ドレイン、前記ソース、および前記アクティブ層の上に設けられる第2の絶縁層と、
前記第2の絶縁層の上に設けられ、マイナスの電圧に接続されている第2のゲートとを備え、前記ドレインの少なくとも一部と前記ソースの少なくとも一部とが、前記アクティブ層の外端に離間して設けられ、かつ前記アクティブ層を介して接続されることを特徴とする、TFT基板。 - 請求項1に記載のTFT基板であって、前記第1のゲートおよび前記第2のゲートが前記アクティブ層までそれぞれの距離は同じであることを特徴とする、TFT基板。
- 請求項1に記載のTFT基板であって、前記第2のゲートの形状は、U字状であることを特徴とする、TFT基板。
- 請求項1に記載のTFT基板であって、前記アクティブ層の前記ベース基板への正射影は、前記第1のゲートの前記ベース基板への正射影を少なくとも部分的に覆っていることを特徴とする、TFT基板。
- 請求項1に記載のTFT基板であって、前記ドレインと前記ソースは階段状であり、前記アクティブ層の外端に対称に設けられていることを特徴とする、TFT基板。
- 請求項1に記載のTFT基板であって、前記第1のゲートと、前記第2のゲートとの形状およびサイズは同じであることを特徴とする、TFT基板。
- 請求項1乃至6のいずれか1項に記載のTFT基板を備えるESD保護回路であって、前記TFT基板は、第1のTFTトランジスタと第2のTFTトランジスタとを備え、第1のTFTトランジスタのドレインはプラスの電圧信号に接続され、第2のTFTトランジスタのソースはマイナスの電圧信号に接続され、第1のTFTトランジスタのソースと、第1のTFTトランジスタの第1のゲートと、第2のTFTトランジスタのドレインと共にデータ信号に接続され、第2のTFTトランジスタの第1のゲートは、ソースに接続されることを特徴とする、ESD保護回路。
- 請求項7に記載のESD保護回路であって、前記第1のTFTトランジスタの第2のゲートおよび前記第2のTFTトランジスタの第2のゲートは、第2のTFTトランジスタのソースにそれぞれ接続されることを特徴とする、ESD保護回路。
- TFT基板の製造方法であって、
S11.ベース基板を準備し、前記ベース基板に第1のゲートを形成することと、
S12.前記第1のゲートおよび前記基板に第1の絶縁層を形成し、前記第1の絶縁層は前記第1のゲートを完全に覆うことと、
S13.前記第1の絶縁層にドレイン、ソースおよびアクティブ層を形成し、ドレインの少なくとも一部とソースの少なくとも一部とが、離間して前記アクティブ層の外端に設けられ、かつ前記アクティブ層を介して接続されていることと、
S14.前記ドレイン、前記ソースおよび前記アクティブ層の上に第2の絶縁層を形成し、前記第2の絶縁層は前記ドレイン、前記ソースおよび前記アクティブ層を完全に覆うことと、
S15.前記第2の絶縁層の上にマイナスの電圧に接続される第2のゲートを形成することとのステップを含むことを特徴とする、TFT基板の製造方法。 - 請求項9に記載のTFT基板の製造方法であって、前記ステップS11の内に、前記ベース基板に第1のゲートを形成することは、
前記ベース基板上に第1の金属層を堆積し、フォトリソグラフィプロセスによって前記第1の金属層をパターニングして第1のゲートを得ること、
または、
前記ベース基板上に第1のポリシリコン層を形成し、前記第1のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記N型のドープされたポリシリコン層をパターニングして、第1のゲートを得ることを含むことを特徴とする、TFT基板の製造方法。 - 請求項9に記載のTFT基板の製造方法であって、ステップS13は、
化学的または物理的気相成長法によって前記第1の絶縁層上に半導体層を堆積し、フォトリソグラフィプロセスによって前記半導体層をパターニングして、アクティブ層を得ることと、
前記アクティブ層および前記第1の絶縁層に第2の金属層を堆積し、フォトリソグラフィプロセスによって前記第2の金属層をパターニングして、ソースおよびドレインを得ることと、または、前記アクティブ層および前記第1の絶縁層に第2のポリシリコン層を形成し、前記第2のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記第2のポリシリコン層をパターニングして、ソースおよびドレインを得ることを含むことを特徴とする、TFT基板の製造方法。 - 請求項9に記載のTFT基板の製造方法であって、前記ステップS15は、
前記第2の絶縁層に第3の金属層を堆積し、フォトリソグラフィプロセスによって前記第3の金属層をパターニングして第2のゲートを得ること、
または、
前記第2の絶縁層に第3のポリシリコン層を形成し、前記第3のポリシリコン層にN型ドーピングを実行し、次にフォトリソグラフィプロセスによって前記N型のドープされたポリシリコン層をパターニングして、第2のゲートを得ることを含むことを特徴とする、TFT基板の製造方法。 - 請求項10乃至12のいずれか1項に記載のTFT基板の製造方法であって、前記フォトリソグラフィプロセスは、フォトレジスト、露光、現像およびエッチングプロセスを含むことを特徴とする、TFT基板の製造方法。
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