JP2019097115A - Mpu処理装置、送信装置、mpu処理方法及びプログラム - Google Patents
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Abstract
Description
・ROM(Read Only Memory)52
・RAM(Random Access Memory)53
・RAM53にロードされるプログラム54
・プログラム54を格納する記憶装置55
・記録媒体56の読み書きを行うドライブ装置57
・通信ネットワーク59と接続する通信インタフェース58
・データの入出力を行う入出力インタフェース60
・各構成要素を接続するバス61
各実施形態の各構成要素は、これらの機能を実現するプログラム54をCPU51が取得して実行することで実現される。例えば、図1の送信装置1の例では、第1のMPU処理部11及び第2のMPU処理部12は、プログラム54を取得したCPU51が、プログラム54に基づき入力MPUに対する処理を行うことで機能が実現されてもよい。切替部13は、例えばプログラム54を取得したCPU51が、第1のMPU処理部11と第2のMPU処理部12の切り替え処理を行うことで機能が実現されてもよい。第1のリセット制御部14及び第2のリセット制御部15は、例えばプログラム54を取得したCPU51が、プログラム54に基づき第1及び第2のMPUシーケンス番号が第1及び第2のMPU処理部の切り替えで0にリセットされるよう第1及び第2のMPU処理部を制御する処理を行うことで機能が実現されてもよい。
10、20、30 MPU処理装置
11、21、31 MPU処理部
12、22、32 MPU処理部
13、23、33 切替部
14、15、24、25、34、35、36、37 リセット制御部
16 制御情報生成部
161 PAメッセージ生成部
162 PAメッセージ生成部
163 切替出力部
17 合成部
171 MMTマルチプレクサ
172 MMTマルチプレクサ
173 切替出力部
174 MMTマルチプレクサ
18 送信部
19 制御情報
191 MPT
201 アセット情報
202 PID
203 MPUタイムスタンプ記述子
204 MPU拡張タイムスタンプ記述子
205 MPUシーケンス番号
211 処理部
221 処理部
212 MPUシーケンス番号記述部
222 MPUシーケンス番号記述部
213、223、313、317、323、327 同期部
214、224、314、318、324、328 遅延部
311、321 映像MPU処理部
312、322 VMPUシーケンス番号記述部
315、325 音声MPU処理部
316、326 AMPUシーケンス番号記述部
Claims (10)
- 入力MPUに第1の処理を行い第1のMPUシーケンス番号を記述する第1のMPU処理部と、
前記入力MPUに第2の処理を行い第2のMPUシーケンス番号を記述する第2のMPU処理部と、
前記第1のMPU処理部と第2のMPU処理部の切り替えを行う切替部と、
前記第1及び第2のMPUシーケンス番号が前記切り替えでリセットされるよう前記第1のMPU処理部及び前記第2のMPU処理部を制御する第1及び第2のリセット制御部と、
を有するMPU処理装置。 - 前記第1のMPU処理部は、
前記入力MPUに処理を行う第1の処理部と、
前記第1の処理部の出力に前記第1のMPUシーケンス番号を記述する第1のMPUシーケンス番号記述部と、
を有し
前記第2のMPU処理部は、
前記入力MPUに処理を行う第2の処理部と、
前記第2の処理部の出力に前記第2のMPUシーケンス番号を記述する第2のMPUシーケンス番号記述部と、
を有し、
前記第1のリセット制御部及び前記第2のリセット制御部は、前記切り替えで前記第1のMPUシーケンス番号及び前記第2のMPUシーケンス番号が0にリセットされるよう前記第1のMPUシーケンス番号記述部及び前記第2のMPUシーケンス番号記述部を制御する、
請求項1に記載のMPU処理装置。 - 前記第1及び第2のMPU処理部は、前記切り替えの指示があると前記第1のMPUと前記第2のMPUのGOPを同期する第1及び第2の同期部を有し、
前記第1のリセット制御部及び前記第2のリセット制御部は、前記切り替えの指示から所定の複数番目のGOPで前記第1のMPUシーケンス番号及び前記第2のMPUシーケンス番号が0にリセットされるよう前記第1のMPUシーケンス番号記述部及び前記第2のMPUシーケンス番号記述部を制御する、
請求項1又は2に記載のMPU処理装置。 - 前記切り替えの指示から所定の複数番目のGOPで、前記入力MPUの前記第1及び第2のMPU処理部への入力を遅延する第1及び第2の遅延部を有する、
請求項3に記載のMPU処理装置。 - 前記第1のMPU処理部は、
前記入力MPUのうち映像のMPUに前記第1の処理のうち第1の映像処理を行う第1の映像MPU処理部と、
前記入力MPUのうち音声のMPUに前記第1の処理のうち第1の音声処理を行う第1の音声MPU処理部と、
を有し、
前記第1のMPUシーケンス番号記述部は、
前記第1の映像MPU処理部の出力に第1のVMPUシーケンス番号を記述する第1のVMPUシーケンス番号記述部と、
前記第1の音声MPU処理部の出力に第1のAMPUシーケンス番号を記述する第1のAMPUシーケンス番号記述部と、
を有し
前記第2のMPU処理部は、
前記入力MPUのうち映像のMPUに前記第2の処理のうち第2の映像処理を行う第2の映像MPU処理部と、
前記入力MPUのうち音声のMPUに前記第2の処理のうち第2の音声処理を行う第2の音声MPU処理部と、
を有し、
前記第2のMPUシーケンス番号記述部は、
前記第2の映像MPU処理部の出力に第2のVMPUシーケンス番号を記述する第2のVMPUシーケンス番号記述部と、
前記第2の音声MPU処理部の出力に第2のAMPUシーケンス番号を記述する第2のAMPUシーケンス番号記述部と、
を有し、
前記第1のMPUシーケンス番号は、前記第1のVMPUシーケンス番号及び前記第1のAMPUシーケンス番号からなり、
前記第2のMPUシーケンス番号は、前記第2のVMPUシーケンス番号及び前記第2のAMPUシーケンス番号からなる、
請求項1に記載のMPU処理装置。 - 請求項1から5のいずれか1項に記載のMPU処理装置と、
前記第1のMPUシーケンス番号及び前記第2のMPUシーケンス番号を含む制御情報を生成する制御情報生成部と、
前記切り替えに対応して、前記第1のMPU処理部の出力と前記第1のMPUシーケンス番号を含む制御情報、又は前記第2のMPU処理部の出力と前記第2のMPUシーケンス番号を含む制御情報、を合成する合成部と、
を有する送信装置。 - 前記制御情報生成部は、
前記第1のMPUシーケンス番号を含む第1の制御情報を生成する第1のPAメッセージ生成部と、
前記第2のMPUシーケンス番号を含む第2の制御情報を生成する第2のPAメッセージ生成部と、
を有し、
前記合成部は、
前記第1のMPU処理部の出力と前記第1の制御情報とを合成する第1のMMTマルチプレクサと、
前記第2のMPU処理部の出力と前記第2の制御情報とを合成する第2のMMTマルチプレクサと、
前記切り替えに対応して前記第1のMMTマルチプレクサの出力と前記第2のMMTマルチプレクサの出力とを切り替えて出力する切替出力部と、
を有する請求項6に記載の送信装置。 - 前記制御情報生成部は、
前記第1のMPUシーケンス番号を含む第1の制御情報を生成する第1のPAメッセージ生成部と、
前記第2のMPUシーケンス番号を含む第2の制御情報を生成する第2のPAメッセージ生成部と、
前記切り替えに対応して前記第1の制御情報と前記第2の制御情報とを切り替えて出力する切替出力部と
を有し、
前記合成部は、
前記切り替えに対応して前記第1のMPU処理部の出力又は前記第2のMPU処理部の出力と、前記切り替えに対応して前記制御情報生成部から出力された前記第1の制御情報又は前記第2の制御情報とを合成する第3のMMTマルチプレクサ、
を有する請求項6に記載の送信装置。 - 第1及び第2のMPU処理部を有する送信装置のMPU処理方法において、
前記第1のMPU処理部により入力MPUに第1の処理を行い、
前記第2のMPU処理部により前記入力MPUに第2の処理を行い、
前記第1のMPU処理部と前記第2のMPU処理部を切り替え、
前記第1及び第2のMPU処理部の出力に記述される第1及び第2のMPUシーケンス番号が前記切り替えでリセットされるよう制御する、
MPU処理方法。 - コンピュータを、
入力MPUに第1の処理を行い第1のMPUシーケンス番号を記述する第1のMPU処理部、
前記入力MPUに第2の処理を行い第2のMPUシーケンス番号を記述する第2のMPU処理部、
前記第1のMPU処理部と第2のMPU処理部を切り替える切替部、及び
前記第1及び第2のMPUシーケンス番号が前記切り替えでリセットされるよう前記第1のMPU処理部及び前記第2のMPU処理部を制御する第1及び第2のリセット制御部、
として機能させるプログラム。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017226979A JP7024353B2 (ja) | 2017-11-27 | 2017-11-27 | Mpu処理装置、送信装置、mpu処理方法及びプログラム |
JP2022013874A JP2022048256A (ja) | 2017-11-27 | 2022-02-01 | Mpu処理装置、送信装置、mpu処理方法、送信方法、プログラム及び送信プログラム |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2017226979A JP7024353B2 (ja) | 2017-11-27 | 2017-11-27 | Mpu処理装置、送信装置、mpu処理方法及びプログラム |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2022013874A Division JP2022048256A (ja) | 2017-11-27 | 2022-02-01 | Mpu処理装置、送信装置、mpu処理方法、送信方法、プログラム及び送信プログラム |
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JP7024353B2 JP7024353B2 (ja) | 2022-02-24 |
Family
ID=66973226
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
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Family Applications After (1)
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JP2022013874A Pending JP2022048256A (ja) | 2017-11-27 | 2022-02-01 | Mpu処理装置、送信装置、mpu処理方法、送信方法、プログラム及び送信プログラム |
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Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
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JP2015170972A (ja) * | 2014-03-06 | 2015-09-28 | 株式会社東芝 | Mmt送信システム、暗号化処理装置、受信装置 |
JP2016048858A (ja) * | 2014-08-27 | 2016-04-07 | シャープ株式会社 | 再生装置 |
JP2018125741A (ja) * | 2017-02-01 | 2018-08-09 | 株式会社東芝 | 符号化装置、多重化装置、切替装置、送信システム、および送信方法 |
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2017
- 2017-11-27 JP JP2017226979A patent/JP7024353B2/ja active Active
-
2022
- 2022-02-01 JP JP2022013874A patent/JP2022048256A/ja active Pending
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
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JP2018125741A (ja) * | 2017-02-01 | 2018-08-09 | 株式会社東芝 | 符号化装置、多重化装置、切替装置、送信システム、および送信方法 |
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