JP2018129627A5 - - Google Patents

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Claims (6)

  1. NMOSトランジスタにより構成され、第1の入力信号と第2の入力信号との差に応じた信号を出力する差動対回路と、
    前記第1の入力信号の電圧レベルが所定の閾値よりも低いときには、前記第1の入力信号の電圧レベルを上げて前記差動対回路へ入力する第1の入力回路と、
    を有するコンパレータ。
  2. 前記第1の入力回路は、前記第1の入力信号の電圧レベルを上げるようにシフトアップする第1のレベルシフト回路を有し、前記第1の入力信号の電圧レベルが前記所定の閾値よりも低いときには、前記第1の入力信号の電圧レベルを上げるために前記第1のレベルシフト回路によりシフトアップされた前記第1の入力信号を前記差動対回路へ供給し、前記第1の入力信号の前記電圧レベルが前記所定の閾値よりも低くないときには、前記第1の入力信号をそのまま前記差動対回路へ供給する請求項1に記載のコンパレータ。
  3. 更に、第2の入力回路を有し、
    前記第2の入力回路は、前記第2の入力信号の電圧レベルを上げるようにシフトアップする第2のレベルシフト回路を有し、前記第1の入力信号の電圧レベルが前記所定の閾値よりも低いときには、前記第2のレベルシフト回路によりシフトアップされた前記第2の入力信号を前記差動対回路へ供給し、前記第1の入力信号の前記電圧レベルが前記所定の閾値よりも低くないときには、前記第2の入力信号をそのまま前記差動対回路へ供給する請求項2に記載のコンパレータ。
  4. NMOSトランジスタにより構成され、第1の入力信号と第2の入力信号との差に応じた信号を出力する差動対回路と、
    前記第1の入力信号の電圧レベルをシフトアップする第1のレベルシフト回路と、 前記第2の入力信号の電圧レベルをシフトアップする第2のレベルシフト回路と、
    前記第1の入力信号の電圧レベルが前記所定の閾値よりも低いときには、前記第1のレベルシフト回路によりシフトアップされた前記第1の入力信号を選択し、前記第1の入力信号の前記電圧レベルが前記所定の閾値よりも低くないときには、前記第1の入力信号を選択して、前記差動対回路へ供給する第1の選択回路と、
    前記第1の入力信号の電圧レベルが前記所定の閾値よりも低いときには、前記第2のレベルシフト回路によりシフトアップされた前記第2の入力信号を選択し、前記第1の入力信号の前記電圧レベルが前記所定の閾値よりも低くないときには、前記第2の入力信号を選択して、前記差動対回路へ供給する第2の選択回路と、
    を有するコンパレータ。
  5. 前記第1の入力信号に基づいて、選択信号を前記第1の選択回路及び前記第2の選択回路に出力する選択信号出力回路を有し、
    前記第1の選択回路は、前記選択信号に基づいて、前記第1のレベルシフト回路によりシフトアップされた前記第1の入力信号あるいはそのままの前記第1の入力信号を選択して、前記差動対回路へ供給し、
    前記第2の選択回路は、前記選択信号に基づいて、前記第2のレベルシフト回路によりシフトアップされた前記第2の入力信号あるいはそのままの前記第2の入力信号を選択して、前記差動対回路へ供給する請求項4に記載のコンパレータ。
  6. デジタル信号をアナログ信号に変換して前記第1の入力信号を生成するデジタルアナログ変換器を有する請求項5に記載のコンパレータ。
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