JP2018067672A - 酸化物半導体装置及びその製造方法 - Google Patents

酸化物半導体装置及びその製造方法 Download PDF

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Abstract

【課題】、酸化物半導体で構成された活性層領域を備える酸化物半導体装置において、ストレス印加時の安定性を向上させる。
【解決手段】酸化物半導体装置は、インジウム(In),ガリウム(Ga),亜鉛(Zn)の酸化物半導体で構成された活性層領域を備え、この活性層領域に、第4族元素のチタン(Ti),ジルコニウム(Zr),ハフニウム(Hf)又は第14族元素の炭素(C),ケイ素(Si),ゲルマニウム(Ge),スズ(Sn)から選択される元素を、数密度で1×1016〜1×1020cm-3の範囲内で含有させた。
【選択図】図1

Description

本発明は、酸化物半導体装置及びその製造方法に関するものである。
TFT(Thin Film Transistor)は、ガラス基板上に形成されるフラットパネルディスプレイ用のアクティブ素子として普及している。TFTは、基本構成として、ゲート端子、ソース端子及びドレイン端子を備えた3端子素子であり、基板上に成膜した半導体薄膜を、電子又はホールが移動するチャネル層として用い、ゲート端子に電圧を印加して、チャネル層に流れる電流を制御し、ソース端子とドレイン端子間の電流をスイッチングする機能を有する。
TFTのチャネル層としては、多結晶シリコン薄膜やアモルファスシリコン薄膜が広く用いられているが、スマートフォンに代表されるモバイル電子機器の普及によって、小型画面のディスプレイに超高精細・高画質且つ低消費電力の画像表示性能が求められており、これに対応できるTFT材料として、酸化物半導体が注目されている。
酸化物半導体の中で、インジウム(In),ガリウム(Ga),亜鉛(Zn)の酸化物であるIGZOは、従来のアモルファスシリコンなどに比べて、ディスプレイの高精細化や低消費電力化が可能になるTFT材料であることが知られている。下記特許文献1には、気相成膜法で成膜され、In、Ga、Zn及びOの元素から構成される透明アモルファス酸化物薄膜であって、酸化物の組成は、結晶化したときの組成がInGaO3(ZnO)m(mは6未満の自然数)であり、不純物イオンを添加することなしに、電子移動度が1cm2/(V・秒)超、かつ電子キャリヤ濃度が1016/cm3以下である半絶縁性である透明半絶縁性アモルファス酸化物薄膜をTFTのチャネル層とすることが示されている。
特開2010−219538号公報
前述したように、IGZOは、ディスプレイ用TFTのチャネル材料として有効であるが、酸素欠損に起因する欠陥によるTFT特性、特に、しきい値電圧のストレス印加時における安定性には改善の余地がある。特に、モバイル電子機器は、屋外での使用が前提となるため、太陽光照射や温度上昇といったストレスを受けやすい使用状況への対応が求められ、また、長時間の連続動作によって、バックライトによる光ストレスの蓄積が問題になる。
本発明は、このような問題に対処するために提案されたものである。すなわち、本発明は、酸化物半導体の活性層領域を備える酸化物半導体装置において、ストレス印加時の安定性を向上させることを課題としている。
このような課題を解決するために、本発明による酸化物半導体装置は、以下の構成を具備するものである。
インジウム(In),ガリウム(Ga),亜鉛(Zn)の酸化物半導体の活性層領域を備える酸化物半導体装置であって、第4族元素のチタン(Ti),ジルコニウム(Zr),ハフニウム(Hf)又は第14族元素の炭素(C),ケイ素(Si),ゲルマニウム(Ge),スズ(Sn)から選択される元素を、数密度で1×1016〜1×1020cm-3の範囲内で含有させた前記活性層領域を備えることを特徴とする酸化物半導体装置。
TFTの構造例を示す説明図である。 Siイオン注入されたIGZO活性層領域を有するTFTがストレス印加時の安定性を有することを示したグラフである。 Siイオン注入されたIGZO活性層領域にレーザーアニールを行うことで、TFTのヒステリシス電圧を低減することができることを示したグラフである。
以下、図面を参照して本発明の実施形態を説明する。図1は、本発明の実施形態に係る酸化物半導体装置であるTFTの構成例を示している。TFT1は、ガラス基板10上にゲート端子11が形成され、そのケート端子11を覆うようにゲート絶縁膜12が形成され、ゲート絶縁膜12上に、チャネル層13と、チャネル層に接触するソース端子14とドレイン端子15が形成されている。また、チャネル層13とソース端子14とドレイン端子15を覆うように、パッシベーション膜16が形成されている。
各端子の材料は、例えば、ゲート端子11,ソース端子14,ドレイン端子15がTiNで構成され、ゲート絶縁膜12及びパッシベーション膜16がSiO2で構成されている。そして、活性層領域であるチャネル層13は、後述するように、特定元素を注入したIn,Ga,Znの酸化物半導体(IGZO)で構成されている。このTFT1は、ゲート端子11に電圧を印加して、チャネル層13に流れる電流を制御し、ソース端子14とドレイン端子15間の電流をスイッチングする機能を有する。
チャネル層13に注入される元素は、第4族元素であるTi,Zr,Hf、或いは第14族元素であるC,Si,Ge,Snである。以下、Siを注入する場合を例にして説明するが、前述した各元素であれば同等の効果を得ることができる。ここでの元素注入量は、酸化物半導体に、バルク材以外の材料を不純物として機能する程度の量だけ注入するものであり、これによって、酸素欠損に起因する欠陥によるTFT特性、特に、しきい値電圧の安定性を改善することができる。好ましい元素注入量は、数密度で1×1016〜1×1020cm-3の範囲である。
以下、図1に示した構成のTFT1を得る具体的な工程例(第1実施例)を示す。先ず、ガラス基板10上にスパッタリングでTiNを150nm程度成膜し、フォトリソグラフィーとエッチングでパターニングすることで、ゲート端子11を形成する。ゲート端子11の材料は、TiNに限らず、Al,Ti,Mo,Wなどであってもよい。
次に、プラズマCVD(ガスSiH4,O2,Ar)でSiO2を成膜し、ゲート絶縁膜12を形成する。ゲート絶縁膜12の材料は、SiO2に限らず、シリコン窒化膜や、Al23などであってもよい。
その後、IGZO(In:Ga:Zn=1:1:1)のターゲットを用い、スパッタリングによりチャネル層13を成膜する。成膜条件の一例としては、膜厚を50nmに設定し、Ar/O2雰囲気で、圧力5mTorr、O2分圧を16%とした。ここでの成膜には、例えば、回転マグネットスパッタ装置を用いることができる。チャネル層13におけるIGZOの元素比率は、前述した比率(In:Ga:Zn=1:1:1)に限定されない。
なお、前述したO2分圧16%は、その後行う水蒸気雰囲気の400℃アニールで、酸素欠損量が1×1017cm-3以下になる条件である。一方、元素注入を行わない従来のIGZO膜(チャネル層)では、O2分圧2%で成膜している。この場合、400℃のアニール後の酸素欠損量は、1×1018cm-3程度になる。
前述した成膜の後、IGZOのチャネル層13に、Siをイオン注入機を用いて注入する。注入条件は、一例として、Si+イオンをエネルギー40keVでドーズ量1×1013cm-2とした。これにより、Si原子が1×1018cm-3の密度でIGZO膜に注入された。Si原子のIGZO中の密度は、1×1016〜1×1020cm-3、好ましくは、1×1017〜1×1019cm-3とする。
Siの注入後、水分雰囲気(H2O/O2=100/900sccm)、400℃で1時間アニールを行う。アニール温度は、400℃に限らず、300℃〜800℃、好ましくは、350℃〜500℃である。また、ここでのアニールは、水分雰囲気に限らず、酸素雰囲気であってもよい。
Siが注入されたIGZO膜は、前述したアニールの後、フォトリソグラフィーとエッチングでパターニングして、島状のチャネル層13を形成する。
その後は、ソース端子14とドレイン端子15となるTiNを、例えば150nm成膜し、フォトリソグラフィーとエッチングで、ソース端子14とドレイン端子15とを形成する。ソース端子14とドレイン端子15の材料は、Tiに限らず、Al,Ti,Mo,Wなどであってもよい。その後は、パッシベーション膜16となるSiO2をプラズマCVDなどで成膜し、その後、フォトリソグラフィーとエッチングにより、各端子(ソース端子14,ドレイン端子15,ゲート端子11)への電気的接触が可能なように接続端子を形成する。
このようにして得られたTFT1(図1参照)は、負バイアス・光ストレスの継続的印加に対して、安定したTFT特性を示すことが試験にて確認された。試験条件は、デバイス寸法が、チャネル長:40μm、チャネル幅:20μmであり、ストレス条件として、ゲート電圧に−20Vを印加し、白色LEDによる光照射(30,000lx)を雰囲気温度60℃にて行った。
図2は、前述したストレスを経時的に加えた場合のTFT1のしきい値電圧の変化(ΔVT(V))を示している。図2に示されるように、Siイオンを注入しなかったIGZO膜のチャネル層を備えるTFTに対して、Siイオンを注入したIGZO膜のチャネル層13を備えるTFT1の方が、しきい値電圧の経時的変化(ΔVT(V))が少ないことが確認できる。
このような試験結果は、活性層領域のIGZO膜にSiを所定量注入することにより、TFT動作の安定性が向上することを示している。このような結果は、酸素欠損に起因するキャリアではなく、Siがドーパントとして働き、キャリアである電子を供給しているためであり、酸素欠損により形成されるIGZOのバンドギャップ内における深い準位のトラップが減少しているからと考えられる。
次に他の工程例(第2実施例)を説明する。この例では、前述した工程例(第1実施例)における水分雰囲気のアニールの前に、波長400nm以下のXeFレーザーによる局所レーザーアニールを行った。他の工程は第1実施例と同様である。
レーザーアニールにおけるレーザーエネルギー密度は、一回の照射で150mJ/cm2とし、これを重畳させることでアニールを行った。アニールした領域は、60μm×60μmとし、TFTのチャネル層13となる活性層領域が含まれるようにアニールした。レーザー照射の位置合わせには、ゲート端子11のパターンを用いた。なお、トップゲートTFTを作成する場合には、ゲート端子11を位置合わせに用いることができないが、何らかの位置合わせパターンを自在に形成しておくことで、局所レーザーアニールを活性層領域に精度良く実施することが可能になる。
図3は、前述の工程例で作成したTFTの伝達特性(ドレイン電流のゲート電圧依存性)から求めた、しきい値電圧付近のヒステリシス電圧を、XeFレーザーアニールのshot回数に対してプロットしたグラフである。図3においては、Siイオン注入無しの場合とSiイオン注入無しの場合を示している。
グラフ縦軸のヒステリシス電圧(V)は、ゲート電圧を負から正に掃引した場合の電圧特性と、正から負に掃引して求めた電圧特性のずれであり、具体的には、両者の電圧特性から求めたしきい値電圧の差として評価した。
図3から明らかなように、XeFレーザーの局所アニールを導入することで、IGZOを活性層領域に用いたTFTのヒステリシス電圧が低減し、TFTの安定性が向上することが確認できた。IGZO膜中に例えば電子を捕獲するようなトラップ準位があると、ヒステリシス電圧は増加し、不安定なデバイスとなってしまうが、IGZOの活性層領域にSiを注入してレーザーアニールを行うことで、電子を捕獲するようなトラップ準位が少なくなると考えられる。
以上説明したように、本発明の実施形態に係る酸化物半導体装置及びその製造方法によると、ストレス印加時の安定性を向上させることができ、屋外使用や長時間使用などでの耐久性を向上させることができる。また、活性層領域へのレーザーアニールを追加することで、安定性の高いデバイスを得ることができる。
1:TFT,10:ガラス基板,11:ゲート端子,12:ゲート絶縁膜,
13:チャネル層,14:ソース端子,15:ドレイン端子,
16:パッシベーション膜

Claims (3)

  1. インジウム(In),ガリウム(Ga),亜鉛(Zn)の酸化物半導体で構成される活性層領域を有する酸化物半導体装置であって、第4族元素のチタン(Ti),ジルコニウム(Zr),ハフニウム(Hf)又は第14族元素の炭素(C),ケイ素(Si),ゲルマニウム(Ge),スズ(Sn)から選択される元素を、数密度で1×1016〜1×1020cm-3の範囲内で含有させた前記活性層領域を備えることを特徴とする酸化物半導体装置。
  2. 前記活性層領域は、波長400nm以下のレーザーを照射してアニールした領域であることを特徴とする請求項1記載の酸化物半導体装置。
  3. インジウム(In),ガリウム(Ga),亜鉛(Zn)の酸化物半導体で構成される活性層領域を有する酸化物半導体装置の製造方法であって、
    前記活性層領域に、第4族元素のチタン(Ti),ジルコニウム(Zr),ハフニウム(Hf)又は第14族元素の炭素(C),ケイ素(Si),ゲルマニウム(Ge),スズ(Sn)から選択される元素を、数密度で1×1016〜1×1020cm-3の範囲内イオン注入する工程と、
    イオン注入後の前記活性層領域に、波長400nm以下のレーザーを照射して、アニールする工程とを有することを特徴とする酸化物半導体の製造方法。
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2021034623A (ja) * 2019-08-27 2021-03-01 株式会社デンソー 半導体装置の製造方法

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2019244945A1 (ja) * 2018-06-21 2019-12-26 株式会社アルバック 酸化物半導体薄膜、薄膜トランジスタおよびその製造方法、ならびにスパッタリングターゲット
JP7128284B2 (ja) * 2019-06-28 2022-08-30 株式会社アルバック スパッタリングターゲットの製造方法
US11430898B2 (en) * 2020-03-13 2022-08-30 Applied Materials, Inc. Oxygen vacancy of amorphous indium gallium zinc oxide passivation by silicon ion treatment

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011101027A (ja) * 2009-03-31 2011-05-19 Panasonic Corp フレキシブル半導体装置およびその製造方法
JP2012028481A (ja) * 2010-07-22 2012-02-09 Fujifilm Corp 電界効果型トランジスタ及びその製造方法
JP2013041945A (ja) * 2011-08-12 2013-02-28 Fujifilm Corp 薄膜トランジスタ及びその製造方法、表示装置、イメージセンサー、x線センサー並びにx線デジタル撮影装置
JP2013110176A (ja) * 2011-11-18 2013-06-06 Semiconductor Energy Lab Co Ltd 半導体装置および半導体装置の作製方法
JP2015228495A (ja) * 2014-05-08 2015-12-17 株式会社Flosfia 結晶性積層構造体、半導体装置

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1737044B1 (en) 2004-03-12 2014-12-10 Japan Science and Technology Agency Amorphous oxide and thin film transistor
CN102163625A (zh) * 2011-03-17 2011-08-24 复旦大学 用于氧化物薄膜晶体管的半导体层材料铟锌钛氧化物
JP4982620B1 (ja) * 2011-07-29 2012-07-25 富士フイルム株式会社 電界効果型トランジスタの製造方法、並びに、電界効果型トランジスタ、表示装置、イメージセンサ及びx線センサ
CN110777359A (zh) * 2014-07-22 2020-02-11 株式会社Flosfia 结晶性半导体膜和板状体以及半导体装置

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011101027A (ja) * 2009-03-31 2011-05-19 Panasonic Corp フレキシブル半導体装置およびその製造方法
JP2012028481A (ja) * 2010-07-22 2012-02-09 Fujifilm Corp 電界効果型トランジスタ及びその製造方法
JP2013041945A (ja) * 2011-08-12 2013-02-28 Fujifilm Corp 薄膜トランジスタ及びその製造方法、表示装置、イメージセンサー、x線センサー並びにx線デジタル撮影装置
JP2013110176A (ja) * 2011-11-18 2013-06-06 Semiconductor Energy Lab Co Ltd 半導体装置および半導体装置の作製方法
JP2015228495A (ja) * 2014-05-08 2015-12-17 株式会社Flosfia 結晶性積層構造体、半導体装置

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2021034623A (ja) * 2019-08-27 2021-03-01 株式会社デンソー 半導体装置の製造方法
WO2021038909A1 (ja) * 2019-08-27 2021-03-04 株式会社デンソー 半導体装置の製造方法
JP7230743B2 (ja) 2019-08-27 2023-03-01 株式会社デンソー 半導体装置の製造方法

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