JP2015170725A - 複合基板 - Google Patents

複合基板 Download PDF

Info

Publication number
JP2015170725A
JP2015170725A JP2014044520A JP2014044520A JP2015170725A JP 2015170725 A JP2015170725 A JP 2015170725A JP 2014044520 A JP2014044520 A JP 2014044520A JP 2014044520 A JP2014044520 A JP 2014044520A JP 2015170725 A JP2015170725 A JP 2015170725A
Authority
JP
Japan
Prior art keywords
substrate
metal post
solder
metal
composite
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2014044520A
Other languages
English (en)
Inventor
外茂也 台蔵
Tomoya Taizo
外茂也 台蔵
武馬 足立
Takema Adachi
武馬 足立
剛士 古澤
Takeshi Furusawa
剛士 古澤
航 中村
Wataru Nakamura
航 中村
勇希 伊藤
Yuki Ito
勇希 伊藤
裕樹 吉川
Yuki Yoshikawa
裕樹 吉川
智義 平林
Tomoyoshi Hirabayashi
智義 平林
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ibiden Co Ltd
Original Assignee
Ibiden Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ibiden Co Ltd filed Critical Ibiden Co Ltd
Priority to JP2014044520A priority Critical patent/JP2015170725A/ja
Priority to US14/638,324 priority patent/US9401320B2/en
Publication of JP2015170725A publication Critical patent/JP2015170725A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49811Additional leads joined to the metallisation on the insulating substrate, e.g. pins, bumps, wires, flat leads
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49827Via connections through the substrates, e.g. pins going through the substrate, coaxial cables
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49833Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers the chip support structure consisting of a plurality of insulating substrates
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/10Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers
    • H01L25/105Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers the devices being of a type provided for in group H01L27/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/50Multistep manufacturing processes of assemblies consisting of devices, each device being of a type provided for in group H01L27/00 or H01L29/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/16227Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/8119Arrangement of the bump connectors prior to mounting
    • H01L2224/81191Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed only on the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/818Bonding techniques
    • H01L2224/81801Soldering or alloying
    • H01L2224/81815Reflow soldering
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/10All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
    • H01L2225/1005All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/1011All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
    • H01L2225/1017All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support
    • H01L2225/1023All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support the support being an insulating substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/10All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
    • H01L2225/1005All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/1011All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
    • H01L2225/1047Details of electrical connections between containers
    • H01L2225/1058Bump or bump-like electrical connections, e.g. balls, pillars, posts
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/10All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
    • H01L2225/1005All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/1011All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
    • H01L2225/1047Details of electrical connections between containers
    • H01L2225/107Indirect electrical connections, e.g. via an interposer, a flexible substrate, using TAB
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49866Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers characterised by the materials
    • H01L23/49894Materials of the insulating layers or coatings
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L24/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L24/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1531Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15311Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1532Connection portion the connection portion being formed on the die mounting surface of the substrate
    • H01L2924/1533Connection portion the connection portion being formed on the die mounting surface of the substrate the connection portion being formed both on the die mounting surface of the substrate and outside the die mounting surface of the substrate
    • H01L2924/15331Connection portion the connection portion being formed on the die mounting surface of the substrate the connection portion being formed both on the die mounting surface of the substrate and outside the die mounting surface of the substrate being a ball array, e.g. BGA
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation

Abstract

【課題】パッケージ基板同士の間の電気接続の信頼性が高い複合基板を提供する。【解決手段】本発明の複合基板10によれば、第1基板11と第2基板30との間で突き合わされてはんだ付けされる第1と第2の金属ポスト51,52のうち第2金属ポスト52の先端面52Bにリセス52Aを設けたので、はんだとの接触面積が広くなり、第1と第2の金属ポスト51,52のはんだ付けの強度が高くなる。このことによって第1基板11と第2基板30との間の電気接続の信頼性が向上する。【選択図】図1

Description

本発明は、第1基板に第2基板を重ねて電気接続してなる複合基板に関する。
従来、この種の複合基板として、第1基板から突出した金属ポストを、第2基板のはんだバンプにはんだ付けしたものが知られている(例えば、特許文献1参照)。
韓国特許第100722634号(図4a)
しかしながら、上記した従来の複合基板では、第1基板と第2基板の熱変形により金属ポストとはんだバンプとの間に内部応力が生じ、それらの電気接続の信頼性が低下するという問題が考えられる。
本発明は、上記事情に鑑みてなされたもので、基板同士の間の電気接続の信頼性が高い複合基板の提供を目的とする。
本発明に係る複合基板は、第1金属ポストを有する第1基板と前記第1金属ポストと対向する位置に形成されている第2金属ポストを有する第2基板と前記第1金属ポストと前記第2金属ポストとの間にはさまれているはんだとを有する。そして、前記第1金属ポストと前記第2金属ポストの一方または両方の前記はんだがのっている面にリセスがある。
本発明の第1実施形態に係る複合基板の断面図 第1基板のF面の平面図 第2基板のB面の平面図 複合基板の分解断面図 第1と第2の金属ポストの断面図 第2実施形態の第1と第2の金属ポストの断面図 第3実施形態の第1と第2の金属ポストの断面図 金属ポストの断面写真
[第1実施形態]
以下、本発明の第1実施形態を図1〜図5に基づいて説明する。本実施形態の複合基板10は、第1基板11に第2基板30が重ねられてなる。この複合基板10に第3基板20を重ねて、所謂、PoP構造(パッケージオンパッケージ構造)にしたものを図1に示す。このPoP構造において、第2基板30は、第3基板20を第1基板11に接続するためのインターポーザになっている。
第1基板11は、基板本体11Hに、例えばCPU12を実装したCPU基板である。基板本体11Hは、図示しない回路を内蔵した多層構造をなし、実装面であるF面11Fとその裏面であるB面11Bとをソルダーレジスト層11S,11Sで覆われている。また、表裏のソルダーレジスト層11S,11Sには、例えば、円形のパッド用開口11Kが複数形成されていて、基板本体11Hの内部回路に接続された複数のパッド13a,13b,14がソルダーレジスト層11S,11Sのパッド用開口11Kの奥側に配置されている。第1基板11のF面11Fの平面図を図2に示す。F面11Fの中央部には前記したCPU12を接続するためのパッド13a群がマトリクス状に配置され、その周囲の枠状の領域にはパッド13aよりも大きいパッド32b群がマトリクス状に配置されている。そして、前記したCPU12がパッド13a群に、はんだボール15によってバンプ接続(「フリップチップ接続」ともいう)されると共に、パッド13b群から、後に詳説する第1金属ポスト51が突出している。なお、基板本体11Hは、例えば、特開2007−227512公報に開示されているようなコア基板を有する多層基板であってもよいし、特開2005−236244公報に開示されているようなコア基板を有さない、所謂、コアレス基板であってもよい。また、基板本体11HのB面11Bのパッド14群は、図示しない別の基板にバンプ接続される。
第3基板20は、基板本体20Hに、例えばメモリーチップ21を実装したメモリー基板である。基板本体20Hは、例えば、第1基板11の基板本体11Hと平面形状が略同一になっている。また、図示しないがこの基板本体20Hも、第1基板11の基板本体11Hと同様に回路を内蔵した多層構造になっていて、その内部回路に接続された複数のパッドがF面20FとB面20Bとに備えられている。そして、前記したメモリーチップ21がF面20Fの中央に固定されて、その周囲のパッド23群にワイヤーボンディングされている。また、基板本体20HのB面20Bの略全体にパッド群(図示せず)に接続されたはんだバンプ25が備えられている。
第2基板30は、例えば平面形状が第1基板11及び第3基板20の基板本体11H,20Hと略同一になっている。この第2基板30も、上記した基板本体11H,20Hと同様に図示しない回路を内蔵した多層構造をなし、F面30FとB面30Bとがソルダーレジスト層30S,30Sで覆われ、それらソルダーレジスト層30S,30Sのパッド用開口30K群の奥側にパッド33,34を備えている。第2基板30のB面30Bの平面図を図3に示す。パッド34群は、図2に示した第1基板11のF面11Fに配置されたパッド13b群に対向するように配置されている。また、第2基板30はCPU12やメモリーチップ21を実装する基板本体11H,20Hに比べると、必要とされる強度は低く、回路構造も単純であるため、第1基板11及び第3基板20より薄くなっている。
第2基板30のF面30Fのパッド33群には、第3基板20のはんだバンプ25がはんだ付けされている。一方、第2基板30のB面30Bのパッド34群からは、第1基板11の第1金属ポスト51に対応した複数の第2金属ポスト52が突出していて、それら第2金属ポスト52群と第1金属ポスト51群とが突き合わされた状態ではんだ53によって固定されている。
第1及び第2の金属ポスト51,52は、例えば、第1基板11の基板本体11H及び第2基板30に銅めっき処理を行うことで形成されている。具体的には、基板本体11Hの全体を図示しない絶縁被膜で覆い、その絶縁被膜の一部に円形孔を形成して基板本体11Hのパッド13bを露出させた状態にしてから、基板本体11Hに銅めっき処理を行うことで第1金属ポスト51が形成される。そして、第1金属ポスト51は、図5に示すように、例えばソルダーレジスト層11Sにおけるパッド13b用の円形の開口11Kより外径が大きな円柱状をなし、パッド用開口11Kの開口縁とその内面とパッド用開口11K内のパッド13bとに密着している。第2金属ポスト52も、同様にめっき処理で形成され、ソルダーレジスト層30Sのパッド用開口30Kより外径が大きな円柱状をなし、パッド用開口30Kの開口縁及び内面とパッド34とに密着している。
第1金属ポスト51は、第2金属ポスト52に比べて細くかつ長くなっている。具体的には、第1金属ポスト51の外径は、70〜170[μm]、全長は、30〜160[μm]であり、第2金属ポスト52の外径は、70〜140[μm]、全長は、15〜90[μm]になっている。ここで、金属ポストを形成するパッド同士のピッチ(中心間距離)が100[μm]より小さいと、形成可能な金属ポストが細くなり接続信頼性が低下し易く、ピッチが300[μm]より大きいと、基板サイズが大きくなり金属ポストにかかる応力が大きくなり接続信頼性が低下し易い。そのため、パッド13b同士、及びパッド34同士のピッチは、100〜300[μm]が好ましい。なお、金属ポストの全長とは、基板の最表層(ソルダーレジスト層11S,30S)表面から、金属ポストのうち最も高くなった部分までの高さを指す。具体的には、図5に示す第2金属ポスト52のように先端面52Bがリセス52Aを有する凹面になっている場合には、ソルダーレジスト層30S表面から先端面52Bの外縁部までの高さを指し、同図の第1金属ポスト51のように先端面51Bがリセスを有さない平坦面になっている場合には、ソルダーレジスト層11S表面から平坦面である先端面51Bまでの高さを指す。
第1金属ポスト51の先端面51Bは、全体が平坦になっているのに対し、第2金属ポスト52の先端面52Bは、平坦面の一部にリセス52Aが形成されて凹面状になっている。リセス52Aは、第2金属ポスト52の先端面52Bの外縁部から中心部に向かうに従って徐々に深くなるように陥没している。より具体的には、リセス52Aの最大深さは、5〜40[μm]になっている。
第1及び第2の金属ポスト51,52を接続するはんだ53は、例えば、図4に示すように、当初は第2金属ポスト52側に球状又は楕円球状になって固着され、そのはんだ53の一部は第2金属ポスト52の側面の全部または一部を覆っている。また、はんだ53の融点は、CPU12のはんだボール15より低く、第3基板20のはんだバンプ25より高くなっている。
本実施形態の複合基板10の構造に関する説明は、以上である。次に、複合基板10の製造方法について説明する。複合基板10を製造するには、予めはんだバンプ25を備えた基板本体20HのF面20Fにメモリーチップ21を実装して第3基板20を製造しておく。また、基板本体11HのF面11FにCPU12を実装して第1基板11を製造しておく。そして、第1基板11に第2基板30を実装する。
具体的には、第1基板11のF面11Fに第2基板30を重ね、第2金属ポスト52群のはんだ53を第1金属ポスト51群の先端面51Bに当接させた状態にする。次いで、それら第1基板11及び第2基板30を、上記したCPU12のはんだボール15の融点より低い温度で加熱してはんだ53をリフローし、第1及び第2の金属ポスト51,52の先端面51B,52Bの間ではんだ53を押し潰す。そして、はんだ53を固化させて第1基板11に第2基板30が固定された複合体にしてから、その複合体の第2基板30に第3基板20を重ね、上記したはんだ53の融点より低い温度で加熱し、第3基板20のはんだバンプ25をリフローすることで第2基板30に第3基板20をはんだ付けする。以上により、複合基板10が製造される。なお、第1基板11と第2基板30を接続した後、モールド樹脂を流し込んでCPU12と基板とを固定してから、第3基板20を実装してもよい。
上記したように本実施形態の複合基板10によれば、第2金属ポスト52の先端面52Bにリセス52Aを形成したのではんだとの接触面積が広くなり、はんだの固着強度が高くなる。このことにより、第1基板11と第2基板20の間の電気接続の信頼性が向上する。また、第1及び第2の金属ポスト51,52を銅めっきで形成するので、それぞれの金属ポストの高さを均一にし易い。それに加えて、本実施形態のように第1及び第2の金属ポスト51,52の外径をパッド用開口11K,30Kの外径より大きく銅めっきで形成することで、第1及び第2の金属ポスト51,52の先端面51B,52Bの中央部をパッド用開口11K,30Kの分窪ませてリセスを形成することができる。
さらに、第1金属ポスト51の外径が、第2金属ポスト52の外径より大きいので、第1金属ポスト51の先端面51B内で第2金属ポスト52の先端面52Bの位置ずれを許容することができ、第1と第2の金属ポスト51,52とを突き合わせ作業が容易になる。それに加えて、上記したように、第1基板11は、第2基板30より厚いため、熱変形し難く、本実施形態では、このように熱変形し難い第1基板11の第1金属ポスト51の方を長くしたので、第1基板11と第2基板30とを加熱してはんだ付けする際の第1と第2の金属ポスト51,52の先端面51B,52Bの相互の位置ずれを抑えることができる。
[第2実施形態]
図6には、第2実施形態の複合基板に設けられた第1と第2の金属ポスト51,52が示されている。本実施形態では、第2基板30の第2金属ポスト52が、第1基板11の第1金属ポスト51より長くなっている。第1と第2の金属ポスト51,52のうち細い方の第2金属ポスト52を長くしたことで、その第2金属ポスト52が曲がり易くなり、第1基板11及び第2基板30の熱変形による内部応力を緩和させることができる。
[第3実施形態]
図7には、第3実施形態の複合基板に設けられた第1と第2の金属ポスト51,52が示されている。これら第1と第2の金属ポスト51,52は、同じ太さ、同じ長さになっていて、それらの先端面51B,52Bにはそれぞれリセス51A,52Aが形成されている。これにより、第1及び第2の金属ポストのリセスが形成された面それぞれと、はんだとの固着強度が高くなり、第1基板11と第2基板30の間の電気接続の信頼性が向上する。
[実施例]
前記第1実施形態で説明したように第2基板30に銅めっき処理を行って形成した実際の第2金属ポスト52の写真を図8に示す。同図に示すように、この第2金属ポスト52の先端面52Bには、リセス52Aが形成されている。
[他の実施形態]
本発明は、前記実施形態に限定されるものではなく、例えば、以下に説明するような実施形態も本発明の技術的範囲に含まれ、さらに、下記以外にも要旨を逸脱しない範囲内で種々変更して実施することができる。
(1)前記第1実施形態では、第1基板11に第2基板30を実装した後、その第2基板30に第3基板20を実装したが、第2基板30に第3基板20を実装してから、第2基板30を第1基板11に実装してもよい。
(2)前記第1及び第2の実施形態では、長さ及び太さが異なる第1と第2の金属ポスト51,52のうち細い側の第2金属ポスト52側のみにリセス52Aを設けた例を示したが、太い側の第1金属ポスト51のみにリセスを設けてもよいし、太さが異なる第1と第2の金属ポスト51,52の両方にリセスを設けてもよい。
10 複合基板
11 第1基板
20 第3基板
30 第2基板
51 第1金属ポスト
51A,52A リセス
52 第2金属ポスト
53 はんだ

Claims (7)

  1. 第1金属ポストを有する第1基板と
    前記第1金属ポストと対向する位置に形成されている第2金属ポストを有する第2基板と
    前記第1金属ポストと前記第2金属ポストとの間にはさまれているはんだとを有する複合基板であって
    前記第1金属ポストと前記第2金属ポストの一方または両方の前記はんだがのっている面にリセスがある。
  2. 請求項1に記載の複合基板であって、前記第1金属ポストと前記第2金属ポストの両方の前記はんだがのっている面にリセスがある。
  3. 請求項1に記載の複合基板であって、前記第1金属ポストと前記第2金属ポストは銅めっきで形成されている。
  4. 請求項1に記載の複合基板であって、前記第1金属ポストの外径が第2金属ポストの外径より大きい。
  5. 請求項1に記載の複合基板であって、前記第1金属ポストの軸長と前記第2金属ポストの軸長が異なる。
  6. 請求項1に記載の複合基板であって、前記第1金属ポストと前記第2金属ポストの一方が他方に比べて細くて長い。
  7. 請求項1に記載の複合基板であって、前記第1金属ポストが第2金属ポストに比べて軸長が長い。
JP2014044520A 2014-03-07 2014-03-07 複合基板 Pending JP2015170725A (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP2014044520A JP2015170725A (ja) 2014-03-07 2014-03-07 複合基板
US14/638,324 US9401320B2 (en) 2014-03-07 2015-03-04 Combined substrate

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2014044520A JP2015170725A (ja) 2014-03-07 2014-03-07 複合基板

Publications (1)

Publication Number Publication Date
JP2015170725A true JP2015170725A (ja) 2015-09-28

Family

ID=54018129

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2014044520A Pending JP2015170725A (ja) 2014-03-07 2014-03-07 複合基板

Country Status (2)

Country Link
US (1) US9401320B2 (ja)
JP (1) JP2015170725A (ja)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2017111790A1 (en) * 2015-12-23 2017-06-29 Manusharow Mathew J Improving size and efficiency of dies
JP2017135290A (ja) * 2016-01-28 2017-08-03 新光電気工業株式会社 電子部品内蔵基板
JP2019519103A (ja) * 2016-06-30 2019-07-04 マイクロン テクノロジー,インク. 1つ以上の窓を含むパッケージオンパッケージ半導体デバイスアセンブリ並びに関連する方法及びパッケージ
JP2020004926A (ja) * 2018-07-02 2020-01-09 凸版印刷株式会社 配線基板及び配線基板の製造方法

Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10643965B2 (en) * 2016-05-25 2020-05-05 Taiwan Semiconductor Manufacturing Company, Ltd. Structure and method of forming a joint assembly
WO2018207055A1 (en) * 2017-05-10 2018-11-15 3M Innovative Properties Company Multilayer construction having electrically continuous conductor
US10515901B2 (en) 2017-09-29 2019-12-24 Taiwan Semiconductor Manufacturing Company, Ltd. InFO-POP structures with TIVs having cavities
JP2021093431A (ja) * 2019-12-10 2021-06-17 イビデン株式会社 プリント配線板及びプリント配線板の製造方法
US20230230908A1 (en) * 2022-01-19 2023-07-20 Qualcomm Incorporated Package comprising a substrate with post interconnects and a solder resist layer having a cavity

Family Cites Families (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TWI273667B (en) * 2005-08-30 2007-02-11 Via Tech Inc Chip package and bump connecting structure thereof
KR100722634B1 (ko) 2005-10-06 2007-05-28 삼성전기주식회사 고밀도 반도체 패키지 및 그 제조 방법
US8269345B2 (en) * 2007-10-11 2012-09-18 Maxim Integrated Products, Inc. Bump I/O contact for semiconductor device
US8318596B2 (en) * 2010-02-11 2012-11-27 Taiwan Semiconductor Manufacturing Company, Ltd. Pillar structure having a non-planar surface for semiconductor devices
US8241963B2 (en) * 2010-07-13 2012-08-14 Taiwan Semiconductor Manufacturing Company, Ltd. Recessed pillar structure
US20130256873A1 (en) * 2012-04-03 2013-10-03 Nvidia Corporation System, method, and computer program product for preparing a substrate post
TW201409636A (zh) * 2012-08-31 2014-03-01 Chipmos Technologies Inc 半導體結構

Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2017111790A1 (en) * 2015-12-23 2017-06-29 Manusharow Mathew J Improving size and efficiency of dies
US10886228B2 (en) 2015-12-23 2021-01-05 Intel Corporation Improving size and efficiency of dies
US11715695B2 (en) 2015-12-23 2023-08-01 Intel Corporation Size and efficiency of dies
US11961804B2 (en) 2015-12-23 2024-04-16 Intel Corporation Size and efficiency of dies
JP2017135290A (ja) * 2016-01-28 2017-08-03 新光電気工業株式会社 電子部品内蔵基板
JP2019519103A (ja) * 2016-06-30 2019-07-04 マイクロン テクノロジー,インク. 1つ以上の窓を含むパッケージオンパッケージ半導体デバイスアセンブリ並びに関連する方法及びパッケージ
US10777530B2 (en) 2016-06-30 2020-09-15 Micron Technology, Inc. Package-on-package semiconductor device assemblies including one or more windows and related methods and packages
JP2020004926A (ja) * 2018-07-02 2020-01-09 凸版印刷株式会社 配線基板及び配線基板の製造方法

Also Published As

Publication number Publication date
US20150255433A1 (en) 2015-09-10
US9401320B2 (en) 2016-07-26

Similar Documents

Publication Publication Date Title
JP2015170725A (ja) 複合基板
US9330999B2 (en) Multi-component integrated heat spreader for multi-chip packages
JP5187714B2 (ja) 半導体チップの電極接続構造
CN104685622A (zh) Bva中介结构
JP2004343030A (ja) 配線回路基板とその製造方法とその配線回路基板を備えた回路モジュール
JP2000138313A (ja) 半導体装置及びその製造方法
JP2015076465A (ja) プリント配線板、プリント配線板の製造方法、パッケージ−オン−パッケージ
JP5117270B2 (ja) 配線基板、半導体装置、ならびに半導体装置の製造方法
US20120319289A1 (en) Semiconductor package
JP2008147472A (ja) 半導体装置および半導体装置の製造方法
US7994638B2 (en) Semiconductor chip and semiconductor device
JP2015015302A (ja) プリント配線板及びプリント配線板の製造方法
JP5128180B2 (ja) チップ内蔵基板
JP6318084B2 (ja) 半導体装置及びその製造方法
JP2010263094A (ja) リードフレーム
JP2002368155A (ja) 配線基板、半導体装置及び配線基板の製造方法
JP2006344624A (ja) 電子部品の製造方法
JP2008270303A (ja) 積層型半導体装置
JP4417974B2 (ja) 積層型半導体装置の製造方法
JP2011249398A (ja) 回路装置
JP2008091692A (ja) 半導体回路モジュールの製造方法
JP2015154055A (ja) プリント配線板
JP2016162813A (ja) プリント基板及びハンダ付け方法
JP2012227320A (ja) 半導体装置
JP5098220B2 (ja) インターポーザー基板及びその製造方法、並びにインターポーザー基板を用いた電子デバイスパッケージ