JP2015154662A - ディジタル形保護リレー - Google Patents
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Abstract
【課題】簡単な構成でありながら、フルスケールを広くとり、量子化誤差を抑えることができるディジタル保護リレーを提供する。
【解決手段】電力系統からの情報をセンサ検出信号として取込む入力回路を2つ備え、前記入力回路の一方は正側の信号を抽出しゲインを2倍にする手段を、他方の回路は負側の信号を抽出しゲインを2倍する手段を備え、前記2つの入力回路で求められた信号の内、基準値レベルより変化の大きい方の信号を使用して、保護リレー演算を行なう。
【選択図】図1
【解決手段】電力系統からの情報をセンサ検出信号として取込む入力回路を2つ備え、前記入力回路の一方は正側の信号を抽出しゲインを2倍にする手段を、他方の回路は負側の信号を抽出しゲインを2倍する手段を備え、前記2つの入力回路で求められた信号の内、基準値レベルより変化の大きい方の信号を使用して、保護リレー演算を行なう。
【選択図】図1
Description
本発明は、電力系統の電圧・電流を測定し、その信号をもとに演算を行い、過電圧・過電流等の事故を検出し保護リレー動作を行うディジタル形保護リレーに関する。より詳しくは、量子化誤差を大きくすることなく、入力部に入力回路のフルスケールを拡張する回路を備えたディジタル形保護リレーに関する。
一般に、ディジタル形保護リレーは、電力系統の電圧や電流信号をサンプリングで取り込み、フィルタ部で高調波を取り除き、サンプルホールド部によってそれぞれサンプルホールドされ、マルチプレクサによって、A/D変換部に取り込まれ、アナログ量からディジタル量に変換して、CPUで保護リレー演算を行う。そして信号の値が所定の動作値、動作時間を超えた場合に、保護リレー動作指令を出力するようになっている。保護リレー動作指令は遮断器に出力され、事故区間を電力系統から除去するようにしている。
図4は、ディジタル形保護リレーの基本構成を示している。保護対象から補助変圧器(PT)や補助変流器(CT)により変成して取り込まれる各相の電圧や電流信号は、アナログフィルタ部(AF)5によってそれぞれ高調波成分が取り除かれ、サンプルホールド部(S/H)6によってそれぞれサンプルホールドされる。これらのホールド信号がマルチプレクサ(MPX)7によって時分割でA/D変換部8に取り込まれ、A/D変換(アナログ−ディジタル変換)され、CPU9に取り込まれ、ここで保護リレー演算が行われる。
A/D変換部8の構成の主要部であるA/D変換器は、アナログ信号をサンプリング周波数で取り込んで標本化し、それを量子化することによってディジタル信号に変換するものであるが、その量子化の過程で量子化誤差が発生する。例えば、AC10Aと20Aのフルスケールの異なる回路があり、A/D変換が16bit分解能で行われた場合、10Aでは10A/2^15bit、0A〜20Aでは20A/2^15bitの量子化誤差を持つディジタル変換データで保護リレー演算が行なわれることになる。つまり、10A〜20Aの演算では10A以下と比較して量子化誤差を2倍持つ。入力信号がフルスケールを超えてしまうような場合は、この量子化誤差がさらに大きくなり、ディジタル形保護リレーとしての動作誤差が大きくなることにつながる。
ディジタル形保護リレーを電力系統に適用する際のフルスケールの決め方としては、一般に、電力系統の通常時の電圧値・電流値や、事故時の電圧値・電流値を考慮して、A/D変換して得たディジタル信号の値に基づいてフルスケールを定めている。
しかしながら、系統電気量の入力電流レンジの大きな変化に対しては、フルスケールをオーバーする場合が発生する。フルスケールをオーバーすると量子化誤差が増大する。量子化誤差を増大させないように、さまざまなアイデアが考えられている。
例えば、特許文献1には、同一の系統電気量を入力するフルスケールの異なる電気量入力回路と、複数のディジタル変換データを用いる複数の保護リレー演算手段を有し、系統電気量の大きさに応じて、複数の保護リレー演算手段から保護動作出力に用いる出力を選択することにより、入力フルスケールを小さくすることなく量子化誤差を少なくし、かつ精度の高い保護リレー演算を行う技術が開示されている。
また特許文献2には、入力電流の大きさを検出し、フルスケールを超えるか否か判定し、その結果によりフルスケール切替信号を送出し、フルスケール切替回路でフルスケールを切り変えて処理を行う技術が開示されている。
しかしながら、特許文献1に記載の技術では、複数のディジタル変換信号を用いて、複数の保護リレー演算を行う為、処理が複雑になる。また、特許文献2では、フルスケール切替回路が動作して、最適の回路に切替わるまでは、期待と異なる回路で動作することになる為、正確な演算ができない時間が存在することになる。本発明の目的は、簡単な構成でありながら、入力フルスケールを広くとり、量子化誤差を抑えることができるディジタル形保護リレーを提供することにある。
電力系統からの電気量をセンサ検出信号として取込む入力回路を2つ備え、前記入力回路の一方は正側の信号を抽出しゲインを2倍にする手段を、他方の回路は負側の信号を抽出しゲインを2倍する手段を、それぞれ備え、前記2つの回路で求められた信号の内、基準値レベルより変化の大きい方の信号を使用して、保護リレー演算を行う。
本発明では、正側と負側に入力を分けたことにより量子化誤差を大きくすることなく、フルスケールを2倍にすることができる。
以下、本発明の実施例を図1〜図3により説明する。図1は、本発明のブロック図である。補助変圧器(PT)、補助変流器(CT)から同一の電力系統の電気量を入力する2つの電気量入力回路を備えている。2つの電気量入力回路は、おのおの正側(プラス側)を抽出する正側抽出部2と負(マイナス側)の信号を抽出する負側抽出部3と、前記抽出された値のゲインを増幅する増幅部4を備えている。本実施例においては、ゲインを2倍に設定している。抽出部は、オペアンプを用いた加算回路や整流ダイオード等を使用して構成することができる。
前記抽出された信号は、その後アナログフィルタ部(AF)5により高調波成分を取り除き、サンプルホールド部(S/H)6によってそれぞれサンプルホールドされ、これらホールドされた信号がマルチプレクサ(MPX)7によって時分割でA/D変換器8に取り込まれ、A/D変換(アナログ−ディジタル変換)され、CPU9に取り込まれ、ここで保護リレー演算が行われる。
保護リレー演算処理を効率よく行う為、1つの演算とする。2つのディジタル変換信号のうち、どちらを使用するかを決め、合成信号用意する必要がある。本発明では、正側(プラス側)と負側(マイナス側)のどちら側の入力波形を用いて判断するかを決める方法として、基準値レベルより変化の大きい方の信号を使用して保護リレー演算を行っている。これは、変化の大きい信号が入力信号に相当するからである。
ここでいう基準値レベルとは、交流の場合、正側(プラス側)と負側(マイナス側)の中心点である。正側(プラス側)のディジタル変換データでは16bit分解能(0〜65535)の場合は0で、負側(マイナス側)のディジタル変換信号では16bit分解能(65535〜0)の場合は65535に相当する値である。
図2は、入力波形に対して、正側(プラス側)を抽出する正側抽出回路で、正側(プラス側)と、負(マイナス側)の信号を抽出する負側抽出回路で負側(マイナス側)の波形がおのおの抽出された波形図である。この抽出された波形のままでは、分解能が1bit分無駄になってしまうので、増幅器によってゲインを2倍することにより、空きビットをなくし、全てのbitを使用できるようにしている。
図3は、ディジタル変換信号を合成して保護リレー演算するフローチャートである。A/D変換によりディジタル信号に変換された、正側(プラス側)と負側(マイナス側)の両方のディジタル変換信号をメモリに保存する(S1)。正側のディジタル変換信号と基準値との差を算出負側のディジタル変換信号と基準値との差を算出する(S2)。負側のディジタル変換信号と基準値との差を算出する(S3)。前記S2,S3の算出結果の内、差の大きい信号を合成信号として保存する(S4)。前記S4で保存した合成信号を用いて保護リレー演算を行う(S5)。
このように、入力波形を正・負の信号に分けることによりフルスケールは1/2に縮小した波形となるが、後段でゲインを2倍することにより、全てのビットを使用することができ、A/D変換器の機能を無駄にしないようにしている。
本発明の実施例では、入力を2分割したが、4分割する構成でももちろん実施可能である。上記の正側(プラス側)と負側(マイナス側)を抽出した回路の出力に対して、更に同様の2分割する回路を設けて抽出し、ゲインを2倍ではなく4倍する。
1 入力部
2 正側抽出部
3 負側抽出部
4 増幅部
5 アナログフィルタ部(AF)
6 サンプルホールド部(S/H)
7 マルチプレクサ(MPX)
8 A/D変換部(A/D)
9 CPU
2 正側抽出部
3 負側抽出部
4 増幅部
5 アナログフィルタ部(AF)
6 サンプルホールド部(S/H)
7 マルチプレクサ(MPX)
8 A/D変換部(A/D)
9 CPU
Claims (1)
- 電力系統からの電気量をセンサ検出信号として取込む入力回路を2つ備え、前記入力回路の一方は正側の信号を抽出しゲインを2倍にする手段を、他方の回路は負側の信号を抽出しゲインを2倍する手段を備え、前記2つの入力回路で求められた信号の内、基準値レベルより変化の大きい方のデータを使用して、保護リレー演算を行うことを特徴とするディジタル形保護リレー。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2014028333A JP2015154662A (ja) | 2014-02-18 | 2014-02-18 | ディジタル形保護リレー |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2014028333A JP2015154662A (ja) | 2014-02-18 | 2014-02-18 | ディジタル形保護リレー |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2015154662A true JP2015154662A (ja) | 2015-08-24 |
Family
ID=53896384
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2014028333A Pending JP2015154662A (ja) | 2014-02-18 | 2014-02-18 | ディジタル形保護リレー |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2015154662A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPWO2018109922A1 (ja) * | 2016-12-16 | 2019-08-08 | 株式会社Fuji | テープフィーダ |
-
2014
- 2014-02-18 JP JP2014028333A patent/JP2015154662A/ja active Pending
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Publication number | Priority date | Publication date | Assignee | Title |
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JPWO2018109922A1 (ja) * | 2016-12-16 | 2019-08-08 | 株式会社Fuji | テープフィーダ |
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