JP2015154133A - 遅延時間差計測システム及び遅延時間差計測方法 - Google Patents
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Abstract
Description
最初に、本願発明の実施形態の内容を列記して説明する。(1)本願発明による遅延時間差計測システムは、光通信信号を伝送する現用光伝送路に設けられる第1及び第2の光分岐結合部と、第1の光分岐結合部と第2の光分岐結合部との間に接続される迂回用光伝送路とを備える光伝送路二重化装置において、第1の光分岐結合部と第2の光分岐結合部との間の現用光伝送路と迂回用光伝送路とに生じる遅延時間差を計測するシステムであって、第1の光分岐結合部において分岐されたのち現用光伝送路を経て第2の光分岐結合部に到達した光通信信号を電気的な第1のシリアル信号に変換し、第1の光分岐結合部において分岐されたのち迂回用光伝送路を経て第2の光分岐結合部に到達した光通信信号を電気的な第2のシリアル信号に変換する光電変換部と、第1及び第2のシリアル信号のうち少なくとも一方のシリアル信号に遅延を与えることにより第1のシリアル信号と第2のシリアル信号との時間差を調整する遅延部と、第1のシリアル信号を電気的な第1のパラレル信号に変換し、第2のシリアル信号を電気的な第2のパラレル信号に変換する信号変換部と、第1のパラレル信号と第2のパラレル信号との第1の時間差を演算する時間差演算部と、遅延部から出力された第1のシリアル信号と第2のシリアル信号との論理和を出力する論理回路と、論理回路からの出力信号に基づいて、遅延部から出力された第1のシリアル信号と第2のシリアル信号との時間差の有無を確認する確認部とを備え、遅延部は、第1の時間差と、第1の時間差に第1及び第2のパラレル信号のビット数に応じた時間を加算した第2の時間差と、第1の時間差にビット数に応じた時間を減算した第3の時間差とを順次補正するように、上記少なくとも一方のシリアル信号に遅延を与え、時間差演算部は、第1ないし第3の時間差のうち、確認部において第1のシリアル信号と第2のシリアル信号との時間差が実質的に無いと確認された時間差を遅延時間差として選択する。
本発明の実施形態にかかる遅延時間差計測システム及び遅延時間差計測方法の具体例を、以下に図面を参照しつつ説明する。なお、本発明はこれらの例示に限定されるものではなく、特許請求の範囲によって示され、特許請求の範囲と均等の意味及び範囲内でのすべての変更が含まれることが意図される。以下の説明では、図面の説明において同一の要素には同一の符号を付し、重複する説明を省略する。
Claims (3)
- 光通信信号を伝送する現用光伝送路に設けられる第1及び第2の光分岐結合部と、前記第1の光分岐結合部と前記第2の光分岐結合部との間に接続される迂回用光伝送路とを備える光伝送路二重化装置において、前記第1の光分岐結合部と前記第2の光分岐結合部との間の前記現用光伝送路と前記迂回用光伝送路とに生じる遅延時間差を計測するシステムであって、
前記第1の光分岐結合部において分岐されたのち前記現用光伝送路を経て前記第2の光分岐結合部に到達した光通信信号を電気的な第1のシリアル信号に変換し、前記第1の光分岐結合部において分岐されたのち前記迂回用光伝送路を経て前記第2の光分岐結合部に到達した光通信信号を電気的な第2のシリアル信号に変換する光電変換部と、
前記第1及び第2のシリアル信号のうち少なくとも一方のシリアル信号に遅延を与えることにより前記第1のシリアル信号と前記第2のシリアル信号との時間差を補正する遅延部と、
前記第1のシリアル信号を電気的な第1のパラレル信号に変換し、前記第2のシリアル信号を電気的な第2のパラレル信号に変換する信号変換部と、
前記第1のパラレル信号と前記第2のパラレル信号との第1の時間差を演算する時間差演算部と、
前記遅延部から出力された前記第1のシリアル信号と前記第2のシリアル信号との論理和を出力する論理回路と、
前記論理回路からの出力信号に基づいて、前記遅延部から出力された前記第1のシリアル信号と前記第2のシリアル信号との時間差の有無を確認する確認部と
を備え、
前記遅延部は、前記第1の時間差と、前記第1の時間差に前記第1及び第2のパラレル信号のビット数に応じた時間を加算した第2の時間差と、前記第1の時間差に前記ビット数に応じた時間を減算した第3の時間差とを順次補正するように、前記少なくとも一方のシリアル信号に遅延を与え、
前記時間差演算部は、前記第1ないし第3の時間差のうち、前記確認部において前記第1のシリアル信号と前記第2のシリアル信号との時間差が実質的に無いと確認された時間差を前記遅延時間差として選択する、遅延時間差計測システム。 - 前記遅延部は、
前記少なくとも一方のシリアル信号をパラレル信号に変換するシリアル/パラレル変換部と、
前記シリアル/パラレル変換部から出力された前記パラレル信号に遅延を与える遅延処理部と、
前記遅延処理部から出力された前記パラレル信号をシリアル信号に変換するパラレル/シリアル変換部と
を有する、請求項1に記載の遅延時間差計測システム。 - 光通信信号を伝送する現用光伝送路に設けられる第1及び第2の光分岐結合部と、前記第1の光分岐結合部と前記第2の光分岐結合部との間に接続される迂回用光伝送路とを備える光伝送路二重化装置において、前記第1の光分岐結合部と前記第2の光分岐結合部との間の前記現用光伝送路と前記迂回用光伝送路とに生じる遅延時間差を計測する方法であって、
前記第1の光分岐結合部において分岐されたのち前記現用光伝送路を経て前記第2の光分岐結合部に到達した光通信信号を電気的な第1のシリアル信号に変換し、前記第1の光分岐結合部において分岐されたのち前記迂回用光伝送路を経て前記第2の光分岐結合部に到達した光通信信号を電気的な第2のシリアル信号に変換する光電変換ステップと、
前記第1のシリアル信号を電気的な第1のパラレル信号に変換し、前記第2のシリアル信号を電気的な第2のパラレル信号に変換する信号変換ステップと、
前記第1のパラレル信号と前記第2のパラレル信号との第1の時間差を演算する時間差演算ステップと、
前記第1及び第2のシリアル信号のうち少なくとも一方のシリアル信号に遅延を与えることにより前記第1のシリアル信号と前記第2のシリアル信号との時間差を補正し、前記第1のシリアル信号と前記第2のシリアル信号との論理和を演算し、該演算結果に基づいて、前記第1のシリアル信号と前記第2のシリアル信号との時間差の有無を確認する遅延処理ステップと
を備え、
前記遅延処理ステップでは、前記第1の時間差と、前記第1の時間差に前記第1及び第2のパラレル信号のビット数に応じた時間を加算した第2の時間差と、前記第1の時間差に前記ビット数に応じた時間を減算した第3の時間差とが順次補正されるように、前記少なくとも一方のシリアル信号に遅延を与え、
前記第1ないし第3の時間差のうち、前記遅延処理ステップにおいて前記第1のシリアル信号と前記第2のシリアル信号との時間差が実質的に無いと確認された時間差を前記遅延時間差として選択する、遅延時間差計測方法。
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