JP2013243781A - 撮像素子およびその制御方法並びにカメラ - Google Patents
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Abstract
【解決手段】複数の垂直信号線VSLと、複数の画素回路11が行列状に配列された画素部10と、画素部10の複数の画素回路11が列単位でグループ毎に異なる垂直信号線VSLに接続され、グループ分けされた複数の画素回路11が接続された垂直信号線VSLに出力した電圧信号を処理するカラム回路13a、13bとを有する。
【選択図】図1
Description
図1は、本発明の第1実施形態に係るCMOSイメージセンサの構成例を示す概略ブロック図である。
第2実施形態は、画素部10を2つの画素領域に分割する代わりに、垂直信号線の本数を2倍にし、フォーカルプレーン現象の緩和、および高速な画素の読み出しを図ったものである。以下、第1実施形態と異なる点について説明する。
第3実施形態は、第1実施形態と第2実施形態との組み合わせである。すなわち、第3実施形態は、画素部10を2つの画素領域に分割した上で、一列に2本の垂直信号線を配し、フォーカルプレーン現象の緩和、および高速な画素の読み出しを図ったものである。
光電変換素子と、増幅トランジスタと、選択トランジスタとを有する、二次元状に配設された、複数の画素回路と、複数の水平走査線と、複数の垂直信号線と、制御部とを具備し、
前記複数の垂直信号線の各々は、一方の側において、前記複数の画素回路の列方向に分割した画素回路を独立して駆動可能で、かつ、各分割した画素回路内の同一行の画素回路内の選択トランジスタに列毎に交互に接続されるように、複数の副垂直信号線で構成されており、
前記各副垂直信号線の他方の側にはA/D変換回路が接続されており、
前記画素回路はCMOS回路で構成されており、
前記選択トランジスタを介して前記増幅トランジスタに接続される副垂直信号線と、前記増幅トランジスタとはソースフォロー型の読み出し機構を構成しており、
前記制御部は、前記列方向に分割した各分割領域内の複数の画素回路について、端部から隣接する部分に同じ向きに、または、対向する端部から隣接する部分に接近する向きに、または、隣接する端部から離間する端部に向かう向きに、複数の画素回路を行単位で順次駆動するように、前記画素回路を駆動する、
撮像素子が提供される。
行、列の二次元状に配設された複数の画素回路と、複数の水平走査線と、複数の垂直信号線と、制御部とを具備し、
各画素回路は、光電変換素子と、入力端子が前記光電変換素子に接続された転送トランジスタと、入力端子が所定の電位の線に接続され、出力端子が前記転送トランジスタの出力端子と接続されてフローティングデフュージョン(FD)部を構成しているリセットトランジスタと、制御端子が前記FD部に接続されて前記FD部の電位を増幅する増幅トランジスタと、入力端子が前記増幅トランジスタの出力端子に接続され、制御端子が対応する水平走査線に接続された、選択トランジスタとを有しており、
前記複数の垂直信号線の各々は、一方の側において、前記複数の画素回路の列方向に分割した画素回路を独立して駆動可能で、かつ、各分割した画素回路内の同一行の画素回路内の選択トランジスタに列毎に交互に接続する複数の副垂直信号線で構成されており、
前記各副垂直信号線の他方の側には前記増幅トランジスタの出力をデジタル信号に変換するA/D変換回路が接続されており、
前記画素回路はCMOS回路で構成されており、
前記選択トランジスタを介して前記増幅トランジスタに接続される副垂直信号線と、前記増幅トランジスタとはソースフォロー型の読み出し機構を構成しており、
前記制御部は、
前記列方向に分割した各分割領域内の複数の画素回路について、端部から隣接する部分に同じ向きに、または、対向する端部から隣接する部分に接近する向きに、または、隣接する端部から離間する端部に向かう向きに、複数の画素回路を行単位で順次駆動するように、前記転送トランジスタの制御端子に転送信号を印加し、前記リセットトランジスタの制御端子にリセット信号を印加し、および、前記水平走査線を介して前記選択トランジスタを駆動する、
撮像素子が提供される。
Claims (8)
- 複数の読み出し信号線と、
複数の画素回路が行列状に配列された画素部と、
上記画素部の上記複数の画素回路が列単位でグループ毎に異なる上記読み出し信号線に接続され、グループ分けされた複数の画素回路が接続された読み出し信号線に出力した読み出し信号を処理する処理部と
を有する撮像素子。 - 上記画素部は、
第1の画素領域と第2の画素領域とに分割され、
上記複数の画素回路は、
上記第1の画素領域の複数の画素回路と上記第2の画素領域の複数の画素回路とによって列単位でグループ分けされている
請求項1記載の撮像素子。 - 上記各々の画素回路を選択し、駆動する選択駆動部を有し、
上記選択駆動部は、
上記第1の画素領域内の複数の画素回路を上記第1の画素領域の最終行から上記第1の画素領域の初行へ行単位で順次駆動し、上記第2の画素領域内の複数の画素回路を上記第2の画素領域の最終行から上記第2の画素領域の初行へ行単位で順次駆動する
請求項2記載の撮像素子。 - 上記各々の画素回路を選択し、駆動する選択駆動部を有し、
上記選択駆動部は、
上記第1の画素領域内の複数の画素回路を上記第1の画素領域の初行から上記第1の画素領域の最終行へ行単位で順次駆動し、上記第2の画素領域内の複数の画素回路を上記第2の画素領域の最終行から上記第2の画素領域の初行へ行単位で順次駆動する
請求項2記載の撮像素子。 - 上記各々の画素回路を選択し、駆動する選択駆動部を有し、
上記選択駆動部は、
上記第1の画素領域内の複数の画素回路を上記第1の画素領域の最終行から上記第1の画素領域の初行へ行単位で順次駆動し、上記第2の画素領域内の複数の画素回路を上記第2の画素領域の初行から上記第2の画素領域の最終行へ行単位で順次駆動する
請求項2記載の撮像素子。 - 上記複数の画素回路は、
上記読み出し信号線に接続された画素回路によって列単位でグループ分けされている
請求項1から5のいずれか一に記載の撮像素子。 - 行列状に配列された画素部の複数の画素回路が列単位でグループ毎に異なる読み出し信号線に接続され、グループ分けされた複数の画素回路が接続された読み出し信号線に読み出し信号を出力するステップと、
上記読み出し信号線に出力された画素回路の読み出し信号を処理するステップと
を有する撮像素子の制御方法。 - 撮像素子と、
上記撮像素子の画素領域に対して入射光を導く光学系と、
上記撮像素子が出力した読み出し信号に信号処理を施す信号処理部と
を有し、
上記撮像素子は、
複数の読み出し信号線と、
複数の画素回路が行列状に配列された画素部と、
上記画素部の上記複数の画素回路が列単位でグループ毎に異なる上記読み出し信号線に接続され、グループ分けされた複数の画素回路が接続された読み出し信号線に出力した読み出し信号を処理する処理部と
を有するカメラ。
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- 2013-08-27 JP JP2013175972A patent/JP2013243781A/ja active Pending
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