JP2010204549A - 画像表示装置及び制御装置 - Google Patents
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Abstract
【解決手段】画像表示装置1は、1フレーム分の画像データの各行に応じた画像信号と、1行分に応じた画像信号の出力期間に応じて有効となり、当該出力期間の終了に応じて無効となるDE信号とを出力する画像生成手段2と、画像生成手段2にカスケード接続され、入力されるDE信号に基づいて、下流へのDE信号の出力をそれぞれ制御する複数の制御手段4と、複数の制御手段4にそれぞれ接続される複数の表示手段5とを備える。制御手段4は、DE信号が有効から無効に切り替わった回数を計数する計数部と、表示手段5の表示領域の行数に基づく閾値に、当該回数が達したか否かを判定する判定部と、当該回数が閾値に達していないと判定されると、下流側の制御手段に対するDE信号の出力を規制し、閾値に達したと判定されると、DE信号の出力を許容する出力制御部とを備える。
【選択図】図1
Description
また、制御手段と、当該制御手段に接続される表示手段とは、これらを一体化した表示モジュールとして構成することも可能である。このような表示モジュールを、画像生成手段にカスケード接続して前述の画像表示装置を構成すれば、当該画像表示装置の構成を簡略化することができるほか、各構成の接続及び配線を簡略化することができる。
本発明によれば、判定部により、計数部により計数される回数が閾値に達していないと判定される間は、制御信号出力部により、無効状態を示す制御信号がマスク回路に出力されることで、当該マスク回路は、信号出力部に対してイネーブル信号を出力しない。これにより、下流側の制御手段へのイネーブル信号の出力を確実に規制することができる。
また、判定部により、当該回数が閾値に達したと判定されると、制御信号出力部により、有効状態を示す制御信号がマスク回路に出力されるので、当該マスク回路は、信号出力部にイネーブル信号を出力する。これにより、下流側の制御手段へのイネーブル信号の出力を許容することができる。
従って、下流側の制御手段へのイネーブル信号の出力制御を確実に行うことができる。ここで、マスク回路を、構成が簡易なAND回路で構成すれば、制御手段の構成を簡略化することができる。また、これにより、画像表示装置の構成を簡略化することができ、当該画像表示装置の製造コストを低減することができる。
本発明によれば、出力制御部は、イネーブル信号が無効状態から有効状態に切り替わるまでの期間内に、下流側の制御手段に対してイネーブル信号を出力可能に切り替える。このため、当該下流側の制御手段に入力される時点のイネーブル信号は無効状態であり、当該イネーブル信号は、やがて無効状態から有効状態に切り替わることとなる。これによれば、当該制御手段に接続された表示手段は、イネーブル信号が無効状態から有効状態に切り替わった後に入力される画像信号を、画像表示に利用する画像信号として適切に取得することができる。従って、当該画像信号を用いて画像を適切に表示することができるので、各表示手段による画像表示を適切に行うことができる。
このような同期信号としては、Vsync信号(垂直同期信号)を例示できる。
本発明によれば、同期信号が無効状態から有効状態に切り替わった際、すなわち、次のフレームに応じた各信号が入力されるタイミングで、計数部が、計数していた回数を初期化する。これによれば、各制御手段による前述のイネーブル信号の出力制御、及び、各表示手段による画像表示を、生成される画像データのフレームごとに繰り返し行うことができる。従って、フレームごとに画像表示を適切に行うことができる。
これにより、各表示領域が、前述の間隔に応じた部分が隠されたように認識される連続した1つの画像として、各部分画像を表示することができる。従って、画像表示装置の汎用性を向上することができる。
図1は、本実施形態に係る画像表示装置1の構成を示すブロック図である。
本実施形態に係る画像表示装置1は、外部から入力されるコマンドに応じた画像を表示するものであり、例えば、パチンコ機等の遊技機に採用されるものである。この画像表示装置1は、図1に示すように、当該コマンドに応じた画像データを生成する画像生成手段2と、当該画像生成手段2にカスケード接続される複数の表示モジュール3(3A〜3C)とを備えている。
以下、これら画像生成手段2及び表示モジュール3について詳述する。
画像生成手段2は、前述のコマンドに応じた画像データを生成し、当該画像データに基づく画像信号を出力する。この画像生成手段2は、詳しい図示を省略したが、VDP(Video Display Processor)又はGPU(Graphics Processing Unit)等の描画回路と、キャラクターデータ及び背景データ等を記憶するCGROM(Character Generator Read Only Memory)と、描画時の作業領域となるVRAM(Video Random Access Memory)とを備えて構成されている。
また、第2画像データを生成する場合には、描画回路は、各表示領域521の間隔D(図2参照)の寸法に応じた行数分の解像度を、各表示領域521の解像度に合算した解像度の画像データをフレームごとに生成する。
なお、これら画像データ、及び、表示される画像については、後に詳述する。
これらのうち、Vsync信号は、1フレーム分の画像データの出力期間に略応じてローレベル(有効状態)となり、当該出力期間の終了に応じてハイレベル(無効状態)となる同期信号である。
DC信号は、1ドット分の画像データの出力期間に応じてローレベル(有効状態)となり、当該出力期間の終了に応じてハイレベル(無効状態)となる信号である。
DE信号は、本発明のイネーブル信号に相当し、1行分の画像データの出力期間に応じてローレベル(有効状態)となり、当該出力期間の終了に応じてハイレベル(無効状態)となる信号である。
表示モジュール3(3A〜3C)は、前述のように、画像生成手段2にカスケード接続され、当該画像生成手段2により出力される各信号に応じた画像を表示する。具体的に、表示モジュール3Aは、画像生成手段2に接続され、表示モジュール3B,3Cは、それぞれ表示モジュール3A,3Bに接続されている。なお、これら画像生成手段2と表示モジュール3A〜3Cとは、本実施形態では、LVDS(Low voltage differential signaling)により接続されているが、CMOS/TTLにより接続される構成としてもよい。
このような表示モジュール3(3A〜3C)は、それぞれ、制御手段4(4A〜4C)及び表示手段5(5A〜5C)を備える。
このうち、表示手段5は、制御手段4に接続され、当該制御手段4を介して画像生成手段2から入力される各信号に基づく画像を表示する。この表示手段5は、それぞれドライバー回路51及び表示部52を備える。
ドライバー回路51は、入力される各信号(Pixel信号、Vsync信号、DC信号及びDE信号)に基づいて、表示部52を駆動させ、当該表示部52により、当該画像信号に応じた画像を表示させる。
表示部52(表示手段5A〜5Cの表示部を、それぞれ52A〜52Cとする)は、ドライバー回路51から入力される駆動信号に応じた画像を表示する。この表示部52は、本実施形態では液晶パネルで構成されているが、有機EL(Electro-Luminescence)、プラズマ及びCRT(Cathode Ray Tube)等の各種表示器を採用してもよい。
これら表示部52A〜52Cは、図2に示すように、表示画素がマトリクス状に配列された表示領域521と、当該表示領域521を囲む枠部522とを有し、当該表示領域521は、列方向に長く、行方向に短い略矩形状を有している。そして、各表示部52A〜52Cは、表示領域521の長手方向が上下方向となるように、それぞれ隣接配置される。すなわち、各表示部52は、各表示領域521の行方向が左から右に向かう方向となり、かつ、列方向が下から上に向かう方向となるように配置される。
図1に戻り、制御手段4(4A〜4C)は、本発明の制御手段及び制御装置に相当し、それぞれ画像生成手段2にカスケード接続される。具体的に、制御手段4Aは、画像生成手段2に接続され、制御手段4B,4Cは、制御手段4A及び制御手段4Bにそれぞれ接続されている。そして、これら各制御手段4A〜4Cに、表示手段5A〜5Cがそれぞれ接続される。
このような制御手段4A〜4Cは、それぞれ、入力インターフェース(以下、「入力IF」と略す場合がある)41と、出力インターフェース(以下、「出力IF」と略す場合がある)42と、マスク回路43と、調停回路44とを備える。
出力IF42は、本発明の信号出力部に相当し、入力IF41と信号線を介して接続され、当該入力IF41から入力される各信号を、下流側の表示モジュール3の入力IF41に出力する。これら信号線のうち、Pixel信号、Vsync信号及びDC信号が伝送される各信号線は、入力IF41と出力IF42とを直接接続するが、DE信号が伝送される信号線(DE信号線)は、マスク回路43を介して入力IF41と出力IF42とを接続する。
調停回路44は、入力IF41と表示手段5とを接続するVsync信号線及びDE信号線から分岐した各信号線と接続され、当該入力IF41から入力されるVsync信号及びDE信号に基づいて、下流側の表示モジュール3へのDE信号の出力を制御する制御信号をマスク回路43に出力し、当該マスク回路43によるDE信号の出力を制御する。この調停回路44は、図3に示すように、Vsync判定部441、DE判定部442、計数部443、ライン判定部444、制御信号出力部445、閾値設定部446及び記憶部447を備える。
DE判定部442は、入力されるDE信号の状態を判定する。具体的に、DE判定部442は、当該DE信号がローレベル(有効状態)であるか、ハイレベル(無効状態)であるかを判定する。
制御信号出力部445は、マスク回路43とともに本発明の出力制御部を構成する。この制御信号出力部445は、ライン判定部444により、計数部443により計数されている回数が閾値に達していないと判定されている間は、マスク回路43に対して、DE信号の出力を規制するローレベルの制御信号を出力する。また、制御信号出力部445は、当該回数が閾値に達したと判定されると、マスク回路43に対して、DE信号の出力を許容するハイレベルの制御信号を出力する。
具体的に、閾値設定部446は、画像生成手段2が第1画像データを生成する場合には、当該閾値設定部446を有する表示モジュール3を構成する表示領域521の行数を閾値に設定する。
また、閾値設定部446は、画像生成手段2が第2画像データを生成する場合には、当該閾値設定部446を有する表示モジュール3の表示領域521の行数と、当該表示領域521と下流側の表示モジュール3の表示領域521との間隔D(図2)に応じた行数とを合算した行数を、閾値に設定する。
図4は、各制御手段4により実行される表示制御処理を示すフローチャートである。
各制御手段4は、以下に示す表示制御処理を実行し、画像生成手段2から入力されるDE信号の出力制御を行い、これにより、各表示手段5による画像の表示制御を行う。
この表示制御処理では、図4に示すように、まず、Vsync判定部441が、入力IF41を介して上流側の手段(例えば、制御手段4Aから見て画像生成手段2)から入力されるVsync信号がハイレベル(無効状態)からローレベル(有効状態)に切り替わったか否かを判定する(ステップS1)。ここで、ハイレベルからローレベルに切り替わっていないと判定した場合には、当該Vsync判定部441による判定処理が継続実行される。
また、制御信号出力部445が、マスク回路43にローレベルの制御信号を出力する(ステップS3)。これにより、マスク回路43から出力IF42へのDE信号の出力が規制される。
一方、DE判定部442により、ローレベルからハイレベルに切り替わったと判定されると、計数部443が、DE信号が切り替わった回数を計数(1加算)する(ステップS5)。
一方、閾値に達したと判定されると、制御信号出力部445が、ハイレベルの制御信号をマスク回路43に出力する(ステップS7)。この制御信号の出力は、DE信号がハイレベルからローレベルに推移する前に行われ、これにより、当該DE信号はハイレベルからローレベルに推移する前に、出力IF42を介して、下流側の表示モジュール3に出力される。
以下、画像表示装置1にて表示される画像について説明する。
図5は、画像表示装置1により表示される画像を示す図であり、第1画像データF1及び当該データに基づく部分画像P11〜P13を示す図である。このうち、図5(A)は、生成された第1画像データF1を示し、図5(B)は、各表示モジュール3により取得される部分画像データF11〜F13を示し、図5(C)は、各表示領域521により表示される部分画像P11〜P13を示している。
ここで、画像生成手段2が、各表示領域521の解像度を合算した解像度を有し、かつ、当該各表示領域521による画像表示に利用される部分画像データF11〜F13が行方向(V方向)に接続された第1画像データF1を生成する場合について、図5を用いて説明する。
このため、画像生成手段2が、図5(A)に示す第1画像データF1を生成する場合、各表示モジュール3の閾値設定部446は、当該表示モジュール3が有する表示領域521の行数を閾値として設定する。これにより、各表示モジュール3A〜3Cは、対応する部分画像データF11〜F13の出力期間の終了に応じて、下流側の表示モジュール3に、入力されたDE信号を出力することとなる。
この際、当該表示モジュール3Aは、入力される各信号に基づいて、表示手段5Aによる部分画像データF11に応じた部分画像P11の表示が開始される。
一方、表示モジュール3B,3Cにも、部分画像データF11に応じたPixel信号と、Vsync信号及びDC信号とが入力される。しかしながら、これら表示モジュール3B,3Cには、DE信号は入力されない。このため、当該表示モジュール3B,3Cでは、画像信号が入力されていないものと認識され、部分画像P11の表示は行われない。
ここで、表示モジュール3Bの計数部443による計数は、当該表示モジュール3BにDE信号が入力されてから開始される。このため、部分画像データF12に応じた信号が入力されている間は、当該計数部443により計数される回数は閾値に達しないので、DE信号は、表示モジュール3Cに出力されない。これにより、表示モジュール3Cによる部分画像P12の表示は行われない。
一方、表示モジュール3Aには、引き続き各信号が入力される。しかしながら、Vsync信号がハイレベルからローレベルへと推移していないので、当該表示モジュール3Aでは、入力される各信号は余分な信号として消費されるので、部分画像P11の表示が継続され、部分画像P12の表示は行われない。
そして、画像生成手段2により、第1画像データF1の次のフレームに応じた各信号の出力が開始されると、同様に、各表示モジュール3A〜3Cにより、当該フレームに含まれる部分画像データF11〜F13に基づく部分画像P11〜P13が表示される。
図6は、画像表示装置1により表示される画像を示す図であり、第2画像データF2及び当該データF2に基づく部分画像P21〜P23を示す図である。このうち、図6(A)は、生成された第2画像データを示し、図6(B)は、各表示モジュール3により取得される部分画像データF21〜F23を示し、図6(C)は、各表示領域521により表示される部分画像P21〜P23を示す図である。
次に、画像生成手段2が、表示された際に全体で1つの画像となる第2画像データF2を生成する場合について、図6を用いて説明する。
表示モジュール3Aでは、画像生成手段2から入力される信号に基づいて、閾値設定部446により、表示領域521の行数と、表示モジュール3A,3Bの各表示領域521の間隔Dに応じた行数とを合算した行数が閾値に設定される。同様に、表示モジュール3Bの閾値設定部446により、当該表示モジュール3Bの表示領域521の行数と、表示モジュール3B,3Cの各表示領域521の間隔Dに応じた行数とを合算した行数が閾値に設定される。
ここで、表示モジュール3Aの表示領域521は、入力される部分画像データF21に応じた信号のうち、当該表示領域521の行数に応じた信号しか画像表示に利用できない。このため、表示モジュール3A,3Bの各表示領域521の間隔Dに応じた行数分の画像データ(図6(B)における一点鎖線部分の画像データ)に応じたPixel信号が入力されている間、DE信号は、表示モジュール3Aにて消費される。また、当該Pixel信号も余分な信号として、表示モジュール3A内では消費される。
DE信号が入力された表示モジュール3Bでは、当該Pixel信号及びDE信号に応じて、部分画像データF22に基づく部分画像P22の表示が開始される。ここで、当該表示モジュール3Bにおいても、当該部分画像データF22に応じたPixel信号のうち、表示領域521の行数分のPixel信号しか画像表示に利用できない。このため、表示モジュール3B,3Cの各表示領域521の間隔Dに応じた行数分の画像データ(同様に、図6(B)における一点鎖線部分の画像データ)に応じたPixel信号が出力されている間、DE信号は、表示モジュール3Bにて消費され、前述の場合と同様に、当該Pixel信号も消費される。
ここで、表示モジュール3Cは、最下流に位置しているため、閾値設定部446により、当該表示モジュール3Cの表示領域521の行数が閾値に設定される。これにより、表示モジュール3Cの表示領域521に、部分画像データF23に基づく部分画像P23が表示される。なお、最下流に位置する閾値設定部446により設定される閾値は、前述の理由により、表示領域521の行数以上であればよい。
そして、画像生成手段2により、第2画像データF2の次のフレームに応じた各信号の出力が開始されると、同様に、各表示モジュール3A〜3Cにより、当該フレームに含まれる部分画像データF21〜F23に基づく部分画像P21〜P23が表示される。
各表示手段5A〜5Cには、当該各表示手段5A〜5Cにより表示される部分画像のPixel信号、Vsync信号及びDC信号が、制御手段4A〜4Cを介して入力されるほか、DE信号が順次入力される。これによれば、各表示手段5A〜5Cには、サンプリング回路及びフレームメモリ等が必要ないので、画像表示装置1の製造コストを低減することができる。
また、制御手段4と、表示手段5とは、これらを一体化した表示モジュール3として構成されているので、画像表示装置1の構成を簡略化することができるほか、各構成の配線作業を簡略化することができる。
従って、下流側の制御手段4へのDE信号の出力制御を確実に行うことができる。
また、マスク回路43は、AND回路で構成されているので、制御手段4の構成を簡略化することができる。これにより、画像表示装置1の構成を簡略化することができ、当該画像表示装置1の製造コストを低減することができる。
本発明は前述の実施形態に限定されるものではなく、本発明の目的を達成できる範囲での変形、改良等は本発明に含まれるものである。
前述の実施形態では、制御手段4は、入力されるPixel信号、Vsync信号、DC信号及びDE信号のうち、下流側の制御手段4に対するDE信号の出力制御を行うとしたが、本発明はこれに限らない。すなわち、下流側の制御手段4に対して、少なくともDE信号の出力が制御される構成であれば、他の信号の出力については、常に許容してもよく、Pixel信号及びDC信号については、DE信号とともに規制してもよい。
前述の実施形態では、画像生成手段2は、必要に応じて、第1画像データF1と第2画像データF2とを生成するとしたが、本発明はこれに限らず、いずれか一方でもよい。また、画像生成手段2が第2画像データF2を生成する場合には、閾値設定部446が、表示領域521の行数に、間隔Dに応じた行数を合算した行数を閾値に設定するとしたが、本発明はこれに限らない。すなわち、間隔Dを考慮せず、それぞれ離間配置される上流側の表示領域521と下流側の表示領域521とで、連続した画像を表示してもよい。
例えば、表示領域521の解像度がそれぞれ同じ複数の表示手段5を互いに重なるように配置し、手前側に配置される最上流の表示手段5と、奥側に配置される最下流の表示手段5とをそれぞれ反対方向に移動させつつ、これら表示手段5の移動量に応じて上流側の閾値設定部446が閾値を増加させることで、連続した1つの画像(前述の第2画像データに応じた画像)が次第に拡幅されるかのような表示形態を実現することができる。
Claims (6)
- 画像を表示する画像表示装置であって、
1フレーム分の画像データを生成して、当該画像データの各行に応じた画像信号と、1行分の前記画像データに応じた前記画像信号の出力期間に応じて有効状態となり、かつ、当該出力期間の終了に応じて無効状態となるイネーブル信号とを出力する画像生成手段と、
前記画像生成手段にそれぞれカスケード接続され、入力される前記イネーブル信号に基づいて、下流への前記イネーブル信号の出力をそれぞれ制御する複数の制御手段と、
前記複数の制御手段にそれぞれ接続され、当該制御手段を介して入力される前記画像信号及び前記イネーブル信号に基づく画像を表示する表示領域を有する複数の表示手段とを備え、
前記制御手段は、
前記イネーブル信号が有効状態から無効状態に切り替わった回数を計数する計数部と、
当該制御手段に接続された前記表示手段の前記表示領域の行数に基づく閾値に、前記回数が達したか否かを判定する判定部と、
前記回数が前記閾値に達していないと判定されると、当該制御手段に接続された下流側の前記制御手段に対する前記イネーブル信号の出力を規制し、前記閾値に達したと判定されると、前記下流側の制御手段に対する前記イネーブル信号の出力を許容する出力制御部とを備えることを特徴とする画像表示装置。 - 請求項1に記載の画像表示装置において、
前記制御手段は、
前記画像信号及び前記イネーブル信号が入力される信号入力部と、
前記画像信号及び前記イネーブル信号を前記下流側の制御手段に出力する信号出力部とを備え、
前記出力制御部は、
前記判定部により前記回数が前記閾値に達していないと判定された場合に無効状態となり、前記閾値に達したと判定された場合に有効状態となる制御信号を出力する制御信号出力部と、
前記信号入力部に接続される第1入力部、前記制御信号出力部に接続される第2入力部、及び、前記信号出力部に接続される出力部を有するマスク回路とを備え、
前記マスク回路は、前記第1入力部に前記イネーブル信号が入力されている状態で、前記第2入力部に有効状態を示す前記制御信号が入力されると、入力された前記イネーブル信号を前記出力部により前記信号出力部に出力することを特徴とする画像表示装置。 - 請求項1又は請求項2に記載の画像表示装置において、
前記出力制御部は、前記判定部により前記回数が前記閾値に達したと判定された際に、前記イネーブル信号が無効状態から有効状態に切り替わるまでの期間内に、前記下流側の制御手段に前記イネーブル信号を出力可能に切り替えることを特徴とする画像表示装置。 - 請求項1から請求項3のいずれかに記載の画像表示装置において、
前記画像生成手段は、前記1フレーム分の画像データに応じた前記画像信号の出力期間に略応じて有効状態となり、当該出力期間の終了に略応じて無効状態となる同期信号を出力し、
前記計数部は、前記同期信号が無効状態から有効状態に切り替わると、前記回数を初期化することを特徴とする画像表示装置。 - 請求項1から請求項4のいずれかに記載の画像表示装置において、
前記複数の表示手段のうち、少なくとも2つは、それぞれの前記表示領域の行方向に沿って配置され、
前記2つの表示手段に接続される2つの前記制御手段のうち、上流側に位置する前記制御手段は、当該制御手段に接続される前記表示手段の前記表示領域の行数と、前記2つの表示手段の前記各表示領域間の間隔に応じた行数とを合算した行数を前記閾値に設定する閾値設定部を有することを特徴とする画像表示装置。 - 入力される信号の出力を制御する制御装置であって、
1フレーム分の画像データにおける1行分のデータに応じた画像信号の出力期間に応じて有効状態となり、かつ、当該出力期間の終了に応じて無効状態となるイネーブル信号が入力される信号入力部と、
入力される前記イネーブル信号を出力する信号出力部と、
入力される前記イネーブル信号が有効状態から無効状態に切り替わった回数を計数する計数部と、
取得される前記画像データの行数に基づく閾値に、前記回数が達したか否かを判定する判定部と、
前記判定部により前記回数が前記閾値に達していないと判定されると、前記信号出力部による前記イネーブル信号の出力を規制し、前記判定部により前記回数が前記閾値に達したと判定されると、前記信号出力部による前記イネーブル信号の出力を許容する出力制御部と、
を備えることを特徴とする制御装置。
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Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2014191020A (ja) * | 2013-03-26 | 2014-10-06 | Futaba Corp | 表示装置、表示駆動方法、表示駆動装置 |
EP3324608A1 (en) | 2016-11-18 | 2018-05-23 | Konica Minolta, Inc. | Image processing device, image processing method, image forming apparatus, and image display device |
CN114049859A (zh) * | 2021-11-03 | 2022-02-15 | 广州小鹏汽车科技有限公司 | 一种显示装置、显示方法及车辆 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08101666A (ja) * | 1994-09-30 | 1996-04-16 | Takiron Co Ltd | ドットマトリクス型led表示装置のデータ分配器 |
JP2000330534A (ja) * | 1999-05-20 | 2000-11-30 | Hitachi Ltd | 表示装置システム |
JP2003029717A (ja) * | 2001-07-13 | 2003-01-31 | Nec Corp | 液晶表示制御回路 |
JP2008116934A (ja) * | 2006-10-31 | 2008-05-22 | Toppoly Optoelectronics Corp | 画像表示システムの電源遮断時の残像をなくす方法 |
-
2009
- 2009-03-05 JP JP2009052218A patent/JP2010204549A/ja not_active Withdrawn
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08101666A (ja) * | 1994-09-30 | 1996-04-16 | Takiron Co Ltd | ドットマトリクス型led表示装置のデータ分配器 |
JP2000330534A (ja) * | 1999-05-20 | 2000-11-30 | Hitachi Ltd | 表示装置システム |
JP2003029717A (ja) * | 2001-07-13 | 2003-01-31 | Nec Corp | 液晶表示制御回路 |
JP2008116934A (ja) * | 2006-10-31 | 2008-05-22 | Toppoly Optoelectronics Corp | 画像表示システムの電源遮断時の残像をなくす方法 |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2014191020A (ja) * | 2013-03-26 | 2014-10-06 | Futaba Corp | 表示装置、表示駆動方法、表示駆動装置 |
EP3324608A1 (en) | 2016-11-18 | 2018-05-23 | Konica Minolta, Inc. | Image processing device, image processing method, image forming apparatus, and image display device |
US10382651B2 (en) | 2016-11-18 | 2019-08-13 | Konica Minolta, Inc. | Image processing device, image processing method, image forming apparatus, and image display device |
CN114049859A (zh) * | 2021-11-03 | 2022-02-15 | 广州小鹏汽车科技有限公司 | 一种显示装置、显示方法及车辆 |
CN114049859B (zh) * | 2021-11-03 | 2023-07-14 | 广州小鹏汽车科技有限公司 | 一种显示装置、显示方法及车辆 |
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