JP2010034104A - 光結合型半導体リレー - Google Patents
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Abstract
【課題】従来設備を流用することで、現行のものより端子間ピッチを大きく、あるいは小さくすることのできる光結合型半導体リレーを提供する。
【解決手段】発光側内部リードフレーム11に設けた発光素子13と、受光側内部リードフレーム12に設けた受光素子14とを対向配設し、これらの両素子を透光性樹脂17で一体モールドして光結合成形体10を形成するとともに、光結合成形体10の外側に突出した、発光側、受光側内部リードフレーム11,12のそれぞれを、発光側、受光側外部リードフレーム21,22に接合し、光結合成形体10とリードフレームの接合部31,32とを、遮光性樹脂18で一体モールドして外側成形体20で覆っている。
【選択図】図1
【解決手段】発光側内部リードフレーム11に設けた発光素子13と、受光側内部リードフレーム12に設けた受光素子14とを対向配設し、これらの両素子を透光性樹脂17で一体モールドして光結合成形体10を形成するとともに、光結合成形体10の外側に突出した、発光側、受光側内部リードフレーム11,12のそれぞれを、発光側、受光側外部リードフレーム21,22に接合し、光結合成形体10とリードフレームの接合部31,32とを、遮光性樹脂18で一体モールドして外側成形体20で覆っている。
【選択図】図1
Description
本発明は、発光素子と受光素子とを対向配置させ、それらを透光性樹脂でモールドし、さらにその周りを遮光性樹脂でモールドした2重モールドタイプの光結合型半導体リレーの改良に関するものである。
従来の光結合型半導体リレーには、図6に示すように、2重モールド構造の高絶縁性のものがある。図6(a)、(b)は、この種の光結合型半導体リレーの透視平面図、断面図である。この半導体リレーは、発光側リードフレーム101に設けた発光素子103と、受光側リードフレーム102に設けた受光素子104とを対向配置し、これらの両素子を透光性樹脂105で一体モールドし、さらにその周りを遮光性樹脂106で一体モールドしたものである。なお、107は受光素子104の信号によって動作するスイッチング素子である。
光結合型半導体リレーには、このような対向配置型のもののほかに、両素子を平面配置した平面カップリング型のものも知られているが、対向配置型の半導体リレーのほうが、平面配置型のものより光結合効率がよいうえ、小型化できるため、一般に広く利用されている。
ところが、ユーザによっては、高い耐電圧が得られるように、端子間のピッチ(外部沿面距離)を大きくした大型のリレーを望む要求がある。ちなみに図6のものは、入出力間の沿面距離L3は長く、入出力間では比較的高い耐電圧が得られるが、端子間ピッチL4は1mm強と小さいため耐電圧は低く、その10倍程度のピッチのものが要求される場合もある。
このような要求に対し、上記のような2重モールドタイプの半導体リレーにおいては、端子間ピッチL4が大きくなるように、素子を配置する箇所と端子との距離の長いリードフレームを配設し、それに対応したモールド設備を準備すれば、所望の大きさのものは得られる。しかし、そのようなものでは、設備を新たに準備しなければならず、設備費用が多大なものとなる可能性がある。
なお、特許文献1には、端子間ピッチを変更可能としたサーマルリレーが提案されているが、光結合型半導体リレーにおいては、そのようなピッチを可変としたものは全く提案されていない。
特開平5−128959号公報
本発明は、このような事情を考慮して提案されたもので、その目的は、従来設備を流用することで、現行のものより端子間ピッチを大きく、あるいは小さくすることのできる光結合型半導体リレーを提供することにある。
また、上記のように、平面配置型のリレーは対向配置型のものよりも大型サイズであるため、対向配置型の半導体リレーを製造するのに、併設された平面配置型リレーなどの従来設備を利用できれば、端子間ピッチの大きいリレーを低コストで製造できる。
上記目的を達成するために、請求項1に記載の光結合型半導体リレーは、発光側内部リードフレームに設けた発光素子と、受光側内部リードフレームに設けた受光素子とを対向配設し、これらの両素子を透光性樹脂で一体モールドして光結合成形体を形成するとともに、該光結合成形体の外側に突出した、発光側、受光側内部リードフレームのそれぞれを、発光側、受光側外部リードフレームに接合し、光結合成形体とリードフレームの接合部とを、遮光性樹脂で一体モールドして外側成形体で覆ったことを特徴とする。
請求項2に記載の光結合型半導体リレーでは、発光側、受光側外部リードフレームのそれぞれは、発光側、受光側内部リードフレームの切断端部と接合されている。
請求項3に記載の光結合型半導体リレーは、外部リードフレームは、内部リードフレームとの接合部と、外側成形体の出口側との高さを異ならせて成形されている。
請求項4に記載の光結合型半導体リレーは、内部リードフレームは、光結合成形体の出口側と、外部リードフレームとの接合部との高さを異ならせて成形されている。
請求項1に記載の光結合型半導体リレーは、2重モールドのうち外側の遮光性樹脂による成形層において、内部リードフレームを外部リードフレームに接合させている。そのため、種々の寸法の外部リードフレームを準備することで、従来製造していた内部の光結合成形体を使用して種々のサイズの光結合型半導体リレーを製造できる。例えば、対向配置型の光結合成形体を平面配置型の外部成形型で2重モールドすることで、端子間ピッチの大きい半導体リレーを提供することができる。このように、他のタイプの従来設備を利用できるので、種々の寸法の半導体リレーを、新たな設備を準備する必要なく低コストで製造できる。
請求項2に記載の光結合型半導体リレーでは、内部リードフレームを切断した端部を外部リードフレームに接合するようにしているため、長さ調節が簡易に行える。
請求項3に記載の光結合型半導体リレーでは、外部リードフレームは、内部リードフレームとの接合部と、外側成形体の出口側との高さを異ならせて成形されている。また、請求項4では、内部リードフレームは、光結合成形体の出口側と、外部リードフレームとの接合部との高さを異ならせて成形されている。つまり、光結合成形体の出口側と外側成形体の出口側の高さが異なる場合でも、リードフレームを折り曲げるなどして高さ調整がされているため、従来のモールド設備をそのまま有効利用することができる。
以下に、本発明の実施の形態について、添付図面を参照しながら説明する。
図1は本発明の光結合型半導体リレーの一実施形態を示す説明図で、(a)は光結合型半導体リレーの透視平面図、(b)は同断面図である。
この光結合型半導体リレー1(以下、半導体リレーと略す。)は、発光素子13と受光素子14とをそれぞれの内部リードフレーム11,12に設けて対向配置し、これらの両素子13,14を含む光結合空間Aを透光性樹脂17でモールドし、さらに透光性樹脂層17の周りを遮光性樹脂23で一体モールドした2重モールド構造のリレーである。つまり、光結合空間Aは内部成形型によって透光性樹脂17でモールド成形されて光結合成形体10が形成され、その光結合成形体10はさらに外部成形型によって遮光性樹脂23でモールド成形されて、遮光性樹脂層23による外側成形体20が形成されている。
本実施形態では、この外側成形体20の中で、発光素子13、受光素子14のそれぞれの内部リードフレーム11,12に継ぎ足しされるように、他の外部リードフレーム21,22が連結されていることを特徴としている。
すなわち、発光側のリードフレームは、発光素子13を取付端部11aに設けた内部リードフレーム11と、リレーの端子として外部に突出する外部リードフレーム21とが接合されて構成されている。一方、受光側のリードフレームは、受光素子14、スイッチング素子15を取付端部12aに設けた内部リードフレーム12と、リレーの端子として外部に突出する外部リードフレーム22とが接合されて構成されている。
これらの接合部31,32は、図1に示すように、発光側、受光側ともに、光結合成形体10から突出した内部リードフレーム11,12の切断端部11b,12bを、外部リードフレーム21,22に重ね合わせて半田で接合してなる。この図例では、3本の発光側内部リードフレーム11が発光側外部リードフレーム21と接合され、2本の受光側内部リードフレーム12が受光側外部リードフレーム22と接合されている。
このように、外側成形体20内において、内部リードフレーム11,12を外部リードフレーム21,22に接合させているため、種々の寸法の外部リードフレームを準備することで、従来製造していた内部の光結合成形体10を使用して種々のサイズの光結合型半導体リレーを製造することができる。例えば、図1の例のように、端子間ピッチL1を大きくした半導体リレー1を製造することができる。
また図1の例では、外部リードフレーム21,22を含む外側成形体20は、平面配置型の8端子タイプの半導体リレーの成形型を使用して、その成形型に4端子21a,22aが割り付けられるようにして製されている。
したがって、外側の遮光性樹脂層23を肉厚にし、外部リードフレーム21,22を長くすることで図1のように、長手方向、短手方向ともに光結合成形体10に比してきわめて大きい半導体リレー1が得られる。図1の半導体リレー1を図6に示したものと比較すると、光結合成形体10の寸法は同じであるが、端子間ピッチL1は約10倍程度に大幅に大きくなっている。端子間ピッチL1が大きくなることで、沿面距離が長くなり、端子間耐電圧の高いリレーが得られる。
つぎに、図2〜4を参照しながら、同半導体リレー1の構造をより詳細に説明するとともに、製造手順についても説明する。
図2は同半導体リレー1の構成を示した分離構成図で、(a)は平面図、(b)は断面図である。図3は光結合成形体10の内部構造を示す図であり、(a)は透視平面図、(b)は発光側と受光側とを分離した平面図である。図4は外側成形体20の内部構造を示す図であり、(a)は平面図、(b)は断面図、(c)は平面配置型の半導体リレーの断面図である。なお、図4(c)は本発明の図例ではないが、比較参考のために図示している。
この半導体リレー1は、大別して光結合成形体10と、外側成形体20とより構成されている。
この半導体リレー1は、内部リードフレーム11,12のそれぞれに取り付けた発光素子13、受光素子14を対向配置してなる光結合空間Aを内部成形型で一体モールドして光結合成形体10を形成し、その後、その光結合成形体10の外側に突出した内部リードフレーム11,12の各切断端部11b,12bを、半田によって外部リードフレーム21,22に接合し、光結合成形体10とリードフレームの接合部31,32(図1を参照)とを外部成形型で一体モールドして外側成形体20で覆うようにして製されている。
この光結合成形体10では、図3に示すように、発光側内部リードフレーム11に設けた発光素子13と、受光側内部リードフレーム12に設けた受光素子14とが対向配置されているとともに、受光側内部リードフレーム12には2つのスイッチング素子15が設けられている。
発光(入力)側では、3つのリードフレーム11が個別に配置され、その中央のリードフレームに発光素子13が実装されている。一方、受光(出力)側では、3つのリードフレーム12が個別に配置され、その中央のリードフレーム12に受光素子14が実装され、他の2つのリードフレーム12にはスイッチング素子15が実装されている。
発光素子13は発光ダイオードなどよりなり、受光素子14はフォトダイオードなどよりなる。また、スイッチング素子15は、受光素子14の出力信号にもとづいてオン、オフ動作するMOSFETなどの半導体素子で構成されている。
また、発光素子13は透明シリコーンよりなるJCR16(ジャンクション・コーティング・レジン)で覆われている。この透明シリコーンは、不純物の含有率が低く、絶縁性にもすぐれており、これによって光結合効率のよい光結合空間が得られる。一方、受光側では、受光素子14と2つのスイッチング素子15とがワイヤ18で導電接続されている。
これらの素子を含む光結合空間Aが、内部成形型によって透光性樹脂17で一体モールドされることで、光結合成形体10が形成されている。この光結合成形体10の外側に突出した内部リードフレーム11,12は、外部リードフレーム21,22と接合可能なように切断されている。
一方、この光結合成形体10を外部より覆う外側成形体20は、図4に示したようなキャビティBを有した外部成形型が使用される。
この外部成形型には、図4(c)に示すような平面配置型の半導体リレー50の成形型が使用されており、図例では8端子タイプの成形型を使用している。この8端子タイプのものは、図4(a)の破線で示す位置にも端子が配されているが、本実施形態に示した半導体リレー1では、それらの箇所には端子を配さず、発光側、受光側のそれぞれの辺の両端に端子21a,22aが突出するように、外部リードフレーム21,22が配置されている。
なお、図4(c)において、51は発光素子、52は受光素子、53はスイッチング素子、54はリードフレーム、55は透光性樹脂層、56は光反射樹脂層、57は遮光性樹脂層である。また、この平面配置型のリレー50については平面図を割愛しているが、各素子51,52はそれぞれのリードフレーム54に個別に配置され、素子51,52間や、素子51,52、リードフレーム54間がワイヤ58で接続されている。
この平面配置型の8端子タイプのリレーは、端子間ピッチL2が3.6mmであるが、本実施形態の半導体リレー1では端子を各辺の両端のみに配置することで、端子間ピッチL1が13.8mmとなっている。
こうして、先に成形しておいた光結合成形体10の外側に突出した内部リードフレーム11,12の切断端部11b,12bを、図4のキャビティBで示される外部成形型内に配置した外部リードフレーム21,22に重合するように半田で接合し、外部成形型によって遮光性樹脂で一体モールドすることで、図1に示すような端子間ピッチL1の大きい半導体リレー1が得られる。
また、図4(c)で示しているように、平面配置型の半導体リレー50は発光素子51と受光素子52とを上方より覆うように反射用樹脂56が山型に形成されており、そのため、各素子(を配設したリードフレーム)の高さ位置は、成形体の高さに対して、中間位置よりも下側となっている。
したがって、外部リードフレーム21,22を平面配置型の半導体リレー50のリードフレーム54と同じ高さにして成形すれば、光結合成形体10が中央より下方向にずれて配置される。そのため図4(b)に示すように、外部リードフレーム21,22を折り曲げて、内部リードフレーム11,12との接合部31,32がやや高くなるようにしている。
このように、内部リードフレーム11,12との接合部31,32と、外側成形体の出口側との高さを異ならせるように折曲した外部リードフレーム21,22を使用することで、平面配置型の半導体リレーの成形型を有効に利用することができる。
また、本実施形態では、外部リードフレーム21,22を折り曲げて高さの調節をしているが、内部リードフレーム11,12を折り曲げることで高さ調節してもよい。図5は、内部リードフレーム11,12を折り曲げて高さ調節した光結合型半導体リレーの断面図である。この内部リードフレーム11,12は、その端部12cと光結合成形体10の出口側との間で折曲されている。
図1の実施形態では、内部リードフレーム11,12として、その端部を切断して使用するものを示したが、内部リードフレームとして使用するリードフレームがもともと長いものであれば、本実施形態のように、光結合成形体10から突出した内部リードフレーム11,12を折り曲げることで高さの調節をすることができる。
このような構成によれば、もともと長めの内部リードフレームを有効に利用でき、継ぎ足しされる外部リードフレーム21,22を短くでき、リードフレームのコストを低減できる。また、内部リードフレームの端部に、折り曲げる必要のない段差がもともと形成されていれば、内部リードフレームを折曲加工することなく外部リードフレームと接合することができる。
なお、図5の実施形態における他の構成については図1のものと同様であるため、同一の符号を付してその説明は省略する。また、平面図も省略しているが、リードフレームを継ぎ足ししているため、端子間ピッチを大きくできる利点があることはいうまでもない。
なお、以上の2つの実施形態では、端子間ピッチを大きくする例を示したが、リードフレームを接合することで端子間ピッチを小さくするものでもよい。
1 光結合型半導体リレー
10 光結合成形体
11 発光側内部リードフレーム
11a 素子取付端部
11b 切断端部
12 受光側内部リードフレーム
12a 素子取付端部
12b 切断端部
13 発光素子
14 受光素子
15 スイッチング素子
16 JCR(透明シリコーン)
17 透光性樹脂(層)
A 光結合空間
20 外側成形体
21 発光側外部リードフレーム
21a 端子
22 受光側外部リードフレーム
22a 端子
23 遮光性樹脂(層)
B 外部成形型のキャビティ
31,32 接合部
10 光結合成形体
11 発光側内部リードフレーム
11a 素子取付端部
11b 切断端部
12 受光側内部リードフレーム
12a 素子取付端部
12b 切断端部
13 発光素子
14 受光素子
15 スイッチング素子
16 JCR(透明シリコーン)
17 透光性樹脂(層)
A 光結合空間
20 外側成形体
21 発光側外部リードフレーム
21a 端子
22 受光側外部リードフレーム
22a 端子
23 遮光性樹脂(層)
B 外部成形型のキャビティ
31,32 接合部
Claims (4)
- 発光側内部リードフレームに設けた発光素子と、受光側内部リードフレームに設けた受光素子とを対向配設し、これらの両素子を透光性樹脂で一体モールドして光結合成形体を形成するとともに、該光結合成形体の外側に突出した上記発光側、受光側内部リードフレームのそれぞれを、発光側、受光側外部リードフレームに接合し、上記光結合成形体と上記リードフレームの接合部とを、遮光性樹脂で一体モールドして外側成形体で覆ったことを特徴とする光結合型半導体リレー。
- 請求項1において、
上記発光側、受光側外部リードフレームのそれぞれは、上記発光側、受光側内部リードフレームの切断端部と接合されている光結合型半導体リレー。 - 請求項1または2において、
上記外部リードフレームは、上記内部リードフレームとの接合部と、上記外側成形体の出口側との高さを異ならせて成形されている光結合型半導体リレー。 - 請求項1または2において、
上記内部リードフレームは、上記光結合成形体の出口側と、上記外部リードフレームとの接合部との高さを異ならせて成形されている光結合型半導体リレー。
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2008191673A JP2010034104A (ja) | 2008-07-25 | 2008-07-25 | 光結合型半導体リレー |
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JP2008191673A JP2010034104A (ja) | 2008-07-25 | 2008-07-25 | 光結合型半導体リレー |
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN107154389A (zh) * | 2017-03-29 | 2017-09-12 | 江苏捷捷微电子股份有限公司 | 一种高散热能力的小型贴片固态继电器及其制造方法 |
US11342312B2 (en) | 2014-12-16 | 2022-05-24 | Citizen Electronics Co., Ltd. | Light emitting element with particular phosphors |
-
2008
- 2008-07-25 JP JP2008191673A patent/JP2010034104A/ja not_active Withdrawn
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US11342312B2 (en) | 2014-12-16 | 2022-05-24 | Citizen Electronics Co., Ltd. | Light emitting element with particular phosphors |
CN107154389A (zh) * | 2017-03-29 | 2017-09-12 | 江苏捷捷微电子股份有限公司 | 一种高散热能力的小型贴片固态继电器及其制造方法 |
CN107154389B (zh) * | 2017-03-29 | 2023-07-21 | 捷捷半导体有限公司 | 一种高散热能力的小型贴片固态继电器及其制造方法 |
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