JP2009010920A - 画像処理コントローラ及び画像処理装置 - Google Patents
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Abstract
【解決手段】画像処理コントローラは、画像データと、当該画像データの出力先を示すアドレスと、を受信可能な第1PCIeバスインターフェースと、オプションボードに対して、PCIバスで画像データを送信するPCIバスインターフェースと、これらインターフェースを接続する第1信号線と、第1信号線上に備えられたFIFOメモリと、受信した画像データをメモリに送信する第2PCIeバスインターフェースと、受信したアドレスに基づいて、画像データの送信先をPCIバスインターフェースと第2PCIeバスインターフェースとのいずれかに特定する特定部と、PCIバスインターフェースに特定された場合、第1信号線及びFIFOメモリを介して画像データをPCIバスインターフェースに送信する第1送受信部と、を備える。
【選択図】 図1
Description
図1は、第1の実施の形態にかかる画像処理コントローラ及び周辺デバイスの概略を示した図である。図1を参照すると、プロッタ・スキャナを有するエンジンと接続する第1のインターフェース(101)を具備し、別のエンジン、オプションの画像処理コントローラのほか、オプションデバイスを接続する第2のインターフェース(102)を具備し、メモリ、HDDのインターフェース(103、104)をそれぞれ具備する画像処理コントローラ(100)において、第1のインターフェースと第2のインターフェースがFIFOメモリ(105)とアドレスコンバータ(106)を介して直接通信することを特徴とする画像処理コントローラが示されている。また、画像処理コントローラ100内の、インターフェース(101、102)と、アービタ110と、の間は信号線(107a、107b)で接続されている。
第1の実施の形態にかかる画像形成装置300では、画像処理コントローラ100のPCIeバスを介して画像処理エンジン301が接続された例について説明した。しかしながら、画像処理コントローラ100は、セレクタ108の出力先を変更することで、画像処理エンジンをPCIバス側に接続することができる。そこで、第2の実施の形態にかかる画像処理装置では、画像処理コントローラ100のPCIバス側に画像処理エンジンを接続した例について説明する。以下の説明では、上述した第1の実施の形態と同一の構成要素には同一の符号を付してその説明を省略している。
101 第1PCIeバスインターフェース
102 PCIバスインターフェース
103 第2PCIeバスインターフェース
104 HDD用インターフェースモジュール
105 FIFOメモリ
106 アドレスコンバータ
107 信号線
108 セレクタ
109 ビデオ出力モジュール
110 アービタ(メモリ調停器)
151 ChipSet
152 CPU
153 メモリ
201 PCIeバスインターフェースモジュール
202 PCIバスインターフェースモジュール
203 PCIeエンドポイント
204 DMAC
210 信号線
211 特定部
212 第1指示部
213 第1送受信部
214 記憶部
221 第2指示部
222 第2送受信部
231a〜d FIFOメモリ
232a〜d DMAC
300、700 画像形成装置
301、701 画像処理エンジン
303 外部コントローラ
304 オプションボード(FAXコントロールユニット)
702 オプションコントローラ
1201 画像処理コントローラ
1202 画像処理エンジン
1203 メモリ
1211 PCIバスインターフェースモジュール
1212 AGPバスインターフェースモジュール
1301 画像処理コントローラ
1302 画像処理エンジン
1303 メモリ
1304 ChipSet
1305 PCIe―PCIスイッチデバイス
Claims (9)
- 第1の外部装置から、画像情報と、当該画像情報の出力先を示すアドレスと、を受信可能な第1のインターフェースと、
第1のインターフェースより低い通信速度で、第2の外部装置に画像情報を送信する第2のインターフェースと、
前記第1のインターフェースと、前記第2のインターフェースとを接続し、データの送受信を行う通信経路と、
前記通信経路上に備えられたFIFOメモリと、
第3の外部装置に前記画像情報を送信する第3のインターフェースと、
前記第1のインターフェースが前記アドレスを受信した場合に、当該アドレスに基づいて、前記第1のインターフェースが受信する前記画像情報の送信先を、前記第2のインターフェースと前記第3のインターフェースとのいずれかに特定する特定部と、
前記第2のインターフェースが送信先として特定された場合、前記通信経路及び前記FIFOメモリを介して前記画像情報を前記第2のインターフェースに送信する送信部と、
を備えることを特徴とする画像処理コントローラ。 - 前記第1のインターフェースは、さらに、前記第1の外部装置に対して画像情報を送信可能とし、
前記第3のインターフェースは、さらに、前記第3の外部装置から画像情報を受信し、
前記第3のインターフェースが受信した前記画像情報の送信先を、前記第1のインターフェースと前記第2のインターフェースとのいずれかを選択する選択部を、さらに備えること、
を特徴とする請求項1に記載の画像処理コントローラ。 - 前記送信部は、さらに、前記画像情報の出力先を示すアドレスを送信し、
前記送信部から前記通信経路を介して送信された前記アドレスを、前記第2のインターフェースで利用されるアドレス空間上のアドレスに変換するアドレス変換部を、さらに備えること、
を特徴とする請求項1又は2に記載の画像処理コントローラ。 - 前記第1のインターフェースは、前記第1の外部装置が一回の画像処理で出力されるデータ量単位で、前記画像情報を受信し、
前記FIFOメモリは、前記データ量単位の画像情報を格納する記憶容量を有していること、
を特徴とする請求項1乃至3のいずれか一つに記載の画像処理コントローラ。 - 前記第2のインターフェースは、さらに、前記第2の外部装置から画像情報を受信し、
前記第1のインターフェースは、前記通信経路及び前記FIFOメモリを介して受信した画像情報を、前記第1の外部装置に送信し、
前記通信経路を介して前記第1のインターフェース側に配置され、前記第2のインターフェースが受信した前記画像情報を、前記FIFOメモリに格納するように前記第2のインターフェースに対して指示した後、前記FIFOメモリに対して、前記第1の外部装置が一回の画像処理に必要なデータ量単位で、前記画像情報を送信するよう指示する指示部を、さらに備えること、
を特徴とする請求項4に記載の画像処理コントローラ。 - 画像処理を行う画像処理エンジンと、
前記画像処理エンジンより画像処理能力が低い画像処理部と、
画像データを格納する画像記憶部と、
前記画像処理エンジンから、画像情報と、当該画像情報の出力先を示すアドレスと、を受信可能な第1のインターフェースと、第1のインターフェースより低い通信速度で、前記画像処理部に画像情報を送信する第2のインターフェースと、前記第1のインターフェースと、前記第2のインターフェースとを接続し、データの送受信を行う通信経路と、
前記通信経路上に備えられたFIFOメモリと、前記画像記憶部に前記画像情報を送信する第3のインターフェースと、前記第1のインターフェースが前記アドレスを受信した場合に、当該アドレスに基づいて、前記第1のインターフェースが受信する前記画像情報の送信先を、前記第2のインターフェースと前記第3のインターフェースとのいずれかに特定する特定部と、前記第2のインターフェースが送信先として特定された場合、前記通信経路及び前記FIFOメモリを介して前記画像情報を前記第2のインターフェースに送信する送信部と、を有する画像処理コントローラと、
を備えることを特徴とする画像処理装置。 - 前記画像処理コントローラは、
前記送信部が、さらに、前記画像情報の出力先を示すアドレスを送信し、
前記送信部から前記通信経路を介して送信された前記アドレスを、前記第2のインターフェースで利用されるアドレス空間上のアドレスに変換するアドレス変換部を、さらに有すること、
を特徴とする請求項6に記載の画像処理装置。 - 前記画像処理コントローラは、
前記第1のインターフェースが、前記第1の外部装置から、通信規格で定められた一度に送信可能な所定のデータ量単位で、前記画像情報を受信し、
前記FIFOメモリは、前記データ量単位の画像情報を格納する記憶容量を有していること、
を特徴とする請求項6又は7に記載の画像処理装置。 - 前記画像処理コントローラは、
前記第2のインターフェースが、さらに、前記第2の外部装置から画像情報を受信し、
前記第1のインターフェースが、前記通信経路及び前記FIFOメモリを介して受信した画像情報を、前記第1の外部装置に送信し、
前記通信経路を介して前記第1のインターフェース側に配置され、前記第2のインターフェースが受信した前記画像情報を、前記FIFOメモリに格納するように前記第2のインターフェースに対して指示した後、前記FIFOメモリに対して、前記第1の外部装置から前記所定のデータ量単位で、前記画像情報を送信するよう指示する指示部を、さらに有すること、
を特徴とする請求項8に記載の画像処理装置。
Priority Applications (2)
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