JP2008242834A - 基板の配線位置決定方法およびこれを用いて製造した基板 - Google Patents

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Abstract

【課題】配線図形を使用せずに配線設計と配線評価が可能であり、従来よりも設計の自由度が増す基板の配線位置決定方法およびこれを用いて製造した基板を提供する。
【解決手段】ピンa〜hを接続する配線パターン10を基板に形成するための方法であり、配線パターン10を形成する領域に、点P1〜P9とこれを接続する枝B1〜B12で構成される仮想領域11を形成する配線領域形成工程と、選択した2つの点P1からP9へかけて形成される経路L1〜L3上に各点P2〜P8を位置させる経路形成工程と、各経路L1〜L3が通過する点P2〜P8に順次増大する番号を付し、更に各枝B1〜B12に方向を付する番号および方向付与工程と、付した方向が各点P1〜P9の入側から出側へかけて順方向となる領域へ向け予備配線を形成する予備配線付与工程と、予備配線同士を交差させずにピンa〜hまで延ばして配線La〜Lhとする配線位置決定工程を有する。
【選択図】図1

Description

本発明は、基板に配線パターンを形成するための基板の配線位置決定方法およびこれを用いて製造した基板に関する。
従来、基板へ配線パターンを形成する方法として、配線データの保持方法があるが、この方法は以下に示す3つの方式に分類される。
(a)図11に示すように、端子の位置をxy座標で表して配線形状をそのまま扱う直接描画方式(例えば、特許文献1参照)。
(b)図12に示すように、配線領域を垂直および水平線分で区切って矩形状のセルに分割し、セル内部および境界上の状況で配線を行うグリッド方式(例えば、特許文献2参照)。
(c)図13に示すように、配線領域を十分に小さな多角形セルに分割し、各セル内で経路を保持する細分方式(例えば、特許文献3参照)。
上記したいずれの方式も、配線形状をそのまま表す方式である。
この方法に対して、図14に示すように、混雑情報を使って配線修正を簡略化する方法がある。この方法は、平面引き出し配線の修正方法であり、一行に並んだピンに左から順に1からnまでの通し番号をつけて引き出し配線をしたとき、配線が上向きに進まないという前提条件のもと、隣接する対をなすピン間を通過する最大と最小の差が、通過数を表すように点に番号を割り当てる方法である。
特開2001−60753号公報 特開2003−45973号公報 特開2000−58549号公報
しかしながら、上記したように、配線形状をそのままあるいは簡略化して計算機のデータ化する従来方法では、平面をどのように分割するか、また配線をどのように割り当てるかに多様性があり、更に配線は本来図形であるため、それをどのように抽象化してデータ化するかが問題になる。
また、大域的な配線経路の変更と配線形状の修正には、大量のデータ処理を必要とするため、小規模でなければ設計に使用できないという問題も生じる。
このように、複数の配線を交差させることなく、平面性を実現する効果的な方法を得るという課題は、未だ解決されていない。
本発明はかかる事情に鑑みてなされたもので、配線図形を使用せずに配線設計と配線評価が可能であり、従来よりも設計の自由度が増す基板の配線位置決定方法およびこれを用いて製造した基板を提供することを目的とする。
前記目的に沿う第1の発明に係る基板の配線位置決定方法は、対となるピンを接続する複数の配線で構成される配線パターンを基板に形成するための基板の配線位置決定方法において、
配線領域形成手段により、前記配線パターンを形成する領域に、前記配線の本数と同数以上の点と、隣り合う該点を接続する枝とで構成される仮想領域を形成する配線領域形成工程と、
経路形成手段により、前記各点の中から基準となる2つの点を選択し、該基準となる点の一方側から他方側へかけて複数の経路を形成し、該基準となる点を除く他の前記点を前記複数の経路のいずれかに位置させる経路形成工程と、
番号および方向付与手段により、前記各経路が通過する前記各点に、前記一方側の点から前記他方側の点へかけて異なる増大する番号を付し、更に、前記各枝に、前記点に付した番号の小さい側から大きい側へ向けて方向を付する番号および方向付与工程と、
予備配線付与手段により、前記各枝に付した方向が、前記各点の入側から出側へかけて順方向となる領域へ向け、前記各点をそれぞれ通過する予備配線を形成する予備配線付与工程と、
配線位置決定手段により、前記予備配線同士を、延線を行う前記各点の番号を区間に含む前記各枝を通過させるという配線規則によって、交差させることなく前記予備配線の両側を前記対となるピンまで延ばし、これを前記配線とする配線位置決定工程とを有する。
第1の発明に係る基板の配線位置決定方法において、前記経路形成工程と前記番号および方向付与工程の代わりに、シンクソース非形成手段により、前記各点の中から基準となる2つの点を選択して番号1と番号nをそれぞれ付し、該基準となる点を除く他の前記各点に番号2から番号n−1を順次付すに際し、該各点に付した番号の小さい側から大きい側へ向けて前記各枝に付す方向が、該各点に対して入る方向と出る方向の双方を備えるように、前記他の各点に番号を付すシンクソース非形成工程を行った後、前記予備配線付与工程と前記配線位置決定工程を順次行うことが好ましい。
第1の発明に係る基板の配線位置決定方法において、前記配線位置決定工程で得られた前記各配線のうちいずれか1または2以上を変更する際には、前記経路形成工程で前記経路を変更し、前記番号および方向付与工程、前記予備配線付与工程、および前記配線位置決定工程を順次行うことが好ましい。
第1の発明に係る基板の配線位置決定方法において、前記配線位置決定工程で得られた前記各配線のうちいずれか1または2以上を変更する際には、前記配線領域形成工程で前記点の個数を前記対となるピンの組数よりも多く設定し、該対となるピンの接続に使用する前記点を変更することが好ましい。
前記目的に沿う第2の発明に係る基板は、第1の発明に係る基板の配線位置決定方法を用いて製造した。
請求項1〜4記載の基板の配線位置決定方法、および請求項5記載の基板の配線位置決定方法を用いて製造した基板は、配線パターンを形成する領域にポテンシャルグラフを作成できる。これにより、複数の配線同士が交差しない配線パターンを、一括処理で作成できる。
また、配線領域形成工程で複数の点と、この隣り合う点を接続する枝とで構成される仮想領域を形成するので、配線パターンを形成する領域をグラフでシミュレーションすることができ、従来と比較して使用するデータ量を削減できる。
そして、番号および方向付与工程で点に番号を付すので、各点をポテンシャルで制御でき、配線の制御と間隔規則の遵守を高速に指摘できる。
これにより、配線図形を使用せずに配線設計と配線評価が可能であり、しかも従来よりも設計の自由度を増すことができる。
特に、請求項2記載の基板の配線位置決定方法は、経路形成工程と番号および方向付与工程の代わりに、基準となる点を除く他の各点に対して入る方向と出る方向の双方を備えるようにこの各点に番号を付すシンクソース非形成工程を行うので、各枝に付した方向が各点の入側から出側へかけて順方向となる領域を、各点ごとに2つずつ形成できる。これにより、配線図形を使用せずに配線設計と配線評価が可能であり、しかも従来よりも設計の自由度を増すことができる。
また、請求項3記載の基板の配線位置決定方法は、配線位置決定工程で得られた配線を変更する際に、経路を変更すればよいので、大幅な設計変更を行うことなく、簡単な操作で配線パターンを変更できる。
そして、請求項4記載の基板の配線位置決定方法は、配線位置決定工程で得られた配線を変更する際に、点の個数を対となるピンの組数よりも多く設定し、対となるピンの接続に使用する点を変更すればよいので、大幅な設計変更を行うことなく、簡単な操作で配線パターンを変更できる。
続いて、添付した図面を参照しつつ、本発明を具体化した実施の形態につき説明し、本発明の理解に供する。
ここで、図1は本発明の一実施の形態に係る基板の配線位置決定方法の配線領域形成工程での配線平面のシミュレーションの説明図、図2は同基板の配線位置決定方法の経路形成工程でのパス被覆の説明図、図3は同基板の配線位置決定方法の番号および方向付与工程でのパスの単調ポテンシャルを示す説明図、図4(A)、(B)はそれぞれ同基板の配線位置決定方法の番号および方向付与工程での他のパスの単調ポテンシャルを示す説明図、図5は同基板の配線位置決定方法のシンクソース非形成工程の規則に従わなかった場合の説明図、図6は同基板の配線位置決定方法の予備配線付与工程での各点の時計回り順面、反時計回り順面、および非順面の説明図、図7は同基板の配線位置決定方法の予備配線付与工程での点から予備配線を引き出す規則の説明図、図8は同基板の配線位置決定方法の配線位置決定工程での配線規則の説明図、図9は同基板の配線位置決定方法を使用して決定した配線パターンの説明図、図10は同基板の配線位置決定方法を使用して決定した他の配線パターンの説明図である。
図1〜図10に示すように、本発明の一実施の形態に係る基板の配線位置決定方法は、対となるピンa−a、b−b、c−c、d−d、e−e、f−f、g−g、およびh−h(以下、単にa〜hと記載する)をそれぞれ接続する複数の配線La〜Lhで構成される配線パターン10を図示しない基板(例えば、半導体装置)に形成するための方法であり、配線La〜Lhを直接に扱うことなく、平面上に配置された多数のピンa〜hを、ポテンシャル分布で表し制御する方法である。なお、本実施の形態においては、基板の配線位置決定方法を、基板の配線位置決定装置(以下、単に決定装置ともいう)を使用して実施する。この決定装置は、配線領域形成手段、経路作成手段、番号および方向付与手段、シンクソース非形成手段、予備配線付与手段、配線位置決定手段、および記憶手段を有しており、この各手段は、例えば、コンピュータに搭載されたプログラムによって構成されている。なお、この決定装置は、配線を行う装置(図示しない)の制御装置とも接続可能となっており、作業者が操作する入力手段(例えば、キーボードおよびマウス)を使用して入力した条件に基づき、制御可能な構成となっている。
まず、配線領域形成手段により、図1に示すように、過配線を制御したい領域にある対となるピンa〜hを入力し、記憶手段に記憶させる。なお、ここで各ピンに付された同じ記号a〜hは、そのピン同士を配線La〜Lhで接続することを意味している。ここで、配線La〜Lhで接続する対となるピンa〜hの間、即ち配線パターン10を形成する領域に、配線位置を決定するための仮想領域11を入力し、これを記憶手段に記憶させる。
この仮想領域11は、配線の本数(ここでは8本)と同数以上(対となるピンの組数以上:ここでは9個)の点P1〜P9と、この点P1〜P9のうち隣り合う点を接続する枝B1〜B12とで構成されるものである。
この各枝B1〜B12のなす角は90度となって、仮想領域11が格子状となっているが、仮想領域は、例えば、一部が上下方向または左右方向に突出した形状でもよい。また、各枝は、上下方向と水平方向に隣り合う点を接続しているが、斜め方向に隣り合う点を接続してもよい。このとき、接続する枝同士を交差させない。そして、各点は、上下方向と左右方向にそれぞれ同じ間隔をあけて整列させているが、そのいずれか一方または双方の間隔を変えてもよい。
これにより、配線パターン10の形成領域に仮想領域11を形成できる(以上、配線領域形成工程)。
次に、経路形成手段により、図2に示すように、複数の点P1〜P9の中から基準となる2つの点、即ち始点(一方側の点:ソース)P1と終点(他方側の点:シンク)P9を選択し、これを記憶手段に記憶させる。ここで、始点P1を左上とし、終点P9を右下としているが、始点と終点の位置はこれに限定されるものではなく、仮想領域の外周に位置する点(例えば、点P2〜P4、点P6〜P8)であれば、いずれの点でもよい。
そして、始点P1から終点P9へかけて、複数のパス(経路の一例)L1〜L3を形成する。このパスの形成に際しては、基準となる点P1、P9を除く他の点P2〜P8を、複数のパスL1〜L3のいずれかに位置させる(即ち、パス被覆ともいう)ようにし、しかも一つのパスで同じ点を通過しないようにする。なお、パスの本数は、3本としているが、1本でもよく、また2本でもよく、更には4本以上としてもよい。
これにより、パスL1〜L3の集合が作成される(以上、経路形成工程)。
そして、番号および方向付与手段により、図3に示すように、パスL2が通過する各点P1〜P3、P6、およびP9、パスL3が通過する各点P1、P4、およびP7〜P9、パスL1が通過する各点P1、P4〜P6、およびP9に、始点P1から終点P9へかけて異なる増大する番号を付し、これを各点のポテンシャル(単調増加ポテンシャル、即ち単調ポテンシャルともいう)として、記憶手段に記憶させる。
具体的には、始点P1は最初の点であるため番号「1」を付し、終点P9は最終の点であるため番号「9」を付す。続いて、仮想領域11の中央を通過するパスL1について、始点P1の下方に位置する点P4に「2」を付し、仮想領域の中央の点P5に「3」を付す。次に、その右側に位置する点P6に番号を付す場合、ここで「4」を付すと、パスL2が通過する点P2、P3に、この番号より小さい番号を付すことができなくなるので、「8」を付す。
同様の方法で、他のパスL2が通過する点P2、P3、パスL3が通過する点P7、P8についても番号を付す。このように、各パスL1〜L3が通過する点P2〜P8に番号を付す場合、仮想領域11の始点P1側から終点P9側へかけて、番号が大きくなるように付すことが好ましい。
これにより、各点P1〜P9のポテンシャルを決定し、これを記憶手段に記憶させる。
そして、各枝B1〜B12に、各点P1〜P9に付した番号の小さい側から大きい側へ向けて方向を付し、更に始点P1に入る枝B13と終点P9から出る枝B14を追加して、記憶手段に記憶させる。
これにより、ポテンシャルグラフが得られる。
なお、ポテンシャルグラフは、このグラフに限定されるものではなく、以下の要件により変更できる。
(i)基準となる始点と終点を変更する。
(ii)現状のパスを変えることなく、各点に付した番号を入れ換える。
(iii)パスの本数を変更する。
(iv)(i)〜(iii)のいずれか1または2以上を組み合わせる。
ここで、前記した(ii)の具体例としては、図4(A)に示すポテンシャルグラフがある。これは、仮想領域11の中央部の点P5と、左下の点P7の番号を入れ換えている。
また前記した(iv)の具体例としては、図4(B)に示すポテンシャルグラフがある。これは、終点を点P9からその上の点P6へ変更し、パスの本数をL4、L5の2本としている(以上、番号および方向付与工程)。
なお、上記したポテンシャルグラフを得るため、経路形成手段と番号および方向付与手段を使用することなく、シンクソース非形成手段を使用することもできる。
このシンクソース非形成手段は、複数の点P1〜P9の中から基準となる2つの点、即ち始点(一方側の点:ソース)P1と終点(他方側の点:シンク)P6を選択し、この始点P1に番号「1」を付し、終点P6に番号「9(即ち、nに対応)」を付して、これを記憶手段に記憶させる。
次に、この基準となる点P1、P6を除く他の各点P2〜P5、P7〜P9に、番号2から番号8(即ち、n−1に対応)を順次付すに際し、各点P2〜P5、P7〜P9に付した番号2〜8の小さい側から大きい側へ向けて各枝B1〜B12に付す方向が、各点P2〜P5、P7〜P9に対して入る方向と出る方向の双方となるように、各点P2〜P5、P7〜P9に番号2〜8を付して、これを記憶手段に記憶させる。これにより、前記した図4(B)のポテンシャルグラフが得られる。
この条件を満足するように、各点P2〜P5、P7〜P9に番号2〜8を付さなければ、図5に示すように、付される方向が出る方向のみとなる点P9と、入る方向のみとなる点P4が形成される。これは、始点P1以外に、始点となる点P9が新たに形成され、また終点P6以外に、終点となる点P4が新たに形成されることを意味する。
この場合、各枝に付した方向が、各点の入側から出側へかけて順方向となるように、二つの枝の向きが揃ったパスを共有する面(辺部)、即ち順面が二つでない点(順面が0、1、または3以上存在する点)、具体的にはP4(順面数:0)とP5(順面数:4)が必ず発生し、同時に、どのように前記した経路形成工程を実行しても、各パスが通過する各点に付した番号が、単調に増加しないことになる。
そこで、各枝B1〜B12に付す方向が、各点P2〜P5、P7〜P9に対して入る方向と出る方向の双方となるように、各点P2〜P5、P7〜P9に番号2〜8を付す(以上、シンクソース非形成工程)。
次に、予備配線付与手段により、図6に示す規則に基づき、図7に示すように、各点をそれぞれ通過する予備配線を形成し、これを記憶手段に記憶させる。
図6に示すように、図3に示すポテンシャルグラフの各点P1〜P9には、各枝B1〜B14に付した方向が、各点P1〜P9の入側から出側へかけて順方向となるように、二つの枝の向きが揃ったパスを共有する順面が二つ存在する。そこで、各点P1〜P9の側方で、枝B1〜B14の向きが揃った領域の枝の向きを、時計回りまたは反時計回りで示す。
次に、各点P1〜P9から出る予備配線は、上記した二つの順面に限るという配線規則を設定することで、図7に示すように、枝の向きが揃った領域へ向け、各点P1〜P9からそのポテンシャルを示す配線を両側に一意に延伸できる。
これにより、各点P1〜P9をそれぞれ通過する予備配線を形成できる(以上、予備配線付与工程)。
更に、配線位置決定手段により、図8に示すように、各内面から外面に形成する配線は、延線を行う点の値を区間に含む枝を通過させるという配線規則を設けることにより、配線パターン10を構成する各配線La〜Lhが一意に決まるので、この配線La〜Lhを記憶手段に記憶させる。
具体的には、点P5の番号は「3」であるため、この番号を間に含む点P1(番号「1」)と点P2(番号「4」)の間の枝B1と、P4(番号「2」)と点P7(番号「5」)の間の枝B8を通過させるように、点P5の配線を決定する(他の点も同様)。
これにより、予備配線同士を交差させることなく、予備配線の両側を対となるピンa−a、b−b、c−c、d−d、e−e、f−f、g−g、およびh−hまで延ばすことで、図9に示すポテンシャルグラフが構成される。なお、点a〜hは、番号「1」〜「7」、および「9」に、それぞれ対応させている。
このようにして作成したポテンシャルグラフが、配線パターン10と同等となるため、ポテンシャルグラフを配線データとして使用できる。なお、前記した各工程の操作は、平面画像としてディスプレイ上に現れる画像を確認しながら行う(以上、配線位置決定工程)。
ここで、配線位置決定工程で得られた各配線のうちいずれか1または2以上を変更する際には、前記した番号および方向付与工程で示したように、ポテンシャルグラフの形成条件を満足するように変更し、これを記憶手段に記憶させる。
具体的には、番号および方向付与工程で各点に付した番号、即ち図9に示す番号「3」と番号「5」を入れ換え、枝に付した方向を付与し直した後、前記した予備配線付与工程と配線位置決定工程を順次行う。これにより、図10に示す配線パターン12を形成できる。
また、前記した経路形成工程で経路を変更し、更に、前記した番号および方向付与工程、前記した予備配線付与工程、および前記配線位置決定工程を順次行う。
そして、配線領域形成工程で点の個数を対となるピンの組数よりも多く設定し(ここでは1個多く)、対となるピンの接続に使用する点を変更する。
以上の方法により、基板を製造でき、更には、従来のように、実際に配線することなく配線評価ができる。
以上、本発明を、実施の形態を参照して説明してきたが、本発明は何ら上記した実施の形態に記載の構成に限定されるものではなく、特許請求の範囲に記載されている事項の範囲内で考えられるその他の実施の形態や変形例も含むものである。例えば、前記したそれぞれの実施の形態や変形例の一部または全部を組合せて本発明の基板の配線位置決定方法およびこれを用いて製造した基板を構成する場合も本発明の権利範囲に含まれる。
また、前記実施の形態においては、基板の配線位置決定方法を、配線位置を初めから決定した場合について説明したが、例えば、予め作成した基板の配線位置を変更する場合についても、勿論適用できる。
本発明の一実施の形態に係る基板の配線位置決定方法の配線領域形成工程での配線平面のシミュレーションの説明図である。 同基板の配線位置決定方法の経路形成工程でのパス被覆の説明図である。 同基板の配線位置決定方法の番号および方向付与工程でのパスの単調ポテンシャルを示す説明図である。 (A)、(B)はそれぞれ同基板の配線位置決定方法の番号および方向付与工程での他のパスの単調ポテンシャルを示す説明図である。 同基板の配線位置決定方法のシンクソース非形成工程の規則に従わなかった場合の説明図である。 同基板の配線位置決定方法の予備配線付与工程での各点の時計回り順面、反時計回り順面、および非順面の説明図である。 同基板の配線位置決定方法の予備配線付与工程での点から予備配線を引き出す規則の説明図である。 同基板の配線位置決定方法の配線位置決定工程での配線規則の説明図である。 同基板の配線位置決定方法を使用して決定した配線パターンの説明図である。 同基板の配線位置決定方法を使用して決定した他の配線パターンの説明図である。 従来例に係る直接描画方式の説明図である。 従来例に係るグリッド方式の説明図である。 従来例に係る細分方式の説明図である。 混雑情報を使って配線修正を簡略化する方法の説明図である。
符号の説明
10:配線パターン、11:仮想領域、12:配線パターン

Claims (5)

  1. 対となるピンを接続する複数の配線で構成される配線パターンを基板に形成するための基板の配線位置決定方法において、
    配線領域形成手段により、前記配線パターンを形成する領域に、前記配線の本数と同数以上の点と、隣り合う該点を接続する枝とで構成される仮想領域を形成する配線領域形成工程と、
    経路形成手段により、前記各点の中から基準となる2つの点を選択し、該基準となる点の一方側から他方側へかけて複数の経路を形成し、該基準となる点を除く他の前記点を前記複数の経路のいずれかに位置させる経路形成工程と、
    番号および方向付与手段により、前記各経路が通過する前記各点に、前記一方側の点から前記他方側の点へかけて異なる増大する番号を付し、更に、前記各枝に、前記点に付した番号の小さい側から大きい側へ向けて方向を付する番号および方向付与工程と、
    予備配線付与手段により、前記各枝に付した方向が、前記各点の入側から出側へかけて順方向となる領域へ向け、前記各点をそれぞれ通過する予備配線を形成する予備配線付与工程と、
    配線位置決定手段により、前記予備配線同士を、延線を行う前記各点の番号を区間に含む前記各枝を通過させるという配線規則によって、交差させることなく前記予備配線の両側を前記対となるピンまで延ばし、これを前記配線とする配線位置決定工程とを有することを特徴とする基板の配線位置決定方法。
  2. 請求項1記載の基板の配線位置決定方法において、前記経路形成工程と前記番号および方向付与工程の代わりに、シンクソース非形成手段により、前記各点の中から基準となる2つの点を選択して番号1と番号nをそれぞれ付し、該基準となる点を除く他の前記各点に番号2から番号n−1を順次付すに際し、該各点に付した番号の小さい側から大きい側へ向けて前記各枝に付す方向が、該各点に対して入る方向と出る方向の双方を備えるように、前記他の各点に番号を付すシンクソース非形成工程を行った後、前記予備配線付与工程と前記配線位置決定工程を順次行うことを特徴とする基板の配線位置決定方法。
  3. 請求項1記載の基板の配線位置決定方法において、前記配線位置決定工程で得られた前記各配線のうちいずれか1または2以上を変更する際には、前記経路形成工程で前記経路を変更し、前記番号および方向付与工程、前記予備配線付与工程、および前記配線位置決定工程を順次行うことを特徴とする基板の配線位置決定方法。
  4. 請求項1および2のいずれか1項に記載の基板の配線位置決定方法において、前記配線位置決定工程で得られた前記各配線のうちいずれか1または2以上を変更する際には、前記配線領域形成工程で前記点の個数を前記対となるピンの組数よりも多く設定し、該対となるピンの接続に使用する前記点を変更することを特徴とする基板の配線位置決定方法。
  5. 請求項1〜4のいずれか1項に記載の基板の配線位置決定方法を用いて製造したことを特徴とする基板。
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN101964008A (zh) * 2009-07-22 2011-02-02 富士通株式会社 布线设计辅助设备和布线设计辅助方法

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5233761B2 (ja) * 2009-03-12 2013-07-10 富士通株式会社 配線経路作成支援方法、配線経路作成支援プログラム、及び配線経路作成支援装置
CN103875189B (zh) 2013-01-28 2016-06-29 华为终端有限公司 Nfc配置方法、nfc数据传输方法、控制器及nfc控制器
US11126780B1 (en) * 2018-11-12 2021-09-21 Synopsys, Inc. Automatic net grouping and routing

Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62109173A (ja) * 1985-11-08 1987-05-20 Yokogawa Electric Corp プリント基板設計装置
JPS6386493A (ja) * 1986-09-29 1988-04-16 三菱電機株式会社 プリント基板自動配線方法
JPS63314846A (ja) * 1987-06-17 1988-12-22 Fujitsu Ltd 一層配線方式
JPS6462773A (en) * 1987-09-03 1989-03-09 Fujitsu Ltd Wiring system for printed board
JPH04299464A (ja) * 1991-03-27 1992-10-22 Narumi China Corp 配線状態識別方法
JPH07199819A (ja) * 1993-12-31 1995-08-04 Casio Comput Co Ltd 表示装置
JPH08190579A (ja) * 1995-01-09 1996-07-23 Nec Corp 自動配線方式
JP2000035986A (ja) * 1998-05-13 2000-02-02 Seiko Epson Corp 回路基板の配線経路決定方法、装置及び情報記憶媒体
JP2004259293A (ja) * 2004-04-12 2004-09-16 Fujitsu Ltd 配線設計装置
JP2006268462A (ja) * 2005-03-24 2006-10-05 Shinko Electric Ind Co Ltd 自動配線決定装置およびそのコンピュータプログラム

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4768154A (en) * 1987-05-08 1988-08-30 Telesis Systems Corporation Computer aided printed circuit board wiring
US6516447B2 (en) * 2001-06-22 2003-02-04 Cadence Design Systems, Inc. Topological global routing for automated IC package interconnect
US7506295B1 (en) * 2002-12-31 2009-03-17 Cadence Design Systems, Inc. Non manhattan floor plan architecture for integrated circuits
US7594215B2 (en) * 2004-11-20 2009-09-22 Cadence Design Systems, Inc. Method and system for optimized automated IC package pin routing
US7299442B2 (en) * 2005-01-11 2007-11-20 International Business Machines Corporation Probabilistic congestion prediction with partial blockages
JP4592494B2 (ja) * 2005-05-25 2010-12-01 新光電気工業株式会社 自動配線決定装置
TW200721924A (en) * 2005-11-23 2007-06-01 Inventec Corp Arc-like winding system and method
US7484199B2 (en) * 2006-05-16 2009-01-27 International Business Machines Corporation Buffer insertion to reduce wirelength in VLSI circuits
US7536665B1 (en) * 2006-07-25 2009-05-19 Cadence Design Systems, Inc. User-guided autorouting
US7533360B1 (en) * 2008-07-22 2009-05-12 International Business Machines Corporation Flow based package pin assignment

Patent Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62109173A (ja) * 1985-11-08 1987-05-20 Yokogawa Electric Corp プリント基板設計装置
JPS6386493A (ja) * 1986-09-29 1988-04-16 三菱電機株式会社 プリント基板自動配線方法
JPS63314846A (ja) * 1987-06-17 1988-12-22 Fujitsu Ltd 一層配線方式
JPS6462773A (en) * 1987-09-03 1989-03-09 Fujitsu Ltd Wiring system for printed board
JPH04299464A (ja) * 1991-03-27 1992-10-22 Narumi China Corp 配線状態識別方法
JPH07199819A (ja) * 1993-12-31 1995-08-04 Casio Comput Co Ltd 表示装置
JPH08190579A (ja) * 1995-01-09 1996-07-23 Nec Corp 自動配線方式
JP2000035986A (ja) * 1998-05-13 2000-02-02 Seiko Epson Corp 回路基板の配線経路決定方法、装置及び情報記憶媒体
JP2004259293A (ja) * 2004-04-12 2004-09-16 Fujitsu Ltd 配線設計装置
JP2006268462A (ja) * 2005-03-24 2006-10-05 Shinko Electric Ind Co Ltd 自動配線決定装置およびそのコンピュータプログラム

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN101964008A (zh) * 2009-07-22 2011-02-02 富士通株式会社 布线设计辅助设备和布线设计辅助方法

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